AK8111

ASAHI KASEI
[AK8111]
AK8111
Single Clock Generator
AK8111は、PLL を内蔵した単出力クロックジェネレータIC です。 27MHzのクロック入力から、12.288MHz
または24.576MHzのクロックを出力することができます。 生成したクロックは、制御端子によりON/OFFお
よび周波数切替えが可能です。 クロック用水晶発振器を使用せずに、高精度、低ジッタの出力クロック
を生成することが可能になります。
特
□ 電源電圧：
□ 低消費電流：
□ マスタクロック：
□ 生成クロック
CLKOUT：
□ 出力負荷
CLKOUT：
□ 低ジッタ出力
CLKOUT：
□ 小型パッケージ：
長
2.7 ～ 3.6V
3.5mA typ.
27MHz (外部入力)
12.288MHz/24.576MHz ( 制御端子によりON/OFF, 周波数切替え可能)
15pF max.
15ps typ. (1σ)
6ピンSON (鉛フリー)
Body Size: 2.6mmx1.6mm
VDD
CLKIN
INPUT
Buffer
PLL
OUTPUT
Buffer
CLKOUT
OE
FSEL
VSS
MS0453-J-04
2007/02
- 1 -
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１．端子説明
１－１）端子配置図
6:CLKIN
1:VDD
5:FSEL
2:VSS
4:OE
3:CLKOUT
１－２）端子機能説明
端子番号
1
2
3
4
5
6
端子名
説明
(端子タイプ)
VDD
(PWR)
電源端子.
VSS
接地端子.
(PWR)
CLKOUT
(DO)
OE
(DI)
FSEL
(DI)
CLKIN
（DI）
クロック出力端子. FSEL端子の設定により12.288MHzか24.576MHzの
いずれかを出力します. パワーダウン時は“L”となります.
CLKOUT出力イネーブル端子. この端子が“L”の時PLLはパワーダウン
されCLKOUTは出力されません. 100kΩで内部プルダウン.
ク ロ ッ ク 出 力 周 波 数 設 定 端 子 . “ L ” の 時 24.576MHz 、 “ H ” の 時
12.288MHzを出力します. 100kΩで内部プルダウン.
クロック入力端子（27.000MHz）.
クロックが入力されない場合、パワーダウン状態にして下さい.
無入力もしくは不安定なクロック入力の場合、出力が安定しません。
PWR：電源
DO ：デジタル出力
DI ：デジタル入力
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２．電気的特性
２－１）絶対最大定格
項
目
記号
MIN
MAX
単位
電源電圧
VDD
-0.3
4.6
V
グランド・レベル
VSS
0
0
V
入力端子電圧
VIN
VSS-0.3
VDD+0.3
V
入力電流
IIN
-10
10
mA
保存温度
Tstg
-55
130
℃
備考
２－２）動作条件
項
目
動作温度
電源電圧
出力端子
負荷容量
記号
MIN
Ta
-10
VDD
2.7
TYP
3.0
Cpl
MAX
単位
80
℃
3.6
V
15
pF
２－３）消費電流
項
備考
CLKOUT
VDD＝3.0V， Ta＝25℃
目
消費電流
ﾊﾟﾜｰﾀﾞｳﾝ時消費電流
(OE=”L”)
記号
MIN
TYP
IDD
IPD
3.5
0
MAX
単位
備考
10
mA
μA
*1
FSEL=“L”
又は
OPEN 時
*1 CLKOUT 端子無負荷時
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２－４）ＤＣ特性
項目
VDD＝2.7～3.6V，Ta＝-10～80℃
端子
MIN
0.8*VDD
高ﾚﾍﾞﾙ出力電圧
CLKIN
FSEL
OE
同上
CLKIN
OE
FSEL
CLKOUT
低ﾚﾍﾞﾙ出力電圧
CLKOUT
高ﾚﾍﾞﾙ入力電圧
低ﾚﾍﾞﾙ入力電圧
入力ﾘｰｸ電流 1
入力ﾘｰｸ電流 2
TYP
MAX
単位
備考
V
0.2*VDD
+10
+75
-10
-10
0.8*VDD
V
μA
μA
V
0.2*VDD
２－５）ＡＣ特性
V
VDD=3.0V,Ta=25℃
IOH=-4mA
VDD=3.0V,Ta=25℃
IOL=4mA
VDD＝2.7～3.6V，Ta＝-10～80℃
項目
端子
MIN
TYP
MAX
単位
外部入力 CLK
周波数
外部入力 CLK
ﾃﾞｭｰﾃｨｰｻｲｸﾙ
出力 CLK
立ち上がり時間
CLKIN
27.0000
MHz
CLKIN
50
%
CLKOUT
4.0
ns
出力 CLK
立ち下がり時間
CLKOUT
4.0
ns
出力 CLK ジッタ
CLKOUT
出力 CLK
ﾃﾞｭｰﾃｨｰｻｲｸﾙ
CLKOUT
ﾊﾟﾜｰｱｯﾌﾟ時間
CLKOUT
15
45
50
1
ps
55
%
ms
備考
Cp1=15pF
0.2*VDD→0.8*VDD
*1
Cp1=15pF
0.8*VDD→0.2*VDD
*1
Cp1=15pF
周期ジッタ（１σ）
*1
Cp1=15pF
*1
*2
*1 設計値
*2 電源が VDD 電圧に達した後、出力が所定の周波数の±0.1％に安定するまでの時間。
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３．パッケージ外形寸法図（SON6 単位ｍｍ）
0.8MAX
1.6±0.2
0.2±0.1
(0.1)
(1.24)
2.6±0.1
3.0±0.1
(0.1)
(0.1)
0.13±0.05
0.2±0.1
0.5
(0.1)
(0.1)
(Φ0.4)
0.5
Bottom View
S
+
0.1
0.1
S
M
４．マーキング図
ａ． １ピン表示
丸印
ｂ． マーケティングコード
111 （AK8111）
ｃ． 日付コード
ddd （3 桁）
b
11
1d
dd
c
a
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ずる損害等の責任を一切負うものではありませんのでご了承下さい。
● お客様の転売等によりこの注意事項の存在を知らずに上記用途に弊社製品が使用され、そ
の使用から損害等が生じた場合は全てお客様にてご負担または補償して頂きますのでご了承
下さい。
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