AKM AK8151A

[AK8151A]
AK8151A
60MHz/72MHz ２出力クロックジェネレータ
AK8151Aは、PLL を内蔵した２出力クロックジェネレータIC です。27MHzのクロック入力から60MHzまたは72MHzの
どちらか一方の周波数を1.8Vまたは3.3Vで出力します。
特
□ 電源電圧：
□ 低消費電力：
□ 入力クロック：
□ 生成クロック
CLKOUT1：
CLKOUT2：
□ 出力負荷
CLKOUT：
□ 低ジッタ出力
ピリオド：
□ 小型パッケージ：
長
VDD(コア)
VDDO1 ,２(CLKOUT1,２)
11.2 mW (typ) at 60MHz
13.1 mW (typ) at 72MHz
27 MHｚ
SEL端子による切替
60MHz または72MHz
60MHz または72MHz
15pF max.
25ps typ(1σ),
8ピンUSON (鉛フリー)
Body Size: 2.0mmx2.0mm
VDD
ICLK
INPUT
Buffer
PLL
SEL
GND
MS1092-J-00
：1.7 ～ 1.9V
：1.7 ～ 1.9V or 2.7 ～ 3.6V
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品名：AK8151AU
VDDO1
OUTPUT
Buffer
CLKOUT1
OUTPUT
Buffer
CLKOUT2
VDDO２
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１．端子説明
１－１）端子配置図
8:VDD
1:CLKOUT１
2:ICLK
7:GND
3:SEL
6:VDDO2
4:VDDO1
5: CLKOUT2
１－２）端子機能説明
端子
番号
端子名
(端子タイプ)
1
CLKOUT1
(DO)
2
ICLK
(DI)
3
SEL
(DI)
4
VDDO１
(PWR)
5
CLKOUT2
(DO)
VDDO2
（PWR）
GND
7
（PWR）
VDD
8
（PWR）
PWR：電源
DO ：デジタル出力
DI ：デジタル入力
6
MS1092-J-00
説明
クロック出力端子1
内蔵PLLで生成された60MHzまたは72MHzのクロックを出力します。
出力周波数はSEL端子で設定します。
出力電圧は1.8Vまたは3.3V出力で、VDDO1端子で設定します。
クロック入力端子
27.00MHzのクロックを入力して下さい。
1.8Vまたは3.3V入力です。
【重要】ICLKは常に入力して下さい。ICLKを停止すると、所定の出力周波
数以外のクロックがCLKOUT1,2より出力されます。
クロック出力設定端子
出力クロックの周波数を設定します。
SEL=L：60MHz, SEL=H：72MHz
1.8Vまたは3.3V入力です（200kΩのプルダウン抵抗内蔵）。
出力端子用電源端子１
CLKOUT1端子用の電源端子です。1.8Vまたは3.3Vを供給して下さい。
クロック出力端子2
内蔵PLLで生成された60MHzまたは72MHzのクロックを出力します。
出力周波数はSEL端子で設定します。
出力電圧は1.8Vまたは3.3V出力で、VDDO2端子で設定します。
出力端子用電源端子２
CLKOUT2端子用の電源端子です。1.8Vまたは3.3Vを供給して下さい。
接地端子
0Vを接続して下さい。
コア用電源端子
1.8Vを供給して下さい。
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２．電気的特性
２－１）絶対最大定格
項
目
記号
MIN
MAX
単位
電源電圧
VDD
-0.3
4.6
V
グランド・レベル
VSS
0
0
V
入力端子電圧
VIN
VSS-0.3
3.6
V
入力電流
IIN
-10
10
mA
保存温度
Tstg
-55
130
℃
備考
注意：この値を超えた条件で使用した場合デバイスを破壊することがあります。
また、通常の動作は保証されません。
２－２）動作条件
項
目
記号
MIN
動作温度
Ta
-20
電源電圧 1
VDD
1.7
電源電圧 2
VDDO1
VDDO2
出力端子
負荷容量
TYP
MAX
単位
85
℃
1.8
1.9
V
1.7
1.8
1.9
V
1.8V 出力時
2.7
3.3
3.6
V
3.3V 出力時
15
pF
CLKOUT1 端子
CLKOUT2 端子
Cpl
Cp2
備考
*VDD,VDDO1,2 は、各端子と VSS 間に 0.1μF 程度のコンデンサを挿入してください。
２－３）消費電力
VDD＝1.8V，VDDO1=3.3V
項
目
VDDO2=1.8V
消費電力 1*1 (SEL=L)
MIN
TYP
MAX
単位
備考
W
11
mW
60MHz 出力
(SEL=H)
W
13
mW
72MHz 出力
消費電力 3*1 (SEL=L)
消費電力 4*1 (SEL=H)
W
W
16
19
mW
mW
60MHz 出力
72MHz 出力
消費電力 2
VDDO2=3.3V
*1
MS1092-J-00
記号
Ta＝25℃
*1
CLKOUT1 端子,CLKOUT2 端子無負荷時
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２－４）ＤＣ特性
VDD＝1.7-1.9V，VDDO1,VDDO2=1.7-1.9Vor2.7-3.6V
項目
端子
MIN
高ﾚﾍﾞﾙ入力電圧 1
(VIH1)
低ﾚﾍﾞﾙ入力電圧 1
(VIL1)
高ﾚﾍﾞﾙ入力電圧 2
(VIH2)
低ﾚﾍﾞﾙ入力電圧 2
(VIL2)
入力ﾘｰｸ電流 1
入力ﾘｰｸ電流 2
高ﾚﾍﾞﾙ出力電圧
(VOH)
低ﾚﾍﾞﾙ出力電圧
(VOL)
SEL
２－５）ＡＣ特性
TYP
MAX
単位
0.7*VDDI
VDDI
V
SEL
VSS
0.2*VDDI
V
ICLK
0.7*VDDI
VDDI
V
ICLK
VSS
0.3*VDDI
V
ICLK
SEL
CLKOUT1
CLKOUT2
CLKOUT1
CLKOUT2
-10
-10
0.8*VDDO1
0.8*VDDO2
+10
+40
Ta＝-20～85℃
備考
VDDI=3.0V±10%
VDDI=1.7～1.9V
VDDI=3.0V±10%
VDDI=1.7～1.9V
VDDI=3.0V±10%
VDDI=1.7～1.9V
VDDI=3.0V±10%
VDDI=1.7～1.9V
or
or
or
or
uA
uA
V
Ioh= -5mA
V
Ioh= -5mA
0.2*VDDO1
V
Iol= 5mA
0.2*VDDO2
V
Iol= 5mA
VDDI：入力信号を駆動する IC の電源電圧
VDD＝1.7-1.9V，VDDO1,VDDO2=1.7-1.9Vor2.7-3.6V Ta＝-20～85℃
項目
端子
外部入力 CLK
周波数
外部入力 CLK
ﾃﾞｭｰﾃｨｰｻｲｸﾙ
出力周波数 1,2
ICLK
ICLK
MIN
TYP
MAX
27.00
30
50
CLKOUT1,2
単位
MHz
70
60.00
%
MHz
72.00
出力 CLK
立ち上がり時間
立ち下がり時間
出力 CLK ジッタ
（ピリオド）
出力 CLK
CLKOUT1
3.0
ns
ps
Cp1 =15pF
0.2*VDDO1→0.8*VDDO1
Cp2 =15pF
0.2*VDDO2→0.8*VDDO2
Cp1 =15pF
0.2*VDDO1→0.8*VDDO1
Cp2 =15pF
0.2*VDDO2→0.8*VDDO2
Cp1,2=15pF, 1000cycle
CLKOUT2
3.0
ns
CLKOUT1
3.0
ns
CLKOUT2
3.0
ns
55
%
Cp1=15pF
1.54
ns
VDDO1：3.3±0.165V
VDDO2：1.8±0.09V
Cp1=Cp2
3
ms
*1
*1
CLKOUT1,2
25
(1σ)
CLKOUT1,2
45
50
CLKOUT1,2
-1.54
SEL=L
SEL=H
*1
出力 CLK
備考
*1
ﾃﾞｭｰﾃｨｰｻｲｸﾙ
出力 CLK 位相差
ﾊﾟﾜｰｱｯﾌﾟ時間
*1 *2
*1 *3
CLKOUT1,2
*1 設計値
*2 出力 CLK 位相差の定義は「3.出力クロック位相差」に記載
*3 電源が VDD 電圧に達した後、出力が所定の周波数の±0.1％に安定するまでの時間
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３．出力クロック位相差
出力クロック位相差の定義は以下のようになります。
【条件】VDD=1.7～1.9 V，VDDO1=3.3±0.165 V，VDDO2=1.8±0.09 V，Ta＝-20～85℃，
Cp1=Cp2，SEL=”L” or “H”
【定義】CLKOUT1を基準とした時の、CLKOUT1とCLKOUT2の位相差（下図参照）
VDDO1
CLKOUT1
VDDO1×0.5
VSS
VDDO2
VDDO2×0.5
VSS
CLKOUT2
±1.54 ns (max)
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４．パッケージ外形寸法図（8pinUSON
単位ｍｍ）
0.02
0.58＋
－ 0.03
2.00±0.05
2.00±0.05
S
S
1.0±0.05
0.25±0.05
0.05
1.8±0.05
0.05
0.50
M
S
0.25±0.05
５．マーキング図
ａ．
１ピン表示
ｂ． マーケティングコード
ｃ． 日付コード
b
1 5 1 A
YMA
c
a
1pin
MS1092-J-00
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下さい。
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