AK8859VQ

[AK8859VQ]
AK8859VQ
NTSC/PAL/SECAM Digital Video Decoder
概要
AK8859VQ は、NTSC / PAL / SECAM のコンポジットビデオ信号及び、S(Y/C)ビデオ信号のデジタルデコ
ード処理を行います。出力ビデオデータは ITU-R BT.601 及び ITU-R BT.656 規定の Y,Cb,Cr データです。
クロック、ビデオデータに加え、HD / VD / FIELD/ DVALID 信号を出力します。Y/C 分離は適応型 2 次元
Y/C 分離です。動作温度は、−40°C ~ 105°C です。
特徴
• NTSC-J,M, 4.43 / PAL-B,D,G,H,I,N, Nc, M, 60 / SECAM 規格のコンポジットビデオ信号及び、S(Y/C)ビ
デオ信号のデコード処理
• 入力チャンネル数：2ch
• 10-bit 27MHz ADC 2ch 内蔵
• デジタル PGA
• 適応型 Auto Gain Control ( AGC )
• Auto Color Control ( ACC )
• 画質調整機能 ( Contrast , Saturation , Brightness , Hue , Sharpness )
• 入力信号自動判定機能
• 適応型 2 次元 YC 分離
• 出力データ：ITU-R BT.601 ( YCbCr, 4:2:2, 8bit )
• 出力インターフェース：ITU-R BT.656 ( 4:2:2, 8bit parallel, EAV/SAV )インターフェース及び、
HD, VD, FIELD, DVALID タイミング信号インターフェース
• クローズドキャプション信号デコード機能 (レジスタにて出力)
• VBID(CGMS-A)信号デコード機能[CRCC デコード] (レジスタにて出力)
• WSS 信号デコード機能 (レジスタにて出力)
• Macrovision 信号検知機能( Macrovision Certification )
• パワーダウン機能
• I2C コントロール
• コア電源電圧：1.70 ~ 2.00V
• インターフェース部電源電圧：1.70 ~ 3.60V
• 推奨動作温度範囲：−40°C ~ 105°C
• 48 ピン LQFP パッケージ( 7.0mm x 7.0mm )
(Notice) This device is protected by U.S. patent number 6,600,873 and other intellectual property rights.
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目次
[1.] ブロック図 ............................................................................................................................................. 5
[2.] ピン配置 ................................................................................................................................................. 6
[3.] ピン機能説明.......................................................................................................................................... 7
[3.1.] ピン機能 .......................................................................................................................................... 7
[3.2.] 出力ピン状態 ................................................................................................................................... 9
[4.] 電気的特性 ........................................................................................................................................... 10
[4.1.] 絶対最大定格 ................................................................................................................................. 10
[4.2.] 推奨動作条件 ................................................................................................................................. 10
[4.3.] DC特性 ........................................................................................................................................... 10
[4.4.] アナログ特性 ..................................................................................................................................11
[4.4.1.] 入力レンジ ...............................................................................................................................11
[4.4.2.] ADC ..........................................................................................................................................11
[4.4.3.] 消費電流...................................................................................................................................11
[4.4.4.] 水晶発振回路部 ....................................................................................................................... 12
[5.] ACタイミング ....................................................................................................................................... 13
[5.1.] 外部クロック入力 .......................................................................................................................... 13
[5.2.] クロック出力(DTCLK) .................................................................................................................. 13
[5.3.] 出力データタイミング................................................................................................................... 14
[5.4.] パワーダウンシーケンス ............................................................................................................... 14
[5.5.] 電源投入シーケンス ...................................................................................................................... 15
[5.6.] I2Cバス入出力タイミング.............................................................................................................. 16
[5.6.1.] タイミング 1 ........................................................................................................................... 16
[5.6.2.] タイミング 2 ........................................................................................................................... 16
[6.] 機能概要 ............................................................................................................................................... 17
[7.] 機能説明 ............................................................................................................................................... 18
[7.1.] 入力信号選択 ................................................................................................................................. 18
[7.2.] クロックモード.............................................................................................................................. 18
[7.3.] アナログクランプ回路................................................................................................................... 18
[7.4.] 入力映像信号属性 .......................................................................................................................... 20
[7.5.] 入力映像信号自動認識機能 ........................................................................................................... 21
[7.6.] 入力映像信号自動認識制限機能 .................................................................................................... 22
[7.7.] 出力データ垂直ブランキング期間 ................................................................................................ 23
[7.8.] 出力データコードリミット ........................................................................................................... 23
[7.9.] V-bit ................................................................................................................................................ 24
[7.10.] スライス機能 ............................................................................................................................... 24
[7.11.] VBI区間デコードデータ ............................................................................................................... 25
[7.12.] 出力ピン状態 ............................................................................................................................... 26
[7.13.] HDピン出力 .................................................................................................................................. 27
[7.14.] VD_F及びVARピン及びVARSUBピン出力選択 .......................................................................... 27
[7.15.] ピン出力極性 ............................................................................................................................... 28
[7.16.] 位相補正機能 ............................................................................................................................... 28
[7.17.] 無信号判定時出力信号................................................................................................................. 29
[7.18.] アクティブ映像データ開始位置 .................................................................................................. 29
[7.19.] VLOCK機構.................................................................................................................................. 30
[7.20.] Y/C分離......................................................................................................................................... 30
[7.21.] EAV/SAVコード............................................................................................................................ 30
[7.22.] 出力インターフェース................................................................................................................. 31
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[7.22.1.] 656 インターフェース ........................................................................................................... 31
[7.22.2] タイミング信号を使用したインターフェース....................................................................... 32
[7.23] ピクセル補間器............................................................................................................................. 33
[7.24] クロック生成 ................................................................................................................................ 34
[7.24.1.] ラインロッククロックモード ............................................................................................... 34
[7.24.2.] フレームロッククロックモード ........................................................................................... 34
[7.24.3.] 固定クロックモード.............................................................................................................. 34
[7.24.4.] 自動遷移モード ..................................................................................................................... 34
[7.25.] PGA .............................................................................................................................................. 34
[7.26.] AGC(Auto Gain Control) ............................................................................................................ 35
[7.27.] ACC(Auto Color Control) ........................................................................................................... 36
[7.28.] シャープネス調整 ........................................................................................................................ 36
[7.29.] カラーキラー ............................................................................................................................... 36
[7.30.] 画質調整機能 ............................................................................................................................... 37
[7.30.1.] コントラスト調整 ................................................................................................................. 37
[7.30.2.] ブライトネス調整 ................................................................................................................. 37
[7.30.3.] サチュレーション(彩度)調整 ................................................................................................ 38
[7.30.4.] HUE（色相）調整.................................................................................................................. 38
[7.31.] VBI期間情報デコード................................................................................................................... 39
[7.32.] 内部状態通知機能 ........................................................................................................................ 40
[7.32.1.] 無信号判定 ............................................................................................................................ 40
[7.32.2.] VLOCK機構状態 .................................................................................................................... 40
[7.32.3.] インターレース信号.............................................................................................................. 40
[7.32.4.] カラーキラー動作 ................................................................................................................. 40
[7.32.5.] クロックモード ..................................................................................................................... 40
[7.32.6.] 輝度デコードオーバーフロー ............................................................................................... 40
[7.32.7.] 色デコードオーバーフロー................................................................................................... 41
[7.32.8.] AGC状態 ................................................................................................................................ 41
[7.33.] マクロビジョン信号検知 ............................................................................................................. 41
[7.34.] 入力映像信号自動認識結果 ......................................................................................................... 42
[8.] デバイスコントロールインターフェース ............................................................................................ 43
[8.1.] I2Cバス SLAVE Address .............................................................................................................. 43
[8.2.] I2Cコントロールシーケンス .......................................................................................................... 43
[8.2.1.] Writeシーケンス ...................................................................................................................... 43
[8.2.2.] Readシーケンス ...................................................................................................................... 43
[8.2.3.] I2C General Call機能 .............................................................................................................. 43
[9.] レジスタ一覧........................................................................................................................................ 45
[9.1.] レジスタ設定概要 .......................................................................................................................... 47
[9.1.1.] Sub Address 0x00 “Input Channel Select Register (R/W)”................................................ 47
[9.1.2.] Sub Address 0x01 “Clamp Control Register (R/W)” .......................................................... 48
[9.1.3.] Sub Address 0x02 “Input Video Standard Register (R/W)” ............................................... 49
[9.1.4.] Sub Address 0x03 “NDMODE Register (R/W)” ................................................................... 50
[9.1.5.] Sub Address 0x04 “Output Format Register (R/W)” .......................................................... 51
[9.1.6.] Sub Address 0x05 “Output Pin Control Register (R/W)” ................................................... 53
[9.1.7.] Sub Address 0x06 “Output Pin Polarity Set Register (R/W)” ............................................ 54
[9.1.8.] Sub Address 0x07 “Control 0 Register (R/W)” ................................................................... 55
[9.1.9.] Sub Address 0x08 “Control 1 Register (R/W)” ................................................................... 56
[9.1.10.] Sub Address 0x09 “Reserved Register (R/W)” ................................................................. 56
[9.1.11.] Sub Address 0x0A “PGA1 Control Register (R/W)” ......................................................... 57
[9.1.12.] Sub Address 0x0B “PGA2 Control Register (R/W)” ......................................................... 57
[9.1.13.] Sub Address 0x0C “AGC and Color Control Register (R/W)”......................................... 58
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[9.1.14.] Sub Address 0x0D “Contrast Control Register (R/W)” .................................................... 59
[9.1.15.] Sub Address 0x0E “Brightness Control Register (R/W)” ................................................ 60
[9.1.16.] Sub Address 0x0F “Saturation Control Register (R/W)” ................................................. 61
[9.1.17.] Sub Address 0x10 “HUE Control Register (R/W)”............................................................ 61
[9.1.18.] Sub Address 0x11 “High Slice Data Set Register (R/W)”................................................. 62
[9.1.19.] Sub Address 0x12 “Low Slice Data Set Register (R/W)” ................................................. 62
[9.1.20.] Sub Address 0x13 “Request VBI Information Register (R/W)” ....................................... 63
[9.1.21.] Sub Address 0x14 “Reserved Register (R/W)” ................................................................. 63
[9.1.22.] Sub Address 0x15 “Status 1 Register (R Only)”............................................................... 64
[9.1.23.] Sub Address 0x16 “Status 2 Register (R Only)”............................................................... 65
[9.1.24.] Sub Address 0x17 “Macrovision Status Register (R Only)”............................................ 66
[9.1.25.] Sub Address 0x18 “Input Video Status Register (R Only)” ............................................. 67
[9.1.26.] Sub Address 0x19 “Closed Caption 1 Register (R Only)” ............................................... 68
[9.1.27.] Sub Address 0x1A “Closed Caption 2 Register (R Only)”............................................... 68
[9.1.28.] Sub Address 0x1B “WSS 1 Register (R Only)”................................................................. 68
[9.1.29.] Sub Address 0x1C “WSS 2 Register (R Only)”................................................................. 68
[9.1.30.] Sub Address 0x1D “Extended Data 1 Register (R Only)” ................................................ 68
[9.1.31.] Sub Address 0x1E “Extended Data 2 Register (R Only)” ................................................ 68
[9.1.32.] Sub Address 0x1F “VBID 1 Register (R Only)”................................................................. 68
[9.1.33.] Sub Address 0x20 “VBID 2 Register (R Only)” ................................................................. 68
[9.1.34.] Sub Address 0x21 “Device and Revision ID Register (R Only)”..................................... 69
[10.] システム接続例 .................................................................................................................................. 70
[11.] パッケージ図 ...................................................................................................................................... 71
[12.] マーキング図...................................................................................................................................... 72
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[1.] ブロック図
TEST
XTI
TEST
LOGIC
XTO
SELA
Clock
Module
SDA SCL PDN
Microprocessor
Interface
Timing Controller
Digital PLL
VBI
Decoding
HD
Sync
Separation
10-bit
ADC
CLAMP
AIN1
10-bit
ADC
CLAMP
AIN2
PGA1
MUX
PGA2
Decimation
Filter
CVBS
Y
YC
Separation
VD_F
Y
C
Chroma
Process
Luminance
Process
VAR
Y
Output
Buffer
VARSUB
Cb
DTCLK
Cr
DATA[7:0]
VREF
VCOM
MS1178-J-00
VRP
VRN
IREF
AVDD
AVDD
AVSS
AKM Confidential
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DVDD
DVSS
PVDD
DVSS
DVSS
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[2.] ピン配置
48 ピン LQFP パッケージ( 7.0mm x 7.0mm )
NC
DVSS
DVDD
XTO
DVDD
XTI
DVSS
DVSS
AIN2
VCOM
IREF
NC
36 35 34 33 32 31 30 29 28 27 26 25
NC
37
24
NC
VRN
38
23
NC
VRP
39
22
VARSUB
AIN1
40
21
HD
AVDD
41
20
VD_F
AVDD
42
19
VAR
AVSS
43
18
DATA0
AVSS
44
17
DATA1
PDN
45
16
DATA2
SELA
46
15
DATA3
TEST
47
48
14
13
DATA4
NC
NC
PVDD
AKM Confidential
-6-
PVDD
DATA6
9 10 11 12
DVSS
DVSS
6 7 8
DATA5
5
DATA7
DTCLK
SCL
3 4
SDA
2
NC
MS1178-J-00
1
NC
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[3.] ピン機能説明
[3.1.] ピン機能
ピン
番号
端子名
電源
I/O
1
NC
-
-
2
SCL
P
I
3
SDA
P
I/O
4
DTCLK
P
O
5
DATA7
P
6
DATA6
P
7
DATA5
P
8
DVSS
D
G
デジタルグランドピンです。
9
DVSS
D
G
デジタルグランドピンです。
10
PVDD
P
P
I/F 用電源ピンです。
11
PVDD
P
P
I/F 用電源ピンです。
12
NC
-
-
OPEN としてください。
13
NC
-
-
OPEN としてください。
O
(I/O)
O
(I/O)
O
(I/O)
機能概要
OPEN としてください。
I2C クロック入力ピンです。PVDD でプルアップしてください。
PDN=L の時には、Hi-z 入力が可能です。
I2C データピンです。PVDD でプルアップしてください。
PDN=L の時には、Hi-z 入力が可能です。
出力 I/F 用データクロック出力ピンです。※
約 27MHz のクロックを出力します。
データ出力ピンです。(MSB) ※
(なお、このピンはテストモード時 I/O ピンとして使用します。)
データ出力ピンです。※
(なお、このピンはテストモード時 I/O ピンとして使用します。)
データ出力ピンです。※
(なお、このピンはテストモード時 I/O ピンとして使用します。)
O
(I/O)
O
(I/O)
O
(I/O)
O
(I/O)
O
(I/O)
データ出力ピンです。※
(なお、このピンはテストモード時 I/O ピンとして使用します。)
データ出力ピンです。※
15
DATA3
P
(なお、このピンはテストモード時 I/O ピンとして使用します。)
データ出力ピンです。※
16
DATA2
P
(なお、このピンはテストモード時 I/O ピンとして使用します。)
データ出力ピンです。※
17
DATA1
P
(なお、このピンはテストモード時 I/O ピンとして使用します。)
データ出力ピンです。(LSB) ※
18
DATA0
P
(なお、このピンはテストモード時 I/O ピンとして使用します。)
DVALID / FIELD / NSIG / LINE 信号出力ピンです。※
O
19
VAR
P
レジスタ設定にて DVALID/FIELD/NSIG/LINE 信号出力を切り替えます。
(I/O)
(なお、このピンはテストモード時 I/O ピンとして使用します。)
VD / FIELD 信号出力ピンです。※
O
20
VD_F
P
レジスタ設定にて、VD/ FIELD 信号出力を切り替えます。
(I/O)
(なお、このピンはテストモード時 I/O ピンとして使用します。)
[電源]： A - AVDD, D - DVDD, P - PVDD
[I/O]： I - 入力ピン, O - 出力ピン, I/O - 入出力ピン, P - 電源ピン, G - グランド接続ピン
※
各ピン出力と、PDN ピン状態及びレジスタ設定との関係については、
「[3.3.] 出力ピン状態」を参照して
ください。
14
DATA4
MS1178-J-00
P
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ピン
番号
端子名
電源
I/O
機能概要
21
HD
P
O
(I/O)
22
VARSUB
P
O
HD 信号出力ピンです。※
(なお、このピンはテストモード時 I/O ピンとして使用します。)
DVALID / FIELD / NSIG / LINE 信号出力ピンです。※
レジスタ設定にて DVALID/FIELD/NSIG/LINE 信号出力を切り替えます。
23
NC
-
-
OPEN としてください。
24
NC
-
-
OPEN としてください。
25
NC
-
-
OPEN としてください。
26
DVSS
D
G
デジタルグランドピンです。
27
DVDD
D
P
デジタル電源ピンです。
28
DVDD
D
P
デジタル電源ピンです。
水晶振動子接続端子です。24.576MHz の水晶振動子を使用してくださ
い。(推奨回路では 22pF のコンデンサを介して DVSS に接地)
PDN=L の際には、DVSS レベル出力となります。
水晶振動子を使用しない場合は、NC または DVSS に接地してください。
水晶振動子接続端子です。24.576MHz の水晶振動子を使用してくださ
い。(推奨回路では 22pF のコンデンサを介して DVSS に接地)
また、外部から 24.576MHz のクロックを入力する場合は、このピンに
入力してください。
29
XTO
D
O
30
XTI
D
I
31
DVSS
D
G
デジタルグランドピンです。
32
DVSS
D
G
デジタルグランドピンです。
アナログ信号入力ピンです。「システム接続例」のように、抵抗分割に
て約 39%（−8.19dB）のレベルに減衰させた後、0.033uF のセラミック
コンデンサを介して入力してください。また未使用時は NC としてくだ
さい。
AD コンバータ内部コモン電圧ピンです。
0.1uF(±5%精度)以上のセラミックコンデンサを AVSS との間に接続し
てください。
基準電流設定ピンです。
6.8kΩ(±1%精度)の抵抗を介して AVSS に接地してください。
33
AIN2
A
I
34
VCOM
A
O
35
IREF
A
O
36
NC
-
-
OPEN としてください。
37
NC
-
-
OPEN としてください。
AD コンバータ内部負基準電圧ピンです。
38
VRN
A
O
0.1uF(±5%精度)以上のセラミックコンデンサを AVSS との間に接続し
てください。
[電源]： A - AVDD, D - DVDD, P - PVDD
[I/O]： I - 入力ピン, O - 出力ピン, I/O - 入出力ピン, P - 電源ピン, G - グランド接続ピン
※
各ピン出力と、PDN ピン状態及びレジスタ設定との関係については、
「[3.3.] 出力ピン状態」を参照して
ください。
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ピン
番号
端子名
電源
I/O
39
VRP
A
O
40
AIN1
A
I
41
AVDD
A
P
アナログ電源ピンです。
42
AVDD
A
P
アナログ電源ピンです。
43
AVSS
A
G
アナロググランドピンです。
44
AVSS
A
G
アナロググランドピンです。
機能概要
AD コンバータ内部正基準電圧ピンです。
0.1uF(±5%精度)以上のセラミックコンデンサを AVSS との間に接続して
ください。
アナログ信号入力ピンです。
「システム接続例」のように、抵抗分割にて約 39%（−8.19dB）のレベル
に減衰させた後、0.033uF のセラミックコンデンサを介して入力してくだ
さい。また未使用時は NC としてください。
45
PDN
P
I
パワーダウン制御ピンです。Hi-z 入力は禁止します。
L: パワーダウン
H: 通常動作
46
SELA
P
I
I2C バスアドレス選択用ピンです。
47
TEST
P
I
テストモード設定用ピンです。DVSS に接続して下さい。
48
NC
-
-
OPEN としてください。
[電源]： A - AVDD, D - DVDD, P - PVDD
[I/O]： I - 入力ピン, O - 出力ピン, I/O - 入出力ピン, P - 電源ピン, G - グランド接続ピン
[3.2.] 出力ピン状態
PDN ピン状態及び各レジスタ設定と、各デジタル出力ピン状態の関係は下表の通りです。
なおレジスタ設定に関しては、「[7.12.] 出力ピン状態」を参照してください。
PDN
ピン
各レジスタ設定
各デジタル出力ピン状態
OEN
-bit
DL
-bit
VD_FL
-bit
VAR
-bit
HL
-bit
L
X
X
X
X
X
Low
H
H
X
X
X
X
Hi-z
H
L
L
L
L
L
DOUT
DOUT
DOUT
H
L
H
H
H
H
Low
Low
Low
DATA[7:0]
VD_F
VAR
VARSUB
HD
DTCLK
DOUT
DOUT
DOUT
Low
Low
DOUT
*DOUT は、通常出力。
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[4.] 電気的特性
[4.1.] 絶対最大定格
項目
最小
最大
単位
−0.3
−0.3
2.2
4.2
V
アナログ入力ピン電圧
−0.3
AVDD+0.3(≦2.2)
V
デジタル入出力ピン電圧 D
−0.3
DVDD+0.3(≦2.2)
V
XTI,XTO ピン
デジタル入出力ピン電圧 P
−0.3
PVDD+0.3(≦4.2)
V
(*1)
入力ピン電流(Iin)
−10
10
mA
電源ピンは除く
保存温度
−40
125
°C
AVDD, DVDD
PVDD
電源電圧
備考
(*1)対象ピンは、DTCLK, DATA[7:0], HD, VD_F, VAR, VARSUB, SELA, PDN, SDA, SCL, TEST
・電源電圧は、各グランドピン(AVSS=DVSS)を 0V(電圧基準)とした時の値です。
・全ての電源グランド(AVSS, DVSS)は同電位としてください。
・デジタル出力ピンをデータバスに接続する場合、データバスの動作電圧範囲は上記デジタル入出力ピ
ン電圧の範囲としてください。
・上記限界以上での動作は素子の永久破壊を引き起こす可能性があります。
・上記状態では、通常動作の保証はされません。
[4.2.] 推奨動作条件
項目
最小
標準
最大
単位
条件
アナログ電源電圧 (AVDD)
デジタル電源電圧 (DVDD)
1.70
1.80
2.00
V
AVDD=DVDD
I/F 用電源電圧 (PVDD)
1.70
1.80
3.60
V
PVDD≧DVDD
動作温度(Ta)
−40
105
°C
・電源電圧は、各グランドピン(AVSS=DVSS)を 0V(電圧基準)とした時の値です。
・全ての電源グランド(AVSS, DVSS)は同電位としてください。
[4.3.] DC 特性
(Ta: −40°C~105°C / DVDD=AVDD=1.7V~2.0V / PVDD=DVDD~3.6V)
項目
記号
最小
デジタル入力 H 電圧(*1)
VIH
0.7PVDD
(*1)
VIL
0.3PVDD
V
IL
±10
uA
デジタル入力 L 電圧
デジタル入力リーク電流
(*1)
(*2)
VOH
デジタル出力 H 電圧
(*2)
標準
最大
単位
V
0.8PVDD
V
IOH = −600uA
IOL = 1mA
VOL
0.2PVDD
V
HIL
±10
uA
I2C(SDA)L 出力
VOLC
0.4
0.2PVDD
V
XTI 入力 H 電圧
VXIH
XTI 入力 L 電圧
VXIL
デジタル出力 L 電圧
(*2)
デジタル出力 Hi-z リーク電流
条件
0.8DVDD
IOLC = 3mA
PVDD≧2.0V
PVDD＜2.0V
V
0.2DVDD
V
(*1)対象ピンは、SELA, PDN, SDA, SCL, TEST
(*2)対象ピンは、DTCLK, DATA[7:0], HD, VD_F, VAR, VARSUB
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- 10 -
2010/03
[AK8859VQ]
[4.4.] アナログ特性
(AVDD=1.8V, Ta=25˚C)
[4.4.1.] 入力レンジ
項目
記号
最小
標準
最大
単位
入力レンジ
VIMX
0
0.50
0.60
Vpp
条件
[4.4.2.] ADC
項目
記号
最小
標準
最大
単位
分解能
RES
10
bit
サンプリング周波数
FS
27
MHz
積分非直線性誤差
INL
±1.0
±2.0
LSB
微分非直線性誤差
DNL
±0.5
±1.0
LSB
S/N
SN
53
dB
S/(N+D)
SND
51
dB
ADC 内部コモン電圧
VCOM
0.96
V
ADC 内部正側 VREF 電圧
VRP
1.36
V
ADC 内部負側 VREF 電圧
VRN
0.56
V
条件
Fin=1MHz*, FS=27MHz,
0.6Vpp 入力時
Fin=1MHz*, FS=27MHz,
0.6Vpp 入力時
[4.4.3.] 消費電流
(AVDD = DVDD = PVDD = 1.8V, Ta = −40 ~ 105˚C)
項目
記号
最小
標準
最大
単位
条件
45
62
mA
S(Y/C)ビデオ信号入力時
27
mA
S(Y/C)ビデオ信号入力時
19
mA
コンポジットビデオ信号入力時*
10
mA
無入力設定時
S(Y/C)ビデオ信号入力時
Xtal 発振子接続時
負荷条件：CL=15pF
（動作時消費電流）
全消費電流
アナログ部
IDD
AIDD
デジタル部
DIDD
13
mA
I/F 部
PIDD
5
mA
パワーダウン時全消費電流
SIDD
≦1
アナログ部
ASIDD
≦1
uA
デジタル部
DSIDD
≦1
uA
I/F 部
PSIDD
≦1
uA
（パワーダウン時消費電流）
200
uA
*参考値です。
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- 11 -
2010/03
[AK8859VQ]
[4.4.4.] 水晶発振回路部
項目
記号
最小
標準
最大
発振周波数
f0
周波数精度
Δf / f
負荷容量
CL
実効等価抵抗
Re
水晶振動子並列静電容量
CO
0.9
pF
XTI 端子外部接続負荷容量
CXI
22
pF
CL=15pF 使用時
XTO 端子外部接続負荷容量
CXO
22
pF
CL=15pF 使用時
24.576
単位
条件
MHz
±100
15
ppm
pF
100
(*1)
Ω
(*1)実効等価抵抗は、一般に Re = R1 x (1+CO/CL)2 で与えられます。(R1：水晶振動子直列等価抵抗)
回路接続例
AK8859 内部回路
Rf
XTI pin
XTO pin
外部接続回路
Rd (* 2)
CXI = 22pF
CXO = 22pF
(*2)制限抵抗(Rd)の有無および抵抗値は、使用する水晶振動子の仕様に合わせて決定して下さい。
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- 12 -
2010/03
[AK8859VQ]
[5.] AC タイミング
(1.70≦DVDD≦2.00, DVDD≦PVDD≦3.60, 負荷条件：CL=15pF)
[5.1.] 外部クロック入力
fCLK
tCLKL
tCLKH
0.8DVDD
0.5DVDD
0.2DVDD
項目
記号
最小
標準
最大
入力 CLK
fCLK
CLK パルス幅 H
tCLKH
16
nsec
CLK パルス幅 L
tCLKL
16
nsec
24.576
MHz
±100
周波数安定度
単位
ppm
[5.2.] クロック出力(DTCLK)
fDTCLK
0.5PVDD
項目
記号
DTCLK
fDTCLK
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最小
標準
27
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- 13 -
最大
単位
MHz
2010/03
[AK8859VQ]
[5.3.] 出力データタイミング
0.5PVDD
(*1)
DTCLK
tDS
tDH
0.5PVDD
Output Data
(*2)
項目
記号
最小
標準
最大
単位
Output Data Setup Time
tDS
10
nsec
Output Data Hold Time
tDH
10
nsec
(*1)レジスタにてクロック出力(DTCLK)の極性を反転することが可能です。
(*2)Output Data は DATA[7:0], HD, VD_F, VAR, VARSUB の総称です。
[5.4.] パワーダウンシーケンス
sVREF
VIH
PDN
VIL
VIL
nPDN
aPDN
項目
記号
最小
標準
最大
単位
パワーダウンパルス除去期間
nPDN
50
nsec
パワーダウンパルス幅
aPDN
500
nsec
VREF 安定期間
sVREF
10
msec
○DTCLK ピン, DATA[7:0]ピン, HD ピン, VD_F ピン, VAR ピン, VARSUB ピンはパワーダウン中は Low
出力となります。
○パワーダウン解除後もレジスタを設定しない限り、DATA[7:0]ピン, HD ピン, VD_F ピン, VAR ピン,
VARSUB ピンは Low 出力となっています。なお、レジスタ設定は「VREF 安定期間」後に行ってくだ
さい。
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- 14 -
2010/03
[AK8859VQ]
[5.5.] 電源投入シーケンス
PWUPTIME
AVDD/DVDD/PVDD
sVREF
VIH
PDN
VIL
rPDN
項目
記号
最小
標準
最大
単位
パワーアップタイム
PWUPTIME
100
msec
パワーダウンリリース
rPDN
500
nsec
VREF 安定期間
sVREF
10
msec
○電源投入時は、必ず PDN ピン=Low としてください。
○各電源の立ち上げ順序は問いません。PDN ピン=Low の状態で 100msec 以内に全ての電源を立ち上
げてください。
○パワーダウン解除後もレジスタを設定しない限り、DATA[7:0]ピン, HD ピン, VD_F ピン, VAR ピン,
VARSUB ピンは Low 出力となっています。なお、レジスタ設定は「VREF 安定期間」後に行ってくだ
さい。
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2010/03
[AK8859VQ]
[5.6.] I2C バス入出力タイミング
[5.6.1.] タイミング 1
tBUF tHD : STA
tR
tF
tSU : STO
VIH
SDA
VIL
tF
tR
VIH
SCL
VIL
tLOW
tSU : STA
項目
記号
最小
最大
単位
Bus Free Time
tBUF
1.3
usec
Hold Time (Start Condition)
tHD:STA
0.6
usec
Clock Pulse Low Time
tLOW
1.3
usec
Input Signal Rise Time
tR
300
nsec
Input Signal Fall Time
tF
300
nsec
Setup Time(Start Condition)
tSU:STA
0.6
usec
Setup Time(Stop Condition)
tSU:STO
0.6
usec
上記 I2C バスに関するタイミングは I2C バスの規格であり、
デバイスの制約によるものではありません。
詳細に関しては I2C バス規格を参照してください。
[5.6.2.] タイミング 2
tHD : DAT
VIH
SDA
VIL
tHIGH
VIH
SCL
VIL
TSU : DAT
項目
Data Setup Time
記号
tSU:DAT
最小
100
最大
(*1)
Data Hold Time
tHD:DAT
0.0
Clock Pulse High Time
tHIGH
0.6
単位
nsec
0.9
(*2)
usec
usec
(*1)I2C バス標準モードで使用する場合 tSU:DAT ≥250nSec を満たす必要があります。
(*2)AK8859 を、tLOW を延長しないバス上で使用する場合(tLOW=最小規格で使用する場合)、この条件
を満足する必要があります
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- 16 -
2010/03
[AK8859VQ]
[6.] 機能概要
○ AK8859 はコンポジットビデオ信号及び、S(Y/C)ビデオ信号を入力信号とします。
入力ピンは 2ch あり、
レジスタ設定により被デコード信号を切り替えます。
○ AK8859 は、コンポジットビデオ信号及び S(Y/C)ビデオ信号の属性をレジスタにて設定する事により、
以下の映像信号をデコードすることが出来ます。
NTSC-M,J / NTSC-4.43 / PAL-B,D,G,H,I,N / PAL-Nc / PAL-M / PAL-60 / SECAM
また、これらの入力信号の属性判別を自動的に行う機能も備えています。
○ AK8859 は、ITU-R BT.656 規格準拠のビデオデータを出力します。
(ただし、固定クロックモード時及び、入力信号品位が悪い場合には、準拠できない場合があります。)
○ AK8859 は、ITU-R BT.656 インターフェースを持たないような機器との接続に備えて、アクティブ映
像領域を示す DVALID 信号を出力することができます。
○ AK8859 は、入力信号に対してアナログ回路にてクランプをかけます。また ADC にてデジタル化され
た入力データは、デジタル信号処理にてペデスタルクランプされます。
○ AK8859 は、VBI 区間のデータをスライスする機能を持っています。スライス結果は ITU-R BT.601 規
格準拠のデジタルデータとして出力されます。
○ AK8859 は、デジタル PGA を内蔵しています。ゲイン値は−4.06dB～6.90dB までレジスタにて可変で
きます。
○ AK8859 は、適応型 AGC 機能を持っています。入力信号の大きさを測定し、入力信号レベルを判断し
ます。
○ AK8859 は、適応型 2 次元 Y/C 分離を行います。相関検出器が、縦横斜めのサンプルから最も相関のあ
る方向を選択し、最適な Y/C 分離を選択します。
○ AK8859 は、垂直方向のピクセル位置を揃えるために、デジタルピクセル補間器を持っています。この
機能により、縦位置を揃える事が出来ます。
○ AK8859 は、次の 3 種類のクロックモードで動作します。
ラインロッククロックモード、フレームロッククロックモード、固定クロックモード
また、AK8859 は上記のモードを自動遷移して、最適なクロックモードを選択する機能があります。
○ AK8859 は、ACC 機能を持っています。入力信号のカラーバーストの大きさを測定し、カラーバース
トレベルを適正レベルに設定します。
○ AK8859 は、入力信号のカラーバーストレベルからクロマ信号品位を判断し、不良であると判断した場
合には、カラーキラーをかける事が出来ます。また、色デコード用 PLL のロックが外れた場合にもカ
ラーキラーが作動します。
○ AK8859 は、コントラスト調整、ブライトネス調整、彩度調整、色相調整機能をもっています。
○ AK8859 は、VBI 期間に重畳される Closed Caption Data, Closed Caption Extended Data,
VBID(CGMS), WSS 信号のデコードを行う事が出来ます。デコードされたデータは、それぞれの格納
レジスタに書き込まれます。
○ AK8859 は、内部機能の状態をいくつかモニタできるレジスタを持っています。
○ AK8859 は、デコードしたデータにマクロビジョン信号が付加されている場合に、デコードした
Macrovision 信号のタイプをレジスタにて通知することができます。
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2010/03
[AK8859VQ]
[7.] 機能説明
[7.1.] 入力信号選択
AK8859 は、アナログビデオ信号入力ピンを 2ch 持っています。デコードできるアナログビデオ信号は、
コンポジットビデオ信号及び、S(Y/C)ビデオ信号です。デコードする信号は、内部のセレクタを用いて選
択されます。セレクタの切替えは、AINSEL レジスタにて設定できます。
Sub Address: 0x00 [1:0]
入力ビデオ信号を選択します。
Name
Definition
備考
[AINSEL1 : AINSEL0]
[00]: AIN1 入力選択 (CVBS)
[01]: AIN2 入力選択 (CVBS)
[10]: AIN1(Y) / AIN2(C)入力選択 (S(Y/C)ビデオ)
[11]: 無入力 (アナログ部のみパワーダウンとなります*)
* ADC ブロック, CLAMP ブロックがパワーダウンとなります。
AINSEL0
~
AINSEL1
なお、無入力設定時は無信号判定出力時と同様に、NSIGMD[1:0]レジスタ*の設定に依存したデータ出力を
行います。ただし、NSIGMD=[10]「入力状態(砂嵐)を出力」の場合には、DATA[7:0], VD_F, VAR, VARSUB,
HD ピンは Low 出力となります。
* Sub Address: 0x07 [3:2]
[7.2.] クロックモード
AK8859 は、水晶発振回路を内蔵しています。また、外部からクロックを入力して動作させることも可能
です。入力クロック周波数は 24.576MHz です。
Sub Address: 0x00 [7]
クロックモードを設定します。
Name
Definition
CLKMD
[0]: 水晶発振回路部動作モード
[1]: 外部クロック入力モード(水晶発振器など)
備考
[7.3.] アナログクランプ回路
AK8859 は、入力されるビデオ信号に対しアナログ回路にてクランプをかけます。クランプを行う方法は
下記の通りです。
○コンポジットビデオ信号をデコードする場合
AK8859 は、シンクチップにクランプをかけます (アナログシンクチップクランプ)。
アナログシンクチップクランプのタイミングパルスは、AK8859 内部で同期分離された同期信号の立下
りを起点として、同期信号のほぼ中央の位置に発生します。
○S(Y/C)ビデオ信号をデコードする場合
(Y 信号)：AK8859 は、入力される Y 信号のシンクチップにクランプをかけます。
クランプパルスは、AK8859 内部で同期分離された同期信号の立下りを起点として、同期信号
のほぼ中央の位置に発生します (アナログシンクチップクランプ)。
(C 信号)：AK8859 は、入力される C 信号に対しペデスタルレベルにてクランプをかけます。
クランプパルスは、Y 信号と同じタイミングで発生します。(アナログミドルクランプ)
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- 18 -
2010/03
[AK8859VQ]
各クランプパルスの発生位置は、下図の通りです。
Y
アナログシンクチップクランプ
CVBS
C
アナログシンクチップクランプ
アナログミドルクランプ
また、クランプ電流調整及び、クランプパルスのパルス幅調整がレジスタにて設定できます。
クランプ回路のクランプ電流の設定をします。
Sub Address: 0x01 [1:0]
Name
Definition
備考
CLPG0
~
CLPG1
[00]: Min.
[01]: Middle 1 {=(Min. x 3 倍)}
[10]: Middle 2 {=(Min. x 5 倍)}
[11]: Max. {=(Min. x 7 倍)}
初期設定値は[00]
Sub Address: 0x01 [4]
クランプパルス幅を設定します。
Name
Definition
備考
CLPWIDTH
[0]: 275nsec
[1]: 555nsec
初期設定値は[0]
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- 19 -
2010/03
[AK8859VQ]
[7.4.] 入力映像信号属性
AK8859 は、入力されるビデオ信号の属性をレジスタにて設定する事により、下記の各映像信号をデコー
ドすることが出来ます。
NTSC-M, J
NTSC-4.43
PAL-B, D, G, H, I, N
PAL-Nc
PAL-M
PAL-60
SECAM
入力信号の属性を設定するレジスタには以下のようなものがあります。
ビデオ信号のサブキャリア周波数を設定します。
Name
Definition
VSCF0
~
VSCF1
[ VSCF1 : VSCF0 ] ( MHz )
[00]: 3.57954545 (NTSC-M,J)
[01]: 3.57561149 (PAL-M)
[10]: 3.58205625 (PAL-Nc)
[11]: 4.43361875(PAL-B,D,G,H,I,N,60, NTSC-4.43, SECAM)
備考
ビデオ信号のカラーエンコード方式を設定します。
Name
Definition
VCEN0
~
VCEN1
[VCEN1 : VCEN0]
[00]: NTSC
[01]: PAL
[10]: SECAM
[11]: Reserved
Sub Address: 0x02 [3:2]
備考
Sub Address: 0x02 [4]
ビデオ信号のライン数を設定します。
Name
Definition
VLF
[0]: 525 ライン(NTSC-M,J, NTSC-4.43, PAL-M,60)
[1]: 625 ライン(PAL-B,D,G,H,I,N, PAL-Nc, SECAM)
備考
Sub Address: 0x02 [5]
白黒モードの設定をします。
Name
Sub Address: 0x02 [1:0]
Definition
備考
[0]: 白黒モード OFF
[1]: 白黒モード ON
コンポジットビデオ信号入力時に白黒モードに設定された場合、入力信号は白黒信号とみなされ、AD コ
ンバータによってデジタル化されたサンプリングデータは、全て Luminance Process を通して輝度信号と
して処理されます。すなわちこのビットが ON になった場合、YC 分離ブロックに入力された信号は、す
べて輝度信号として YC 分離ブロックから輝度信号処理ブロックへデータが出力されます。白黒モード設
定時に、Cb/Cr コードは入力によらず 0x80(601 レベルデータ)を出力します。S(Y/C)ビデオ信号入力時は、
輝度信号のみをデコードします。
BW
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- 20 -
2010/03
[AK8859VQ]
Setup 処理の設定をします。
Name
Sub Address: 0x02 [6]
Definition
備考
[0]: Setup なしの信号入力として信号処理します。
[1]: Setup ありの信号入力として信号処理します。
Setup 有りとして設定された場合、輝度信号と色信号に以下の処理を行います。
輝度信号: YOUT=(YIN−7.5)/0.925
色信号: UOUT=UIN/0.925 , VOUT=VIN/0.925
※YOUT：セットアップ処理後輝度信号、YIN：セットアップ処理前輝度信号
UOUT：セットアップ処理後色(U)信号、UIN：セットアップ処理前色(U)信号
VOUT：セットアップ処理後色(V)信号、VIN：セットアップ処理前色(V)信号
SETUP
[7.5.] 入力映像信号自動認識機能
AK8859 は、入力信号の自動認識を行うことができます。
Sub Address: 0x02 [7]
ビデオ信号の自動認識機能を設定します。
Name
Definition
AUTODET
[0]: OFF(マニュアル設定)
[1]: ON(自動認識)
備考
AK8859 は、自動認識機能が ON の時、次の項目を自動で認識します。
フレーム毎のライン数:
525 (Line)
625 (Line)
サブキャリア周波数:
3.57954545 (MHz)
3.57561149 (MHz)
3.58205625 (MHz)
4.43361875 (MHz)
カラーエンコード方式:
NTSC
PAL
SECAM
白黒信号判定*:
白黒ではない
白黒である
(白黒信号の自動判定機能は、カラーキラー設定が ON の場合に有効です。)
AK8859 は、上記信号の認識を自動で行い、認識結果を Input Video Status Register に反映するため、この
レジスタの値を読み取る事により、入力信号が NTSC-M,J / NTSC-4.43 / PAL-B,D,G,H,I,N / PAL-M /
PAL-Nc / PAL-60 / SECAM 及び、白黒信号のどれに当てはまるのかをホスト側は判断する事が出来ます。
ただし、NTSC-M と NTSC-J の判別及び、PAL-B,D,G,H,I,N の判別は行いません。
Sub Address: 0x18 “Input Video Status Register”
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
FIXED
UNDEF
ST_B/W
ST_VLF
ST_VCEN1
ST_VCEN0
ST_VSCF1
ST_VSCF0
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2010/03
[AK8859VQ]
[7.6.] 入力映像信号自動認識制限機能
AK8859 は、自動認識機能に対し、自動認識を行う際の候補となる信号を制限することが出来ます。
Sub Address: 0x03 “NDMODE Register”
Name
NDPALM
NDPALNC
NDSECAM
Reserved
NDNTSC443
NDPAL60
ND525L
ND625L
Definition
備考
[0]: PAL-M を自動認識の候補とします。
[1]: PAL-M を自動認識の候補としません。
[0]: PAL-Nc を自動認識の候補とします。
[1]: PAL-Nc を自動認識の候補としません。
[0]: SECAM を自動認識の候補とします。
[1]: SECAM を自動認識の候補としません。
Reserved
[0]: NTSC-4.43 を自動認識の候補とします。
[1]: NTSC-4.43 を自動認識の候補としません。
[0]: PAL-60 を自動認識の候補とします。
[1]: PAL-60 を自動認識の候補としません。
[0]: 525Line 系を自動認識の候補とします。
[1]: 525Line 系を自動認識の候補としません。
[0]: 625Line 系を自動認識の候補とします。
[1]: 625Line 系を自動認識の候補としません。
上記レジスタの設定を行うには、以下の制約があります。
[1] NDNTSC443(bit 4)と、NDPAL60(bit 5)の両方共に[1](High)に設定する事は禁止します。
[2] ND525L(bit 6)と、ND625L(bit 7)の両方共に[1](High) に設定する事は禁止します。
[3] 候補となる信号を制限する場合、以下のように、あらかじめ自動認識モード OFF の状態で、制限しな
い信号の状態へ設定し、その後上記レジスタの設定を行い、自動認識モード ON として下さい。
自動認識モード OFF
Input Video Standard Register にて、制限しない信号状態へ設定する
NDMODE Register の設定
自動認識モード ON
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2010/03
[AK8859VQ]
[7.7.] 出力データ垂直ブランキング期間
AK8859 は、出力されるデータの垂直ブランキング期間の長さを設定できます。
垂直ブランキング期間の長さを設定します。
Name
設定値
[001]
[010]
[011]
VBIL0
~
VBIL2
[000]
[101]
[110]
[111]
[100]
Sub Address: 0x04 [2:0]
525/625 ライン系
垂直ブランキング期間
525
Line1~Line20 及び Line263.5~Line283.5
625
Line623.5~Line24.5 及び Line311~Line336
525
Line1~Line21 及び Line263.5~Line284.5
625
Line623.5~Line25.5 及び Line311~Line337
525
Line1~Line22 及び Line263.5~Line285.5
625
Line623.5~Line26.5 及び Line311~Line338
525
Line1~Line19 及び Line263.5~Line282.5
625
Line623.5~Line23.5 及び Line311~Line335
525
Line1~Line16 及び Line263.5~Line279.5
625
Line623.5~Line20.5 及び Line311~Line332
525
Line1~Line17 及び Line263.5~Line280.5
625
Line623.5~Line21.5 及び Line311~Line333
525
Line1~Line18 及び Line263.5~Line281.5
625
Line623.5~Line22.5 及び Line311~Line334
Reserved
Reserved
備考
+1Line
+2Lines
+3Lines
初期値
−3Lines
−2Lines
−1Line
上記は、
525 ライン系 : Line1~Line19 及び Line263.5~Line282.5
625 ライン系 : Line623.5~Line23.5 及び Line311~Line335
を初期値として、初期値との差異を設定します。
[7.8.] 出力データコードリミット
AK8859 は、ITU-R BT.601 規格準拠の形式(Y:Cb:Cr=4:2:2)にてデコードデータを出力します。内部での演
算はすべて Min=1,Max=254 で演算されています。
下記のレジスタを設定する事により、1~15,236~254 のコードをそれぞれ 16,235 にクリッピングすること
ができます。
出力データコードの Min - Max を規定します。
Name
設定値
[0]
LIMIT601
[1]
出力コード Min~Max
Y: 1~254
Cb, Cr: 1~254
Y: 16~235
Cb, Cr: 16~240
Sub Address: 0x04 [3]
備考
初期設定値
また、LIMIT601=[0]の時に EAVSAVN=[1]*に設定した場合、出力コードは 0～255 となります。
*Sub Address: 0x08 [2]
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2010/03
[AK8859VQ]
[7.9.] V-bit
AK8859 は、ITU-R BT.656 規格準拠 EAV/SAV コード内の V-bit を下記の通り設定できます。
ITU-R BT.656 にて規定されている Timing reference signals の V-bit の値が変化するラインを切り替えます。
Sub Address: 0x04 [4]
Name
設定値
525 ライン系
V-bit=0
625 ライン系
V-bit=1
[0]
Line10~Line263
BT. 656-3 準拠 Line273~Line525
[1]
TRSVSEL
BT. 656-4 及び Line20~Line263
Line283~Line525
SMPTE125M
準拠
これらは VBIL[2:0]-bit には影響されません。
V-bit=0
V-bit=1
Line23~Line310
Line336~Line623
Line1~Line22
Line311~Line335
Line624~Line625
Line1~Line9
Line264~Line272
Line1~Line19
Line264~Line282
[7.10.] スライス機能
AK8859 は、内部 YCbCr 変換後の VBI データをスライスする機能を持っています。
スライス結果は、ITU-R BT.601 規格準拠のデジタルデータとして出力されます。
VBI は、VBIL[2:0]-bit にて設定される区間です。VBI スライス機能は輝度処理パスで行いますので、スライ
ス機能が有効なラインの 601 出力コードの Cb/Cr の値は、対応する輝度信号と同じレベルにて出力されま
す。また、スライスレベル・出力コードはレジスタにて設定されます。
Sub Address: 0x04 [5]
スライスレベルを設定します。
Name
Definition
SLLVL
[0]: スライスレベルは約 25IRE です。
[1]: スライスレベルは約 50IRE です。
出力コードの値は、Hi/Low Slice Data Set Register にて設定されます。
スライスされて 2 値化したデータの High の値を設定します。
Sub Address: 0x11
Name
Definition
H0
~
H7
初期値は、0xEB(235)です。
0x00 及び 0xFF を設定する場合は、601 の特殊コードに相当しますのでご注意ください。
スライスされて 2 値化したデータの Low の値を設定します。
Sub Address: 0x12
Name
Definition
L0
~
L7
初期値は、0x10(16)です。
0x00 及び 0xFF を設定する場合は、601 の特殊コードに相当しますのでご注意ください。
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2010/03
[AK8859VQ]
* (mV)
NTSC/PAL
601 Code
714/700
235
100% White
357/350
127
SLLVL=[1]にて設定された
場合の閾値 50IRE
180/175
63
SLLVL=[0]にて設定された
場合の閾値 25IRE
L
`````
L
Cb/Y
````
``````
L
L
H
Cr/Y
H
Cb/Y
````
H
``````
H
Cr/Y
L
L: Low Slice Data Set Register
にて設定された値
High
Slice Data Set Register
H:
にて設定された値
```````
*閾値(mV)は目安の電圧です。
上図の変化点は Cb/Y の組み合わせとしていますが、これは一例であり、Cr/Y の組み合わせで変化するこ
ともあります。
[7.11.] VBI 区間デコードデータ
AK8859 は、VBI 区間のデコードデータを設定できます。
VBI 区間のデコードデータを設定します。
Name
VBIDEC0
~
VBIDEC1
Sub Address: 0x04 [7:6]
設定値
デコードデータ内容
[00]
黒コード出力
[01]
白黒モード動作
[10]
スライス結果を出力
[11]
Reserved
備考
Y = 0x10
Cb/Cr = 0x80
Y =入力信号を 601 レベルへ変換したもの
Cb/Cr = 0x80
Y/Cb/Cr = スライスレベルに応じた値
(Hi/Low Slice Data Set Register にて設定した値)
Reserved
ただし、Line1 ~ Line9 , Line263.5 ~ Line272.5……… (525Line 系)
Line623.5 ~ Line6.5 , Line311 ~ Line318 ……(625Line 系)
の区間には、VBIDEC[1:0]の設定は反映されません。常に黒コード出力をします。
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2010/03
[AK8859VQ]
[7.12.] 出力ピン状態
AK8859 は、レジスタにて DATA[7:0], VD_F, VAR, VARSUB, HD ピンそれぞれからの出力を Low 固定に設
定する事が出来ます。
各デジタル出力ピンを Low 出力固定にします。
Name
Sub Address: 0x05 [3:0]
Definition
備考
[0]: 通常出力
[1]: [D7: D0]ピンは Low 出力
[0]: 通常出力
[1]: VD_F ピンは Low 出力
[0]: 通常出力
[1]: VAR ピンと VARSUB ピンは Low 出力
[0]: 通常出力
[1]: HD ピンは Low 出力
DL
VD_FL
VARL
HL
初期設定は、[1] Low 出力
初期設定は、[1] Low 出力
初期設定は、[1] Low 出力
初期設定は、[1] Low 出力
また、レジスタにて DTCLK, DATA[7:0], VD_F, VAR, VARSUB, HD ピンを Hi-z 出力に設定する事が出来ま
す。
デジタル出力ピンを Hi-z 出力にします。
Name
Sub Address: 0x05 [4]
Definition
備考
[0]: 各デジタル出力ピンは Hi-Z 出力ではない。*
初期設定は、[0] Hi-z 出力ではない
[1]: 各デジタル出力ピンは Hi-Z 出力
*“各デジタル出力ピン”とは、DTCLK, DATA[7:0], HD, VD_F, VAR, VARSUB ピンを指します。
OEN
ただし、これらの設定に関わらず、PDN ピンが Low の時は、OE 設定に関わらず DTCLK, DATA[7:0], VD_F,
VAR, VARSUB, HD ピンは Low 出力となります。
PDN ピン及び上記レジスタ設定と各デジタル出力ピン状態の関係は下表の通りです。
PDN
ピン
各レジスタ設定
各デジタル出力ピン状態
OEN
-bit
DL
-bit
VD_FL
-bit
VAR
-bit
HL
-bit
L
X
X
X
X
X
Low
H
H
X
X
X
X
Hi-z
H
L
L
L
L
L
DOUT
DOUT
DOUT
H
L
H
H
H
H
Low
Low
Low
DATA[7:0]
VD_F
VAR
VARSUB
HD
DTCLK
DOUT
DOUT
DOUT
Low
Low
DOUT
*DOUT は、通常出力。
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2010/03
[AK8859VQ]
[7.13.] HD ピン出力
AK8859 は、HD ピンから水平方向同期タイミング用信号を出力します。
出力ピン名
525-Line 系
625-Line 系
HD
15.734kHz 間隔で 4.7[usec]の
期間 Low になります。
15.625kHz 間隔で 4.7[usec]の
期間 Low になります。
[7.14.] VD_F 及び VAR ピン及び VARSUB ピン出力選択
AK8859 は、レジスタを切り替えることによって VD_F、VAR ピン及び VARSUB ピンから下表のタイミン
グ信号を出力します。
出力ピン名
VD_F
VAR
VARSUB
出力信号
内容
525-Line 系
625-Line 系
VD
Line4~Line6 及び
Line266.5~Line269.5 で
Low になります。
Line1~Line3.5 及び
Line313.5~Line315 で
Low になります。
FIELD
ODD-Field: Low,
DVALID
有効映像データ区間を示します。Active-Low
FIELD
ODD-Field: Low,
NSIG
LINE
EVEN-Field: High
EVEN-Field: High
入力信号に対する同期状態を示します。
Low: 信号あり(同期しています)
High: 無信号または同期が外れています。
入力映像信号自動判定機能のライン数判定結果を示します。
525LINE: Low, 625LINE: High
なお、自動判定機能が OFF の時は、VLF-bit*にて設定しているラインを示しま
す。
(*Sub-address:0x02-“bit4”)
VD_F, VAR ピン及び VARSUB ピンからの出力は、下記レジスタにて切り替えてください。
VD_F ピンから出力される信号を選択します。
Name
Definition
VD_FSEL
[0]: VD 信号を出力します。
[1]: FIELD 信号を出力します。
Sub Address: 0x05 [5]
備考
VAR ピン及び VARSUB ピンから出力される信号を選択します。
Name
Definition
VARSEL0
~
VARSEL1
VAR ピン
[ VARSEL1 : VARSEL0 ]
[00]: DVALID 信号を出力します。
[01]: FIELD 信号を出力します。
[10]: NSIG 信号を出力します。
[11]: LINE 信号を出力します。
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Sub Address: 0x05 [7:6]
備考
VARSUB ピン
[ VARSEL1 : VARSEL0 ]
[00]: NSIG 信号を出力します。
[01]: LINE 信号を出力します。
[10]: FIELD 信号を出力します。
[11]: DVALID 信号を出力します。
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2010/03
[AK8859VQ]
[7.15.] ピン出力極性
各デジタル出力ピンからの信号極性は下記レジスタにて反転させることができます。
Sub Address: 0x06 [7:5]
出力ピン極性を設定します。
Name
出力ピン名
出力信号
HDP
HD
VD_FP
VD_F
VAR
VARSUB
VARP
設定値
[0]
[1]
HD
Active Low
Active High
VD
Active Low
Active High
Field
Low: Odd-Field
High: Even-Field
Low: Even-Field
High: Odd-Field
DVALID
Active Low
Active High
Field
Low: Odd-Field
High: Even-Field
Low: Even-Field
High: Odd-Field
NSIG
High: 無信号
Low: 無信号
LINE
Low: 525Line
High: 625Line
Low: 625Line
High: 525Line
また、DTCLK ピンからの出力極性を反転させることも可能です。
DTCLK 信号出力の極性を設定します。
Sub Address: 0x06 [4]
Name
Definition
CLKINV
[0]: 通常出力( ↑エッジでデータを取り込んで下さい)
[1]: データとクロックの位相を反転させます。( ↓エッジでデータを取り込んで下さい)
[7.16.] 位相補正機能
コンポジットビデオ信号及び、S(Y/C)ビデオ信号の PAL-B,D,G,H,I,N,Nc,60,M のデコード時に、ライン毎
の位相誤差を補正する機能です。この機能が ON の場合、ラインごとに色の平均化処理を行います。
また、適応型位相補正モードでは、ライン間の相関検出を行い、相関があるサンプルに色の平均化処理を
行います。NTSC-M,J の場合にも、ライン間の色の平均化処理を行います。SECAM では行いません。
色の平均化処理(PAL 位相補正回路)の設定を行います。
Name
Definition
DPAL0
~
DPAL1
[ DPAL1 : DPAL0 ]
[00]: 適応型位相補正 ON
[01]: 位相補正 ON
[10]: 位相補正 OFF
[11]: Reserved
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Sub Address: 0x07 [1:0]
2010/03
[AK8859VQ]
[7.17.] 無信号判定時出力信号
無信号時（無信号判定を示す NOSIG-bit*が[1]の時）に出力される信号は、レジスタ設定によって、黒レベ
ル、青レベル(ブルーバック)、入力状態そのまま(砂嵐)のいずれかとなります。(*Sub-address:0x15-“bit0”)
Sub Address: 0x07 [3:2]
無信号判定時の出力を設定します。
Name
Definition
NSIGMD0
~
NSIGMD1
[ NSIGMD1 : NSIGMD0 ]
[00]: 黒レベル出力
[01]: 青レベル(ブルーバック)出力
[10]: 入力状態(砂嵐)を出力
[11]: Reserved
なお、S(Y/C)ビデオ信号入力時には Y 信号のみを無信号判定に用います。C 信号は判定に用いません。
[7.18.] アクティブ映像データ開始位置
AK8859 は、
アクティブ映像データの開始位置をレジスタにて調整できます。調整幅は 1sample が 13.5MHz
レートです。
Sub Address: 0x07 [6:4]
ビデオデータの開始位置調整を行います。
Name
Definition
ACTSTA0
~
ACTSTA2
[ ACTSTA2 : ACTSTA0 ]
[001]: 1Sample 遅れてデコードします。
[010]: 2Sample 遅れてデコードします。
[011]: 3Sample 遅れてデコードします。
[000]: 通常位置からデコードします。
[101]: 3Sample 早まってデコードします。
[110]: 2Sample 早まってデコードします。
[111]: 1Sample 早まってデコードします。
[100]: Reserved
初期値でのスタート位置は次図のとおりです。(ITU-R BT.601 規格準拠)
OH
OH
122sample(525Line)
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Active video start
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132sample(625Line)
Active video start
2010/03
[AK8859VQ]
[7.19.] VLOCK 機構
AK8859 は、入力信号のフレーム構造に対して内部動作を同期させます。例えば、入力信号のフレーム構
造が 524 ラインで生成されている場合、内部動作は 1 フレームの構造を 524 ラインで動作するようにしま
す。この機構を VLOCK 機構と呼びます。1 フレームが 525 ラインで構成される入力信号が、524 ライン
で構成される入力信号に切り替わったような場合、切り替わった入力信号に追従するような動作を行いま
す。このような場合、引き込み過程で VLOCK 機構が UnLock 状態になります。この UnLock 状態は
VLOCK-bit*で確認することが可能です。チャンネル切り替えなどで入力信号が切り替わった場合、VLOCK
機構がロックするまで約 4 フレームの時間がかかります。(*Sub-address:0x15-“bit1”)
なお、VLOCK 機構は引き込み過程を経て内部動作を同期させます(VLOCK 方式)が、信号が切り替わった
際に、即座に内部動作を切り替えて動作させることも可能(直接同期方式)です。
下記レジスタにて設定できます。
Sub Address: 0x07 [7]
垂直同期方式を設定します。
Name
Definition
VERTS
垂直同期方式を設定します。
[0]: VLOCK 方式
[1]: 直接同期方式
[7.20.] Y/C 分離
AK8859 は、コンポジットビデオ信号入力時、適応型 2 次元 Y/C 分離を行います。
相関検出器が、縦横斜めのサンプルから最も相関のある方向を選択し、最適な Y/C 分離を選択します。
また、レジスタによって、2 次元 Y/C 分離及び 1 次元 YC 分離に固定することも可能です。
ただし、NTSC-4.43 , PAL-60 , SECAM 入力時には、設定によらず、1 次元 Y/C 分離のみとなります。
Y/C 分離方式を設定します。
Name
YCSEP0
~
YCSEP1
Sub Address: 0x08 [1:0]
設定値
YC 分離方式
備考
[00]
適応型 Y/C 分離
[01]及び[10]設定のどちらか最適な Y/C 分離を選択します。
[01]
1 次元 Y/C 分離
1 次元(BPF)Y/C 分離
[10]
2 次元 Y/C 分離
(NTSC-M,J, PAL-M): 3Line2 次元 Y/C 分離
(PAL-B,D,G,H,I,N,Nc): 5Line2 次元 Y/C 分離
[11]
Reserved
[7.21.] EAV/SAV コード
AK8859 は、DATA[7:0]から出力される映像データ上に ITU-R BT.656 で規定されている EAV 及び SAV コ
ードを付加して出力します。
なお、レジスタ設定にて EAV 及び SAV コードを付加せずに出力することも可能です。
EAV/SAV コードのデータ出力付加設定です。
Name
Definition
EAVSAVN
[0]: EAV/SAV コードはデータに付加されています。
[1]: EAV/SAV コードはデータに付加されていません。
Sub Address: 0x08 [2]
また、LIMIT601=[0]*の時に EAVSAVN=[1]に設定された場合、出力コードは 0～255 となります。
*Sub Address: 0x04 [3]
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2010/03
[AK8859VQ]
[7.22.] 出力インターフェース
[7.22.1.] 656 インターフェース
[7.22.1.1.] ラインロッククロックモード及び、フレームロッククロックモード時
AK8859 のデコードデータは ITU-R BT.656 規格準拠で出力されます。
ITU-R BT.656 規格準拠のデータの 1 ラインサンプル数及び 1 フレームライン数は、下記の通りです。
1 ライン当たりのサンプル数: 858 サンプル(525 系) / 864 サンプル(625 系)
1 フレーム当たりのライン数: 525 本 / 625 本
なお、AK8859 は入力信号の品位が悪い場合には、上記出力を満足できない場合があります。
AK8859 は、入力信号の揺らぎを吸収する為のバッファを出力段に設けていますが、入力信号の揺らぎが
非常に大きい場合には、PLL の追従が出来なくなり、ITU-R BT.656 規格を満足できなくなる為です。
AK8859 は、ITU-R BT.656 規格準拠の信号を出力できない場合(信号品位が悪い場合)に、ラインドロップ
またはラインリピート処理を行います。すなわち、1 フレームあたりのライン数が 525/625 本でない状況
が起こる可能性があります。(ラインドロップ時は 524/624 本。ラインリピート時は 626/626 本。)
ラインドロップ、ラインリピートはフレームの任意のラインで起こります。
[7.22.1.2.] 固定クロックモード時
固定クロックモードは、入力クロック(24.576MHz)から内部生成される 27MHz のクロックで動作するモー
ドです。入力信号と同期していない為、出力データは ITU-R BT.656 規格を満たしません。また、出力デー
タは SAV 基準で出力されます。
固定クロックモードの場合、下図の通り SAV から EAV の 720Pixel はピクセル数保証しますが、EAV から
SAV までのサンプル数は、保証できません。(例として、コンポジット信号での図を記載しています。)
SAV
EAV
720 pixels
858 / 864 ( NTSC / PAL ) pixels ± α
固定クロックモードで使用される場合は、SAV 基準でデータの取り込みを行ってください。
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- 31 -
2010/03
[AK8859VQ]
[7.22.2] タイミング信号を使用したインターフェース
[7.22.2.1.] ラインロッククロックモード及び、フレームロッククロックモード時
AK8859 は、ITU-R BT.656 インターフェースを持たないような機器との接続に備えて、HD 信号、VD 信号、
DVALID 信号、FIELD 信号を出力します。
HD 信号、VD 信号と FIELD 信号とのタイミング関係は下記の通りです。
525Line 系入力時出力タイミング (例として、コンポジット信号入力での図を記載しています。)
CVBS
523
HD
524
525
1
2
3
4
5
6
7
8
9
10
11
VD
FIELD
ODD
EVEN
CVBS
261
HD
262
263
264
265
266
267
268
269
270
271
272
274
273
VD
ODD
FIELD
EVEN
625Line 系入力時出力タイミング (例として、コンポジット信号入力での図を記載しています。)
CVBS
HD
620
621
622
623
624
625
1
2
3
4
5
6
7
8
VD
FIELD
CVBS
HD
VD
FIELD
ODD
EVEN
308
309
310
311
312
313
314
ODD
315
316
317
318
319
320
321
EVEN
また、HD 信号、DVALID 信号と EAV/SAV コードとのタイミング関係は下記の通りです。
DTCLK
HD
DVALID
DATA [7:0]
FF
00
128CLK
00
SAV Cb0
Y0
Cr0
Y1
Cb1
Y2
Cr1
1440CLK
244CLK
(264CLK)
FF
00
00
EAV
FF
32CLK
(24CLK)
*カッコ内は、625 ライン系の場合のクロック数です。
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2010/03
[AK8859VQ]
[7.22.2.2.] 固定クロックモード時
固定クロックモードの時、内部動作クロックは入力信号と同期していませんが、HD 信号から DVALID 信
号までの 122 / 132 (NTSC / PAL)Pixel はピクセル数保証します。
(例として、コンポジット信号での図を記載しています。また下図は 1pixel = 2CLK として記載しています。)
Video Signal
HD
DVALID
····· SAV
Cb0
Y0
Cr0
Y1
Cb1
Y2
Cr1
Y3
······
Y718 Cr359 Y719
FF
··············
128CLK
244CLK
(264CLK)
32CLK
(24CLK)
1440CLK
実映像区間
常に一定
一定ではない
[7.23] ピクセル補間器
AK8859 は、垂直方向のピクセル位置を揃えるために、デジタルピクセル補間器を持っています。これに
より、フレームロッククロックモード及び固定クロックモード動作時でも、縦方向を揃える事が出来ます
す。このピクセル補間器は、レジスタにてピクセル補間機能の ON/OFF を設定出来ます。
また、レジスタにて AUTO 設定にすると、クロックモードの状態によって、以下のように ON/OFF します。
ラインロッククロックモード
OFF
フレームロッククロックモード
ON
固定クロックモード
ON
Sub Address: 0x08 [5:4]
ピクセル補間器の動作を設定します。
Name
INTPOL0
~
INTPOL1
設定値
ピクセル補間器の動作
備考
[00]
Auto
クロックモードによって切り替わります。
[01]
ON
[10]
OFF
[11]
Reserved
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2010/03
[AK8859VQ]
[7.24] クロック生成
<クロック生成>
AK8859 は、3 種類のクロックモードで動作します。
[7.24.1.] ラインロッククロックモード
入力信号中の水平同期信号を用いて、PLL にてクロックを生成します。このようにして生成されるクロッ
クをラインロッククロックと呼びます。ただし、ラインロッククロックモードに設定した場合でも、信号
が無入力の場合は、固定クロックモードとなります。
[7.24.2.] フレームロッククロックモード
入力信号中の垂直同期信号を用いて、PLL にてクロックを生成します。このようにして生成されるクロッ
クをフレームロッククロックと呼びます。ただし、フレームロッククロックモードに設定した場合でも、
信号が無入力の場合は、固定クロックモードとなります。
[7.24.3.] 固定クロックモード
PLL 制御のかからないクロックで動作するモードです。無信号時及び、レジスタにて設定した場合にのみ
このモードで動作します。固定クロックモード時に取り込むデータは、SAV(Start Active Video)基準で取り
込んでください(EAV 基準では取り込めません)。このモードの場合、1 ラインのピクセル数は保証しませ
んが、SAV から EAV の期間のピクセル数は保証します。
[7.24.4.] 自動遷移モード
AK8859 は、上記の 3 つのクロックモードを自動遷移して、最適なクロックモードを選択する機能があり
ます。このとき、信号が無入力の場合は、固定クロックモードになります。
Sub Address: 0x08 [7:6]
クロック生成モードを選択します。
Name
CLKMODE0
~
CLKMODE1
設定値
モード選択
備考
[00]
自動遷移モード
[01]
ラインロッククロックモード
[10]
フレームロッククロックモード
[11]
固定クロックモード
[7.25.] PGA
AK8859 は、デジタル PGA を内蔵しています。
設定値は線形変化となり、ADC 通過後のデータに対して−4.06dB～6.90dB のゲイン調整が可能です。
初期設定値は、0x3C(HEX.)=0.00dB です。
PGA ゲイン演算式：
ゲイン(dB) =
⎛ (2.5 × PGA) + 251.5 ⎞
20 LOG⎜
⎟
401.5
⎝
⎠
*PGA：PGA1 及び PGA2 レジスタ設定値(Dec.)
なお初期設定値は、0.5Vpp のコンポジットビデオ信号を AIN 端子に入力した際に、最適なレンジにてデ
コードが行われる設定値です。
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- 34 -
2010/03
[AK8859VQ]
PGA1 は、CVBS 及び Y 信号処理用です。PGA2 は、C 信号処理用です。
PGA1 の値を設定します。
Sub Address: 0x0A [7:0]
Name
Definition
PGA1_0
~
PGA1_7
PGA1 のゲインを設定します。
PGA ゲインは上記の演算式に従って変化します。
PGA2 の値を設定します。
Sub Address: 0x0B [7:0]
Name
Definition
PGA2_0
~
PGA2_7
PGA2 のゲインを設定します。
PGA ゲインは上記の演算式に従って変化します。
また、これらのレジスタにて、AGC が設定している値を読むことが出来ます。
AGC 機能が Enable の場合、PGA1[7:0]-bit 及び PGA2[7:0]-bit の設定値は無効となります。つまり、AGC
機能が Disable の場合に限り、PGA のマニュアル設定が可能です。
[7.26.] AGC(Auto Gain Control)
AK8859 は、AGC 機能を持っています。
入力信号の同期信号の大きさ(シンクチップレベルとペデスタルレベルの差異)を測定し、同期信号レベル
が 286mV / 300mV 相当になるように PGA1 の値を制御します。なお、S(Y/C)ビデオ信号入力時の PGA2
のレジスタ値は PGA1 と同値となります。
また、AK8859 の AGC 機能は適応型 AGC 機能の為、シンク AGC 機能に加えてピーク AGC 機能も持って
います。同期信号のレベルが適正であり、映像区間の信号のみが大きいような入力信号の場合、ピーク AGC
機能が有効です。
コンポジットビデオ信号及び、S(Y/C)ビデオ信号入力時の同期信号の深さは、下記の通りです。
NTSC-M,J, NTSC-4.43, PAL-M…………………………286mV
PAL-B,D,G,H,I,N, PAL-Nc, PAL-60, SECAM…………. 300mV
AGC の ON/OFF を設定します。
Name
Definition
AGC
[0]: AGC OFF
[1]: AGC ON
Sub Address: 0x0C [0]
AGC の不感帯を設定します。
Sub Address: 0x0C [3:2]
Name
Definition
AGCC0
~
AGCC1
[ AGCC1 : AGCC0 ]
[00]: ±2LSB の不感帯を持ちます。
[01]: ±3LSB の不感帯を持ちます。
[10]: ±4LSB の不感帯を持ちます。
[11]: 不感帯はありません。
MS1178-J-00
AKM Confidential
- 35 -
2010/03
[AK8859VQ]
[7.27.] ACC(Auto Color Control)
AK8859 は、ACC 機能を持っています。
入力信号のカラーバーストの大きさを測定し、カラーバーストレベルを適正レベルに設定します。ただし、
SECAM 信号入力時には設定は無効です。適正レベルは、286mV / 300mV 相当です。
NTSC-M,J, NTSC-4.43, PAL-M…………………………286mV
PAL-B,D,G,H,I,N, PAL-Nc, PAL-60…………. ………… 300mV
ACC の ON/OFF を設定します。
Name
Definition
ACC
[0]: ACC OFF
[1]: ACC ON
Sub Address: 0x0C [5]
なお、ACC 機能はサチュレーション(彩度)調整機能とは独立に動作します。よって、ACC 機能が ON の場
合は、ACC で適正レベルに調整された信号に対して、サチュレーション(彩度)調整機能が働きます。
[7.28.] シャープネス調整
AK8859 は、輝度信号に対してシャープネス調整を行うことができます。フィルタ特性は下記の通りです。
シャープネス調整によって、デコード映像をシャープな画質にすることができます。
SHARP
(ON/OFF)
処理前輝度信号
Filter
処理後輝度信号
Delay
Sub Address: 0x0C [4]
シャープネス調整を行います。
Name
Definition
SHARP
[0]: シャープネスフィルタなし
[1]: シャープネスフィルタあり
[7.29.] カラーキラー
AK8859 は、入力信号のカラーバーストレベルからクロマ信号品位を判断します。クロマ信号レベルが内
部閾値を下まわった場合、または色デコード用 PLL のロックが外れた場合、AK8859 は入力クロマ信号が
不良であると判断し、カラーキラーを作動させ、白黒モードと同等の処理を行います。カラーキラーが作
動した時の Cb/Cr データは 0x80 固定となります。
カラーキラーの Enable/Disable を設定します。
Name
Definition
CKILLDISS
[0]: Enable
[1]: Disable
MS1178-J-00
AKM Confidential
- 36 -
Sub Address: 0x0C [7]
2010/03
[AK8859VQ]
[7.30.] 画質調整機能
AK8859 は、レジスタにてコントラスト調整、ブライトネス調整、サチュレーション(彩度)調整、HUE（色
相）をすることができます。
[7.30.1.] コントラスト調整
Sub Address: 0x0D [6:0]
コントラスト調整を行うレジスタです。
Register
Definition
[CONTSEL-bit =[0]の時*]
YOUT = (CONT / 64) x ( YIN − 128) +128
[CONTSEL-bit =[1]の時*]
YOUT = (CONT / 64) X YIN
CONT0
~
CONT6
YOUT: コントラスト演算後の輝度信号
YIN: コントラスト演算前の輝度信号
CONT: コントラスト係数(レジスタ設定値)
{0~ (127 / 64)}の範囲を 1/64 ステップで設定できます。初期値は、0x40 です。
上記の通り、コントラスト調整機能は、50%(=8’d128)を基準にする場合と、0%を基準にする場合の 2 通
りをレジスタにて選択できます。
Sub Address: 0x0C [6]
コントラスト調整の基準値設定
Register
Definition
CONTSEL
[0]: 50%基準
[1]: 0%基準
[7.30.2.] ブライトネス調整
Sub Address: 0x0E [6:0]
ブライトネス調整を行うレジスタです。
Name
Definition
YOUT = YIN + ( BR x 2 )
BR0
~
BR6
YOUT: ブライトネス演算後の輝度信号
YIN: ブライトネス演算前の輝度信号
BR: ブライトネス係数(レジスタ設定値)
{−128 ~ 126}の範囲を 2step 毎に設定できます。なお、設定は 2 の補数です。
MS1178-J-00
AKM Confidential
- 37 -
2010/03
[AK8859VQ]
[7.30.3.] サチュレーション(彩度)調整
サチュレーション(彩度)調整を行うレジスタです。
Name
Sub Address: 0x0F [6:0]
Definition
COUT = (SAT / 64) X CIN
SAT0
~
SAT6
COUT: サチュレーション演算後の輝度信号
CIN: サチュレーション演算前の輝度信号
SAT: サチュレーション係数(レジスタ設定値)
{0~ (127 / 64)}の範囲を 1/64 ステップで設定できます。初期値は、0x40 です。
[7.30.4.] HUE（色相）調整
HUE（色相）調整を行うレジスタです。
Sub Address: 0x10 [6:0]
Name
Definition
HUE0
~
HUE 6
±45°の範囲を、1/128 ステップ(約 0.70°ステップ)で設定できます。
なお、設定は 2 の補数です。
MS1178-J-00
AKM Confidential
- 38 -
2010/03
[AK8859VQ]
[7.31.] VBI 期間情報デコード
AK8859 は、VBI 期間に重畳される Closed Caption Data, Closed Caption Extended Data, VBID(CGMS),
WSS 信号のデコードを行う事が出来ます。
デ コ ー ド さ れ た デ ー タ は そ れ ぞ れ の 格 納 レ ジ ス タ に 書 き 込 ま れ ま す 。 Request VBI Information
Register(Sub Address: 0x13 [3:0]) にそれぞれのリクエストビットを立てることにより、AK8859 は、それ
ぞれのデータのデコード要求があると判断し、データ待ちの状態になります。その後データを検知し、格
納レジスタへデコードを行った後、デコードが終了したことを、データの有無を示す格納レジスタの Status
2 Register(Sub Address: 0x16 [3:0]) を使って、ホストに通知します。したがって、ホストはそれぞれの格
納レジスタを読み取る事により、格納されている値を知る事が出来ます。なお、それぞれのデータは下表
のラインにその情報が重畳されています。データの更新については、格納されているレジスタに次の値が
書き込まれるまでデータは保持されます。また、VBID データ(CGMS-A)に関しては CRCC コードはデコ
ードされ、その演算結果のみがレジスタに反映されます。
信号
重畳されるライン
備考
Closed Caption
Line21
525-Line 系
Closed Caption Extended Data
Line284
525-Line 系
VBID
Line20 / 283
Line20 / 333
525-Line 系
625-Line 系
WSS
Line23
625-Line 系
それぞれの信号の格納レジスタは、以下の通りです。格納されるビットに関しては、レジスタ設定概要を
参照ください。( Sub Address: 0x19 ~ 0x20 )
Closed Caption 1 Register, Closed Caption 2 Register, WSS 1 Register, WSS 2 Register, Extended Data 1
Register, Extended Data 2 Register, VBID 1 Register, VBID 2 Register
データ読み取りフローは下図の通りです。
START
[Request VBI Information Register]
xxRQ-bit = 1
（デコード要求）
[Status 2 Register] Read
（デコード終了確認）
No
Request に対応した
ビット = 1 ?
YES
Request に対応した
データレジスタのリード
END
MS1178-J-00
AKM Confidential
- 39 -
2010/03
[AK8859VQ]
[7.32.] 内部状態通知機能
AK8859 は、内部状態をレジスタにて示すことが可能です。
[7.32.1.] 無信号判定
無信号判定を示します。
Name
NOSIG
Sub Address: 0x15 [0]
設定値
Definition
[0]
信号が入力されています。
[1]
無信号入力状態です。
[7.32.2.] VLOCK 機構状態
VLOCK 機構の状態を示します。
Name
VLOCK
Sub Address: 0x15 [1]
設定値
Definition
[0]
同期が取れています。
[1]
同期が取れていません。
[7.32.3.] インターレース信号
入力信号がインターレース信号であることを示します。
Name
FRMSTD
設定値
Definition
[0]
525/625 のインターレース信号です
[1]
525/625 のインターレース信号ではありません
[7.32.4.] カラーキラー動作
カラーキラーの状態を示します。
Name
設定値
COLKILON
備考
Sub Address: 0x15 [2]
備考
Sub Address: 0x15 [3]
Definition
[0]
カラーキラーは動作していません。
[1]
カラーキラーが動作しています。
[7.32.5.] クロックモード
クロックモードの状態を示します。
Name
設定値
SCLKMODE
備考
備考
Sub Address: 0x15 [5:4]
Definition
[00]
固定クロックモード動作
[01]
ラインロッククロック動作
[10]
フレームロッククロック動作。
[11]
Reserved
備考
[7.32.6.] 輝度デコードオーバーフロー
AGC 機能ブロック通過後の輝度デコード結果が、オーバーフローしている場合に通知します。
Sub Address: 0x15 [6]
Name
PKWHITE
MS1178-J-00
設定値
Definition
[0]
異常なし
[1]
輝度デコード結果がオーバーフロー
AKM Confidential
- 40 -
備考
2010/03
[AK8859VQ]
[7.32.7.] 色デコードオーバーフロー
ACC 機能ブロック通過後の色デコード結果が、、オーバーフローしている場合に通知します。
Sub Address: 0x15 [7]
Name
OVCOL
設定値
Definition
[0]
異常なし
[1]
色デコード結果がオーバーフロー
[7.32.8.] AGC 状態
適応型 AGC の状態を通知します。
Name
AGCSTS
備考
Sub Address: 0x16 [5]
設定値
備考
[0]
シンク AGC が動作しています。
[1]
ピーク AGC が動作しています。
[7.33.] マクロビジョン信号検知
AK8859 は、デコードしたデータにマクロビジョン信号が付加されている場合は、デコードしたマクロビ
ジョン信号のタイプをレジスタにて通知します。
マクロビジョン信号があることを示します。
Name
AGCDET
CSDET
CSTYPE
MS1178-J-00
Sub Address: 0x17 [2:0]
Definition
入力信号に Macrovision AGC プロセスがあることを示します。
[0]: Macrovision AGC プロセスはありません。
[1]: Macrovision AGC プロセスを検知しました。
入力信号に Macrovision Color Stripe プロセスがあることを示します。
[0]: Color Stripe プロセスがありません。
[1]: Color Stripe プロセスを検知しました。
入力信号に含まれるカラーストライプの種類を示します。
[0]: Color Stripe Type2 です。
[1]: Color Stripe Type3 です。
AKM Confidential
- 41 -
2010/03
[AK8859VQ]
[7.34.] 入力映像信号自動認識結果
AK8859 は、自動認識した結果をレジスタにて示すことができます。
Sub Address: 0x18 [7:0]
自動認識結果及び、認識状況を示します。
Name
ST_VSCF0
~
ST_VSCF1
ST_VCEN0
~
ST_VCEN1
ST_VLF
ST_BW
UNDEF
FIXED
Definition
入力ビデオ信号のサブキャリア周波数を示します。
[ ST_VSCF1 : ST_VSCF0 ] ( MHz )
[00]: 3.57954545 (NTSC-M,J)
[01]: 3.57561149 (PAL-M)
[10]: 3.58205625 (PAL-Nc)
[11]: 4.43361875 (PAL-B,D,G,H,I,N,60 , NTSC-4.43)
入力信号のカラーエンコード方式を示します。
[ST_VCEN1 : ST_VCEN0]
[00]: NTSC
[01]: PAL
[10]: SECAM
[11]: Reserved
入力ビデオ信号のライン周波数を示します。
[0]: 525 ライン(NTSC-M,J , NTSC-4.43 , PAL-M,60)
[1]: 625 ライン(PAL-B,D,G,H,I,N,Nc , SECAM)
入力信号が白黒であるかの判断を示します。*
[0]: 白黒ではないと認識しています。
[1]: 白黒信号であると認識しています。
入力信号の認識が行えていない状態を示します。
[0]: 判定中または、判定の結果、信号を認識・確定できたことを示します。
[1]: 判定の結果、信号を認識・確定できていません。
入力信号の判定状態を示します。
[0]: 入力信号形式の判定中です。
[1]: 入力信号形式を認識・確定できた為、判定を終了しました。
*白黒信号の自動認識は、カラーキラー機能が有効の時にカラーキラーが働いた場合に[1]となります。
なお、ユーザが明示的に白黒モードに設定している場合は、入力信号自動判定機能は 525/625 の判定のみ
を行います。
MS1178-J-00
AKM Confidential
- 42 -
2010/03
[AK8859VQ]
[8.] デバイスコントロールインターフェース
AK8859 は、I2C バスコントロールインターフェイスによってコントロールされます。
[8.1.] I2C バス SLAVE Address
I2C スレーブアドレスは SELA ピンの設定により、[1000100]または[1000101]のいずれかを選択すること
ができます。
Slave Address
SELA ピン状態
MSB
LSB
プルダウン[Low]
1
0
0
0
1
0
0
R/W
プルアップ[High] 1
0
0
0
1
0
1
R/W
[8.2.] I2C コントロールシーケンス
[8.2.1.] Write シーケンス
1 バイト目に AK8859 のライトモードのスレーブアドレスを受信すると、2 バイト目にサブアドレス、3
バイト目以降にデータを受信します。Write シーケンスには 1 バイトずつ Write するシーケンスと、複数バ
イト連続して Write する Sequential Write Operation があります。
(a) 1 バイト Write シーケンス
S
Slave Address
w
8-bit
A
Sub Address
A
Data
A
1-bit
8-bit
1-bit
8-bit
1-bit
(b) 複数バイト(m-bytes) Write シーケンス (Sequential Write Operation)
Slave
Sub
Data
A
A
S
w A
Data(n) A
Address
Address(n)
(n+1)
1-bit
8-bit
1-bit 8-bit
1-bit 8-bit
1-bit 8-bit
‘’’’’’’
stp
Data
(n+m)
A
8-bit
1-bit
stp
[8.2.2.] Read シーケンス
1 バイト目に AK8859 のリードモードのスレーブアドレスを受信すると、2 バイト目以降はデータの送信
を行います。
Slave
Sub
Slave
A rS
S
w A
R A Data1 A Data2 A Data3 A
‘’’‘’
Address
Address(n)
Address
8-bit
1
8-bit
1
8-bit
1
8-bit
1
8-bit
1
8-bit
1
’‘’’’’‘’’
‘’‘
Data n
!A
8-bit
1
stp
[8.2.3.] I2C General Call 機能
AK8859 は、I2C インターフェースの General Call に応答します。
General Call 受信後の Second Byte が 0x06(HEX)の場合、レジスタを初期化します。
また、Gerenal Call を受信したあとの DATA[7:0]ピンからの出力は H/L 不定出力となります。
S
DATA[7:0]ピン出力：
MS1178-J-00
General Call Address
A
Second Byte
A
0x00 (Hex. 8-bit)
1-bit
0x06 (Hex. 8-bit)
1-bit
通常データ出力
H/L 不定データ出力
AKM Confidential
- 43 -
stp
Low 出力(初期状態)
2010/03
[AK8859VQ]
なお、各々の略語の意味は次の通りです。
S: Start Condition
A: Acknowledge (SDA Low )
stp: Stop Condition
rS: repeated Start Condition
!A: Not Acknowledge (SDA High)
R/W 1: Read 0: Write
: マスタデバイスによります。通常はマイコン出力します。
: スレーブデバイスによります。AK8859 が出力するものです。
MS1178-J-00
AKM Confidential
- 44 -
2010/03
[AK8859VQ]
[9.] レジスタ一覧
Sub
Address
レジスタ名
Default
R/W
機能
0x00
Input Channel Select Register
0x00
R/W
入力信号チャンネルの選択
0x01
Clamp Control Register
0x00
R/W
アナログ部クランプ回路に関する設定
0x02
Input Video Standard Register
0x00
R/W
入力信号に関する設定
0x03
NDMODE Register
0x00
R/W
信号自動認識機能制限設定
0x04
Output Format Register
0x00
R/W
出力データフォーマットに関する設定
0x05
Output Pin Control Register
0x0F
R/W
Output ピン出力状態設定
0x06
Output Pin Polarity Set Register
0x00
R/W
Output ピン出力極性設定
0x07
Control 0 Register
0x00
R/W
各種コントロールレジスタ
0x08
Control 1 Register
0x00
R/W
各種コントロールレジスタ
0x09
Reserved Register
0x00
R/W
Reserved Register
0x0A
PGA1 Control Register
0x3C
R/W
PGA1 ゲイン設定
0x0B
PGA2 Control Register
0x3C
R/W
PGA2 ゲイン設定
0x0C
AGC and Color Control Register
0x00
R/W
AGC 及び色調整に関する設定
0x0D
Contrast Control Register
0x40
R/W
コントラストの調整
0x0E
Brightness Control Register
0x00
R/W
ブライトネスの調整
0x0F
Saturation Control Register
0x40
R/W
サチュレーション(彩度)の調整
0x10
HUE Control Register
0x00
R/W
HUE（色相）の調整
0x11
High Slice Data Set Register
0xEB
R/W
スライスデータ High 値設定
0x12
Low Slice Data Set Register
0x10
R/W
スライスデータ Low 値設定
0x13
Request VBI Information Register
0x00
R/W
VBI 期間情報のデコード要求設定
0x14
Reserved Register
0x00
R/W
Reserved Register
0x15
Status 1 Register
R
内部状態を示す。
0x16
Status 2 Register
R
内部状態を示す。
0x17
Macrovision Status Register
R
入力マクロビジョン信号を示す。
0x18
Input Video Status Register
R
入力信号自動判定の結果を示す。
0x19
Closed Caption 1 Register
R
Closed Caption データを示す。
0x1A
Closed Caption 2 Register
R
Closed Caption データを示す。
0x1B
WSS 1 Register
R
WSS データを示す。
0x1C
WSS 2 Register
R
WSS データを示す。
0x1D
Extended Data 1 Register
R
Closed Caption Extended データを示す。
0x1E
Extended Data 2 Register
R
Closed Caption Extended データを示す。
0x1F
VBID 1 Register
R
VBID データを示す。
0x20
VBID 2 Register
R
VBID データを示す。
0x21
Device and Revision ID Register
R
Device ID 及び Revision 情報を示す。
MS1178-J-00
AKM Confidential
- 45 -
2010/03
[AK8859VQ]
Sub
Address
0x22
~
0x2F
0x30
レジスタ名
Default
R/W
機能
Reserved Register
0x00
R/W
Reserved Register
Reserved Register
0x0E
R/W
Reserved Register
0x31
Reserved Register
0x00
R/W Reserved Register
~
0x3F
上記以外のレジスタへの書き込みは禁止です。
リザーブレジスタには、Default 値以外の値を書き込まないでください。
MS1178-J-00
AKM Confidential
- 46 -
2010/03
[AK8859VQ]
[9.1.] レジスタ設定概要
[9.1.1.] Sub Address 0x00 “Input Channel Select Register (R/W)”
入力信号チャンネルの選択を行います。
Sub Address: 0x00
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
CLKMD
Reserved
Reserved
Reserved
Reserved
Reserved
AINSEL1
AINSEL0
0
0
0
0
0
0
0
Default Value
0
Input Channel Select Register Definition
Register
Bit
R/W
Name
Definition
bit 0
~
bit 1
AINSEL0
~
AINSEL1
Analog Input
Select
R/W
入力ビデオ信号を選択します。
[ AINSEL1 : AINSEL0 ]
[00]: AIN1 入力選択 (CVBS)
[01]: AIN2 入力選択 (CVBS)
[10]: AIN1(Y) / AIN2(C)入力選択 (S(Y/C)ビデオ)
[11]: 無入力 (アナログ部のみパワーダウンとなります*)
bit 2
~
bit 6
Reserved
Reserved
R/W
Reserved
bit 7
CLKMD
Clock Mode
R/W
クロックモードを設定します。
[0]: 水晶発振回路部動作モード
[1]: 外部クロック入力モード(水晶発振器など)
* ADC ブロック, CLAMP ブロックがパワーダウンとなります。
また、無入力設定時は無信号判定出力時と同様に、NSIGMD[1:0]レジスタの設定に依存したデータ出力を
行います。ただし、NSIGMD=[10]「入力状態(砂嵐)を出力」の場合には、DATA[7:0], VD_F, VAR, VARSUB,
HD ピンは Low 出力となります。
MS1178-J-00
AKM Confidential
- 47 -
2010/03
[AK8859VQ]
[9.1.2.] Sub Address 0x01 “Clamp Control Register (R/W)”
アナログ部クランプ回路に関する設定を行います。
Sub Address: 0x01
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
Reserved
CLPWIDTH
Reserved
Reserved
CLPG1
CLPG0
0
0
0
0
0
0
0
Default Value
0
Clamp Control Register Definition
Register
Bit
Name
R/W
Definition
bit 0
~
bit 1
CLPG0
~
CLPG1
Clamp Gain
R/W
アナログ入力クランプ回路のクランプ電流の設
定をします。
[00]: Min.
[01]: Middle 1 {=(Min. x 3 倍)}
[10]: Middle 2 {=(Min. x 5 倍)}
[11]: Max. {=(Min. x 7 倍)}
bit 2
~
bit 3
Reserved
Reserved
R/W
Reserved
bit 4
CLPWIDTH
Clamp Pulse Width
R/W
クランプパルス幅を設定します。
[0]: 275nsec
[1]: 555nsec
bit 5
~
bit 7
Reserved
Reserved
R/W
Reserved
MS1178-J-00
AKM Confidential
- 48 -
2010/03
[AK8859VQ]
[9.1.3.] Sub Address 0x02 “Input Video Standard Register (R/W)”
入力信号に関する設定を行います。
Sub Address: 0x02
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
AUTODET
SETUP
BW
VLF
VCEN1
VCEN0
VSCF1
VSCF0
0
0
0
0
0
0
0
Default Value
0
Input Video Standard Register Definition
Register
Bit
R/W Definition
Name
ビデオ信号のサブキャリア周波数を設定します。
[ VSCF1 : VSCF0 ] ( MHz )
bit 0 VSCF0
Video
[00]: 3.57954545 (NTSC-M,J)
R/W
~
~
Sub-Carrier
[01]: 3.57561149 (PAL-M)
bit 1 VSCF1
Frequency
[10]: 3.58205625 (PAL-Nc)
[11]: 4.43361875(PAL-B,D,G,H,I,N,60, NTSC-4.43, SECAM*)
ビデオ信号のカラーエンコード方式を設定します。
[VCEN1 : VCEN0]
bit 2 VCEN0
[00]: NTSC
Video Color
R/W
~
~
Encode
[01]: PAL
bit 3 VCEN1
[10]: SECAM
[11]: Reserved
ビデオ信号のライン数を設定します。
Video Line
R/W [0]: 525 ライン(NTSC-M,J, NTSC-4.43, PAL-M,60)
bit 4 VLF
Frequency
[1]: 625 ライン(PAL-B,D,G,H,I,N, PAL-Nc, SECAM)
白黒モードの設定をします。
Black &
R/W [0]: 白黒モード OFF
bit 5 BW
White
[1]: 白黒モード ON
Setup 処理の設定をします。
bit 6 SETUP
Setup
R/W [0]: Setup なしの信号入力として信号処理します。
[1]: Setup ありの信号入力として信号処理します。
Video
ビデオ信号の自動認識機能を設定します。
bit 7 AUTODET Standard
R/W [0]: OFF(マニュアル設定)
Auto Detect
[1]: ON(自動認識)
*入力信号が SECAM の場合、VSCF[1:0]は [11] に設定して下さい。
MS1178-J-00
AKM Confidential
- 49 -
2010/03
[AK8859VQ]
[9.1.4.] Sub Address 0x03 “NDMODE Register (R/W)”
入力ビデオ信号自動認識機能に対し、自動認識を行う際の候補となる信号を制限する為のレジスタです。
Sub Address: 0x03
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
ND625L
ND525L
NDPAL60
NDNTSC443
Reserved
NDSECAM
NDPALNC
NDPALM
0
0
0
0
0
0
Default Value
0
0
NDMODE Register Definition
Register
Bit
Name
R/W
bit 0
NDPALM
No Detect PAL-M
R/W
bit 1
NDPALNC
No Detect PAL-Nc
R/W
bit 2
NDSECAM
No Detect SECAM
R/W
bit 3
Reserved
Reserved
R/W
bit 4
NDNTSC443
No Detect NTSC-4.43
R/W
bit 5
NDPAL60
No Detect PAL-60
R/W
bit 6
ND525L
No Detect 525Line
R/W
bit 7
ND625L
No Detect 625Line
R/W
Definition
[0]: PAL-M を自動認識の候補とします。
[1]: PAL-M を自動認識の候補としません。
[0]: PAL-Nc を自動認識の候補とします。
[1]: PAL-Nc を自動認識の候補としません。
[0]: SECAM を自動認識の候補とします。
[1]: SECAM を自動認識の候補としません。
Reserved
[0]: NTSC-4.43 を自動認識の候補とします。
[1]: NTSC-4.43 を自動認識の候補としません。
[0]: PAL-60 を自動認識の候補とします。
[1]: PAL-60 を自動認識の候補としません。
[0]: 525Line 系を自動認識の候補とします。
[1]: 525Line 系を自動認識の候補としません。
[0]: 625Line 系を自動認識の候補とします。
[1]: 625Line 系を自動認識の候補としません。
上記レジスタの設定を行うには、以下の制約があります。
[1]: NDNTSC443(bit 4)と、NDPAL60(bit 5)の両方共に[1](High)に設定する事は禁止します。
[2]: ND525L(bit 6)と、ND625L(bit 7)の両方共に[1](High) に設定する事は禁止します。
[3]: 候補となる信号を制限する場合、あらかじめ自動認識モード OFF の状態で、制限しない信号の状態へ
設定し、その後上記レジスタの設定を行い、自動認識モード ON として下さい。
MS1178-J-00
AKM Confidential
- 50 -
2010/03
[AK8859VQ]
[9.1.5.] Sub Address 0x04 “Output Format Register (R/W)”
出力データフォーマットに関する設定を行います。
Sub Address: 0x04
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
VBIDEC1
VBIDEC0
SLLVL
TRSVSEL
LIMIT601
VBIL2
VBIL1
VBIL0
0
0
0
0
0
0
0
Default Value
0
Output Format Register Definition
Register
Bit
R/W
Name
bit 0
~
bit 2
VBIL0
~
VBIL2
Vertical
Blanking
Length
R/W
bit 3
LIMIT601
601 Output
Limit
R/W
TRSVSEL
Time
Reference
Signal
V Select
R/W
bit 4
MS1178-J-00
Definition
垂直ブランキング期間の長さを設定します。
初期値は、
525LINE: Line1 ~ Line19 / Line263.5 ~ Line282.5
625LINE: Line623.5 ~ Line23.5 / Line311 ~ Line335
が VBI 期間です。
このレジスタでは、上記の初期値との差異を設定します。
1Line 長く設定した場合、
525LINE: Line1 ~ Line20 / Line263.5 ~ Line283.5
625LINE: Line623.5 ~ Line24.5 / Line311 ~ Line336
が VBI 期間です。
1Line 短く設定した場合、
525LINE: Line1 ~ Line18 / Line263.5 ~ Line281.5
625LINE: Line623.5 ~ Line22.5 / Line311 ~ Line334
が VBI 期間です。
[VBIL2 : VBIL0]
[001]: VBI 期間が 1Line 長くなります。
[010]: VBI 期間が 2Line 長くなります。
[011]: VBI 期間が 3Line 長くなります。
[000]: Default(初期設定)
[101]: VBI 期間が 3Line 短くなります。
[110]: VBI 期間が 2Line 短くなります。
[111]: VBI 期間が 1Line 短くなります。
[100]: Reserved
出力データコードの Min - Max を規定します。
[0]: 1-254 (Y/Cb/Cr)
[1]: 16-235 (Y) / 16-240 (Cb/Cr)
このレジスタが 1 に設定されている場合、
16 以下のデータは 16 に、
235 / 240 (Y / Cb,Cr)以上のデータは 240 に、
それぞれクリップされます。
ITU-R BT.656 にて規定されている Timing reference signals
の V-bit の値が変化するラインを切り替えます。
525LINE 入力時、
このレジスタが 0 に設定されている場合
V=1 (Line1 ~ Line9 / Line264 ~ Line272)
AKM Confidential
- 51 -
2010/03
[AK8859VQ]
V=0 (Line10 ~ Line263 / Line273 ~ Line525)
このレジスタが 1 に設定されている場合
V=1 (Line1 ~ Line19 / Line264 ~ Line282)
V=0 (Line20 ~ Line263 / Line283 ~ Line525)
bit 5
SLLVL
Slice Level
R/W
bit 6
~
bit 7
VBIDEC0
~
VBIDEC1
VBI Decode
R/W
MS1178-J-00
625LINE 入力時
このレジスタによらず、
V=1 (Line1 ~ Line22 / Line311 ~ Line335 / Line624 ~ Line625)
V=0 (Line23 ~ Line310 / Line336 ~ Line623)
スライスレベルを設定します。
[0]: スライスレベルは約 25IRE です。
[1]: スライスレベルは約 50IRE です。
Vertical Blanking Length レジスタで設定された期間の
処理を規定します。
[VBIDEC1 : VBIDEC0]
[00]: 黒レベルを出力
[01]: 白黒モード
[10]: スライスした結果を出力します。
[11]: Reserved
AKM Confidential
- 52 -
2010/03
[AK8859VQ]
[9.1.6.] Sub Address 0x05 “Output Pin Control Register (R/W)”
Output ピン出力状態を設定します。
Sub Address: 0x05
Default Value: 0x0F
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
VARSEL1
VARSEL0
VD_FSEL
OEN
HL
VARL
VD_FL
DL
0
0
0
1
1
1
1
Default Value
0
Output Pin Control Register Definition
Register
Bit
Name
R/W
bit 0
DL
D Output Low
R/W
bit 1
VD_FL
VD/FIELD Low
R/W
bit 2
VARL
VAR Low
R/W
bit 3
HL
HD Low
R/W
bit 4
OEN
Output
Enable
R/W
bit 5
VD_FSEL
VD/FIELD
Select
R/W
bit 6
~
bit 7
VARSEL0
~
VARSEL1
DVALID/FIELD
NSIG/LINE
Select
R/W
Definition
[0]: 通常出力
[1]: [D7: D0]ピンは Low 出力
[0]: 通常出力
[1]: VD_F ピンは Low 出力
[0]: 通常出力
[1]: VAR ピンと VARSUB ピンは Low 出力
[0]: 通常出力
[1]: HD ピンは Low 出力
[0]: 各デジタル出力ピンは Hi-Z 出力ではない。*
[1]: 各デジタル出力ピンは Hi-Z 出力
VD_F ピンから出力される信号を選択します。
[0]: VD 信号を出力します。
[1]: FIELD 信号を出力します。
VAR ピン及び VARSUB ピンから出力される信号を選択
します。
[ VARSEL1 : VARSEL0 ]
[00]: DVALID 信号(VAR ピン)、NSIG 信号(VARSUB ピン)
を出力します。
[01]: FIELD 信号(VAR ピン)、LINE 信号(VARSUB ピン)
を出力します。
[10]: NSIG 信号(VAR ピン)、FIELD 信号(VARSUB ピン)
を出力します。
[11]: LINE 信号(VAR ピン)、DVALID 信号(VARSUB ピン)
を出力します。
*“各デジタル出力ピン”とは、DTCLK, DATA[7:0], HD, VD_F, VAR, VARSUB ピンを指します。
OE=[1]の時は、その他のレジスタ設定に関わらず各デジタル出力ピンは Hi-z となりますが、
PDN ピンが Low の時は、OE 設定に関わらず、各デジタルピンは Low 出力となります。
MS1178-J-00
AKM Confidential
- 53 -
2010/03
[AK8859VQ]
[9.1.7.] Sub Address 0x06 “Output Pin Polarity Set Register (R/W)”
Output ピン出力極性を設定します。
Sub Address: 0x06
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
VARP
VD_FP
HDP
CLKINV
Reserved
Reserved
Reserved
Reserved
0
0
0
0
0
0
Default Value
0
0
Output Pin Polarity Set Register Definition
Register
Bit
R/W
Name
bit 0
Reserved
Reserved
R/W
~
bit 3
bit 4
CLKINV
CLK Invert Set
R/W
bit 5
HDP
HD Pin
Polarity Set
R/W
bit 6
VD_FP
VD_F Pin
Polarity Set
R/W
bit 7
VARP
VAR Pin
Polarity Set
R/W
MS1178-J-00
Definition
Reserved
DTCLK 信号出力の極性を設定します。
[0]: 通常出力
( ↑エッジでデータを取り込んで下さい)
[1]: データとクロックの位相を反転させます。
( ↓エッジでデータを取り込んで下さい)
HD 信号の極性を設定します。
[0]: Active Low
[1]: Active High
VD_F ピンからの出力信号の極性を設定します。
(VD 信号出力の場合)
[0]: Active Low
[1]: Active High
(Field 信号出力の場合)
[0]: Odd-Field Low, Even-Field High
[1]: Even-Field Low, Odd-Field High
VAR ピン及び VARSUB ピンの出力信号の極性を設定しま
す。
(DVALID 信号出力の場合)
[0]: Active Low
[1]: Active High
(Field 信号出力の場合)
[0]: Odd-Field Low , Even-Field High
[1]: Even-Field Low , Odd-Field High
(NSIG 信号出力の場合)
[0]: 無信号時に High 出力
[1]: 無信号時に Low 出力
(LINE 信号出力の場合)
[0]: 525L-Low, 625L-High
[1]: 625L-Low, 525L-High
AKM Confidential
- 54 -
2010/03
[AK8859VQ]
[9.1.8.] Sub Address 0x07 “Control 0 Register (R/W)”
各種コントロールレジスタです。
Sub Address: 0x07
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
VERTS
ACTSTA2
ACTSTA1
ACTSTA0
NSIGMD1
NSIGMD0
DPAL1
DPAL0
0
0
0
0
0
0
Default Value
0
0
Control 0 Register Definition
Register
Bit
Name
R/W
bit 0
~
bit 1
DPAL0
~
DPAL1
Deluxe PAL
R/W
bit 2
~
bit 3
NSIGMD0
~
NSIGMD1
No Signal
Output Mode
R/W
bit 4
~
bit 6
ACTSTA0
~
ACTSTA2
Active Video
Start
R/W
bit 7
VERTS
Vertical Sync
Way
R/W
MS1178-J-00
Definition
色の平均化処理(PAL 位相補正回路)の設定を行います。
この処理は NTSC の場合にも有効となります。
[ DPAL1 : DPAL0 ]
[00]: 適応型位相補正 ON
[01]: 位相補正 ON
[10]: 位相補正 OFF
[11]: Reserved
無信号判定時の出力を設定します。
[ NSIGMD1 : NSIGMD0 ]
[00]: 黒レベル出力
[01]: 青レベル(ブルーバック)出力
[10]: 入力状態(砂嵐)を出力
[11]: Reserved
ビデオデータのスタート位置調整を行います。
1sample が 13.5MHz(約 74nsec)の幅となります。
[ ACTSTA2 : ACTSTA0 ]
[001]: 1Sample 遅れてデコードします。
[010]: 2Sample 遅れてデコードします。
[011]: 3Sample 遅れてデコードします。
[000]: 通常位置からデコードします。
[101]: 3Sample 早まってデコードします。
[110]: 2Sample 早まってデコードします。
[111]: 1Sample 早まってデコードします。
[100]: Reserved
垂直同期方式を設定します。
[0]: VLOCK 方式
[1]: 直接同期方式
AKM Confidential
- 55 -
2010/03
[AK8859VQ]
[9.1.9.] Sub Address 0x08 “Control 1 Register (R/W)”
各種コントロールレジスタです。
Sub Address: 0x08
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
CLKMODE1
CLKMODE0
INTPOL1
INTPOL0
Reserved
EAVSAVN
YCSEP1
YCSEP0
0
0
0
0
0
0
0
Default Value
0
Control 1 Register Definition
Register
Bit
Name
R/W
bit 0
~
bit 1
YCSEP0
~
YCSEP1
YC Separation
Control
R/W
bit2
EAVSAVN
EAV SAV Disable
R/W
bit 3
Reserved
Reserved
R/W
bit 4
~
bit 5
INTPOL0
~
INTPOL1
Interpolator Mode
Select
R/W
bit 6
~
bit 7
CLKMODE0
~
CLKMODE1
Clock Mode
Select
R/W
Definition
YC 分離の設定を行います。
[ YCSEP1 : YCSEP0 ]
[00]: 適応型 YC 分離を行います。
[01]: 1 次元 YC 分離を行います。
[10]: 2 次元 YC 分離を行います。
[11]: Reserved
EAV/SAV コードのデータ出力付加設定です。
[0]: EAV/SAV コードはデータに付加されています。
[1]: EAV/SAV コードはデータに付加されていません。
Reserved
ピクセル補間器の設定を行います。
[ INTPOL1 : INTPOL0 ]
[00]: Auto
[01]: ON
[10]: OFF
[11]: Reserved
クロックモードの設定を行います。
[ CLKMODE1 : CLKMODE0 ]
[00]: 自動遷移モード
[01]: ラインロッククロックモード
[10]: フレームロッククロックモード
[11]: 固定クロックモード
[9.1.10.] Sub Address 0x09 “Reserved Register (R/W)”
Reserved レジスタです。
Sub Address: 0x09
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
0
0
0
0
0
0
0
Default Value
0
MS1178-J-00
AKM Confidential
- 56 -
2010/03
[AK8859VQ]
[9.1.11.] Sub Address 0x0A “PGA1 Control Register (R/W)”
PGA1 のゲインを設定します。
PGA1 は、CVBS 及び Y 信号処理用です。
Sub Address: 0x0A
Default Value: 0x3C
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
PGA1_7
PGA1_6
PGA1_5
PGA1_4
PGA1_3
PGA1_2
PGA1_1
PGA1_0
0
1
1
1
1
0
0
Default Value
0
PGA1 Control Register Definition
Register
Bit
Name
bit 0 PGA1_0
~
PGA1 Gain Set
~
bit 7 PGA1_7
R/W
Definition
R/W
PGA1 のゲインを設定します。
PGA ゲインは下記の演算式に従って変化します。
[9.1.12.] Sub Address 0x0B “PGA2 Control Register (R/W)”
PGA2 のゲインを設定します。
PGA2 は、C 信号処理用です。
Sub Address: 0x0B
Default Value: 0x3C
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
PGA2_7
PGA2_6
PGA2_5
PGA2_4
PGA2_3
PGA2_2
PGA2_1
PGA2_0
0
1
1
1
1
0
0
Default Value
0
PGA2 Control Register Definition
Register
Bit
Name
bit 0 PGA2_0
~
~
PGA2 Gain Set
bit 7 PGA2_7
R/W
Definition
R/W
PGA2 のゲインを設定します。
PGA ゲインは下記の演算式に従って変化します。
PGA ゲイン演算式：
⎛ (2.5 × PGA) + 251.5 ⎞
⎟
401.5
⎝
⎠
ゲイン(dB) = 20 LOG⎜
*PGA：PGA1 及び PGA2 レジスタ設定値(Dec.)
初期設定値は、0x3C(HEX.)=0.00dB です。
MS1178-J-00
AKM Confidential
- 57 -
2010/03
[AK8859VQ]
[9.1.13.] Sub Address 0x0C “AGC and Color Control Register (R/W)”
AGC 及び色調整に関する設定を行うレジスタです。
Sub Address: 0x0C
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
CKILLDIS
CONTSEL
ACC
SHARP
AGCC1
AGCC0
Reserved
AGC
0
0
0
0
0
0
0
Default Value
0
AGC and Color Control Register Definition
Register
Bit
Name
R/W
Definition
bit 0
AGC
AGC Setting
R/W
AGC の ON/OFF を設定します。
[0]: AGC OFF
[1]: AGC ON
bit 1
Reserved
Reserved
R/W
Reserved
bit 2
~
bit 3
AGCC0
~
AGCC1
AGC Coring Control
R/W
bit 4
SHARP
SHARP
R/W
bit 5
ACC
ACC Setting
R/W
bit 6
CONTSEL
Contrast Select
R/W
bit 7
CKILLDISS
Color killer Disable
Set
R/W
MS1178-J-00
AGC の不感帯を設定します。
[ AGCC1 : AGCC0 ]
[00]: ±2LSB の不感帯を持ちます。
[01]: ±3LSB の不感帯を持ちます。
[10]: ±4LSB の不感帯を持ちます。
[11]: 不感帯はありません。
シャープネス調整を行います。
[0]: シャープネスフィルタなし
[1]: シャープネスフィルタあり
ACC の ON/OFF を設定します。
[0]: ACC OFF
[1]: ACC ON
コントラスト調整の基準値設定
[0]: 50%基準
[1]: 0%基準
カラーキラーの Enable/Disable を設定します。
[0]: Enable
[1]: Disable
AKM Confidential
- 58 -
2010/03
[AK8859VQ]
[9.1.14.] Sub Address 0x0D “Contrast Control Register (R/W)”
コントラストの調整をします。
Sub Address: 0x0D
Default Value: 0x40
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
CONT6
CONT5
CONT4
CONT3
CONT2
CONT1
CONT0
1
0
0
0
0
0
0
Default Value
0
Contrast Control Register Definition
Register
Bit
R/W
Name
Definition
コントラスト調整を行うレジスタです。
[CONTSEL-bit =[0]の時]
YOUT = (CONT / 64) x ( YIN − 128) +128
bit 0
~
bit 6
CONT0
~
CONT6
Contrast
Control
R/W
[CONTSEL-bit =[1]の時]
YOUT = (CONT / 64) X YIN
YOUT: コントラスト演算後の輝度信号
YIN: コントラスト演算前の輝度信号
CONT: コントラスト係数(レジスタ設定値)
{0~ (127 / 64)}の範囲を 1/64 ステップで設定できます。
初期値は、0x40 です。
bit 7
Reserved
MS1178-J-00
Reserved
R/W
Reserved
AKM Confidential
- 59 -
2010/03
[AK8859VQ]
[9.1.15.] Sub Address 0x0E “Brightness Control Register (R/W)”
ブライトネスの調整をします。
Sub Address: 0x0E
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
BR6
BR5
BR4
BR3
BR2
BR1
BR0
0
0
0
0
0
0
0
Default Value
0
Brightness Control Register Definition
Register
Bit
R/W
Name
Definition
ブライトネス調整を行うレジスタです。
YOUT = YIN + ( BR x 2 )
bit 0
~
bit 6
BR0
~
BR6
Brightness
Control
R/W
YOUT: ブライトネス演算後の輝度信号
YIN: ブライトネス演算前の輝度信号
BR: ブライトネス係数(レジスタ設定値)
{−128 ~ 126}の範囲を 2step 毎に設定できます。
なお、設定は 2 の補数です。
bit 7
Reserved
MS1178-J-00
Reserved
R/W
Reserved
AKM Confidential
- 60 -
2010/03
[AK8859VQ]
[9.1.16.] Sub Address 0x0F “Saturation Control Register (R/W)”
サチュレーション(彩度)の調整をします。
Sub Address: 0x0F
Default Value: 0x40
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
SAT6
SAT 5
SAT 4
SAT 3
SAT 2
SAT 1
SAT 0
1
0
0
0
0
0
0
Default Value
0
Saturation Control Register Definition
Register
Bit
R/W
Name
Definition
サチュレーション(彩度)調整を行うレジスタです。
COUT = (SAT / 64) X CIN
bit 0
~
bit 6
SAT0
~
SAT6
Saturation
Control
R/W
COUT: サチュレーション演算後の輝度信号
CIN: サチュレーション演算前の輝度信号
SAT: サチュレーション係数(レジスタ設定値)
{0~ (127 / 64)}の範囲を 1/64 ステップで設定できます。
初期値は、0x40 です。
bit 7
Reserved
Reserved
R/W
Reserved
[9.1.17.] Sub Address 0x10 “HUE Control Register (R/W)”
HUE（色相）の調整をします。
Sub Address: 0x10
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
HUE6
HUE 5
HUE 4
HUE 3
HUE 2
HUE 1
HUE 0
0
0
0
0
0
0
0
Default Value
0
HUE Control Register Definition
Register
Bit
Name
R/W
Definition
HUE（色相）調整を行うレジスタです。
bit 0
~
bit 6
HUE0
~
HUE 6
HUE
Control
R/W
±45°の範囲を、
1/128 ステップ(約 0.70°ステップ)で設定できます。
なお、設定は 2 の補数です。
bit 7
Reserved
Reserved
R/W
Reserved
MS1178-J-00
AKM Confidential
- 61 -
2010/03
[AK8859VQ]
[9.1.18.] Sub Address 0x11 “High Slice Data Set Register (R/W)”
VBI スライサでスライスされたデータの High 値を設定します。初期値は 100%ホワイト(235)です。
Sub Address: 0x11
Default Value: 0xEB
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
H7
H6
H5
H4
H3
H2
H1
H0
1
1
0
1
0
1
1
Default Value
1
High Slice Data Set Register Definition
Register
Bit
R/W
Name
bit 0
~
bit 7
H0
~
H7
High Data
Set
R/W
Definition
VBI スライサでスライスされたデータの High 値を設定するレジ
スタです。
0x00 及び 0xFF を設定する場合は、601 の特殊コードに相当しま
すのでご注意ください。
[9.1.19.] Sub Address 0x12 “Low Slice Data Set Register (R/W)”
VBI スライサでスライスされたデータの Low 値を設定します。初期値はペデスタルレベル(16)です。
Sub Address: 0x12
Default Value: 0x10
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
L7
L6
L5
L4
L3
L2
L1
L0
0
0
1
0
0
0
0
Default Value
0
Low Slice Data Set Register Definition
Register
Bit
R/W
Name
bit 0
~
bit 7
L0
~
L7
MS1178-J-00
Low Data
Set
R/W
Definition
VBI スライサでスライスされたデータの Low 値を設定するレジス
タです。
0x00 及び 0xFF を設定する場合は、601 の特殊コードに相当しま
すのでご注意ください。
AKM Confidential
- 62 -
2010/03
[AK8859VQ]
[9.1.20.] Sub Address 0x13 “Request VBI Information Register (R/W)”
VBI 期間情報のデコード要求設定をします。
Sub Address: 0x13
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
Reserved
Reserved
WSSRQ
VBIDRQ
EXTRQ
CCRQ
0
0
0
0
0
0
0
Default Value
0
Request VBI Information Register Definition
Register
Bit
R/W
Name
bit 0
CCRQ
Closed Caption
Decode Request
bit 1
EXTRQ
Extended Data
Decode Request
R/W
bit 2
VBIDRQ
VBID
Decode Request
R/W
bit 3
WSSRQ
WSS
Decode Request
R/W
bit 4
~
bit 7
Reserved
Reserved
R/W
R/W
Definition
クローズドキャプションのデコード要求をします。
[0]: デコード要求しません。
[1]: デコード要求します。
Extended Data のデコード要求をします。
[0]: デコード要求しません。
[1]: デコード要求します。
VBID Data のデコード要求をします。
[0]: デコード要求しません。
[1]: デコード要求します。
WSS Data のデコード要求をします。
[0]: デコード要求しません。
[1]: デコード要求します。
Reserved
[9.1.21.] Sub Address 0x14 “Reserved Register (R/W)”
Reserved レジスタです。
Sub Address: 0x14
Default Value: 0x00
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
0
0
0
0
0
0
0
Default Value
0
MS1178-J-00
AKM Confidential
- 63 -
2010/03
[AK8859VQ]
[9.1.22.] Sub Address 0x15 “Status 1 Register (R Only)”
内部状態を示します。
Sub Address: 0x15
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
OVCOL
PKWHITE
SCLKMD1
SCLKMD0
COLKILON
FRMSTD
VLOCK
NOSIG
Status 1 Register Definition
Register
Bit
Name
R/W
bit 0
NOSIG
No Signal
R
bit 1
VLOCK
Video Locked
R
bit 2
FRMSTD
Frame Standard
R
bit 3
COLKILON
Color Killer
R
bit 4
~
bit 5
SCLKMD0
~
SCLKMD1
Clock Mode
R
bit 6
PKWHITE
Peak White
Detection
R
bit 7
OVCOL
Over Color Level
R
MS1178-J-00
Definition
入力信号の有無を判断します。
[0]: 信号が入力されています。
[1]: 無信号入力状態です。
VLOCK 機構の状態を判断します。
[0]: 同期がとれています。
[1]: 同期がとれていません。
入力信号がインターレースであるかの判断をします。
[0]: 525/625 のインターレース信号です。
[1]: 525/625 のインターレース信号ではありません。
カラーキラー機能動作を示します。
[0]: カラーキラー機能は動作していません。
[1]: カラーキラー機能が動作しています。
クロックモードの状態を示します。
[ SCLKMD1 : SCLKMD0 ]
[00]: 固定クロックモードで動作。
[01]: ラインロッククロックモードで動作。
[10]: フレームロッククロックモードで動作。
[11]: Reserved
AGC 機能ブロック通過後の輝度デコード結果が、オーバ
ーフローしている場合に通知します。
[0]: 異常ありません。
[1]: 入力レベルがオーバーフローしています。
ACC 機能ブロック通過後の色デコード結果が、オーバー
フローしている場合に通知します。
[0]: 異常ありません。
[1]: 過大な色信号入力です。
AKM Confidential
- 64 -
2010/03
[AK8859VQ]
[9.1.23.] Sub Address 0x16 “Status 2 Register (R Only)”
内部状態を示します。
Sub Address: 0x16
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
AGCSTS
Reserved
WSSDET
VBIDDET
EXTDET
CCDET
Status 2 Register Definition
Register
Bit
Name
R/W
Definition
Closed Caption Data 1,2 Register にデコードしたデータが存
在することを示します。
[0]: Closed Caption Data がありません。
[1]: Closed Caption Data があります。
Extended Data 1,2 Register にデコードしたデータが存在す
ることを示します。
[0]: Extended Data がありません。
[1]: Extended Data があります。
VBID Data 1,2 Register にデコードしたデータが存在するこ
とを示します。
[0]: VBID Data がありません。
[1]: VBID Data があります。
WSS Data 1,2 Register にデコードしたデータが存在するこ
とを示します。
[0]: WSS Data がありません。
[1]: WSS Data があります。
bit 0
CCDET
Closed Caption
Detect
R
bit 1
EXTDET
Extended Data
Detect
R
bit 2
VBIDDET
VBID Data
Detect
R
bit 3
WSSDET
WSS Data
Detect
R
bit 4
Reserved
Reserved
R
Reserved
bit 5
AGCSTS
AGC Status
R
[0]: シンク AGC 動作
[1]: ピーク AGC 動作
bit 6
~
bit 7
Reserved
Reserved
R
Reserved
MS1178-J-00
AKM Confidential
- 65 -
2010/03
[AK8859VQ]
[9.1.24.] Sub Address 0x17 “Macrovision Status Register (R Only)”
入力されたマクロビジョン信号のタイプを示します。
Sub Address: 0x17
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
Reserved
Reserved
Reserved
CSTYPE
CSDET
AGCDET
Macrovision Status Register Definition
Bit
Register Name
bit 0
AGCDET
AGC Process
Detect
R
bit 1
CSDET
Color Stripe
Detect
R
bit 2
CSTYPE
Color Stripe
Type
R
bit 3
~
bit 7
Reserved
Reserved
R
MS1178-J-00
R/W
Definition
Macrovision AGC プロセスの検知
[0]: Macrovision AGC プロセスはありません。
[1]: Macrovision AGC プロセスを検知しました。
Macrovision Color Stripe プロセスの検知
[0]: Color Stripe プロセスはありません。
[1]: Color Stripe プロセスを検知しました。
Macrovision Color Stripe プロセスのタイプ
[0]: Color Stripe Type2
[1]: Color Stripe Type3
Reserved
AKM Confidential
- 66 -
2010/03
[AK8859VQ]
[9.1.25.] Sub Address 0x18 “Input Video Status Register (R Only)”
入力信号自動認識の結果を示すレジスタです。
Sub Address: 0x18
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
FIXED
UNDEF
ST_B/W
ST_VLF
ST_VCEN1
ST_VCEN0
ST_VSCF1
ST_VSCF0
Input Video Status Register Definition
Register
BIT
R/W Definition
Name
入力ビデオ信号のサブキャリア周波数を示します。
[ ST_VSCF1 : ST_VSCF0 ] ( MHz )
Status of
bit 0 ST_VSCF0
[00]: 3.57954545 (NTSC-M,J)
Video
R
~
~
Sub-Carrier
[01]: 3.57561149 (PAL-M)
bit 1 ST_VSCF1
[10]: 3.58205625 (PAL-Nc)
Frequency
[11]: 4.43361875 (PAL-B,D,G,H,I,N,60,NTSC-4.43,SECAM*)
入力信号のカラーエンコード方式を示します。
[ ST_VCEN1 : ST_VCEN0 ]
bit 2 ST_VCEN0 Status of
[00]: NTSC
~
~
Video
R
[01]: PAL
bit 3 ST_VCEN1 Color Encode
[10]: SECAM
[11]: Reserved
Status of
入力ビデオ信号のライン周波数を示します。
bit 4 ST_VLF
Video Line
R
[0]: 525 ライン(NTSC-M,J , NTSC-4.43 , PAL-M,60)
Frequency
[1]: 625 ライン(PAL-B,D,G,H,I,N,Nc , SECAM)
入力信号が白黒であるかの判断を示します。
Status of
R
bit 5 ST_BW
[0]: 白黒ではないと認識しています。
B/W Signal
[1]: 白黒信号であると認識しています。
入力信号の認識が行えていない状態を示します。
[0]: 判定中または、判定の結果、信号を認識・確定できた
bit 6 UNDEF
Un_define
R
ことを示します。
[1]: 判定の結果、信号を認識・確定できていません。
入力信号の判定状態を示します。
Input Video
[0]: 入力信号形式の判定中です。
R
bit 7 FIXED
Standard fixed
[1]: 入力信号形式を認識・確定できた為、判定を終了
しました。
*入力信号を SECAM と認識した場合、ST_VSCF[1:0]は、[11]となります。
MS1178-J-00
AKM Confidential
- 67 -
2010/03
[AK8859VQ]
[9.1.26.] Sub Address 0x19 “Closed Caption 1 Register (R Only)”
Closed Caption データを格納するレジスタです。
Sub Address: 0x19
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
CC7
CC6
CC5
CC4
CC3
CC2
CC1
CC0
[9.1.27.] Sub Address 0x1A “Closed Caption 2 Register (R Only)”
Closed Caption データを格納するレジスタです。
Sub Address: 0x1A
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
Bit 1
bit 0
CC15
CC14
CC13
CC12
CC11
CC10
CC9
CC8
[9.1.28.] Sub Address 0x1B “WSS 1 Register (R Only)”
WSS データを格納するレジスタです。
Sub Address: 0x1B
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
WSS2-7
WSS2-6
WSS2-5
WSS2-4
WSS1-3
WSS1-2
WSS1-1
WSS1-0
[9.1.29.] Sub Address 0x1C “WSS 2 Register (R Only)”
WSS データを格納するレジスタです。
Sub Address: 0x1C
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
WSS4-13
WSS4-12
WSS4-11
WSS3-10
WSS3-9
WSS3-8
[9.1.30.] Sub Address 0x1D “Extended Data 1 Register (R Only)”
Closed Caption Extended データを格納するレジスタです。
Sub Address: 0x1D
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
EXT7
EXT6
EXT5
EXT4
EXT3
EXT2
EXT1
EXT0
[9.1.31.] Sub Address 0x1E “Extended Data 2 Register (R Only)”
Closed Caption Extended データを格納するレジスタです。
Sub Address: 0x1E
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
EXT15
EXT14
EXT13
EXT12
EXT11
EXT10
EXT9
EXT8
[9.1.32.] Sub Address 0x1F “VBID 1 Register (R Only)”
VBID データを格納するレジスタです。
Sub Address: 0x1F
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
Reserved
Reserved
VBID1
VBID2
VBID3
VBID4
VBID5
VBID6
[9.1.33.] Sub Address 0x20 “VBID 2 Register (R Only)”
VBID データを格納するレジスタです。
Sub Address: 0x20
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
VBID7
VBID8
VBID9
VBID10
VBID11
VBID12
VBID13
VBID14
MS1178-J-00
AKM Confidential
- 68 -
2010/03
[AK8859VQ]
[9.1.34.] Sub Address 0x21 “Device and Revision ID Register (R Only)”
Device ID 及び Revision 情報を示します。
Device ID は、0x3B です。
Revision ID の初版は 0x00 です。
Revision はコントロールソフトウェアの変更を必要とするような場合にのみ変更されます。
bit 7
bit 6
REV1
REV0
Default Value
0
0
bit 5
DID5
bit 4
DID4
bit 3
DID3
bit 2
DID2
Sub Address: 0x21
bit 1
bit 0
DID1
DID0
1
1
1
0
1
1
Device and Revision ID Register Definition
Bit
Register Name
bit 0
~
bit 5
bit 6
~
bit 7
DID0
~
DID5
REV0
~
REV1
MS1178-J-00
R/W
Definition
Device ID
R
Device ID を示します。
Device ID は 0x3B です。
Revision ID
R
Revision 情報を示します。
初版は 0x00 です。
AKM Confidential
- 69 -
2010/03
[AK8859VQ]
[10.] システム接続例
PVDD
pull
up
Micro Processor
2
(I C Controller)
SELA
SDA SCL
PDN
DATA[7:0]
Video IN
47Ω
0.033uF
VAR
AIN1
VARSUB
30Ω
Video IN
47Ω
VD_F
HD
DTCLK
0.033uF
AIN2
TEST
30Ω
XTI
IREF
VRP
VCOM
VRN
22pF
24.576
MHz
AK8859VQ
XTO
22pF
0.1uF 0.1uF 0.1uF
6.8kΩ
PVDD
PVDD
0.1uF
10uF
DVSS
DVDD
AVDD
DVDD
AVDD
0.1uF
0.1uF
10uF
DVSS
AVSS
Analog GND
MS1178-J-00
10uF
Digital GND
AKM Confidential
- 70 -
2010/03
[AK8859VQ]
[11.] パッケージ図
48 ピン LQFP パッケージ
9.00±0.20
7.00
25
37
24
48
13
7.00
9.00±0.20
36
12
1
0.50
0.10
0゜～ 10゜
M
0.50±0.20
0.10
MS1178-J-00
AKM Confidential
- 71 -
S
1.60MAX
1.4TYP
1.00
S
0.10±0.07
0.17±0.05
0.19±0.05
2010/03
[AK8859VQ]
[12.] マーキング図
AKM
AK8859VQ
XXXXXXX
1
AKM: AKM Logo
AK8859VQ: Marketing Code
XXXXXXX (7 digits): Date Code
MS1178-J-00
AKM Confidential
- 72 -
2010/03
[AK8859VQ]
重要な注意事項
●本書に記載された製品、および、製品の仕様につきましては、製品改善のために予告なく変更すること
があります。従いまして、ご使用を検討の際には、本書に掲載した情報が最新のものであることを弊社
営業担当、あるいは弊社特約店営業担当にご確認下さい。
●本書に掲載された情報・図面の使用に起因した第三者の所有する特許権、工業所有権、その他の権利に
対する侵害につきましては、当社はその責任を負うものではありませんので、ご了承下さい。
●本書記載製品が、外国為替および、外国貿易管理法に定める戦略物資（役務を含む）に該当する場合、
輸出する際に同法に基づく輸出許可が必要です。
●医療機器、安全装置、航空宇宙用機器、原子力制御用機器など、その装置・機器の故障や動作不良が、
直接または間接を問わず、生命、身体、財産等へ重大な損害を及ぼすことが通常予想されるような極め
て高い信頼性を要求される用途に弊社製品を使用される場合は、必ず事前に弊社代表取締役の書面によ
る同意をお取り下さい。
●この同意書を得ずにこうした用途に弊社製品を使用された場合、弊社は、その使用から生ずる損害等の
責任を一切負うものではありませんのでご了承下さい。
●お客様の転売等によりこの注意事項の存在を知らずに上記用途に弊社製品が使用され、その使用から損
害等が生じた場合は全てお客様にてご負担または補償して頂きますのでご了承下さい。
MS1178-J-00
AKM Confidential
- 73 -
2010/03