Pin-Outs

Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO1A
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VCCIO1A
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VREF
VREF1A
VREF1A
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VREF1B
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VREF1C
Pin Name/Function
NC
TDI
TMS
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TCK
TDO
VCCA_PLL_L1
VCCD_PLL_L1
PLL_L1_CLKn
PLL_L1_CLKp
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
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IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel
DIFFIO_TX_L1n
DIFFIO_TX_L1p
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F1517
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G34
F34
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C39
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K32
G35
H34
J35
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E37
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K35
K34
D38
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L33
F36
G36
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M33
D39
E39
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F39
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G38
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L37
L36
J39
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K38
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N33
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P30
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R29
N39
N38
R31
T31
N37
N36
T30
T29
P34
P33
T28
U28
N35
N34
R36
R35
T36
T35
T33
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P37
P36
R34
T34
R38
R37
F1152
D32
G28
H28
J28
F30
G29
H780
E25
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D26
C26
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G31
G30
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E31
J30
J29
F32
F31
K28
K27
C34
C33
N25
M24
H32
H31
M27
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D33
K30
K29
J32
J31
L29
L28
E34
F33
M28
N27
F34
G33
N26
P25
K32
K31
L32
L31
G34
H34
N24
P23
J34
J33
M30
M29
K34
K33
F26
F25
C28
D27
G26
G25
B28
C27
H25
J24
D28
E28
J23
J22
F28
F27
K21
K20
G28
G27
K26
K25
J26
J25
K24
K23
H28
J27
L23
L22
J28
K27
N30
N29
N32
M31
P29
P28
L34
M33
R26
R25
P32
N31
DQS for X8/X9 for
F1517
DQS for X16/X18 for
F1517 (Note 1)
DQ1L
DQ1L
DQSn1L
DQS1L
DQ1L
DQ1L
DQSn2L
DQS2L
DQ2L
DQ2L
DQ2L
DQ2L
DQ3L
DQ3L
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DQS3L
DQ3L
DQ3L
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DQS4L
DQ4L
DQ4L
DQ4L
DQ4L
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DQ5L
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DQ5L
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DQ7L
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DQ1L
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DQ2L
DQ2L
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DQ2L
DQ2L
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DQ2L
DQ2L
DQ2L
DQ2L
DQ3L
DQ3L
DQ3L
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DQ3L
DQ3L
DQSn3L/DQ3L
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DQ3L
DQ3L
DQ3L
DQ3L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L/CQn1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
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DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
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DQ8L
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DQ8L
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DQS9L
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DQ9L
DQ9L
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DQ10L
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DQ10L
DQ10L
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DQ11L
DQ11L
DQ11L
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DQ12L
DQSn12L
DQS12L
DQ12L
DQ12L
DQSn13L
DQS13L
DQ13L
DQ13L
DQ13L
DQ13L
DQ8L
DQ8L
DQ8L
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DQ8L
DQ8L
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DQ8L
DQ8L
DQ8L
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DQ9L
DQ9L
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DQ9L
DQ9L
DQ9L
DQ9L
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DQ12L
DQ12L
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DQ12L
DQ12L
DQSn12L/DQ12L
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DQ12L
DQ12L
DQ12L
DQ12L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L/CQn8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQSn8L/DQ8L
DQS8L/CQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ8L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L/CQn12L
DQ12L
DQ12L
DQ12L
DQ12L
DQS for X4 for F1517
Pin List
DQS for X32/X36 for
F1517 (Note 1)
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
DQ1L
DQ1L
DQSn1L
DQS1L
DQ1L
DQ1L
DQSn2L
DQS2L
DQ2L
DQ2L
DQ2L
DQ2L
DQ3L
DQ3L
DQSn3L
DQS3L
DQ3L
DQ3L
DQSn4L
DQS4L
DQ4L
DQ4L
DQ4L
DQ4L
DQ5L
DQ5L
DQSn5L
DQS5L
DQ5L
DQ5L
DQSn6L
DQS6L
DQ6L
DQ6L
DQ6L
DQ6L
DQ7L
DQ7L
DQSn7L
DQS7L
DQ7L
DQ7L
DQ1L
DQ1L
DQ1L
DQ1L/CQn1L
DQ1L
DQ1L
DQSn1L/DQ1L
DQS1L/CQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ2L
DQ2L
DQ2L
DQ2L/CQn2L
DQ2L
DQ2L
DQSn2L/DQ2L
DQS2L/CQ2L
DQ2L
DQ2L
DQ2L
DQ2L
DQ3L
DQ3L
DQ3L
DQ3L/CQn3L
DQ3L
DQ3L
DQSn3L/DQ3L
DQS3L/CQ3L
DQ3L
DQ3L
DQ3L
DQ3L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L/CQn1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQSn1L/DQ1L
DQS1L/CQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQSn1L
DQS1L
DQ1L
DQ1L
DQSn2L
DQS2L
DQ2L
DQ2L
DQ2L
DQ2L
DQ3L
DQ3L
DQSn3L
DQS3L
DQ3L
DQ3L
DQSn4L
DQS4L
DQ4L
DQ4L
DQ4L
DQ4L
DQ1L
DQ1L
DQ1L
DQ1L/CQn1L
DQ1L
DQ1L
DQSn1L/DQ1L
DQS1L/CQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ2L
DQ2L
DQ2L
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DQ2L
DQ2L
DQSn2L/DQ2L
DQS2L/CQ2L
DQ2L
DQ2L
DQ2L
DQ2L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L/CQn1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQSn1L/DQ1L
DQS1L/CQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ1L
DQ12L
DQ12L
DQSn12L
DQS12L
DQ12L
DQ12L
DQSn13L
DQS13L
DQ13L
DQ13L
DQ13L
DQ13L
DQ12L
DQ12L
DQ12L
DQ12L/CQn12L
DQ12L
DQ12L
DQSn12L/DQ12L
DQS12L/CQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L/CQn12L
DQ12L
DQ12L
DQ12L
DQ12L
DQS for X4 for F1152
Page 1 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VCCIO1C
VREF
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
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VREF1C
VREF1C
VREF1C
VREF1C
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VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
VREF1C
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VCCIO2C
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VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2C
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
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VREF2C
VREF2C
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VREF2C
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VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2C
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
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VREF2B
VREF2B
Pin Name/Function
IO
IO
IO
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IO
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IO
IO
IO
IO
IO
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IO
IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
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IO
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IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
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Function
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DATA2
DATA3
DATA4
DATA5
DATA6
DATA7
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CRC_ERROR
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F1517
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U33
U37
U36
W29
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U39
V39
V31
W30
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W33
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V35
W35
W34
W37
W36
W39
W38
W32
W31
AA31
AA32
AA38
AA39
Y36
Y37
AA34
AA35
AA36
AA37
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AG39
AE31
AD31
AE34
AE35
AD29
AD30
AF36
AF37
AC27
AB28
AH38
AH39
AD28
AC28
AG36
AH37
F1152
R24
T23
M34
N33
R28
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R32
P31
R30
R29
N34
P34
T28
T27
R34
R33
T25
T24
T32
R31
T26
U25
U32
U31
T30
T29
V32
V31
T34
T33
U28
U26
V26
V28
V33
V34
W33
W34
W28
V29
AA33
Y34
W26
W27
Y31
Y32
V24
V25
AB33
AA34
W30
W31
AA31
AA32
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AB34
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W24
AB31
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AD33
AD34
Y25
Y26
AC31
AC32
AA27
AA28
AE33
AE34
AB29
AB30
H780
M23
M22
L26
L25
M21
M20
K28
L28
N21
N20
M26
M25
N25
M24
M28
M27
N23
P23
P25
N24
P20
P19
N27
N26
N28
P28
R22
P22
R27
R28
U28
T28
R20
R21
R26
T27
T25
R25
V27
V28
T20
T21
V26
U26
T24
U25
W27
W28
T22
T23
V24
V25
V23
U23
DQS for X4 for F1517
DQ14L
DQ14L
DQSn14L
DQS14L
DQ14L
DQ14L
DQSn15L
DQS15L
DQ15L
DQ15L
DQ15L
DQ15L
DQ16L
DQ16L
DQSn16L
DQS16L
DQ16L
DQ16L
DQSn17L
DQS17L
DQ17L
DQ17L
DQ17L
DQ17L
DQS for X8/X9 for
F1517
DQ13L
DQ13L
DQ13L
DQ13L/CQn13L
DQ13L
DQ13L
DQSn13L/DQ13L
DQS13L/CQ13L
DQ13L
DQ13L
DQ13L
DQ13L
DQ14L
DQ14L
DQ14L
DQ14L/CQn14L
DQ14L
DQ14L
DQSn14L/DQ14L
DQS14L/CQ14L
DQ14L
DQ14L
DQ14L
DQ14L
DQ18L
DQ18L
DQ18L
DQ18L
DQS18L
DQSn18L
DQ19L
DQ19L
DQS19L
DQSn19L
DQ19L
DQ19L
DQ20L
DQ20L
DQ20L
DQ20L
DQS20L
DQSn20L
DQ21L
DQ21L
DQS21L
DQSn21L
DQ21L
DQ21L
DQ22L
DQ22L
DQ22L
DQ22L
DQS22L
DQSn22L
DQ23L
DQ23L
DQS23L
DQSn23L
DQ23L
DQ23L
DQ24L
DQ24L
DQ24L
DQ24L
DQS24L
DQSn24L
DQ25L
DQ25L
DQS25L
DQSn25L
DQ25L
DQ25L
DQ26L
DQ26L
DQ26L
DQ26L
DQS26L
DQSn26L
DQ21L
DQ21L
DQ21L
DQ21L
DQS21L/CQ21L
DQSn21L/DQ21L
DQ21L
DQ21L
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DQ21L
DQ21L
DQ21L
DQ22L
DQ22L
DQ22L
DQ22L
DQS22L/CQ22L
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DQ22L
DQ22L
DQ22L/CQn22L
DQ22L
DQ22L
DQ22L
DQ23L
DQ23L
DQ23L
DQ23L
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DQ23L
DQ23L
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DQ23L
DQ23L
DQ23L
DQ26L
DQ26L
DQ26L
DQ26L
DQS26L/CQ26L
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DQ26L
DQ26L
DQ26L/CQn26L
DQ26L
DQ26L
DQ26L
DQ27L
DQ27L
DQ27L
DQ27L
DQS27L/CQ27L
DQSn27L/DQ27L
Pin List
DQS for X16/X18 for
F1517 (Note 1)
DQ12L
DQ12L
DQSn12L/DQ12L
DQS12L/CQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQS23L/CQ23L
DQSn23L/DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L/CQn23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQS27L/CQ27L
DQSn27L/DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L/CQn27L
DQ27L
DQS for X32/X36 for
F1517 (Note 1)
DQS for X4 for F1152
DQ14L
DQ14L
DQSn14L
DQS14L
DQ14L
DQ14L
DQSn15L
DQS15L
DQ15L
DQ15L
DQ15L
DQ15L
DQ16L
DQ16L
DQSn16L
DQS16L
DQ16L
DQ16L
DQSn17L
DQS17L
DQ17L
DQ17L
DQ17L
DQ17L
DQS for X8/X9 for
F1152 (Note 1)
DQ13L
DQ13L
DQ13L
DQ13L/CQn13L
DQ13L
DQ13L
DQSn13L/DQ13L
DQS13L/CQ13L
DQ13L
DQ13L
DQ13L
DQ13L
DQ14L
DQ14L
DQ14L
DQ14L/CQn14L
DQ14L
DQ14L
DQSn14L/DQ14L
DQS14L/CQ14L
DQ14L
DQ14L
DQ14L
DQ14L
DQ18L
DQ18L
DQ18L
DQ18L
DQS18L
DQSn18L
DQ19L
DQ19L
DQS19L
DQSn19L
DQ19L
DQ19L
DQ20L
DQ20L
DQ20L
DQ20L
DQS20L
DQSn20L
DQ21L
DQ21L
DQS21L
DQSn21L
DQ21L
DQ21L
DQ22L
DQ22L
DQ22L
DQ22L
DQS22L
DQSn22L
DQ23L
DQ23L
DQS23L
DQSn23L
DQ23L
DQ23L
DQ21L
DQ21L
DQ21L
DQ21L
DQS21L/CQ21L
DQSn21L/DQ21L
DQ21L
DQ21L
DQ21L/CQn21L
DQ21L
DQ21L
DQ21L
DQ22L
DQ22L
DQ22L
DQ22L
DQS22L/CQ22L
DQSn22L/DQ22L
DQ22L
DQ22L
DQ22L/CQn22L
DQ22L
DQ22L
DQ22L
DQ23L
DQ23L
DQ23L
DQ23L
DQS23L/CQ23L
DQSn23L/DQ23L
DQ23L
DQ23L
DQ23L/CQn23L
DQ23L
DQ23L
DQ23L
DQS for X16/X18 for
F1152 (Note 1)
DQ12L
DQ12L
DQSn12L/DQ12L
DQS12L/CQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ12L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQS23L/CQ23L
DQSn23L/DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L/CQn23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQ23L
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQSn15L
DQS15L
DQ15L
DQ15L
DQ15L
DQ15L
DQ16L
DQ16L
DQSn16L
DQS16L
DQ16L
DQ16L
DQSn17L
DQS17L
DQ17L
DQ17L
DQ17L
DQ17L
DQ15L
DQ15L
DQ15L
DQ15L/CQn15L
DQ15L
DQ15L
DQSn15L/DQ15L
DQS15L/CQ15L
DQ15L
DQ15L
DQ15L
DQ15L
DQ18L
DQ18L
DQ18L
DQ18L
DQS18L
DQSn18L
DQ19L
DQ19L
DQS19L
DQSn19L
DQ19L
DQ19L
DQ20L
DQ20L
DQ20L
DQ20L
DQS20L
DQSn20L
DQS for X16/X18 for
H780 (Note 1)
DQ20L
DQ20L
DQ20L
DQ20L
DQS20L/CQ20L
DQSn20L/DQ20L
DQ20L
DQ20L
DQ20L/CQn20L
DQ20L
DQ20L
DQ20L
Page 2 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2B
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
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VCCIO2A
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VCCIO2A
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VCCIO2A
VCCIO2A
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VCCIO2A
VCCIO2A
VCCIO2A
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VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
VCCIO2A
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VCCIO2A
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VCCIO2A
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VCCIO3A
VCCIO3A
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VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
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VCCIO3A
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VCCIO3A
VCCIO3A
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VCCIO3A
VCCIO3A
VREF
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2B
VREF2A
VREF2A
VREF2A
VREF2A
VREF2A
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VREF2A
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VREF2A
VREF2A
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VREF2A
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VREF2A
VREF2A
VREF2A
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VREF2A
VREF2A
VREF2A
VREF2A
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VREF2A
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VREF2A
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VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
VREF3A
Pin Name/Function
IO
IO
IO
IO
IO
IO
IO
IO
IO
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IO
IO
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IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
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PLL_L4_CLKn
VCCD_PLL_L4
VCCA_PLL_L4
nCONFIG
nSTATUS
CONF_DONE
PORSEL
nCE
NC
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
RUP2A
RDN2A
PLL_L4_FB_CLKOUT0p
PLL_L4_CLKOUT0n
PLL_L4_CLKp
PLL_L4_CLKn
Dedicated Tx/Rx
Channel
DIFFIO_TX_L43p
DIFFIO_TX_L43n
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DIFFIO_TX_L44p
DIFFIO_TX_L44n
DIFFIO_RX_L45p
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DIFFIO_TX_L53n
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DIFFIO_RX_L55p
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DIFFIO_TX_L56p
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Emulated LVDS
Output Channel
DIFFOUT_L86p
DIFFOUT_L86n
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DIFFOUT_L87n
DIFFOUT_L88p
DIFFOUT_L88n
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DIFFOUT_L89n
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DIFFOUT_L90n
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DIFFOUT_L92n
DIFFOUT_L93p
DIFFOUT_L93n
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DIFFOUT_L94n
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DIFFOUT_L95n
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DIFFOUT_L96n
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DIFFOUT_L102n
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DIFFOUT_L103n
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DIFFOUT_L104n
DIFFOUT_L105p
DIFFOUT_L105n
DIFFOUT_L106p
DIFFOUT_L106n
DIFFOUT_L107p
DIFFOUT_L107n
DIFFOUT_L108p
DIFFOUT_L108n
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DIFFOUT_L109n
DIFFOUT_L110p
DIFFOUT_L110n
DIFFOUT_L111p
DIFFOUT_L111n
DIFFOUT_L112p
DIFFOUT_L112n
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nSTATUS
CONF_DONE
PORSEL
nCE
RDN3A
RUP3A
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DIFFIO_RX_B1p
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DIFFIO_RX_B2p
DIFFIO_RX_B3n
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DIFFOUT_B1p
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DIFFOUT_B8p
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DIFFOUT_B10p
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DIFFOUT_B11p
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DIFFOUT_B12p
DIFFOUT_B13n
DIFFOUT_B13p
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DIFFOUT_B14p
DIFFOUT_B15n
DIFFOUT_B15p
F1517
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AE30
AF34
AG35
AE32
AF33
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AE27
AE28
AJ36
AJ37
AH35
AH36
AL38
AL39
AH33
AG34
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AM39
AG32
AG33
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AP38
AN38
AF28
AG29
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AL35
AL36
AH31
AH32
AN36
AN37
AK35
AK36
AR39
AP39
AK33
AK34
AT38
AT39
AJ33
AJ34
AP36
AR37
AL33
AL34
AU38
AU39
AK31
AK32
AG28
AN35
AT37
AM34
AH29
AM33
AM30
AM31
AN30
AN29
AN31
AL31
AP33
AN33
AP32
AN32
AR33
AP34
AL29
AL28
AK30
AK29
AK28
AJ28
AT36
AR36
AR34
AT34
AU35
AT35
AW37
AV36
AV37
AU37
AW36
AW38
F1152
H780
AG33
AF34
AA24
AA25
AE31
AE32
AC28
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AG34
AD30
AD31
AF31
AF32
AB24
AB25
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AH34
AB26
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AG31
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AE29
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AK33
AK34
AD28
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AJ31
AJ32
AF28
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AM34
AL34
AE27
AE28
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AH31
AD26
AD27
AL32
AL33
AC25
AC26
AK31
AK32
AG29
AG30
AA27
Y28
W22
W23
AB27
AA28
W24
W25
Y25
Y26
V20
V21
AC28
AB28
AA25
AA26
AB25
AB26
AC25
AC26
AD27
AD28
W20
W21
AG28
AF28
Y23
AA24
AE27
AE28
AA23
AB24
AE25
AH28
AH29
AF26
AE26
AL31
AH27
AJ27
AK28
AJ28
AJ29
AJ26
AM32
AM31
AL29
AM29
AN30
AM30
AH26
AF24
AH24
AG24
AH25
AF23
AP33
AN33
AP32
AP30
AP31
AN31
AK27
AL28
AL27
AL26
AK25
AM26
W19
AD25
AE26
AB23
Y20
AB22
AF26
AH27
AH25
AG25
AG27
AH26
AE22
AD22
AB20
AB21
AD21
AC21
AD24
AE23
AF24
AE24
AF23
AG24
AH24
AH23
AH20
AH21
AH22
AG22
AC20
AG21
AF21
AE21
AF20
AE20
DQS for X4 for F1517
DQ27L
DQ27L
DQS27L
DQSn27L
DQ27L
DQ27L
DQS for X8/X9 for
F1517
DQ27L
DQ27L
DQ27L/CQn27L
DQ27L
DQ27L
DQ27L
DQS for X16/X18 for
F1517 (Note 1)
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ27L
DQ28L
DQ28L
DQS28L
DQSn28L
DQ28L
DQ28L
DQ29L
DQ29L
DQ29L
DQ29L
DQS29L
DQSn29L
DQ30L
DQ30L
DQS30L
DQSn30L
DQ30L
DQ30L
DQ31L
DQ31L
DQ31L
DQ31L
DQS31L
DQSn31L
DQ32L
DQ32L
DQS32L
DQSn32L
DQ32L
DQ32L
DQ33L
DQ33L
DQ33L
DQ33L
DQS33L
DQSn33L
DQ34L
DQ34L
DQS34L
DQSn34L
DQ34L
DQ34L
DQ32L
DQ32L
DQ32L
DQ32L
DQS32L/CQ32L
DQSn32L/DQ32L
DQ32L
DQ32L
DQ32L/CQn32L
DQ32L
DQ32L
DQ32L
DQ33L
DQ33L
DQ33L
DQ33L
DQS33L/CQ33L
DQSn33L/DQ33L
DQ33L
DQ33L
DQ33L/CQn33L
DQ33L
DQ33L
DQ33L
DQ34L
DQ34L
DQ34L
DQ34L
DQS34L/CQ34L
DQSn34L/DQ34L
DQ34L
DQ34L
DQ34L/CQn34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQS34L/CQ34L
DQSn34L/DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L/CQn34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ1B
DQ1B
DQSn1B
DQS1B
DQ1B
DQ1B
DQSn2B
DQS2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ3B
DQ3B
DQSn3B
DQS3B
DQ3B
DQ3B
DQSn4B
DQS4B
DQ4B
DQ4B
DQ4B
DQ4B
DQ5B
DQ5B
DQSn5B
DQS5B
DQ5B
DQ5B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ2B
DQ2B
DQ2B
DQ2B/CQn2B
DQ2B
DQ2B
DQSn2B/DQ2B
DQS2B/CQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ3B
DQ3B
DQ3B
DQ3B/CQn3B
DQ3B
DQ3B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
Pin List
DQS for X32/X36 for
F1517 (Note 1)
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
DQ28L
DQ28L
DQS28L
DQSn28L
DQ28L
DQ28L
DQ29L
DQ29L
DQ29L
DQ29L
DQS29L
DQSn29L
DQ30L
DQ30L
DQS30L
DQSn30L
DQ30L
DQ30L
DQ31L
DQ31L
DQ31L
DQ31L
DQS31L
DQSn31L
DQ32L
DQ32L
DQS32L
DQSn32L
DQ32L
DQ32L
DQ33L
DQ33L
DQ33L
DQ33L
DQS33L
DQSn33L
DQ34L
DQ34L
DQS34L
DQSn34L
DQ34L
DQ34L
DQ32L
DQ32L
DQ32L
DQ32L
DQS32L/CQ32L
DQSn32L/DQ32L
DQ32L
DQ32L
DQ32L/CQn32L
DQ32L
DQ32L
DQ32L
DQ33L
DQ33L
DQ33L
DQ33L
DQS33L/CQ33L
DQSn33L/DQ33L
DQ33L
DQ33L
DQ33L/CQn33L
DQ33L
DQ33L
DQ33L
DQ34L
DQ34L
DQ34L
DQ34L
DQS34L/CQ34L
DQSn34L/DQ34L
DQ34L
DQ34L
DQ34L/CQn34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQS34L/CQ34L
DQSn34L/DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L/CQn34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ31L
DQ31L
DQ31L
DQ31L
DQS31L
DQSn31L
DQ32L
DQ32L
DQS32L
DQSn32L
DQ32L
DQ32L
DQ33L
DQ33L
DQ33L
DQ33L
DQS33L
DQSn33L
DQ34L
DQ34L
DQS34L
DQSn34L
DQ34L
DQ34L
DQ33L
DQ33L
DQ33L
DQ33L
DQS33L/CQ33L
DQSn33L/DQ33L
DQ33L
DQ33L
DQ33L/CQn33L
DQ33L
DQ33L
DQ33L
DQ34L
DQ34L
DQ34L
DQ34L
DQS34L/CQ34L
DQSn34L/DQ34L
DQ34L
DQ34L
DQ34L/CQn34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQS34L/CQ34L
DQSn34L/DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L/CQn34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ34L
DQ1B
DQ1B
DQSn1B
DQS1B
DQ1B
DQ1B
DQSn2B
DQS2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ3B
DQ3B
DQSn3B
DQS3B
DQ3B
DQ3B
DQSn4B
DQS4B
DQ4B
DQ4B
DQ4B
DQ4B
DQ5B
DQ5B
DQSn5B
DQS5B
DQ5B
DQ5B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ2B
DQ2B
DQ2B
DQ2B/CQn2B
DQ2B
DQ2B
DQSn2B/DQ2B
DQS2B/CQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ3B
DQ3B
DQ3B
DQ3B/CQn3B
DQ3B
DQ3B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQSn1B
DQS1B
DQ1B
DQ1B
DQSn2B
DQS2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ3B
DQ3B
DQSn3B
DQS3B
DQ3B
DQ3B
DQSn4B
DQS4B
DQ4B
DQ4B
DQ4B
DQ4B
DQ5B
DQ5B
DQSn5B
DQS5B
DQ5B
DQ5B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ2B
DQ2B
DQ2B
DQ2B/CQn2B
DQ2B
DQ2B
DQSn2B/DQ2B
DQS2B/CQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ3B
DQ3B
DQ3B
DQ3B/CQn3B
DQ3B
DQ3B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B/CQn1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQSn1B/DQ1B
DQS1B/CQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
Page 3 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
VCCIO3A
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VCCIO3B
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VREF
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VREF3A
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VREF3C
VREF3C
Pin Name/Function
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
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IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
Dedicated Tx/Rx
Channel
DIFFIO_RX_B8n
DIFFIO_RX_B8p
DIFFIO_RX_B9n
DIFFIO_RX_B9p
DIFFIO_RX_B10n
DIFFIO_RX_B10p
DIFFIO_RX_B11n
DIFFIO_RX_B11p
DIFFIO_RX_B12n
DIFFIO_RX_B12p
DIFFIO_RX_B13n
DIFFIO_RX_B13p
DIFFIO_RX_B14n
DIFFIO_RX_B14p
DIFFIO_RX_B15n
DIFFIO_RX_B15p
DIFFIO_RX_B16n
DIFFIO_RX_B16p
DIFFIO_RX_B17n
DIFFIO_RX_B17p
DIFFIO_RX_B18n
DIFFIO_RX_B18p
DIFFIO_RX_B19n
DIFFIO_RX_B19p
DIFFIO_RX_B20n
DIFFIO_RX_B20p
DIFFIO_RX_B21n
DIFFIO_RX_B21p
DIFFIO_RX_B22n
DIFFIO_RX_B22p
DIFFIO_RX_B23n
DIFFIO_RX_B23p
DIFFIO_RX_B24n
DIFFIO_RX_B24p
RDN3C
RUP3C
DIFFIO_RX_B25n
DIFFIO_RX_B25p
DIFFIO_RX_B26n
DIFFIO_RX_B26p
DIFFIO_RX_B27n
DIFFIO_RX_B27p
DIFFIO_RX_B28n
DIFFIO_RX_B28p
DIFFIO_RX_B29n
DIFFIO_RX_B29p
PLL_B1_CLKOUT4
PLL_B1_CLKOUT3
DIFFIO_RX_B30n
DIFFIO_RX_B30p
PLL_B1_CLKOUT0n
PLL_B1_CLKOUT0p
PLL_B1_FBn/CLKOUT2
PLL_B1_FBp/CLKOUT1
DIFFIO_RX_B31n
DIFFIO_RX_B31p
Emulated LVDS
Output Channel
DIFFOUT_B16n
DIFFOUT_B16p
DIFFOUT_B17n
DIFFOUT_B17p
DIFFOUT_B18n
DIFFOUT_B18p
DIFFOUT_B19n
DIFFOUT_B19p
DIFFOUT_B20n
DIFFOUT_B20p
DIFFOUT_B21n
DIFFOUT_B21p
DIFFOUT_B22n
DIFFOUT_B22p
DIFFOUT_B23n
DIFFOUT_B23p
DIFFOUT_B24n
DIFFOUT_B24p
DIFFOUT_B25n
DIFFOUT_B25p
DIFFOUT_B26n
DIFFOUT_B26p
DIFFOUT_B27n
DIFFOUT_B27p
DIFFOUT_B28n
DIFFOUT_B28p
DIFFOUT_B29n
DIFFOUT_B29p
DIFFOUT_B30n
DIFFOUT_B30p
DIFFOUT_B31n
DIFFOUT_B31p
DIFFOUT_B32n
DIFFOUT_B32p
DIFFOUT_B33n
DIFFOUT_B33p
DIFFOUT_B34n
DIFFOUT_B34p
DIFFOUT_B35n
DIFFOUT_B35p
DIFFOUT_B36n
DIFFOUT_B36p
DIFFOUT_B37n
DIFFOUT_B37p
DIFFOUT_B38n
DIFFOUT_B38p
DIFFOUT_B39n
DIFFOUT_B39p
DIFFOUT_B40n
DIFFOUT_B40p
DIFFOUT_B41n
DIFFOUT_B41p
DIFFOUT_B42n
DIFFOUT_B42p
DIFFOUT_B43n
DIFFOUT_B43p
DIFFOUT_B44n
DIFFOUT_B44p
DIFFOUT_B45n
DIFFOUT_B45p
DIFFOUT_B46n
DIFFOUT_B46p
DIFFOUT_B47n
DIFFOUT_B47p
DIFFOUT_B48n
DIFFOUT_B48p
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DIFFOUT_B49p
DIFFOUT_B50n
DIFFOUT_B50p
DIFFOUT_B51n
DIFFOUT_B51p
DIFFOUT_B52n
DIFFOUT_B52p
DIFFOUT_B53n
DIFFOUT_B53p
DIFFOUT_B54n
DIFFOUT_B54p
DIFFOUT_B55n
DIFFOUT_B55p
DIFFOUT_B56n
DIFFOUT_B56p
DIFFOUT_B57n
DIFFOUT_B57p
DIFFOUT_B58n
DIFFOUT_B58p
DIFFOUT_B59n
DIFFOUT_B59p
DIFFOUT_B60n
DIFFOUT_B60p
DIFFOUT_B61n
DIFFOUT_B61p
DIFFOUT_B62n
DIFFOUT_B62p
F1517
AU32
AT32
AR31
AT31
AU33
AT33
AK27
AJ27
AH27
AG27
AH26
AH25
AV34
AU34
AV33
AW33
AW35
AW34
AN28
AM28
AR27
AP27
AP29
AP28
AT28
AR28
AR30
AT30
AU29
AT29
AL26
AK26
AM27
AL27
AM25
AL25
AV31
AU30
AW32
AW31
AW30
AV30
AH24
AH23
AJ25
AJ24
AK24
AL24
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AP25
AN26
AP26
AP24
AN25
AT26
AU26
AU27
AT27
AT25
AU25
AW29
AW28
AV27
AV28
AW27
AW26
AP22
AN23
AR24
AP23
AM22
AN22
AU24
AT23
AV25
AW25
AW24
AV24
AU22
AW23
AU23
AT22
AV22
AW22
AR22
AR21
AK22
AJ22
AL23
AK23
AH22
AH21
AN21
AM21
F1152
AP28
AN28
AM28
AP29
AP27
AN27
AE24
AE23
AD22
AC22
H780
AD19
AC19
AB19
AA19
AE19
AD18
Y19
AA18
Y18
Y17
AH23
AJ24
AJ22
AH22
AJ23
AK22
AM24
AL24
AK24
AL25
AM23
AL23
AE22
AE21
AG21
AF21
AD21
AE20
AP25
AN25
AP26
AP23
AP24
AN24
AL22
AM22
AL21
AK21
AJ20
AJ21
AP22
AN22
AM21
AP20
AP21
AN21
AL20
AM18
AM19
AL19
AK18
AL18
AF20
AF19
AE19
AD19
AH19
AG19
AE18
AD18
AK19
AJ19
AF19
AG19
AH19
AG18
AH17
AH18
AF17
AE18
AE16
AD16
AF16
AE17
DQS for X4 for F1517
DQSn6B
DQS6B
DQ6B
DQ6B
DQ6B
DQ6B
DQ7B
DQ7B
DQSn7B
DQS7B
DQ7B
DQ7B
DQSn8B
DQS8B
DQ8B
DQ8B
DQ8B
DQ8B
DQ9B
DQ9B
DQSn9B
DQS9B
DQ9B
DQ9B
DQSn10B
DQS10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ11B
DQ11B
DQSn11B
DQS11B
DQ11B
DQ11B
DQSn12B
DQS12B
DQ12B
DQ12B
DQ12B
DQ12B
DQ13B
DQ13B
DQSn13B
DQS13B
DQ13B
DQ13B
DQSn14B
DQS14B
DQ14B
DQ14B
DQ14B
DQ14B
DQ15B
DQ15B
DQSn15B
DQS15B
DQ15B
DQ15B
DQSn16B
DQS16B
DQ16B
DQ16B
DQ16B
DQ16B
DQ17B
DQ17B
DQSn17B
DQS17B
DQ17B
DQ17B
DQSn18B
DQS18B
DQ18B
DQ18B
DQ18B
DQ18B
DQ19B
DQ19B
DQSn19B
DQS19B
DQ19B
DQ19B
DQS for X8/X9 for
F1517
DQSn3B/DQ3B
DQS3B/CQ3B
DQ3B
DQ3B
DQ3B
DQ3B
DQ4B
DQ4B
DQ4B
DQ4B/CQn4B
DQ4B
DQ4B
DQSn4B/DQ4B
DQS4B/CQ4B
DQ4B
DQ4B
DQ4B
DQ4B
DQ9B
DQ9B
DQ9B
DQ9B/CQn9B
DQ9B
DQ9B
DQSn9B/DQ9B
DQS9B/CQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ10B
DQ10B
DQ10B
DQ10B/CQn10B
DQ10B
DQ10B
DQSn10B/DQ10B
DQS10B/CQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ11B
DQ11B
DQ11B
DQ11B/CQn11B
DQ11B
DQ11B
DQSn11B/DQ11B
DQS11B/CQ11B
DQ11B
DQ11B
DQ11B
DQ11B
DQ12B
DQ12B
DQ12B
DQ12B/CQn12B
DQ12B
DQ12B
DQSn12B/DQ12B
DQS12B/CQ12B
DQ12B
DQ12B
DQ12B
DQ12B
DQ17B
DQ17B
DQ17B
DQ17B/CQn17B
DQ17B
DQ17B
DQSn17B/DQ17B
DQS17B/CQ17B
DQ17B
DQ17B
DQ17B
DQ17B
DQS for X16/X18 for
F1517 (Note 1)
DQ2B
DQ2B/CQn2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQSn2B/DQ2B
DQS2B/CQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ2B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B/CQn9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQSn9B/DQ9B
DQS9B/CQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B/CQn10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQSn10B/DQ10B
DQS10B/CQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQS for X32/X36 for
F1517 (Note 1)
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ1B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B/CQn9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQSn9B/DQ9B
DQS9B/CQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQS for X4 for F1152
DQSn6B
DQS6B
DQ6B
DQ6B
DQ6B
DQ6B
DQS for X8/X9 for
F1152 (Note 1)
DQSn3B/DQ3B
DQS3B/CQ3B
DQ3B
DQ3B
DQ3B
DQ3B
DQS for X16/X18 for
F1152 (Note 1)
DQ9B
DQ9B
DQSn9B
DQS9B
DQ9B
DQ9B
DQSn10B
DQS10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ11B
DQ11B
DQSn11B
DQS11B
DQ11B
DQ11B
DQSn12B
DQS12B
DQ12B
DQ12B
DQ12B
DQ12B
DQ9B
DQ9B
DQ9B
DQ9B/CQn9B
DQ9B
DQ9B
DQSn9B/DQ9B
DQS9B/CQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ10B
DQ10B
DQ10B
DQ10B/CQn10B
DQ10B
DQ10B
DQSn10B/DQ10B
DQS10B/CQ10B
DQ10B
DQ10B
DQ10B
DQ10B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B/CQn9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQSn9B/DQ9B
DQS9B/CQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ9B
DQ17B
DQ17B
DQSn17B
DQS17B
DQ17B
DQ17B
DQSn18B
DQS18B
DQ18B
DQ18B
DQ18B
DQ18B
DQ19B
DQ19B
DQSn19B
DQS19B
DQ19B
DQ19B
DQ17B
DQ17B
DQ17B
DQ17B/CQn17B
DQ17B
DQ17B
DQSn17B/DQ17B
DQS17B/CQ17B
DQ17B
DQ17B
DQ17B
DQ17B
DQS for X4 for H780
DQSn6B
DQS6B
DQ6B
DQ6B
DQ6B
DQ6B
DQS for X8/X9 for
H780 (Note 1)
DQSn3B/DQ3B
DQS3B/CQ3B
DQ3B
DQ3B
DQ3B
DQ3B
DQ17B
DQ17B
DQSn17B
DQS17B
DQ17B
DQ17B
DQSn18B
DQS18B
DQ18B
DQ18B
DQ18B
DQ18B
DQ17B
DQ17B
DQ17B
DQ17B/CQn17B
DQ17B
DQ17B
DQSn17B/DQ17B
DQS17B/CQ17B
DQ17B
DQ17B
DQ17B
DQ17B
DQS for X16/X18 for
H780 (Note 1)
AC17
AB17
AC16
AB16
AA15
Y15
AH16
AG16
Pin List
Page 4 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO3C
VCCIO3C
VCCIO3C
VCCIO3C
VREF
VREF3C
VREF3C
VREF3C
VREF3C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
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VCCIO4C
VCCIO4C
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VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4C
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4B
VCCIO4A
VCCIO4A
VCCIO4A
VCCIO4A
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4C
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4B
VREF4A
VREF4A
VREF4A
VREF4A
Pin Name/Function
IO
IO
IO
IO
VCC_CLKIN3C
VCCA_PLL_B1
VCCD_PLL_B1
VCCD_PLL_B2
VCCA_PLL_B2
VCC_CLKIN4C
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
CLK5n
CLK5p
CLK4n
CLK4p
CLK6p
CLK6n
CLK7p
CLK7n
PLL_B2_FBp/CLKOUT1
PLL_B2_FBn/CLKOUT2
PLL_B2_CLKOUT0p
PLL_B2_CLKOUT0n
Configuration
Function
Dedicated Tx/Rx
Channel
DIFFIO_RX_B32n
DIFFIO_RX_B32p
DIFFIO_RX_B33p
DIFFIO_RX_B33n
DIFFIO_RX_B34p
DIFFIO_RX_B34n
DIFFIO_RX_B35p
DIFFIO_RX_B35n
PLL_B2_CLKOUT3
PLL_B2_CLKOUT4
DIFFIO_RX_B36p
DIFFIO_RX_B36n
DIFFIO_RX_B37p
DIFFIO_RX_B37n
DIFFIO_RX_B38p
DIFFIO_RX_B38n
DIFFIO_RX_B39p
DIFFIO_RX_B39n
DIFFIO_RX_B40p
DIFFIO_RX_B40n
DIFFIO_RX_B41p
DIFFIO_RX_B41n
DIFFIO_RX_B42p
DIFFIO_RX_B42n
DIFFIO_RX_B43p
DIFFIO_RX_B43n
DIFFIO_RX_B44p
DIFFIO_RX_B44n
DIFFIO_RX_B45p
DIFFIO_RX_B45n
DIFFIO_RX_B46p
DIFFIO_RX_B46n
DIFFIO_RX_B47p
DIFFIO_RX_B47n
DIFFIO_RX_B48p
DIFFIO_RX_B48n
DIFFIO_RX_B49p
DIFFIO_RX_B49n
DIFFIO_RX_B50p
DIFFIO_RX_B50n
DIFFIO_RX_B51p
DIFFIO_RX_B51n
DIFFIO_RX_B52p
DIFFIO_RX_B52n
DIFFIO_RX_B53p
DIFFIO_RX_B53n
Emulated LVDS
Output Channel
DIFFOUT_B63n
DIFFOUT_B63p
DIFFOUT_B64n
DIFFOUT_B64p
DIFFOUT_B65p
DIFFOUT_B65n
DIFFOUT_B66p
DIFFOUT_B66n
DIFFOUT_B67p
DIFFOUT_B67n
DIFFOUT_B68p
DIFFOUT_B68n
DIFFOUT_B69p
DIFFOUT_B69n
DIFFOUT_B70p
DIFFOUT_B70n
DIFFOUT_B71p
DIFFOUT_B71n
DIFFOUT_B72p
DIFFOUT_B72n
DIFFOUT_B73p
DIFFOUT_B73n
DIFFOUT_B74p
DIFFOUT_B74n
DIFFOUT_B75p
DIFFOUT_B75n
DIFFOUT_B76p
DIFFOUT_B76n
DIFFOUT_B77p
DIFFOUT_B77n
DIFFOUT_B78p
DIFFOUT_B78n
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DIFFOUT_B79n
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DIFFOUT_B106n
F1517
AW21
AV21
AU21
AT21
AL21
AK21
AJ21
AK19
AL19
AK20
AT20
AU20
AV19
AW19
AM19
AN19
AH19
AH20
AL18
AM18
AK18
AJ19
AP17
AR18
AP20
AR19
AT19
AU19
AP18
AP19
AT18
AU18
AT17
AU17
AR16
AT16
AW18
AV18
AV16
AW17
AW15
AW16
AV15
AW14
AT15
AU15
AV13
AW13
AK17
AL17
AH17
AJ16
AH18
AJ18
AP16
AR15
AN14
AP14
AN15
AP15
AU14
AT14
AR12
AT12
AR13
AT13
AW11
AW12
AV12
AU12
AT11
AU11
AK15
AL16
AL15
AM15
AL14
AK14
AV10
AW10
AV9
AW9
AT10
AU9
AM13
AN13
AN12
AP12
AP11
AR10
AR9
AT9
AN11
AP10
F1152
AP19
AN19
AP18
AN18
AG18
AH18
AF18
AF17
AH17
AE17
AN16
AP16
AN15
AP15
AL17
AM17
AE16
AF16
AL16
AM16
AD15
AD16
AJ16
AK16
AL15
AM15
AL14
AM14
AK13
AL13
AH15
AJ15
AG15
AK15
AH14
AJ14
AP14
AN13
AN12
AP12
AM12
AP13
AN10
AP10
AP9
AP11
AM9
AN9
AE15
AF15
AF13
AF14
AE13
AE14
AK12
AL12
AK10
AM11
AL10
AL11
AM8
AP8
AN7
AP7
AP6
AM7
H780
AH15
AG15
AF15
AE15
AB14
AC14
AB15
DQS for X4 for F1517
DQS for X8/X9 for
F1517
DQS for X16/X18 for
F1517 (Note 1)
DQS for X32/X36 for
F1517 (Note 1)
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQ20B
DQ20B
DQS20B
DQSn20B
DQ20B
DQ20B
DQ21B
DQ21B
DQ21B
DQ21B
DQS21B
DQSn21B
DQ22B
DQ22B
DQS22B
DQSn22B
DQ22B
DQ22B
DQ22B
DQ22B
DQ22B
DQ22B
DQS22B/CQ22B
DQSn22B/DQ22B
DQ22B
DQ22B
DQ22B/CQn22B
DQ22B
DQ22B
DQ22B
DQS for X16/X18 for
H780 (Note 1)
AC13
AE14
AF14
AG13
AH14
AG12
AH13
Y13
Y14
AD13
AE13
AA13
AB13
AG10
AH10
AH11
AH12
AF10
AF11
AF12
AC12
AD12
AE12
AC11
AE11
DQ20B
DQ20B
DQS20B
DQSn20B
DQ20B
DQ20B
DQ21B
DQ21B
DQ21B
DQ21B
DQS21B
DQSn21B
DQ22B
DQ22B
DQS22B
DQSn22B
DQ22B
DQ22B
DQ23B
DQ23B
DQ23B
DQ23B
DQS23B
DQSn23B
DQ24B
DQ24B
DQS24B
DQSn24B
DQ24B
DQ24B
DQ25B
DQ25B
DQ25B
DQ25B
DQS25B
DQSn25B
DQ26B
DQ26B
DQS26B
DQSn26B
DQ26B
DQ26B
DQ27B
DQ27B
DQ27B
DQ27B
DQS27B
DQSn27B
DQ28B
DQ28B
DQS28B
DQSn28B
DQ28B
DQ28B
DQ29B
DQ29B
DQ29B
DQ29B
DQS29B
DQSn29B
DQ30B
DQ30B
DQS30B
DQSn30B
DQ30B
DQ30B
DQ31B
DQ31B
DQ31B
DQ31B
DQ22B
DQ22B
DQ22B
DQ22B
DQS22B/CQ22B
DQSn22B/DQ22B
DQ22B
DQ22B
DQ22B/CQn22B
DQ22B
DQ22B
DQ22B
DQ27B
DQ27B
DQ27B
DQ27B
DQS27B/CQ27B
DQSn27B/DQ27B
DQ27B
DQ27B
DQ27B/CQn27B
DQ27B
DQ27B
DQ27B
DQ28B
DQ28B
DQ28B
DQ28B
DQS28B/CQ28B
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DQ28B
DQ28B
DQ28B/CQn28B
DQ28B
DQ28B
DQ28B
DQ29B
DQ29B
DQ29B
DQ29B
DQS29B/CQ29B
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DQ29B
DQ29B
DQ29B/CQn29B
DQ29B
DQ29B
DQ29B
DQ30B
DQ30B
DQ30B
DQ30B
DQS30B/CQ30B
DQSn30B/DQ30B
DQ30B
DQ30B
DQ30B/CQn30B
DQ30B
DQ30B
DQ30B
DQ35B
DQ35B
DQ35B
DQ35B
Pin List
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
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DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B/CQn29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ29B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQS30B/CQ30B
DQSn30B/DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B/CQn30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ37B
DQ37B
DQ37B
DQ37B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
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DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
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DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ38B
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DQ20B
DQ20B
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DQ20B
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DQ21B
DQ21B
DQ21B
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DQ22B
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DQ22B
DQ22B
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DQ22B
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DQ27B
DQ27B
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DQ28B
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DQ29B
DQ29B
DQ29B
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DQ30B
DQS30B
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DQ30B
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DQ29B
DQ29B
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DQ29B
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DQ29B
DQ29B
DQ29B
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DQ30B
DQ30B
DQ30B
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DQ30B
DQ30B
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DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQS30B/CQ30B
DQSn30B/DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
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DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
DQ30B
Page 5 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO4A
VCCIO4A
VCCIO4A
VCCIO4A
VCCIO4A
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VCCIO4A
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VCCIO4A
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VCCIO4A
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VCCIO4A
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VCCIO4A
VCCIO4A
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VCCIO4A
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VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
VREF
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
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VREF4A
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VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF4A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
VREF5A
Pin Name/Function
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
NC
GND
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
Dedicated Tx/Rx
Channel
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Emulated LVDS
Output Channel
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DIFFOUT_B125n
DIFFOUT_B126p
DIFFOUT_B126n
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DIFFOUT_B127n
DIFFOUT_B128p
DIFFOUT_B128n
nIO_PULLUP
nCEO
DCLK
nCSO
ASDO
PLL_R4_CLKn
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RDN5A
RUP5A
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F1517
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AW6
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AL11
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AM4
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AN2
AN3
AG10
AG11
AN1
AM1
AJ3
AJ4
AL1
F1152
H780
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AD13
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AM4
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AE9
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AE8
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W10
AF3
AE3
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AE8
AM1
AM2
AF5
AF6
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AJ4
AC8
AC9
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AL2
AE5
AE6
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AG4
AB10
AC11
AK1
AJ2
AD6
AD7
AJ1
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AC7
AB8
AF3
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AB9
AA10
AH1
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AC5
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AF1
AC3
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AE2
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AB4
AG1
AF2
Y6
Y7
AE1
AD1
AA4
Y5
AC1
AC2
Y3
Y4
AB1
AB2
W8
W9
AA1
Y2
W5
W6
Y1
W2
V6
V7
W3
W4
DQS for X4 for F1517
DQS31B
DQSn31B
DQ32B
DQ32B
DQS32B
DQSn32B
DQ32B
DQ32B
DQ33B
DQ33B
DQ33B
DQ33B
DQS33B
DQSn33B
DQ34B
DQ34B
DQS34B
DQSn34B
DQ34B
DQ34B
DQ35B
DQ35B
DQ35B
DQ35B
DQS35B
DQSn35B
DQ36B
DQ36B
DQS36B
DQSn36B
DQ36B
DQ36B
DQ37B
DQ37B
DQ37B
DQ37B
DQS37B
DQSn37B
DQ38B
DQ38B
DQS38B
DQSn38B
DQ38B
DQ38B
DQS for X8/X9 for
F1517
DQS35B/CQ35B
DQSn35B/DQ35B
DQ35B
DQ35B
DQ35B/CQn35B
DQ35B
DQ35B
DQ35B
DQ36B
DQ36B
DQ36B
DQ36B
DQS36B/CQ36B
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DQ36B
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DQ36B
DQ36B
DQ36B
DQ37B
DQ37B
DQ37B
DQ37B
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DQ37B
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DQ37B
DQ37B
DQ37B
DQ38B
DQ38B
DQ38B
DQ38B
DQS38B/CQ38B
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DQ38B
DQ38B
DQ38B/CQn38B
DQ38B
DQ38B
DQ38B
DQS for X16/X18 for
F1517 (Note 1)
DQ37B
DQ37B
DQ37B
DQ37B
DQS37B/CQ37B
DQSn37B/DQ37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ37B/CQn37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ37B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQS38B/CQ38B
DQSn38B/DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
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DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ1R
DQ1R
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DQ1R
DQ1R
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DQ2R
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DQ3R
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DQ3R
DQ3R
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DQ4R
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DQ5R
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DQ1R
DQ1R
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DQ1R
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DQ1R
DQ1R
DQ1R
DQ1R
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DQ2R
DQ2R
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DQ2R
DQ2R
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DQ2R
DQ2R
DQ2R
DQ2R
DQ3R
DQ3R
DQ3R
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DQ3R
DQ3R
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DQ3R
DQ3R
DQ3R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R/CQn1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQSn1R/DQ1R
DQS1R/CQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
DQ1R
Pin List
DQS for X32/X36 for
F1517 (Note 1)
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQS38B/CQ38B
DQSn38B/DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B/CQn38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQ33B
DQ33B
DQ33B
DQ33B
DQS33B
DQSn33B
DQ34B
DQ34B
DQS34B
DQSn34B
DQ34B
DQ34B
DQ35B
DQ35B
DQ35B
DQ35B
DQS35B
DQSn35B
DQ36B
DQ36B
DQS36B
DQSn36B
DQ36B
DQ36B
DQ37B
DQ37B
DQ37B
DQ37B
DQS37B
DQSn37B
DQ38B
DQ38B
DQS38B
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DQ38B
DQ38B
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DQ36B
DQ36B
DQ36B
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DQ36B
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DQ36B
DQ36B
DQ36B
DQ37B
DQ37B
DQ37B
DQ37B
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DQ37B
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DQ37B
DQ37B
DQ37B
DQ38B
DQ38B
DQ38B
DQ38B
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DQ38B
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DQ38B
DQ38B
DQ38B
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DQ1R
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DQ2R
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DQ3R
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DQ3R
DQ3R
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DQS3R/CQ3R
DQ3R
DQ3R
DQ3R
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQS38B/CQ38B
DQSn38B/DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
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DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ33B
DQ33B
DQ33B
DQ33B
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DQ34B
DQ34B
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DQ34B
DQ35B
DQ35B
DQ35B
DQ35B
DQS35B
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DQ36B
DQ36B
DQS36B
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DQ36B
DQ36B
DQ37B
DQ37B
DQ37B
DQ37B
DQS37B
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DQS38B
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DQ38B
DQ38B
DQ36B
DQ36B
DQ36B
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DQ36B
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DQ36B
DQ36B
DQ36B
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DQ38B
DQ38B
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DQ38B
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DQ38B
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DQ38B
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DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
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DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
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DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
DQ38B
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DQ1R
DQ1R
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DQ2R
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DQ1R
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DQ1R
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DQ1R
DQ1R
DQ1R
DQ1R
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DQ1R
DQ1R
DQ1R
Page 6 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO5A
VCCIO5A
VCCIO5A
VCCIO5A
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VCCIO5B
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VREF5A
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VREF5A
VREF5A
VREF5A
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VREF5B
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Pin Name/Function
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IO
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IO
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IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
PLL_R3_CLKOUT0n
PLL_R3_FB_CLKOUT0p
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CLK8n
CLK8p
CLK10p
CLK10n
CLK11p
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PLL_R2_CLKOUT0n
Configuration
Function
Dedicated Tx/Rx
Channel
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DIFFIO_TX_R11p
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Emulated LVDS
Output Channel
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F1517
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AF12
AG13
AK2
AK3
AE13
AE14
AK1
AJ1
AG7
AG8
AH1
AH2
AF9
AF10
AH4
AH5
AE10
AE11
AG1
AG2
AE9
AD9
AG3
AG4
AD10
AD11
AF6
AF7
AD12
AC12
AG5
AG6
AE4
AE5
AD4
AD5
AD7
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AF3
AF4
AE6
AD6
AE2
AE3
AC9
AC10
AF1
AE1
AB11
AB12
AD1
AD2
AC6
AC7
AC3
AC4
AA11
AA12
AC1
AB1
AB9
AA10
AB2
AB3
AA7
AB7
AB4
AB5
AA5
AA6
AA3
AA4
AA1
AA2
AA8
AA9
W9
W8
W2
W1
Y4
Y3
W6
W5
W4
W3
V6
V5
V2
V1
V8
W7
V4
F1152
AF2
AB11
AA12
AE3
AE4
AD3
AD4
AE1
AE2
AB5
AB6
AB3
AC4
AA6
AA7
AD1
AC2
Y9
Y10
AA3
AB4
Y7
Y8
AC1
AB2
Y11
W12
Y3
AA4
Y5
Y6
AB1
AA1
W7
W8
W3
Y4
W10
W11
Y1
Y2
W5
W6
V3
V4
W9
V10
U3
U4
W1
W2
V7
V9
U9
U7
U2
U1
T2
T1
U11
U10
P2
R1
T7
U6
R4
R3
T9
T8
N2
H780
U6
U7
V3
V4
U8
U9
W1
V1
T4
U5
U3
U4
T8
T9
T2
T3
T6
R6
R4
T5
R9
R10
U1
U2
T1
R1
P7
R7
P2
P1
M1
N1
P9
P8
N4
P4
N7
N6
P3
N2
N5
M4
L2
DQS for X8/X9 for
F1517
DQ3R
DQS for X16/X18 for
F1517 (Note 1)
DQ8R
DQ8R
DQSn8R
DQS8R
DQ8R
DQ8R
DQSn9R
DQS9R
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DQ9R
DQ9R
DQ9R
DQ10R
DQ10R
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DQS10R
DQ10R
DQ10R
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DQ11R
DQ11R
DQ11R
DQ11R
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DQ12R
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DQ12R
DQ12R
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DQS13R
DQ13R
DQ13R
DQ13R
DQ13R
DQ14R
DQ14R
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DQ14R
DQ14R
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DQS15R
DQ15R
DQ15R
DQ15R
DQ15R
DQ16R
DQ16R
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DQ16R
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DQ17R
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DQ8R
DQ8R
DQ8R
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DQ8R
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DQ8R
DQ8R
DQ8R
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DQ9R
DQ9R
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DQ9R
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DQ9R
DQ9R
DQ9R
DQ12R
DQ12R
DQ12R
DQ12R/CQn12R
DQ12R
DQ12R
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DQS12R/CQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ13R
DQ13R
DQ13R
DQ13R/CQn13R
DQ13R
DQ13R
DQSn13R/DQ13R
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DQ13R
DQ13R
DQ13R
DQ13R
DQ14R
DQ14R
DQ14R
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DQ14R
DQ14R
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DQ14R
DQ14R
DQ14R
DQ14R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
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DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQSn8R/DQ8R
DQS8R/CQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ8R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R/CQn12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
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DQS12R/CQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ18R
DQ18R
DQ18R
DQ18R
DQS18R
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DQ19R
DQ19R
DQS19R
DQ21R
DQ21R
DQ21R
DQ21R
DQS21R/CQ21R
DQSn21R/DQ21R
DQ21R
DQ21R
DQ21R/CQn21R
DQS for X4 for F1517
DQ6R
DQ7R
DQ7R
DQSn7R
DQS7R
DQ7R
DQ7R
Pin List
DQS for X32/X36 for
F1517 (Note 1)
DQS for X8/X9 for
F1152 (Note 1)
DQ3R
DQS for X16/X18 for
F1152 (Note 1)
DQ12R
DQ12R
DQSn12R
DQS12R
DQ12R
DQ12R
DQSn13R
DQS13R
DQ13R
DQ13R
DQ13R
DQ13R
DQ14R
DQ14R
DQSn14R
DQS14R
DQ14R
DQ14R
DQSn15R
DQS15R
DQ15R
DQ15R
DQ15R
DQ15R
DQ16R
DQ16R
DQSn16R
DQS16R
DQ16R
DQ16R
DQSn17R
DQS17R
DQ17R
DQ17R
DQ17R
DQ17R
DQ12R
DQ12R
DQ12R
DQ12R/CQn12R
DQ12R
DQ12R
DQSn12R/DQ12R
DQS12R/CQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ13R
DQ13R
DQ13R
DQ13R/CQn13R
DQ13R
DQ13R
DQSn13R/DQ13R
DQS13R/CQ13R
DQ13R
DQ13R
DQ13R
DQ13R
DQ14R
DQ14R
DQ14R
DQ14R/CQn14R
DQ14R
DQ14R
DQSn14R/DQ14R
DQS14R/CQ14R
DQ14R
DQ14R
DQ14R
DQ14R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R/CQn12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQSn12R/DQ12R
DQS12R/CQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ12R
DQ18R
DQ18R
DQ18R
DQ18R
DQS18R
DQSn18R
DQ19R
DQ19R
DQS19R
DQ21R
DQ21R
DQ21R
DQ21R
DQS21R/CQ21R
DQSn21R/DQ21R
DQ21R
DQ21R
DQ21R/CQn21R
DQS for X4 for F1152
DQ6R
DQ7R
DQ7R
DQSn7R
DQS7R
DQ7R
DQ7R
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQSn15R
DQS15R
DQ15R
DQ15R
DQ15R
DQ15R
DQ16R
DQ16R
DQSn16R
DQS16R
DQ16R
DQ16R
DQSn17R
DQS17R
DQ17R
DQ17R
DQ17R
DQ17R
DQ15R
DQ15R
DQ15R
DQ15R/CQn15R
DQ15R
DQ15R
DQSn15R/DQ15R
DQS15R/CQ15R
DQ15R
DQ15R
DQ15R
DQ15R
DQ18R
DQ18R
DQ18R
DQ18R
DQS18R
DQSn18R
DQ19R
DQ19R
DQS19R
DQ20R
DQ20R
DQ20R
DQ20R
DQS20R/CQ20R
DQSn20R/DQ20R
DQ20R
DQ20R
DQ20R/CQn20R
DQS for X16/X18 for
H780 (Note 1)
Page 7 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
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VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
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VCCIO6C
VCCIO6C
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VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
VCCIO6C
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VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
VCCIO6B
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VCCIO6A
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VCCIO6A
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VREF6C
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VREF6C
VREF6C
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VREF6B
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VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6B
VREF6A
VREF6A
VREF6A
VREF6A
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VREF6A
VREF6A
Pin Name/Function
IO
IO
IO
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IO
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IO
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IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
Dedicated Tx/Rx
Channel
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Emulated LVDS
Output Channel
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F1517
V3
U7
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U1
Y10
Y9
U4
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W10
V9
P1
R1
W12
Y12
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T2
V11
W11
R4
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T4
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U13
V12
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U12
N4
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R10
P6
N5
R8
P7
K1
L1
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R12
L4
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J1
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H1
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P9
G2
F2
N11
P12
H4
H3
N10
N9
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D1
L7
F1152
P1
T5
T4
P4
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M1
N1
P6
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N4
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L2
L1
R10
R9
M4
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P8
P7
K2
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N6
N5
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J1
P11
P10
K4
K3
M7
M6
G2
H1
L5
L4
J4
J3
L7
L6
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N9
N8
H4
H3
K6
K5
E2
E1
N11
N10
F4
F3
J7
J6
G5
G4
K8
K7
C1
D1
M10
M9
D3
D2
L9
H780
L1
N9
N8
L3
M3
L5
L4
K2
K1
L6
M6
H2
J1
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K6
G2
H1
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F1
G1
J4
J3
E2
E1
L9
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K9
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D2
D1
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F4
F3
G4
DQS for X4 for F1517
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DQ19R
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DQ20R
DQ20R
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DQSn20R
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DQ22R
DQ22R
DQ22R
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DQS23R
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DQ23R
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DQ24R
DQ24R
DQ24R
DQS24R
DQSn24R
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DQ25R
DQS25R
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DQ25R
DQ25R
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DQ26R
DQ26R
DQ26R
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DQ27R
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DQ28R
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DQ28R
DQ28R
DQ29R
DQ29R
DQ29R
DQ29R
DQS29R
DQSn29R
DQ30R
DQ30R
DQS30R
DQSn30R
DQ30R
DQ30R
DQ31R
DQ31R
DQ31R
DQ31R
DQS31R
DQSn31R
DQ32R
DQ32R
DQS32R
DQSn32R
DQ32R
DQ32R
DQ33R
DQ33R
DQ33R
DQ33R
DQS33R
DQSn33R
DQ34R
DQ34R
DQS34R
DQSn34R
DQ34R
DQS for X8/X9 for
F1517
DQ21R
DQ21R
DQ21R
DQ22R
DQ22R
DQ22R
DQ22R
DQS22R/CQ22R
DQSn22R/DQ22R
DQ22R
DQ22R
DQ22R/CQn22R
DQ22R
DQ22R
DQ22R
DQ23R
DQ23R
DQ23R
DQ23R
DQS23R/CQ23R
DQSn23R/DQ23R
DQ23R
DQ23R
DQ23R/CQn23R
DQ23R
DQ23R
DQ23R
DQ26R
DQ26R
DQ26R
DQ26R
DQS26R/CQ26R
DQSn26R/DQ26R
DQ26R
DQ26R
DQ26R/CQn26R
DQ26R
DQ26R
DQ26R
DQ27R
DQ27R
DQ27R
DQ27R
DQS27R/CQ27R
DQSn27R/DQ27R
DQ27R
DQ27R
DQ27R/CQn27R
DQ27R
DQ27R
DQ27R
DQ32R
DQ32R
DQ32R
DQ32R
DQS32R/CQ32R
DQSn32R/DQ32R
DQ32R
DQ32R
DQ32R/CQn32R
DQ32R
DQ32R
DQ32R
DQ33R
DQ33R
DQ33R
DQ33R
DQS33R/CQ33R
DQSn33R/DQ33R
DQ33R
DQ33R
DQ33R/CQn33R
DQ33R
DQ33R
DQ33R
DQ34R
DQ34R
DQ34R
DQ34R
DQS34R/CQ34R
DQSn34R/DQ34R
DQ34R
DQ34R
DQ34R/CQn34R
DQ34R
DQ34R
Pin List
DQS for X16/X18 for
F1517 (Note 1)
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQS23R/CQ23R
DQSn23R/DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R/CQn23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQS27R/CQ27R
DQSn27R/DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R/CQn27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ27R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQS34R/CQ34R
DQSn34R/DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R/CQn34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQS for X32/X36 for
F1517 (Note 1)
DQS for X4 for F1152
DQSn19R
DQ19R
DQ19R
DQ20R
DQ20R
DQ20R
DQ20R
DQS20R
DQSn20R
DQ21R
DQ21R
DQS21R
DQSn21R
DQ21R
DQ21R
DQ22R
DQ22R
DQ22R
DQ22R
DQS22R
DQSn22R
DQ23R
DQ23R
DQS23R
DQSn23R
DQ23R
DQ23R
DQS for X8/X9 for
F1152 (Note 1)
DQ21R
DQ21R
DQ21R
DQ22R
DQ22R
DQ22R
DQ22R
DQS22R/CQ22R
DQSn22R/DQ22R
DQ22R
DQ22R
DQ22R/CQn22R
DQ22R
DQ22R
DQ22R
DQ23R
DQ23R
DQ23R
DQ23R
DQS23R/CQ23R
DQSn23R/DQ23R
DQ23R
DQ23R
DQ23R/CQn23R
DQ23R
DQ23R
DQ23R
DQS for X16/X18 for
F1152 (Note 1)
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQS23R/CQ23R
DQSn23R/DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R/CQn23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ23R
DQ28R
DQ28R
DQS28R
DQSn28R
DQ28R
DQ28R
DQ29R
DQ29R
DQ29R
DQ29R
DQS29R
DQSn29R
DQ30R
DQ30R
DQS30R
DQSn30R
DQ30R
DQ30R
DQ31R
DQ31R
DQ31R
DQ31R
DQS31R
DQSn31R
DQ32R
DQ32R
DQS32R
DQSn32R
DQ32R
DQ32R
DQ33R
DQ33R
DQ33R
DQ33R
DQS33R
DQSn33R
DQ34R
DQ34R
DQS34R
DQSn34R
DQ34R
DQ32R
DQ32R
DQ32R
DQ32R
DQS32R/CQ32R
DQSn32R/DQ32R
DQ32R
DQ32R
DQ32R/CQn32R
DQ32R
DQ32R
DQ32R
DQ33R
DQ33R
DQ33R
DQ33R
DQS33R/CQ33R
DQSn33R/DQ33R
DQ33R
DQ33R
DQ33R/CQn33R
DQ33R
DQ33R
DQ33R
DQ34R
DQ34R
DQ34R
DQ34R
DQS34R/CQ34R
DQSn34R/DQ34R
DQ34R
DQ34R
DQ34R/CQn34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQS34R/CQ34R
DQSn34R/DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R/CQn34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQS for X4 for H780
DQSn19R
DQ19R
DQ19R
DQ20R
DQ20R
DQ20R
DQ20R
DQS20R
DQSn20R
DQ31R
DQ31R
DQ31R
DQ31R
DQS31R
DQSn31R
DQ32R
DQ32R
DQS32R
DQSn32R
DQ32R
DQ32R
DQ33R
DQ33R
DQ33R
DQ33R
DQS33R
DQSn33R
DQ34R
DQ34R
DQS34R
DQSn34R
DQ34R
DQS for X8/X9 for
H780 (Note 1)
DQ20R
DQ20R
DQ20R
DQS for X16/X18 for
H780 (Note 1)
DQ33R
DQ33R
DQ33R
DQ33R
DQS33R/CQ33R
DQSn33R/DQ33R
DQ33R
DQ33R
DQ33R/CQn33R
DQ33R
DQ33R
DQ33R
DQ34R
DQ34R
DQ34R
DQ34R
DQS34R/CQ34R
DQSn34R/DQ34R
DQ34R
DQ34R
DQ34R/CQn34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQS34R/CQ34R
DQSn34R/DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R/CQn34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
DQ34R
Page 8 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO6A
VCCIO6A
VCCIO6A
VCCIO6A
VCCIO6A
VCCIO6A
VCCIO6A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
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VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7A
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VREF
VREF6A
VREF6A
VREF6A
VREF6A
VREF6A
VREF6A
VREF6A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7A
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
Pin Name/Function
IO
IO
IO
IO
IO
PLL_R1_CLKp
PLL_R1_CLKn
VCCD_PLL_R1
VCCA_PLL_R1
MSEL2
MSEL1
MSEL0
TEMPDIODEn
TEMPDIODEp
NC
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
RUP6A
RDN6A
PLL_R1_FB_CLKOUT0p
PLL_R1_CLKOUT0n
PLL_R1_CLKp
PLL_R1_CLKn
Dedicated Tx/Rx
Channel
DIFFIO_TX_R55n
DIFFIO_RX_R56p
DIFFIO_RX_R56n
DIFFIO_TX_R56p
DIFFIO_TX_R56n
Emulated LVDS
Output Channel
DIFFOUT_R110n
DIFFOUT_R111p
DIFFOUT_R111n
DIFFOUT_R112p
DIFFOUT_R112n
MSEL2
MSEL1
MSEL0
RDN7A
RUP7A
DIFFIO_RX_T1n
DIFFIO_RX_T1p
DIFFIO_RX_T2n
DIFFIO_RX_T2p
DIFFIO_RX_T3n
DIFFIO_RX_T3p
DIFFIO_RX_T4n
DIFFIO_RX_T4p
DIFFIO_RX_T5n
DIFFIO_RX_T5p
DIFFIO_RX_T6n
DIFFIO_RX_T6p
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DIFFIO_RX_T10n
DIFFIO_RX_T10p
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DIFFOUT_T1n
DIFFOUT_T1p
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DIFFOUT_T3p
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DIFFOUT_T4p
DIFFOUT_T5n
DIFFOUT_T5p
DIFFOUT_T6n
DIFFOUT_T6p
DIFFOUT_T7n
DIFFOUT_T7p
DIFFOUT_T8n
DIFFOUT_T8p
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DIFFOUT_T20p
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DIFFOUT_T21p
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DIFFOUT_T22p
DIFFOUT_T23n
DIFFOUT_T23p
DIFFOUT_T24n
DIFFOUT_T24p
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DIFFOUT_T25p
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DIFFOUT_T26p
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DIFFOUT_T28p
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DIFFOUT_T29p
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DIFFOUT_T31p
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DIFFOUT_T32p
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DIFFOUT_T35p
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DIFFOUT_T36p
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DIFFOUT_T37p
DIFFOUT_T38n
DIFFOUT_T38p
DIFFOUT_T39n
DIFFOUT_T39p
DIFFOUT_T40n
F1517
L6
F4
E3
J7
J6
C2
C1
L9
K9
D3
F5
M11
G5
H6
H7
H9
H10
G10
G11
J9
G9
F7
G7
G8
F8
E7
F6
J12
J11
K10
K11
L12
K12
D4
E4
D6
E6
C5
D5
B4
A3
B3
C3
A2
A4
C8
D8
D9
E9
C7
D7
L13
K13
M14
M15
N13
M13
B6
C6
A7
B7
A5
A6
H12
G12
E13
F13
F12
F11
D12
E12
D10
E10
C11
D11
J13
H13
J14
K14
J15
H15
B9
C10
A9
A8
A10
B10
L16
L15
M16
M17
J16
K16
E15
F1152
L8
E4
E3
H6
H5
H780
G3
B1
C1
H6
G5
K9
J9
K10
D4
E5
G7
F8
F6
E7
F7
F9
G8
C3
C4
C6
D6
B5
C5
J11
G9
G11
H11
J12
G10
A2
B2
A5
A3
A4
B4
D7
E8
C9
D9
E10
D8
A7
B7
A6
C7
A8
B8
M13
L13
K11
K12
G7
J9
H8
D4
D3
E4
A2
C3
A4
B4
A3
B2
D7
E7
G8
G9
E8
F8
D6
E5
C5
D5
B5
C6
A5
A6
A8
A9
A7
B7
B8
F9
C8
D8
D9
C9
E10
F10
H10
G10
D10
E11
H11
J10
J11
J12
G12
F11
F12
F13
G13
E11
C11
D11
D13
D10
C12
D12
K14
K13
H14
J14
K15
L14
A10
B10
A12
A9
A11
B11
DQS for X4 for F1517
DQ34R
DQS for X8/X9 for
F1517
DQ34R
DQS for X16/X18 for
F1517 (Note 1)
DQ34R
DQS for X32/X36 for
F1517 (Note 1)
DQ1T
DQ1T
DQSn1T
DQS1T
DQ1T
DQ1T
DQSn2T
DQS2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ3T
DQ3T
DQSn3T
DQS3T
DQ3T
DQ3T
DQSn4T
DQS4T
DQ4T
DQ4T
DQ4T
DQ4T
DQ5T
DQ5T
DQSn5T
DQS5T
DQ5T
DQ5T
DQSn6T
DQS6T
DQ6T
DQ6T
DQ6T
DQ6T
DQ7T
DQ7T
DQSn7T
DQS7T
DQ7T
DQ7T
DQSn8T
DQS8T
DQ8T
DQ8T
DQ8T
DQ8T
DQ9T
DQ9T
DQSn9T
DQS9T
DQ9T
DQ9T
DQSn10T
DQS10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ11T
DQ11T
DQSn11T
DQS11T
DQ11T
DQ11T
DQSn12T
DQS12T
DQ12T
DQ12T
DQ12T
DQ12T
DQ13T
DQ13T
DQSn13T
DQS13T
DQ13T
DQ13T
DQSn14T
DQ1T
DQ1T
DQ1T
DQ1T/CQn1T
DQ1T
DQ1T
DQSn1T/DQ1T
DQS1T/CQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ2T
DQ2T
DQ2T
DQ2T/CQn2T
DQ2T
DQ2T
DQSn2T/DQ2T
DQS2T/CQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ3T
DQ3T
DQ3T
DQ3T/CQn3T
DQ3T
DQ3T
DQSn3T/DQ3T
DQS3T/CQ3T
DQ3T
DQ3T
DQ3T
DQ3T
DQ4T
DQ4T
DQ4T
DQ4T/CQn4T
DQ4T
DQ4T
DQSn4T/DQ4T
DQS4T/CQ4T
DQ4T
DQ4T
DQ4T
DQ4T
DQ9T
DQ9T
DQ9T
DQ9T/CQn9T
DQ9T
DQ9T
DQSn9T/DQ9T
DQS9T/CQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ10T
DQ10T
DQ10T
DQ10T/CQn10T
DQ10T
DQ10T
DQSn10T/DQ10T
DQS10T/CQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ11T
DQ11T
DQ11T
DQ11T/CQn11T
DQ11T
DQ11T
DQSn11T/DQ11T
DQ1T
DQ1T
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DQ1T
DQ1T
DQ1T
DQ1T
DQ1T/CQn1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQSn1T/DQ1T
DQS1T/CQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
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DQ2T
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DQ2T
DQ2T
DQ2T
DQ2T
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DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T/CQn9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQSn9T/DQ9T
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DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T/CQn1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
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DQS1T/CQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
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DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ9T
DQ9T
DQ9T
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DQ9T
DQ9T
DQ9T
DQ9T
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DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T/CQn9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQSn9T/DQ9T
DQS9T/CQ9T
DQ9T
DQ9T
DQ9T
Pin List
DQS for X4 for F1152
DQ34R
DQS for X8/X9 for
F1152 (Note 1)
DQ34R
DQS for X16/X18 for
F1152 (Note 1)
DQ34R
DQ1T
DQ1T
DQSn1T
DQS1T
DQ1T
DQ1T
DQSn2T
DQS2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ3T
DQ3T
DQSn3T
DQS3T
DQ3T
DQ3T
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DQS4T
DQ4T
DQ4T
DQ4T
DQ4T
DQ5T
DQ5T
DQSn5T
DQS5T
DQ5T
DQ5T
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DQ6T
DQ6T
DQ6T
DQ1T
DQ1T
DQ1T
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DQ1T
DQ1T
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DQS1T/CQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ2T
DQ2T
DQ2T
DQ2T/CQn2T
DQ2T
DQ2T
DQSn2T/DQ2T
DQS2T/CQ2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ3T
DQ3T
DQ3T
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DQ3T
DQ3T
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DQS3T/CQ3T
DQ3T
DQ3T
DQ3T
DQ3T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T/CQn1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQSn1T/DQ1T
DQS1T/CQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ9T
DQ9T
DQSn9T
DQS9T
DQ9T
DQ9T
DQSn10T
DQS10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ11T
DQ11T
DQSn11T
DQS11T
DQ11T
DQ11T
DQSn12T
DQS12T
DQ12T
DQ12T
DQ12T
DQ12T
DQ9T
DQ9T
DQ9T
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DQ9T
DQ9T
DQSn9T/DQ9T
DQS9T/CQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ10T
DQ10T
DQ10T
DQ10T/CQn10T
DQ10T
DQ10T
DQSn10T/DQ10T
DQS10T/CQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T/CQn9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQSn9T/DQ9T
DQS9T/CQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQS for X4 for H780
DQ34R
DQS for X8/X9 for
H780 (Note 1)
DQ34R
DQS for X16/X18 for
H780 (Note 1)
DQ34R
DQ1T
DQ1T
DQSn1T
DQS1T
DQ1T
DQ1T
DQSn2T
DQS2T
DQ2T
DQ2T
DQ2T
DQ2T
DQ3T
DQ3T
DQSn3T
DQS3T
DQ3T
DQ3T
DQSn4T
DQS4T
DQ4T
DQ4T
DQ4T
DQ4T
DQ5T
DQ5T
DQSn5T
DQS5T
DQ5T
DQ5T
DQSn6T
DQS6T
DQ6T
DQ6T
DQ6T
DQ6T
DQ1T
DQ1T
DQ1T
DQ1T/CQn1T
DQ1T
DQ1T
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DQ1T
DQ1T
DQ1T
DQ1T
DQ2T
DQ2T
DQ2T
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DQ2T
DQ2T
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DQ2T
DQ2T
DQ2T
DQ2T
DQ3T
DQ3T
DQ3T
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DQ3T
DQ3T
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DQ3T
DQ3T
DQ3T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T/CQn1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQSn1T/DQ1T
DQS1T/CQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
DQ1T
Page 9 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7B
VCCIO7C
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VCCIO8C
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VCCIO8C
VCCIO8C
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VCCIO8C
VCCIO8C
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VCCIO8C
VCCIO8B
VCCIO8B
VCCIO8B
VCCIO8B
VCCIO8B
VCCIO8B
VCCIO8B
VREF
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7B
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
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VREF7C
VREF7C
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VREF7C
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VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
VREF7C
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VREF7C
VREF7C
VREF7C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
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VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
VREF8C
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VREF8C
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VREF8C
VREF8C
VREF8C
VREF8C
VREF8B
VREF8B
VREF8B
VREF8B
VREF8B
VREF8B
VREF8B
Pin Name/Function
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
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IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
VCC_CLKIN7C
VCCA_PLL_T2
VCCD_PLL_T2
VCCD_PLL_T1
VCCA_PLL_T1
VCC_CLKIN8C
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
IO
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
Dedicated Tx/Rx
Channel
DIFFIO_RX_T20p
DIFFIO_RX_T21n
DIFFIO_RX_T21p
DIFFIO_RX_T22n
DIFFIO_RX_T22p
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DIFFIO_RX_T30n
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PLL_T2_CLKOUT0p
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CLK13n
CLK13p
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CLK14p
CLK14n
CLK15p
CLK15n
PLL_T1_FBp/CLKOUT1
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DIFFIO_RX_T31n
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DIFFIO_RX_T35n
PLL_T1_CLKOUT3
PLL_T1_CLKOUT4
DIFFIO_RX_T36p
DIFFIO_RX_T36n
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DIFFIO_RX_T37n
DIFFIO_RX_T38p
DIFFIO_RX_T38n
DIFFIO_RX_T39p
DIFFIO_RX_T39n
RUP8C
RDN8C
DIFFIO_RX_T40p
DIFFIO_RX_T40n
DIFFIO_RX_T41p
DIFFIO_RX_T41n
DIFFIO_RX_T42p
DIFFIO_RX_T42n
Emulated LVDS
Output Channel
DIFFOUT_T40p
DIFFOUT_T41n
DIFFOUT_T41p
DIFFOUT_T42n
DIFFOUT_T42p
DIFFOUT_T43n
DIFFOUT_T43p
DIFFOUT_T44n
DIFFOUT_T44p
DIFFOUT_T45n
DIFFOUT_T45p
DIFFOUT_T46n
DIFFOUT_T46p
DIFFOUT_T47n
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DIFFOUT_T49n
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DIFFOUT_T50n
DIFFOUT_T50p
DIFFOUT_T51n
DIFFOUT_T51p
DIFFOUT_T52n
DIFFOUT_T52p
DIFFOUT_T53n
DIFFOUT_T53p
DIFFOUT_T54n
DIFFOUT_T54p
DIFFOUT_T55n
DIFFOUT_T55p
DIFFOUT_T56n
DIFFOUT_T56p
DIFFOUT_T57n
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DIFFOUT_T58p
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DIFFOUT_T59p
DIFFOUT_T60n
DIFFOUT_T60p
DIFFOUT_T61n
DIFFOUT_T61p
DIFFOUT_T62n
DIFFOUT_T62p
DIFFOUT_T63n
DIFFOUT_T63p
DIFFOUT_T64n
DIFFOUT_T64p
DIFFOUT_T65p
DIFFOUT_T65n
DIFFOUT_T66p
DIFFOUT_T66n
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DIFFOUT_T67n
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DIFFOUT_T69n
DIFFOUT_T70p
DIFFOUT_T70n
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DIFFOUT_T71n
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DIFFOUT_T72n
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DIFFOUT_T73n
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DIFFOUT_T75n
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DIFFOUT_T76n
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DIFFOUT_T77n
DIFFOUT_T78p
DIFFOUT_T78n
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DIFFOUT_T79n
DIFFOUT_T80p
DIFFOUT_T80n
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DIFFOUT_T81n
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DIFFOUT_T83n
DIFFOUT_T84p
F1517
F15
F14
G14
F16
G15
D14
C14
C13
D13
C15
D15
A11
A12
B12
B13
A13
A14
G18
F18
E16
F17
H18
G17
C16
D17
A15
B15
A16
B16
A17
C18
C17
D18
A18
B18
E18
E19
M19
M18
J17
K17
K18
L18
G19
H19
A19
B19
C19
D19
J19
K19
L19
K21
J21
K20
D20
C20
B21
A21
H21
G21
M21
M20
J22
H22
L21
K22
F21
F20
E22
E21
D21
C21
F22
F23
D22
C22
C23
D23
E24
D24
B22
A22
B24
A23
A24
A25
B25
A26
C25
D25
B27
A27
J23
F1152
H780
D14
E13
E14
F14
F15
D15
A13
B13
A15
C14
A14
B14
C17
C15
C16
D16
D17
E17
J16
J15
L16
K16
G16
H16
K17
L17
E16
F16
A16
B16
A17
B17
H17
G17
J17
J18
G18
K18
B19
A19
B20
A20
D18
C18
K19
J19
D19
C19
L19
L20
F19
E19
C20
D20
D21
C21
D22
E22
G20
F20
E20
H20
G21
F21
A22
A21
B23
A23
B22
C23
B10
C10
A10
B11
A11
A12
C12
D11
E13
D13
C13
D12
G12
F12
F13
G13
H14
J14
A13
B13
DQS for X4 for F1517
DQS14T
DQ14T
DQ14T
DQ14T
DQ14T
DQ15T
DQ15T
DQSn15T
DQS15T
DQ15T
DQ15T
DQSn16T
DQS16T
DQ16T
DQ16T
DQ16T
DQ16T
DQ17T
DQ17T
DQSn17T
DQS17T
DQ17T
DQ17T
DQSn18T
DQS18T
DQ18T
DQ18T
DQ18T
DQ18T
DQ19T
DQ19T
DQSn19T
DQS19T
DQ19T
DQ19T
DQS for X8/X9 for
F1517
DQS11T/CQ11T
DQ11T
DQ11T
DQ11T
DQ11T
DQ12T
DQ12T
DQ12T
DQ12T/CQn12T
DQ12T
DQ12T
DQSn12T/DQ12T
DQS12T/CQ12T
DQ12T
DQ12T
DQ12T
DQ12T
DQ17T
DQ17T
DQ17T
DQ17T/CQn17T
DQ17T
DQ17T
DQSn17T/DQ17T
DQS17T/CQ17T
DQ17T
DQ17T
DQ17T
DQ17T
DQS for X16/X18 for
F1517 (Note 1)
DQ10T/CQn10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQSn10T/DQ10T
DQS10T/CQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQ10T
DQS for X32/X36 for
F1517 (Note 1)
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQ9T
DQS for X4 for F1152
DQ17T
DQ17T
DQSn17T
DQS17T
DQ17T
DQ17T
DQSn18T
DQS18T
DQ18T
DQ18T
DQ18T
DQ18T
DQ19T
DQ19T
DQSn19T
DQS19T
DQ19T
DQ19T
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQ17T
DQ17T
DQ17T
DQ17T/CQn17T
DQ17T
DQ17T
DQSn17T/DQ17T
DQS17T/CQ17T
DQ17T
DQ17T
DQ17T
DQ17T
DQ17T
DQ17T
DQSn17T
DQS17T
DQ17T
DQ17T
DQSn18T
DQS18T
DQ18T
DQ18T
DQ18T
DQ18T
DQ19T
DQ19T
DQSn19T
DQS19T
DQ19T
DQ19T
DQ17T
DQ17T
DQ17T
DQ17T/CQn17T
DQ17T
DQ17T
DQSn17T/DQ17T
DQS17T/CQ17T
DQ17T
DQ17T
DQ17T
DQ17T
DQ22T
DQ22T
DQ22T
DQ22T
DQS22T/CQ22T
DQSn22T/DQ22T
DQ22T
DQ22T
DQ22T/CQn22T
DQ22T
DQ22T
DQ22T
DQ21T
DQ21T
DQ21T
DQ21T
DQS21T
DQSn21T
DQ22T
DQ22T
DQS22T
DQSn22T
DQ22T
DQ22T
DQ22T
DQ22T
DQ22T
DQ22T
DQS22T/CQ22T
DQSn22T/DQ22T
DQ22T
DQ22T
DQ22T/CQn22T
DQ22T
DQ22T
DQ22T
DQS for X16/X18 for
H780 (Note 1)
A14
B14
C14
D14
F14
G15
F15
F16
D15
C15
B16
A15
B17
A16
J16
J15
E16
D16
G16
H16
B19
A19
A17
A18
C19
C18
F17
C17
E17
D17
D18
F18
DQ20T
DQ20T
DQS20T
DQSn20T
DQ20T
DQ20T
DQ21T
DQ21T
DQ21T
DQ21T
DQS21T
DQSn21T
DQ22T
DQ22T
DQS22T
DQSn22T
DQ22T
DQ22T
DQ23T
DQ23T
DQ23T
DQ23T
DQS23T
DQSn23T
DQ24T
DQ22T
DQ22T
DQ22T
DQ22T
DQS22T/CQ22T
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DQ22T
DQ22T
DQ22T/CQn22T
DQ22T
DQ22T
DQ22T
DQ27T
DQ27T
DQ27T
DQ27T
DQS27T/CQ27T
DQSn27T/DQ27T
DQ27T
Pin List
DQ20T
DQ20T
DQS20T
DQSn20T
DQ20T
DQ20T
DQ21T
DQ21T
DQ21T
DQ21T
DQS21T
DQSn21T
DQ22T
DQ22T
DQS22T
DQSn22T
DQ22T
DQ22T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
Page 10 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VCCIO8B
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VCCIO8A
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VREF
VREF8B
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VREF8A
Pin Name/Function
IO
IO
IO
IO
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IO
IO
IO
IO
VCCIO1A
VCCIO1A
VCCIO1A
VCCIO1A
VCCIO1A
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
Configuration
Function
Dedicated Tx/Rx
Channel
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DIFFIO_RX_T62p
DIFFIO_RX_T62n
DIFFIO_RX_T63p
DIFFIO_RX_T63n
RUP8A
RDN8A
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DIFFIO_RX_T64n
Emulated LVDS
Output Channel
DIFFOUT_T84n
DIFFOUT_T85p
DIFFOUT_T85n
DIFFOUT_T86p
DIFFOUT_T86n
DIFFOUT_T87p
DIFFOUT_T87n
DIFFOUT_T88p
DIFFOUT_T88n
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DIFFOUT_T89n
DIFFOUT_T90p
DIFFOUT_T90n
DIFFOUT_T91p
DIFFOUT_T91n
DIFFOUT_T92p
DIFFOUT_T92n
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DIFFOUT_T93n
DIFFOUT_T94p
DIFFOUT_T94n
DIFFOUT_T95p
DIFFOUT_T95n
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DIFFOUT_T96n
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DIFFOUT_T97n
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DIFFOUT_T100p
DIFFOUT_T100n
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DIFFOUT_T101n
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DIFFOUT_T102n
DIFFOUT_T103p
DIFFOUT_T103n
DIFFOUT_T104p
DIFFOUT_T104n
DIFFOUT_T105p
DIFFOUT_T105n
DIFFOUT_T106p
DIFFOUT_T106n
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DIFFOUT_T107n
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DIFFOUT_T108n
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DIFFOUT_T109n
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DIFFOUT_T110n
DIFFOUT_T111p
DIFFOUT_T111n
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DIFFOUT_T112n
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DIFFOUT_T113n
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DIFFOUT_T122n
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DIFFOUT_T124n
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DIFFOUT_T126n
DIFFOUT_T127p
DIFFOUT_T127n
DIFFOUT_T128p
DIFFOUT_T128n
F1517
K23
M23
L24
L22
M22
F24
E25
F26
G26
G25
F25
D26
C26
E28
D28
D27
E27
A29
A28
C28
B28
D29
C29
J24
K25
J25
H25
K26
J26
B30
A30
A31
B31
D30
C31
G27
H27
G28
F28
F29
E30
E31
D31
F30
G29
D33
D32
M24
N25
M25
L25
M26
N26
C32
B33
A32
A33
B34
A34
A35
A36
B37
B36
A37
A38
D34
C34
E33
E34
D35
C35
J27
K27
M27
L27
K28
L28
G31
F31
F33
G33
G32
F32
J30
J31
H30
H31
J29
K29
B39
M31
K33
K36
F37
F1152
H780
B25
A25
A24
A26
C26
B26
K20
J20
J22
J21
K21
K22
D25
D24
C24
E25
E23
D23
A27
C27
B28
A28
C28
A29
M23
L23
L22
K23
G23
F23
F22
H23
G24
F24
F25
D27
E26
D26
F26
D28
B31
A31
A30
A33
B32
A32
C29
B29
D30
C30
C31
D31
F28
E28
F27
G27
F29
E29
J24
K24
H26
G26
J25
K25
B34
N28
L26
H29
G32
G18
F19
J18
J19
B20
A21
A20
D19
D20
C20
D21
C21
B22
A22
A23
B23
B25
A26
A24
A25
B26
A27
F20
E20
H20
G20
H19
J20
D23
C23
D22
D25
D24
C24
F21
G21
F22
E22
E23
G22
E26
H23
H26
DQS for X4 for F1517
DQ24T
DQS24T
DQSn24T
DQ24T
DQ24T
DQ25T
DQ25T
DQ25T
DQ25T
DQS25T
DQSn25T
DQ26T
DQ26T
DQS26T
DQSn26T
DQ26T
DQ26T
DQ27T
DQ27T
DQ27T
DQ27T
DQS27T
DQSn27T
DQ28T
DQ28T
DQS28T
DQSn28T
DQ28T
DQ28T
DQ29T
DQ29T
DQ29T
DQ29T
DQS29T
DQSn29T
DQ30T
DQ30T
DQS30T
DQSn30T
DQ30T
DQ30T
DQ31T
DQ31T
DQ31T
DQ31T
DQS31T
DQSn31T
DQ32T
DQ32T
DQS32T
DQSn32T
DQ32T
DQ32T
DQ33T
DQ33T
DQ33T
DQ33T
DQS33T
DQSn33T
DQ34T
DQ34T
DQS34T
DQSn34T
DQ34T
DQ34T
DQ35T
DQ35T
DQ35T
DQ35T
DQS35T
DQSn35T
DQ36T
DQ36T
DQS36T
DQSn36T
DQ36T
DQ36T
DQ37T
DQ37T
DQ37T
DQ37T
DQS37T
DQSn37T
DQ38T
DQ38T
DQS38T
DQSn38T
DQ38T
DQ38T
DQS for X8/X9 for
F1517
DQ27T
DQ27T/CQn27T
DQ27T
DQ27T
DQ27T
DQ28T
DQ28T
DQ28T
DQ28T
DQS28T/CQ28T
DQSn28T/DQ28T
DQ28T
DQ28T
DQ28T/CQn28T
DQ28T
DQ28T
DQ28T
DQ29T
DQ29T
DQ29T
DQ29T
DQS29T/CQ29T
DQSn29T/DQ29T
DQ29T
DQ29T
DQ29T/CQn29T
DQ29T
DQ29T
DQ29T
DQ30T
DQ30T
DQ30T
DQ30T
DQS30T/CQ30T
DQSn30T/DQ30T
DQ30T
DQ30T
DQ30T/CQn30T
DQ30T
DQ30T
DQ30T
DQ35T
DQ35T
DQ35T
DQ35T
DQS35T/CQ35T
DQSn35T/DQ35T
DQ35T
DQ35T
DQ35T/CQn35T
DQ35T
DQ35T
DQ35T
DQ36T
DQ36T
DQ36T
DQ36T
DQS36T/CQ36T
DQSn36T/DQ36T
DQ36T
DQ36T
DQ36T/CQn36T
DQ36T
DQ36T
DQ36T
DQ37T
DQ37T
DQ37T
DQ37T
DQS37T/CQ37T
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DQ37T
DQ37T
DQ37T/CQn37T
DQ37T
DQ37T
DQ37T
DQ38T
DQ38T
DQ38T
DQ38T
DQS38T/CQ38T
DQSn38T/DQ38T
DQ38T
DQ38T
DQ38T/CQn38T
DQ38T
DQ38T
DQ38T
Pin List
DQS for X16/X18 for
F1517 (Note 1)
DQ29T
DQS29T/CQ29T
DQSn29T/DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T/CQn29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ29T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQS30T/CQ30T
DQSn30T/DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T/CQn30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQS37T/CQ37T
DQSn37T/DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T/CQn37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ37T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQS38T/CQ38T
DQSn38T/DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T/CQn38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQS for X32/X36 for
F1517 (Note 1)
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQS30T/CQ30T
DQSn30T/DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T/CQn30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQS38T/CQ38T
DQSn38T/DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T/CQn38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQ38T
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQ27T
DQ27T
DQ27T
DQ27T
DQS27T
DQSn27T
DQ28T
DQ28T
DQS28T
DQSn28T
DQ28T
DQ28T
DQ29T
DQ29T
DQ29T
DQ29T
DQS29T
DQSn29T
DQ30T
DQ30T
DQS30T
DQSn30T
DQ30T
DQ30T
DQ29T
DQ29T
DQ29T
DQ29T
DQS29T/CQ29T
DQSn29T/DQ29T
DQ29T
DQ29T
DQ29T/CQn29T
DQ29T
DQ29T
DQ29T
DQ30T
DQ30T
DQ30T
DQ30T
DQS30T/CQ30T
DQSn30T/DQ30T
DQ30T
DQ30T
DQ30T/CQn30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQS30T/CQ30T
DQSn30T/DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T/CQn30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ30T
DQ33T
DQ33T
DQ33T
DQ33T
DQS33T
DQSn33T
DQ34T
DQ34T
DQS34T
DQSn34T
DQ34T
DQ34T
DQ35T
DQ35T
DQ35T
DQ35T
DQS35T
DQSn35T
DQ36T
DQ36T
DQS36T
DQSn36T
DQ36T
DQ36T
DQ37T
DQ37T
DQ37T
DQ37T
DQS37T
DQSn37T
DQ38T
DQ38T
DQS38T
DQSn38T
DQ38T
DQ38T
DQ36T
DQ36T
DQ36T
DQ36T
DQS36T/CQ36T
DQSn36T/DQ36T
DQ36T
DQ36T
DQ36T/CQn36T
DQ36T
DQ36T
DQ36T
DQ37T
DQ37T
DQ37T
DQ37T
DQS37T/CQ37T
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DQ38T
DQ38T
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DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
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DQ33T
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DQ33T
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DQ34T
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DQ35T
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DQ35T
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DQ36T
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
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VCCL
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F1517 (Note 1)
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F1517 (Note 1)
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
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AH13
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AC15
AF18
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AM3
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AC6
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AD9
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AA3
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U5
T10
T3
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R3
P6
H7
N7
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AF13
L7
N3
E3
K3
H7
C7
F7
F11
C4
C10
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C13
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F17
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C25
G22
C11
G14
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G25
D29
C25
F23
E19
C22
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Page 12 of 23
Pin Information for the Stratix® III EP3SL200 Device
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VCCL
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VCCL
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VCCL
VCCL
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U24
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N21
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F1517 (Note 1)
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F1517 (Note 1)
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
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AM32
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AJ26
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AJ32
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AJ38
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AF2
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Y24
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W12
W14
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V13
V15
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U12
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U24
U27
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P27
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L24
L27
K13
K15
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H9
H12
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H21
H24
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DQS for X8/X9 for
F1517
Pin List
DQS for X16/X18 for
F1517 (Note 1)
DQS for X32/X36 for
F1517 (Note 1)
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
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PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
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Dedicated Tx/Rx
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U8
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T24
T26
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R25
P2
P5
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F5
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H780
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F1517
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DQS for X16/X18 for
H780 (Note 1)
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VREF
VREF1A
VREF1B
VREF1C
VREF2C
VREF2B
VREF2A
VREF3A
VREF3B
VREF3C
VREF4C
VREF4B
VREF4A
VREF5A
VREF5B
VREF5C
VREF6C
VREF6B
VREF6A
VREF7A
VREF7B
VREF7C
VREF8C
VREF8B
VREF8A
Pin Name/Function
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
VCCPD1A
VCCPD1B
VCCPD1C
VCCPD2C
VCCPD2B
VCCPD2A
VCCPD3A
VCCPD3B
VCCPD3C
VCCPD4C
VCCPD4B
VCCPD4A
VCCPD5A
VCCPD5B
VCCPD5C
VCCPD6C
VCCPD6B
VCCPD6A
VCCPD7A
VCCPD7B
VCCPD7C
VCCPD8C
VCCPD8B
VCCPD8A
VREF1A
VREF1B
VREF1C
VREF2C
VREF2B
VREF2A
VREF3A
VREF3B
VREF3C
VREF4C
VREF4B
VREF4A
VREF5A
VREF5B
VREF5C
VREF6C
VREF6B
VREF6A
VREF7A
VREF7B
VREF7C
VREF8C
VREF8B
VREF8A
VCCPT
VCCPT
VCCPT
VCCPT
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Optional Function(s)
VREF1A
VREF1B
VREF1C
VREF2C
VREF2B
VREF2A
VREF3A
VREF3B
VREF3C
VREF4C
VREF4B
VREF4A
VREF5A
VREF5B
VREF5C
VREF6C
VREF6B
VREF6A
VREF7A
VREF7B
VREF7C
VREF8C
VREF8B
VREF8A
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel
F1517
L29
L35
L38
H2
H5
H8
H11
H14
H17
H20
H23
H26
H29
H32
H35
H38
E2
E5
E8
E11
E14
E17
E20
E23
E26
E29
E32
E35
E38
B2
B5
B8
B11
B14
B17
B20
B23
B26
B29
B32
B35
B38
P27
T27
V27
Y27
AB27
AF27
AG26
AG24
AG22
AG20
AG18
AG16
AF13
AD13
AB13
Y13
V13
P13
N14
N16
N18
N20
N22
N24
K31
R32
V32
Y34
AD32
AJ30
AP30
AM24
AN20
AN17
AM16
AM12
AK9
AE8
AB8
Y6
T8
L10
F10
H16
G20
G23
H24
H28
J32
Y33
AL32
AL20
F1152
H780
N23
L19
R23
W23
N19
R19
AA23
AC23
AC21
AC19
AC17
AC15
AC13
AB12
W15
W13
Y12
T12
T10
P10
P12
M12
M14
M16
M18
M20
M22
J26
M10
K12
P26
V27
N22
U22
AA26
AG25
AG22
AH20
AH16
AG13
AG10
AF7
AA16
AA12
AA9
U8
T7
M7
P9
H10
H13
G15
G19
H22
H25
J27
U29
AG27
AJ17
J7
G11
DQS for X4 for F1517
DQS for X8/X9 for
F1517
DQS for X16/X18 for
F1517 (Note 1)
DQS for X32/X36 for
F1517 (Note 1)
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
U19
W17
W11
V10
K14
K16
K18
K22
Y22
AB18
AB10
W7
H13
H17
G19
G23
R24
AC23
AD15
Pin List
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Bank Number
VREF
Pin Name/Function
VCCPT
VCCPT
VCCPT
VCCPT
VCCPGM
VCCPGM
VCCBAT
NC
NC
NC
NC
NC
NC
Optional Function(s)
Configuration
Function
NC
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel
F1517
AL8
Y7
J8
J20
AJ31
AJ10
K8
AP35
AD27
T13
N12
N28
L30
F1152
AG7
V6
H8
F18
AD24
AD10
G6
AK30
AC10
M25
L11
L25
K26
H780
AB6
P5
G6
E14
AA21
Y8
F6
AE25
V9
U20
M9
L20
K10
DQS for X4 for F1517
DQS for X8/X9 for
F1517
DQS for X16/X18 for
F1517 (Note 1)
DQS for X32/X36 for
F1517 (Note 1)
DQS for X4 for F1152
DQS for X8/X9 for
F1152 (Note 1)
DQS for X16/X18 for
F1152 (Note 1)
DQS for X4 for H780
DQS for X8/X9 for
H780 (Note 1)
DQS for X16/X18 for
H780 (Note 1)
J21
Note:
(1) When not used as clocks, the CQn and DQSn pins can be used as DQ pins.
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Pin List
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Version 1.1
Notes (1), (2)
Pin Name
Pin Type (1st and 2nd
Function)
VCCL
Power
Pin Description
Supply and Reference Pins
VCCL supplies power to the core voltage power supply pins.
VCC
Power
VCC supplies power to the periphery circuitry.
RUP[1..8]A
I/O, Input
Reference pins for I/O banks. The RUP pins share the same VCCIO with the I/O bank where they are located. The
external precision resistor RUP must be connected to the designated RUP pin within the bank. If not required, this pin is a
regular I/O pin.
RDN[1..8]A
I/O, Input
Reference pins for I/O banks. The RDN pins share the same GND with the I/O bank where they are located. The external
precision resistor RDN must be connected to the designated RDN pin within the bank. If not required, this pin is a regular
I/O pin.
VCCIO[1..8][A,B,C]
Power
These are I/O supply voltage pins for banks 1 through 8. Each bank can support a different voltage level. VCCIO supplies
power to the output buffers for all LVDS, LVCMOS(1.2 V, 1.5 V, 1.8 V, 2.5 V, 3.0 V, 3.3 V), HSTL(12, 15, 18), SSTL(15,
18, 2), 3.0-V PCI/PCI-X I/O, and LVTTL(3.0 V, 3.3 V) I/O standards. VCCIO also supplies power to the input buffers used
for LVCMOS(1.2 V, 1.5 V, 1.8 V, 2.5 V, 3.0 V, 3.3 V), 3.0-V PCI/PCI-X and LVTTL(3.0 V, 3.3 V) I/O standards.
VREF[1..8][A,B,C]
Power
VCCA_PLL[L[1:4],R[1:4],T[1:2],B[1:2]]
Power
Input reference voltage for each I/O bank. If a bank uses a voltage-referenced I/O standard, then these pins are used as
the voltage-referenced pins for the bank.
Analog power for PLLs[L[1:4],R[1:4],T[1:2],B[1:2]]. You must connect these pins to 2.5 V, even if the PLL is not used. You
are advised to keep this pin isolated from other VCC for better jitter performance.
VCCD_PLL[L[1:4],R[1:4],T[1:2],B[1:2]]
Power
Digital power for PLLs[L[1:4],R[1:4],T[1:2],B[1:2]]. You must connect these pins to 1.1 V, even if the PLL is not used.
VCCPT
Power
Power supply for the programmable power technology. Connect to 2.5 V.
VCCPGM
Power
Power supply for configuration pins. Can be connected to 1.8 V, 2.5 V, 3.0 V, or 3.3 V depending on the
particular design.
VCCPD[1..8][A,B,C]
Power
Dedicated power pins. This supply is used to power the I/O pre-drivers. This can be connected to 3.3 V, 3.0 V, or 2.5 V.
VCCPD for 3.3-V I/O standard is 3.3 V, VCCPD for 3.0-V I/O standard is 3.0 V, and VCCPD for 2.5-V/1.8-V/1.2-V I/O
standards is 2.5 V.
VCCBAT
Power
Battery back-up power supply for design security volatile key register. Connect to 2.5 V.
VCC_CLKIN[3,4,7,8]
GND
DNU
Power
Ground
Do Not Use
Differential clock input power supply for top and bottom I/O banks. Connect to 2.5 V.
Device ground pins.
NC
No Connect
Do not drive signals into these pins.
nIO_PULLUP
Input
TEMPDIODEp
TEMPDIODEn
MSEL[3..0]
Input
Input
Input
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Do not connect to power or ground or any other signal; must be left floating.
Dedicated Configuration/JTAG Pins
Dedicated input that chooses whether the internal pull-ups on the user I/O pins and dual-purpose I/O pins (nCSO, ASDO,
DATA[7..0], CLKUSR, INIT_DONE, DEV_OE, DEV_CLRn) are on or off before and during configuration. A logic high (1.5
V, 1.8 V, 2.5 V, 3.0 V, or 3.3 V) turns off the weak pull-up, while a logic low turns them on.
Pin used in conjunction with the temperature-sensing diode (bias-high input) inside the Stratix III device.
Pin used in conjunction with the temperature-sensing diode (bias-low input) inside the Stratix III device.
Configuration input pins that set the Stratix III device configuration scheme.
Pin Definitions
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Notes (1), (2)
Pin Name
nCE
Pin Type (1st and 2nd
Function)
Input
nCONFIG
Input
Dedicated configuration control input. Pulling this pin low during user mode will cause the FPGA to lose its configuration
data, enter a reset state, and tri-state all I/O pins. Returning this pin to a logic high level will initiate reconfiguration.
CONF_DONE
Bidirectional
(open-drain)
nCEO
nSTATUS
Output
Bidirectional
(open-drain)
PORSEL
Input
TCK
TMS
TDI
TDO
TRST
Input
Input
Input
Output
Input
This is a dedicated configuration Done pin. As a status output, the CONF_DONE pin drives low before and during
configuration. Once all configuration data is received without error and the initialization cycle starts, CONF_DONE is
released. As a status input, CONF_DONE goes high after all data is received. Then the device initializes and enters user
mode. It is not available as a user I/O pin.
Output that drives low when device configuration is complete.
This is a dedicated configuration status pin. The FPGA drives nSTATUS low immediately after power-up and releases it
after POR time. As a status output, the nSTATUS is pulled low if an error occurs during configuration. As a status input,
the device enters an error state when nSTATUS is driven low by an external source during configuration or initialization. It
is not available as a user I/O pin.
Dedicated input that selects between a POR time of 12 ms or 100 ms. A logic high (1.5 V, 1.8 V, 2.5 V, 3.0 V, 3.3 V)
selects a POR time of 12 ms and a logic low selects POR time of 100 ms.
Dedicated JTAG input pin. Connect TCK to GND if the JTAG circuitry is not used.
Dedicated JTAG input pin. Connect TMS to VCCPD if the JTAG circuitry is not used.
Dedicated JTAG input pin. Connect TDI to VCCPD if the JTAG circuitry is not used.
Dedicated JTAG output pin.
Dedicated active-low JTAG input pin. TRST is used to asynchronously reset the JTAG boundary-scan circuit.
CLK[1,3,8,10]p
Clock, Input
CLK[1,3,8,10]n
Clock, Input
CLK[0,2,9,11]p
CLK[0,2,9,11]n
I/O, Clock
I/O, Clock
CLK[4..7,12..15]p
I/O, Clock
CLK[4..7,12..15]n
I/O, Clock
PLL_[L1,L4,R1,R4]_CLKp
PLL_[L1,L4,R1,R4]_CLKn
PLL_[L2,L3,R2,R3]_CLKOUT0n
Clock, Input
Clock, Input
I/O, Clock
PLL_[L2,L3,R2,R3]_FB_CLKOUT0p
PLL_[T1,T2,B1,B2]_FBp/CLKOUT1
PLL_[T1,T2,B1,B2]_FBn/CLKOUT2
PLL_[T1,T2,B1,B2]_CLKOUT[3,4]
PLL_[T1,T2,B1,B2]_CLKOUT0[p,n]
I/O, Clock
I/O, Clock
I/O, Clock
I/O, Clock
I/O, Clock
PT-EP3SL200-1.1
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Pin Description
Dedicated active-low chip enable. When nCE is low, the device is enabled. When nCE is high, the device is disabled.
Clock and PLL Pins
Dedicated high-speed clock input pins 1, 3, 8, and 10 that can also be used for data inputs. OCT Rd is not supported on
these pins.
Dedicated negative clock input pins for differential clock input that can also be used for data inputs. OCT Rd is not
supported on these pins.
These pins can be used as I/O pins or clock input pins. OCT Rd is supported on these pins.
These pins can be used as I/O pins or negative clock input pins for differential clock inputs. OCT Rd is supported on
these pins.
These pins can be used as I/O pins or clock input pins. OCT Rd is not supported on these pins.
These pins can be used as I/O pins or negative clock input pins for differential clock inputs. OCT Rd is not supported on
these pins.
Dedicated clock input pins to PLL L1, L4, R1, and R4 respectively.
Dedicated negative clock input pins for dfferential clock input to PLL L1, L4, R1, and R4 respectively.
Each left and right PLL supports 2 clock I/O pins, configured either as 2 single-ended I/O or one differential I/O pair.
When using both pins as single-ended I/Os, PLL_#_CLKOUT0n can be the clock output while the PLL_#_FB_CLKOUT0p
is the external feedback input pin.
Dual-purpose I/O pins that can be used as two single-ended outputs or one differential external feedback input pin.
These pins can be used as I/O pins or two single-ended clock ouput pins.
I/O pins that be used as two single-ended clock output pins or one differential clock output pair.
Pin Definitions
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Notes (1), (2)
Pin Name
Pin Type (1st and 2nd
Function)
Pin Description
Optional/Dual-Purpose Configuration Pins
Dedicated output control signal from the Stratix III FPGA to the serial configuration device in AS mode that enables the
configuration device.
Control signal from the Stratix III FPGA to the serial configuration device in AS mode used to read out configuration data.
nCSO
I/O, Output
ASDO
I/O, Output
DCLK
Input (PS, FPP)
Output (AS)
CRC_ERROR
I/O, Output
DEV_CLRn
I/O, Input
Optional pin that allows you to override all clears on all device registers. When this pin is driven low, all registers are
cleared; when this pin is driven high (VCCPGM), all registers behave as programmed.
DEV_OE
I/O, Input
DATA0
I/O, Input
Optional pin that allows you to override all tri-states on the device. When this pin is driven low, all I/O pins are tri-stated;
when this pin is driven high (VCCPGM), all I/O pins behave as defined in the design.
Dual-purpose configuration data input pin. The DATA0 pin can be used for bit-wide configuration or as an I/O pin after
configuration is complete.
DATA[7..1]
I/O, Input
Dual-purpose configuration data input pins. The DATA[7..0] pins can be used for byte-wide configuration or as regular I/O
pins. These pins can also be used as user I/O pins after configuration.
INIT_DONE
I/O, Output
(open-drain)
This is a dual-purpose pin and can be used as an I/O pin when not enabled as INIT_DONE. When enabled, a transition
from low to high at the pin indicates when the device has entered user mode. If the INIT_DONE output is enabled, the
INIT_DONE pin cannot be used as a user I/O pin after configuration.
CLKUSR
I/O, Input
Optional user-supplied clock input. Synchronizes the initialization of one or more devices. If this pin is not enabled for use
as a user-supplied configuration clock, it can be used as a user I/O pin.
DIFFIO_RX[##]p/n
I/O, RX channel
DIFFIO_TX[##]p/n
I/O, TX channel
These are true LVDS transmitter channels on side I/O banks. Pins with a "p" suffix carry the positive signal for the
differential channel. Pins with an "n" suffix carry the negative signal for the differential channel. If not used for differential
signaling, these pins are available as user I/O pins.
DIFFOUT_[##]p/n
I/O, TX channel
These are emulated LVDS output channels. On column I/O banks, there are true LVDS input buffers, but no
true LVDS output buffers. However, all column user I/Os, including I/Os with true LVDS input buffers, can be configured
as emulated LVDS output buffers. Pins with a "p" suffix carry the positive signal for the differential channel. Pins with an
"n" suffix carry the negative signal for the differential channel. If not used for differential signaling, these pins are available
as user I/O pins.
DQS[1..44][T,B], DQS[1..40][L,R]
I/O, DQS
DQSn[1..44][T,B], DQSn[1..40][L,R]
I/O, DQSn
PT-EP3SL200-1.1
Copyright © 2008 Altera Corp.
Dedicated configuration clock pin. In PS and FPP configuration modes, DCLK is used to clock configuration data from an
external source into the Stratix III device. In AS mode, DCLK is an output from the Stratix III device that provides timing
for the configuration interface.
Active-high signal that indicates that the error detection circuit has detected errors in the configuration SRAM bits. This
pin is optional and is used when the CRC error detection circuit is enabled.
Differential I/O Pins
These are true LVDS receiver channels on side and column I/O banks. Pins with a "p" suffix carry the positive signal for
the differential channel. Pins with an "n" suffix carry the negative signal for the differential channel. If not used for
differential signaling, these pins are available as user I/O pins.
External Memory Interface Pins
Optional data strobe signal for use in external memory interfacing. These pins drive to dedicated DQS phase-shift
circuitry. The shifted DQS signal can also drive to internal logic.
Optional complementary data strobe signal for use in QDRII SRAM. These pins drive to dedicated DQS phase-shift
circuitry.
Pin Definitions
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Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
Notes (1), (2)
Pin Name
DQ[1..44][T,B],DQ[1..40][L,R]
Pin Type (1st and 2nd
Function)
I/O, DQ
CQ[1..44][T,B], CQ[1..40][L,R]
DQS
Optional data strobe signal for use in QDRII SRAM. These are the pins for echo clocks.
CQn[1..44][T,B], CQ[1..40][L,R]
DQS
Optional complementary data strobe signal for use in QDRII SRAM. These are the pins for echo clocks.
Pin Description
Optional data signal for use in external memory interfacing. The order of the DQ bits within a designated DQ bus is not
important; however, use caution when making pin assignments if you plan on migrating to a different memory interface
that has a different DQ bus width. Analyze the available DQ pins across all pertinent DQS columns in the pin list.
Notes:
(1) The pin definitions are prepared based on the device with the largest density, EP3SL340. Refer to the pin list for the availability of pins in each density.
(2) Some of the pull-up or pull-down resistors mentioned in the table above may not be required, depending on the exact device configuration scheme.
Should you be required to use a different configuration scheme, the ability to NC or short them may be valuable during the debug phase.
For more information, refer to the Configuring Stratix III Devices chapter in volume 1 of the Stratix III Device Handbook .
PT-EP3SL200-1.1
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Pin Definitions
Page 21 of 23
Pin Information for the Stratix® III EP3SL200 Device
Version 1.1
8C
VREF8A
VREF8B
VREF8C
PLL_T1
PLL_T2
7C
7B
7A
VREF7C
VREF7B
VREF7A
6B
1B
6A
PLL_R1
6C
VREF6C VREF6B VREF6A
8B
1A
8A
1C
VREF1C VREF1B VREF1A
PLL_L1
PLL_R3
2C
5A
5B
2B
2A
PLL_L4
3A
3B
3C
VREF3A
VREF3B
VREF3C
PLL_B1
PLL_B2
4C
4B
4A
VREF4C
VREF4B
VREF4A
VREF5A VREF5B VREF5C
PLL_L3
5C
PLL_R2
VREF2A VREF2B VREF2C
PLL_L2
PLL_R4
Note:
1. This is only a pictorial representation to provide an idea of placement on the device. Refer to the pin list and the Quartus® II software for exact locations.
PT-EP3SL200-1.1
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Bank & PLL Diagram
Page 22 of 23
Pin Information for the Stratix ® III EP3SL200 Device
Version 1.1
Version Number
1.0
Date
12/14/2007
1.1
4/25/2008
PT-EP3SL200-1.0
Copyright © 2008 Altera Corp.
Changes Made
Initial release.
Updated naming convention of DQ/DQS group for H780 package to match pin planner in
Quartus II software and ORCAD symbol files.
Revision History
Page 23 of 23