[AK4454] AK4454 115dB 768kHz 32-bit 4ch Premium DAC 1. 概 要 AK4454 は新開発の歪低減技術により業界最高水準の低歪特性を実現した 32-bit 4ch Premium DAC です。 最大 768kHz の PCM 入力と 11.2MHz の DSD 入力に対応しているため、ネットワークオーディオ、 USB-DAC、カーオーディオシステム等で普及の進むハイレゾリューション音源の再生に最適です。また、 新規搭載の OSR-Doubler 技術により広い信号帯域・低帯域外ノイズ特性と低消費電力を両立すると共に、 5 種類の 32-bit Digital Filter を内蔵しているため、様々なアプリケーションで柔軟かつ容易に音質作りが 可能です。 アプリケーション：AVレシーバー、CD/SACD プレイヤー、ネットワークオーディオ、USB DAC、USB ヘッドフォン、Sound Plate/Bar、カーオーディオ、車載用別体アンプ、計測器、測 定器、制御システム。 2. 特 長 (1) (2) (3) (4) (5) DR, S/N: 115dB THD+N: -107dB 256倍オーバサンプリング サンプリングレート: 8kHz 768kHz 32ビット8倍ディジタルフィルタ - Ripple: 0.0032dB, Attenuation: 80dB(シャープロールオフフィルタ設定時) 5種類の高音質フィルタオプション ・シャープロールオフフィルタ ・スローロールオフフィルタ ・ショートディレイ シャープロールオフフィルタ（GD=5.8/fs） ・ショートディレイ スローロールオフフィルタ（GD=4.8/fs） ・スーパースローロールオフフィルタ (6) 強ジッタ耐力 (7) 低歪差動出力 (8) DSD入力対応 (9) Daisy Chain (10) 32, 44.1,48kHz対応ディジタルディエンファシス内蔵 (11) ソフトミュート (12) ディジタルATT(255 levels and 0.5dB step) (13) オーディオI/Fフォーマット: - 24/32 ビット前詰め, - 16/20/24/32 ビット後詰め, - I2S, - DSD, - TDM (14) 3-wire Serial and I2C μP I/F (15) マスタクロック: - 30kHz ~ 32kHz: 1152fs - 30kHz ~ 54kHz: 512fs or 768fs - 30kHz ~ 108kHz: 256fs or 384fs - 108kHz ~ 216kHz: 128fs or 192fs ~ 384kHz: 64fs or 128fs ~ 768kHz: 64fs 015006358-J-01 2015/08 -1- [AK4454] (16) ディジタル入力レベル: CMOS (17) 電源電圧: - TVDD=1.7 3.6V, - AVDD=3.0 5.5V (18) 105℃対応(Tabを基板のグラウンドに接続した場合) (19) パッケージ: 32ピン QFN 015006358-J-01 2015/08 -2- [AK4454] 3. 目 次 概 要 ............................................................................................................................................................... 1 特 長 ............................................................................................................................................................... 1 目 次 ............................................................................................................................................................... 3 ブロック図と機能説明 ................................................................................................................................... 5 ■ ブロック図 ..................................................................................................................................................... 5 ■ 機能説明 ......................................................................................................................................................... 6 5. ピン配置と機能説明 ....................................................................................................................................... 7 ■ オーダリングガイド ..................................................................................................................................... 7 ■ ピン配置 ......................................................................................................................................................... 7 ■ 機能説明 ......................................................................................................................................................... 8 ■ 使用しないピンの処理について ................................................................................................................. 9 6. 絶対最大定格 ................................................................................................................................................. 10 7. 推奨動作条件 ................................................................................................................................................. 10 8. 電気的特性 ..................................................................................................................................................... 11 ■ アナログ特性 ............................................................................................................................................... 11 ■ シャープロールオフ・フィルタ特性 ....................................................................................................... 13 ■ スローロールオフ・フィルタ特性 ........................................................................................................... 14 ■ ショートディレイシャープロールオフフィルタ特性............................................................................ 15 ■ ショートディレイスローロールオフフィルタ特性................................................................................ 16 ■ DSDモード特性 ........................................................................................................................................... 17 ■ DC特性.......................................................................................................................................................... 17 ■ スイッチング特性 ....................................................................................................................................... 18 ■ タイミング波形 ........................................................................................................................................... 22 9. 動作説明 ......................................................................................................................................................... 26 ■ D/A変換モード ............................................................................................................................................ 26 ■ システムクロック ....................................................................................................................................... 26 ■ オーディオインタフェースフォーマット................................................................................................ 30 ■ D/A変換モード切り替えタイミング......................................................................................................... 42 ■ Digital Filter（PCM mode） ........................................................................................................................ 43 ■ ディエンファシスフィルタ（PCM mode） ............................................................................................. 43 ■ 出力ボリューム（PCM mode、DSD mode） ........................................................................................... 44 ■ 帯域外ノイズ除去フィルタ（PCM mode、DSD mode） ....................................................................... 45 ■ ゼロ検出機能（PCM mode、DSD mode） ............................................................................................... 51 ■ LRチャネル出力信号選択機能 (PCM mode, DSD mode)........................................................................ 51 ■ 音質調整機能(PCM, DSD) .......................................................................................................................... 52 ■ DSD信号フルスケール (FS) 検出機能 .................................................................................................... 53 ■ ソフトミュート機能（PCM mode、DSD mode） ................................................................................... 54 ■ エラー検出 ................................................................................................................................................... 55 ■ システムリセット ....................................................................................................................................... 55 ■ パワーダウン機能 ....................................................................................................................................... 56 ■ パワーオフ、リセット機能 ....................................................................................................................... 57 ■ 同期化機能（PCM mode） ......................................................................................................................... 60 ■ パラレルモード（PCM mode） ................................................................................................................. 61 ■ レジスタコントロールインタフェース ................................................................................................... 61 ■ ファンクションリスト ............................................................................................................................... 66 ■ レジスタマップ ........................................................................................................................................... 67 ■ 詳細説明 ....................................................................................................................................................... 68 10. 外部接続回路例 ......................................................................................................................................... 76 1. 2. 3. 4. 015006358-J-01 2015/08 -3- [AK4454] ■ システム接続例 ........................................................................................................................................... 76 11. パッケージ ................................................................................................................................................. 80 ■ 外形寸法図 ................................................................................................................................................... 80 ■ 材質・メッキ仕様 ....................................................................................................................................... 80 ■ マーキング ................................................................................................................................................... 81 12. 改訂履歴 ..................................................................................................................................................... 81 重要な注意事項 ..................................................................................................................................................... 82 015006358-J-01 2015/08 -4- [AK4454] 4. ブロック図と機能説明 ■ ブロック図 LDOE TVDD VDD18 DVSS PDN AVDD AVSS Bias LDO BICK/DCLK DATT Soft Mute LRCK/DSDL1 8X Interpolator SCF AOUTLP1 AOUTLN1 SDTI1/DSDR1 SDTI2/DSDL2 DSDR2/TDMO1 PCM Data Interface De-empha sis Modulator DATT Soft Mute DSD Filter Vref VREFH1 VREFL1 Noise Rejection Filter SCF AOUTRP1 AOUTRN1 DATT Soft Mute 8X Interpolator SCF AOUTLP2 AOUTLN2 DSD Data Interface Modulator DATT Soft Mute DSD Filter Vref VREFH2 VREFL2 Noise Rejection Filter SCF AOUTRP2 AOUTRN2 DZF/SMUTE CAD1/DCHAIN I2C CAD0_I2C/CSN/DIF Control Register SCL/CCLK/TDM1 Clock Divider SDA/CDTI/TDM0 MCLK PS/CAD0_SPI Figure 1. AK4454 Block Diagram 015006358-J-01 2015/08 -5- [AK4454] ■ 機能説明 ブロック 機能 PCM Data Interface LRCK､BICK に同期して､SDTI より入力される 32bit データをシリアル／パラ レル変換する｡ DSD Data Interface DCLK に同期して DSDL1-2、DSDR1-2 より入力される 1-bit データを取り込む｡ DATT、Soft Mute 入力されたデータに DATT、Soft Mute の処理を行う。 De-emphasis 入力されたデータに De-emphasis の処理を行う。 1fs レートで入力されたデータを 8fs レートにオーバーサンプリングするディ ジタル FIR フィルタ。 3 次ディジタル ΔΣ モジュレータで構成され､SCF にマルチビットデータを出力 する｡ 8x Interpolator ΔΣ Modulator Noise Rejection Filter 帯域外ノイズを減衰し、アナログ特性の劣化を防ぐ。 SCF ΔΣ モジュレータのマルチビット出力をアナログ信号に変換する１次 SCF(カッ トオフ周波数は fs レートに比例)で構成されている。 LDO 内部ディジタル回路用電源(1.8Vtyp)を生成する。 Control Register レジスタに書き込まれる各モードの設定を保持する。 Clock Divider マスタークロックを入力する｡PCM mode ではクロックの fs ﾚｰﾄ自動検出機能に よりマスタークロックを自動で分周する｡DSD mode では DCKS でマスターク ロック周波数を設定する。 015006358-J-01 2015/08 -6- [AK4454] 5. ピン配置と機能説明 オーダリングガイド AK4454VN AKD4454 VREFH2 AOUTL2N AOUTL2P AVDD AVSS AOUTR1P AOUTR1N VREFH1 24 23 22 21 20 19 18 17 ピン配置 VREFL2 25 16 VREFL1 AOUTR2N 26 15 AOUTL1N AOUTR2P 27 14 AOUTL1P LDOE 28 13 I2C TVDD 29 12 PS/CAD0_SPI DVSS 30 11 CAD0_I2C/CSN/DIF VDD18 31 10 SCL/CCLK/TDM1 PDN 32 9 SDA/CDTI /TDM0 Top View 7 8 CAD1/DCHAIN 5 SDTI2/DSDL2 DZF/SMUTE 4 SDTI1/DSDR1 6 3 LRCK/DSDL1 DSDR2/TDMO1 2 BICK/DCLK Back Tab:Note 1 ■ -40～105°C (Tabを基板のグラウンドに接続した場合) -40～85°C (Tabをオープンにした場合) 32-pin QFN AK4454用評価ボード MCLK ■ Note 1. Tabはオープンまたは基板のグラウンドに接続してください。 015006358-J-01 2015/08 -7- [AK4454] ■ 機能説明 No. Pin Name 1 MCLK BICK 2 DCLK LRCK 3 DSDL1 SDTI1 4 DSDR1 SDTI2 5 DSDL2 DSDR2 6 TDMO1 DZF 7 8 9 10 11 SMUTE CAD1 DCHAIN SDA CDTI TDM0 SCL CCLK TDM1 CAD0_I2C CSN I/O I I I I I I I I I I O O I I I I/O I I I I I I I DIF I PS I 12 CAD0_SPI I 13 I2C I 14 15 16 17 18 19 20 21 22 23 24 25 AOUTL1P AOUTL1N VREFL1 VREFH1 AOUTR1N AOUTR1P AVSS AVDD AOUTL2P AOUTL2N VREFH2 VREFL2 O O I I O O O O I I Function External Master Clock Input Pin Audio Serial Data Clock Pin in PCM mode DSD Clock Pin in DSD mode Input Channel Clock Pin in PCM mode Audio Serial Data Input in DSD mode Audio Serial Data Input in PCM mode Audio Serial Data Input in DSD mode Audio Serial Data Input in PCM mode Audio Serial Data Input in DSD mode Audio Serial Data Input in DSD mode Audio Serial Data Output in Daisy Chain mode Zero Input Detect in I2C Bus or 3-wire serial control mode Soft Mute Pin in Parallel control mode. When this pin is changed to “H”, soft mute cycle is initiated. When returning “L”, the output mute releases. Chip Address 0 Pin in I2C Bus or 3-wire serial control mode Daisy Chain Mode select pin in Parallel control mode. Control Data Input Pin in I2C Bus serial control mode Control Data Input Pin in 3-wire serial control mode TDM Mode select pin in Parallel control mode. Control Data Clock Pin in I2C Bus serial control mode Control Data Clock Pin in 3-wire serial control mode TDM Mode select pin in Parallel control mode. Chip Address 0 Pin in I2C Bus serial control mode Chip Select Pin in 3-wire serial control mode Audio Data Format Select in Parallel control mode. “L”：32-bit MSB, “H”：32-bit I2S (I2C pin = “H”) Control Mode Select Pin “L”: I2C Bus serial control mode ,“H”: Parallel control mode. (I2C pin = “L”) Chip Address 0 Pin in 3-wire serial control mode Control Mode Select Pin “L”: 3-wire serial control mode “H”: I2C Bus serial control mode or Parallel control mode. L ch Positive Analog Output 1 Pin L ch Negative Analog Output 1 Pin Negative Voltage Reference Input Pin, AVSS Positive Voltage Reference Input Pin, AVDD R ch Negative Analog Output 1 Pin R ch Positive Analog Output 1 Pin Analog Ground Pin Analog Power Supply Pin, 3.0V5.5V L ch Positive Analog Output 2 Pin L ch Negative Analog Output 2 Pin Positive Voltage Reference Input Pin, AVDD Negative Voltage Reference Input Pin, AVSS 015006358-J-01 PD状態 Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z 100kΩ Pull down 100kΩ Pull down Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z Hi-Z － － Hi-Z Hi-Z Hi-Z Hi-Z 2015/08 -8- [AK4454] Function PD状態 R ch Negative Analog Output 2 Pin Hi-Z R ch Positive Analog Output 2 Pin Hi-Z Internal LDO Enable Pin. 28 LDOE I Hi-Z “L”: Disable, “H”: Enable 29 TVDD Digital Power Supply Pin, 3.0V3.6V － Digital Ground Pin 30 DVSS － (LDOE pin = “H”) O LDO Output Pin This pin should be connected to DVSS with 1.0µF. 31 VDD18 (Note 4) (LDOE pin = “L”) I 1.8V Power Input Pin Power-Down & Reset Pin 32 PDN I When “L”, the AK4454 is powered-down and the control registers Hi-Z are reset to default state. Note 2. 内部プルアップ/ダウンピンを除く全ての入力ピンはフローティングにしないでください。 Note 3. PCM mode、DSD modeの設定はレジスタで行います。 Daisy Chain modeの設定はレジスタ またはピンで行います。 Note 4. LDOE = “H”のときDVSS、LDOE = “L”のときHi-Zです。 No. Pin Name 26 AOUTR2N 27 AOUTR2P ■ I/O O O 使用しないピンの処理について 使用しない入出力ピンは下記の設定を行い、適切に処理して下さい。 Classification Pin Name Setting Analog AOUTL1P/N, AOUTR1P/N AOUTL2P/N, AOUTR2P/N オープン Digital TDMO1, DZF SDTI1-2 オープン DVSSに接続 015006358-J-01 2015/08 -9- [AK4454] 6. 絶対最大定格 (AVSS =DVSS =0V: Note 5) Parameter Symbol Power Supplies: Analog AVDD Digital TVDD |AVSS DVSS| GND Input Current, Any Pin Except Supplies IIN Digital Input Voltage VIND Ambient Temperature (Power applied) タブVSS接続の場合 Ta タブオープンの場合 Ta Storage Temperature Tstg Note 5. 電圧は全てグランドピンに対する値です。 Note 6. AVSS, DVSSは同じアナロググランドに接続して下さい。 min 0.3 0.3 0.3 max 6.0 4.0 0.3 10 TVDD+0.3 Unit V V V mA V 40 40 65 105 85 150 °C °C °C WARNING: この値を超えた条件で使用した場合、デバイスを破壊することがあります。 また通常の動作は保証されません。 7. 推奨動作条件 (AVSS =DVSS =0V: Note 5) Parameter Symbol min typ max Unit Analog AVDD 3.0 5.0 5.5 V (LDOE pin= “L”) (Note 7) Power Supplies I/O buffer TVDD VDD18 1.8 3.6 V Digital VDD18 1.7 1.8 1.98 V (LDOE pin = “H”) (Note 8) I/O buffer TVDD 3.0 3.3 3.6 V Voltage Reference “H” voltage reference “L” VREFH1-2 AVDD0.5 AVDD V voltage reference VREFL1-2 AVSS V Note 7. LDOE pin = “L”のとき、TVDDはVDD18と同時または先に立ち上げてください。AVDDとTVDD およびAVDDとVDD18の電源立ち上げシーケンスを考慮する必要はありません。 Note 8. LDOE pin = “H”のとき、内部LDOが1.8Vを出力します。TVDDとAVDDおよびAVDDとVDD18の電源立 ち上げシーケンスを考慮する必要はありません。 015006358-J-01 2015/08 - 10 - [AK4454] 8. 電気的特性 ■ アナログ特性 (1) AVDD = 5.0Vの場合 (Ta=25C; TVDD=3.3V, AVDD=5.0V, AVSS= DVSS=0V; VREFH1/2=AVDD, VREFL1/2= AVSS; fs=44.1kHz, BICK=64fs, Signal Frequency=1kHz; 24-bit Input Data; RL 2k; measurement bandwidth = 20Hz ~ 20kHz; External Circuit (Figure 72), unless otherwise specified.) Parameter min typ max Unit Resolution 32 bit Dynamic Characteristics (Note 9) 0dBFS fs=44.1kHz -107 -100 dB THD+N BW=20kHz -52 dB 60dBFS 0dBFS fs=96kHz -104 dB BW=40kHz -48 dB 60dBFS 0dBFS fs=192kHz -104 dB BW=40kHz 60dBFS -48 dB BW=80kHz -44 dB 60dBFS dB Dynamic Range (60dBFS with A-weighted) (Note 10) 110 115 dB S/N (A-weighted) (Note 11) 110 115 Inter channel Isolation (1kHz) 100 110 dB DC Accuracy Inter channel Gain Mismatch 0 0.3 dB Gain Drift (Note 12) 20 ppm/°C Output Voltage (Note 13) 2.65 2.8 2.95 Vpp Load Resistance (Note 14) 2 k Load Capacitance (Note 14) 30 pF Power Supplies Power Supply Current Normal operation (PDN pin = “H”, LchとRchに逆相信号を入力) 16 21 mA AVDD 5 7 mA TVDD (fs = 44.1kHz) 7 10 mA TVDD (fs = 96kHz) 11 15 mA TVDD (fs = 192kHz) Power down (PDN pin = “L”) (Note 15) AVDD+TVDD 1 100 A 015006358-J-01 2015/08 - 11 - [AK4454] (2) AVDD = 3.3Vの場合 (Ta=25°C; TVDD=3.3V, AVDD=3.3V, AVSS= DVSS=0V; VREFH1/2=AVDD, VREFL1/2= AVSS; fs=44.1kHz; BICK=64fs; Signal Frequency=1kHz; 24-bit Input Data; RL 2k; measurement bandwidth = 20Hz ~ 20kHz; External Circuit (Figure 72),unless otherwise specified.) Parameter min typ max Unit Resolution 32 bit Dynamic Characteristics (Note 9) 0dBFS fs=44.1kHz -93 -86 dB THD+N BW=20kHz -48 dB 60dBFS 0dBFS fs=96kHz -92 dB BW=40kHz -45 dB 60dBFS 0dBFS fs=192kHz -92 dB BW=40kHz 60dBFS -45 dB BW=80kHz -41 dB 60dBFS dB Dynamic Range(60dBFS with A-weighted) (Note 10) 106 111 dB S/N (A-weighted) (Note 11) 106 111 Inter channel Isolation (1kHz) 100 110 dB DC Accuracy Inter channel Gain Mismatch 0 0.3 dB Gain Drift (Note 12) 20 ppm/°C Output Voltage (Note 13) 1.66 1.85 2.04 Vpp Load Resistance (Note 14) 2 k Load Capacitance (Note 14) 30 pF Power Supplies Power Supply Current Normal operation (PDN pin = “H”, LchとRchに逆相信号を入力) 12 mA AVDD 5 mA TVDD (fs = 44.1kHz) 7 mA TVDD (fs = 96kHz) 11 mA TVDD (fs = 192kHz) Power down (PDN pin = “L”) (Note 15) AVDD+TVDD 1 100 A Note 9. Audio Precision System Two使用。平均値測定。 Note 10. (Figure 72)使用時。100 dB at 16-bit data Note 11. (Figure 72)使用時。S/N比は入力ビット長に依存しません。 Note 12. (VREFH1/2 VREFL1/2)の電圧は+5 V一定。 Note 13. PCM modeで1 kHz、0 dBの sine波を与えたときの出力フルスケール電圧です。DSD modeで1 kHz、 デューティレンジ25 %~75 %の sine波を与えたときの出力フルスケール電圧は、±1.65 Vpp (typ)で す。出力電圧は(VREFH1/2 VREFL1/2)の電圧に比例します。 DAC1：AOUT (typ.@0dB) = (AOUT+) (AOUT) = 2.8Vpp (VREFH1 VREFL1)/5 DAC2：AOUT (typ.@0dB) = (AOUT+) (AOUT) = 2.8Vpp (VREFH2 VREFL2)/5 Note 14. Load Resistanceについては、AC負荷（DCカット用コンデンサ有）に対して2 kΩ(min)です。DC カット用コンデンサ無の場合、グランドに対して3.5 kΩ (min)です。(Figure 72)を参照して下さ い。Load Capacitanceについてはグラウンドに対する値です。 アナログ出力は寄生容量に非常に敏感なため、可能な限り最初の抵抗をアナログ出力ピンの近 くに配置し、寄生容量が極力小さくなるように注意して下さい。 Note 15. パワーダウン時、外部クロック(MCLK, BICK, LRCK)を含む全てのディジタル入力をDVSSに固定した 場合の値です。 015006358-J-01 2015/08 - 12 - [AK4454] ■ シャープロールオフ・フィルタ特性 シャープロールオフ・フィルタ特性 (fs=44.1kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Normal Speed Mode: DEM=OFF, SLOW bit = “0”, SD bit=“0”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 20.0 kHz Pass band (Note 16) PB kHz 3.0dB 21.5 Pass band Ripple (Note 17) PR -0.0032 0.0032 dB Stop band (Note 16) SB 24.1 kHz Stop band Attenuation (Note 19) SA 80 dB Group Delay (Note 18) GD 26.8 1/fs Frequency Response (Note 19) 0.07dB 0 20.0 kHz Digital Filter + SCF (Note 19) -0.2 0.1 Frequency Response: 0 20.0kHz dB シャープロールオフ・フィルタ特性 (fs=96kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Double Speed Mode: DEM=OFF, SLOW bit = “0”, SD bit=“0”) Parameter Symbol min typ max Unit Digital Filter PB 0 43.5 kHz 0.05dB Pass band (Note 16) PB kHz 3.0dB 46.8 Pass band Ripple (Note 17) PR -0.0032 0.0032 dB Stop band (Note 16) SB 52.5 0 43.5 Stop band Attenuation (Note 19) SA 80 dB Group Delay (Note 18) GD 26.8 1/fs Frequency Response (Note 19) 0.07dB 0 43.5 kHz Digital Filter + SCF (Note 19) -0.3 0.1 Frequency Response: 0 40.0kHz dB シャープロールオフ・フィルタ特性 (fs=192kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Quad Speed Mode: DEM=OFF, SLOW bit = “0”, SD bit=“0”) Parameter Symbol min typ max Unit Digital Filter PB 0 87.0 kHz 0.05dB Pass band (Note 16) PB kHz 3.0dB 93.6 Pass band Ripple (Note 17) PR -0.0032 0.0032 dB Stop band (Note 16) SB 105 kHz Stop band Attenuation (Note 19) SA 80 dB Group Delay (Note 18) GD 26.8 1/fs Frequency Response (Note 19) 0.07dB 0 87.0 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 80.0kHz -1 0.1 dB Note 16. 通過域、阻止域の周波数は fs (システムサンプリングレート) に比例し、 PB = 0.4535 fs、SB = 0.546 fsです。 Note 17. Interpolatorの初段、2倍オーバーサンプリングフィルタのパスバンド帯域内のゲインの振幅です。 Note 18. ディジタルフィルタによる演算遅延で、16/20/24/32ビットのインパルスデータが入力レジスタ にセットされてからアナログ信号のピークが出力されるまでの時間です。 Note 19. 入力に1kHz、0dBのsine波を与えたときの出力レベルを0dBとします。 ＊ディジタルフィルタについてはシミュレーション結果を参考値として記載したものです。 015006358-J-01 2015/08 - 13 - [AK4454] ■ スローロールオフ・フィルタ特性 スローロールオフ・フィルタ特性 (fs=44.1kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Normal Speed Mode: DEM=OFF, SLOW bit = “1”, SD bit=“0”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 8.1 kHz Pass band (Note 20) PB kHz 3.0dB 18.2 Pass band Ripple (Note 17) PR -0.043 0.043 dB Stop band (Note 20) SB 39.2 Stop band Attenuation (Note 19) SA 73 dB Group Delay (Note 18) GD 6.3 1/fs Frequency Response (Note 19) 0.05dB 0 8.1 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 20.0kHz -5 0.1 dB スローロールオフ・フィルタ特性 (fs=96kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Double Speed Mode: DEM=OFF, SLOW bit = “1”, SD bit=“0”) Parameter Symbol min typ max Unit Digital Filter PB 0 17.7 kHz Pass band (Note 20) 0.05dB PB kHz 3.0dB 39.5 Pass band Ripple (Note 17) PR -0.043 0.043 dB Stop band (Note 20) SB 85.3 Stop band Attenuation (Note 19) SA 73 dB Group Delay (Note 18) GD 6.3 1/fs Frequency Response (Note 19) 0.05dB PB 0 17.7 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 40.0kHz -5 0.1 dB スローロールオフ・フィルタ特性 (fs=192kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Quad Speed Mode: DEM=OFF, SLOW bit = “1”, SD bit=“0”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 35.5 kHz Pass band (Note 20) PB kHz 3.0dB 79.0 Pass band Ripple (Note 17) PR -0.043 0.043 dB Stop band (Note 20) SB 171 kHz Stop band Attenuation (Note 19) SA 73 dB Group Delay (Note 18) GD 6.3 1/fs Frequency Response (Note 19) 0.05dB PB 0 35.5 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 80.0kHz -5 0.1 dB Note 20. 通過域、阻止域の周波数はfs(システムサンプリングレート)に比例し、 PB = 0.185 fs、SB = 0.888 fsです。 015006358-J-01 2015/08 - 14 - [AK4454] ■ ショートディレイシャープロールオフフィルタ特性 ショートディレイシャープロールオフフィルタ特性 (fs=44.1kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Normal Speed Mode: DEM=OFF, SLOW bit = “0”, SD bit=“1”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 20.0 kHz Pass band (Note 16) PB kHz 3.0dB 21.5 Pass band Ripple (Note 17) PR -0.0031 0.0031 dB Stop band (Note 16) SB 24.1 kHz Stop band Attenuation (Note 19) SA 80 dB Group Delay (Note 18) GD 5.8 1/fs Frequency Response (Note 19) 0.07dB 0 20.0 kHz Digital Filter + SCF (Note 19) -0.2 0.1 Frequency Response: 0 20.0kHz dB ショートディレイシャープロールオフフィルタ特性 (fs=96kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Double Speed Mode: DEM=OFF, SLOW bit = “0”, SD bit=“1”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 43.5 kHz Pass band (Note 16) PB kHz 3.0dB 46.8 Pass band Ripple (Note 17) PR -0.0031 0.0031 dB Stop band (Note 16) SB 52.5 0 43.5 Stop band Attenuation (Note 19) SA 80 dB Group Delay (Note 18) GD 5.8 1/fs Frequency Response (Note 19) 0.07dB 0 43.5 kHz Digital Filter + SCF (Note 19) -0.3 0.1 Frequency Response: 0 40.0kHz dB ショートディレイシャープロールオフフィルタ特性 (fs=192kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Quad Speed Mode: DEM=OFF, SLOW bit = “0”, SD bit=“1”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 87.0 kHz Pass band (Note 16) PB kHz 3.0dB 93.6 Pass band Ripple (Note 17) PR -0.0031 0.0031 dB Stop band (Note 16) SB 105 kHz Stop band Attenuation (Note 19) SA 80 dB Group Delay (Note 18) GD 5.8 1/fs Frequency Response (Note 19) 0.07dB 0 87.0 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 80.0kHz -1 0.1 dB 015006358-J-01 2015/08 - 15 - [AK4454] ■ ショートディレイスローロールオフフィルタ特性 ショートディレイスローロールオフフィルタ特性 (fs=44.1kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Normal Speed Mode: DEM=OFF, SLOW bit = “1”, SD bit=“1”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 11.1 kHz Pass band (Note 21) PB kHz 3.0dB 19.4 Pass band Ripple (Note 17) PR -0.05 0.05 dB Stop band (Note 21) SB 38.1 kHz Stop band Attenuation (Note 19) SA 82 dB Group Delay (Note 18) GD 4.8 1/fs Frequency Response (Note 19) 0.05dB 0 11.1 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 20.0kHz -5 0.1 dB ショートディレイスローロールオフフィルタ特性 (fs=96kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Double Speed Mode: DEM=OFF, SLOW bit = “1”, SD bit=“1”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 24.2 kHz Pass band (Note 21) PB kHz 3.0dB 42.1 Pass band Ripple (Note 17) PR -0.05 0.05 dB Stop band (Note 21) SB 83.0 43.5 Stop band Attenuation (Note 19) SA 82 dB Group Delay (Note 18) GD 4.8 1/fs Frequency Response (Note 19) 0.05dB 0 24.2 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 40.0kHz -5 0.1 dB ショートディレイスローロールオフフィルタ特性 (fs=192kHz) (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V; Quad Speed Mode: DEM=OFF, SLOW bit = “1”, SD bit=“1”) Parameter Symbol min typ max Unit Digital Filter 0.05dB PB 0 48.4 kHz Pass band (Note 21) PB kHz 3.0dB 84.3 Pass band Ripple (Note 17) PR -0.05 0.05 dB Stop band (Note 21) SB 165.9 kHz Stop band Attenuation (Note 19) SA 82 dB Group Delay (Note 18) GD 4.8 1/fs Frequency Response (Note 19) 0.05dB 0 48.4 kHz Digital Filter + SCF (Note 19) Frequency Response: 0 80.0kHz -5 0.1 dB Note 21. 通過域、阻止域の周波数はfs(システムサンプリングレート)に比例し、 PB = 0.252 fs、SB = 0.864 fsです。 015006358-J-01 2015/08 - 16 - [AK4454] ■ DSDモード特性 (1) DSDF bit= “0”の場合 (Ta=-40 105°C: AVDD=3.0 5.5V, TVDD=1.7 3.6V: fs=44.1kHz: D/P bit= “1”, DSDF bit= “0”) Parameter min typ max Unit Digital Filter Response DSDSEL[1:0] 20kHz -0.8 “00” 50kHz -5.5 dB 100kHz -19.9 Frequency Response (Note 23) 40kHz -0.8 “01”” 200kHz -5.5 dB 400kHz -19.9 80kHz -0.8 “10” 400kHz -5.5 dB 800kHz -19.9 (2) DSDF bit= “1”の場合 (Ta=-40 105C: AVDD=3.0 5.5V, TVDD=1.7 3.6V: fs=44.1kHz: D/P bit=“1”, DSDF bit= “1”) Parameter min typ max Unit Digital Filter Response DSDSEL[1:0] 20kHz -0.2 “00” 100kHz -6.3 dB 200kHz -23.7 Frequency Response (Note 23) 40kHz -0.2 “01”” 200kHz -6.3 dB 400kHz -23.7 80kHz -0.2 “10” 400kHz -6.3 dB 800kHz -23.7 Note 22. SACDフォーマットブック(Scarlet Book)では、DSD信号のピークレベルがデューティレンジ 25% ~ 75%を越えることは推奨されていません。 Note 23. 入力に1kHz、デューティレンジ25%~75%のsine波を与えたときの出力レベルを0dBとします。 ※ディジタルフィルタについてはシミュレーション結果を参考値として記載したものです。 ■ DC特性 (Ta=-40 105°C; AVDD=3.0 5.5V, TVDD=1.7 3.6V) Parameter Symbol TVDD=1.7 3.0V High-Level Input Voltage VIH Low-Level Input Voltage VIL TVDD=3.0V 3.6V High-Level Input Voltage VIH Low-Level Input Voltage VIL High-Level Output Voltage (TDMO1, DZF pins: Iout=-100µA) VOH Low-Level Output Voltage (excpt SDA pin : Iout= 100µA) VOL (SDA pin, 2.0V TVDD 3.6V: Iout= 3mA) VOL (SDA pin, 1.7V TVDD 2.0V: Iout= 3mA) VOL Input Leakage Current Iin 015006358-J-01 min typ max Unit 80%TVDD - - 20%TVDD V V 70%TVDD - - 30%TVDD V V TVDD0.5 - - V - - 0.5 0.4 20%TVDD 10 V V V A - 2015/08 - 17 - [AK4454] ■ スイッチング特性 (Ta=-40 105°C: AVDD=3.0 5.5V, TVDD=1.7 3.6V) Parameter Symbol Master Clock Timing Frequency fCLK Duty Cycle dCLK Minimum Pulse Width tCLKH tCLKL LRCK Frequency (Note 24) Normal Mode (TDM1-0 bits = “00”) Normal Speed Mode Double Speed Mode Quad Speed Mode Oct speed mode Hex speed mode Duty Cycle TDM128 mode (TDM1-0 bits = “01”) Normal Speed Mode Double Speed Mode Quad Speed Mode High time Low time TDM256 mode (TDM1-0 bits = “10”) Normal Speed Mode High time Double Speed Mode High time Low time TDM512 mode (TDM1-0 bits = “11”) Normal Speed Mode High time Low time PCM Audio Interface Timing Normal Mode (TDM1-0 bits = “00”) BICK Period Normal Speed Mode Double Speed Mode Quad Speed Mode Oct speed mode Hex speed mode BICK Pulse Width Low BICK Pulse Width High BICK “” to LRCK Edge (Note 25) LRCK Edge to BICK “” (Note 25) SDTI1/2/3/4 Hold Time SDTI1/2/3/4 Setup Time max Unit 2.048 45 9.155 9.155 49.152 55 MHz % ns ns fsn fsd fsq fso fsh Duty 8 54 108 54 108 216 45 55 kHz kHz kHz kHz kHz % fsn fsd fsq tLRH tLRL 8 54 108 1/128fs 1/128fs 54 108 216 kHz kHz kHz nsec ns fsn fsd tLRH tLRL 8 54 1/256fs 1/256fs 54 108 kHz kHz nsec nsec fsn tLRH tLRL 8 1/512fs 1/512fs 54 kHz nsec nsec tBCK tBCK tBCK tBCK tBCK tBCKL tBCKH tBLR tLRB tSDH tSDS 1/256fsn 1/128fsd 1/64fsq 1/64fso 1/64fsh 9 9 5 5 5 5 015006358-J-01 min typ 384 768 nsec nsec nsec nsec nsec nsec nsec nsec nsec nsec nsec 2015/08 - 18 - [AK4454] Parameter TDM128 mode (TDM1-0 bits = “01”) BICK Period Normal Speed Mode Double Speed Mode Quad Speed Mode BICK Pulse Width Low BICK Pulse Width High BICK “” to LRCK Edge (Note 25) LRCK Edge to BICK “” (Note 25) SDTI1/2 Hold Time SDTI1/2 Setup Time TDM256 mode (TDM1-0 bits = “10”) BICK Period Normal Speed Mode Double Speed Mode (Note 26) BICK Pulse Width Low BICK Pulse Width High BICK “” to LRCK Edge (Note 25) LRCK Edge to BICK “” (Note 25) TDMO1/2 Setup time BICK “” TDMO1/2 Hold time BICK “”(Note 28) SDTI1/2 Hold Time SDTI1/2 Setup Time TDM512 mode (TDM1-0 bits = “11”) BICK Period Normal Speed Mode (Note 27) BICK Pulse Width Low BICK Pulse Width High BICK “” to LRCK Edge (Note 25) LRCK Edge to BICK “” (Note 25) TDMO1 Setup time BICK “” TDMO1 Hold time BICK “” (Note 28) SDTI1 Hold Time SDTI1 Setup Time Symbol min tBCK tBCK tBCK tBCKL tBCKH tBLR tLRB tSDH tSDS 1/128fsn 1/128fsd 1/128fsq 14 14 14 14 5 5 nsec nsec nsec nsec nsec nsec nsec nsec nsec tBCK tBCK tBCKL tBCKH tBLR tLRB tBSS tBSH tSDH tSDS 1/256fsn 1/256fsd 14 14 14 14 5 5 5 5 nsec nsec nsec nsec nsec nsec nsec nsec nsec nsec tBCK tBCKL tBCKH tBLR tLRB tBSS tBSH tSDH tSDS 1/512fsn 14 14 14 14 5 5 5 5 nsec nsec nsec nsec nsec nsec nsec nsec nsec 015006358-J-01 typ max Unit 2015/08 - 19 - [AK4454] Parameter DSD Audio Interface Timing Symbol min typ max Unit (64 mode, DSDSEL 1-0 bits = “00”) DCLK Period tDCK 1/64fs nsec DCLK Pulse Width Low tDCKL 144 nsec DCLK Pulse Width High tDCKH 144 nsec DCLK Edge to DSDL/R (Note 29) tDDD 20 20 nsec (128 mode, DSDSEL 1-0 bits = “01”) DCLK Period tDCK 1/128fs nsec DCLK Pulse Width Low tDCKL 72 nsec DCLK Pulse Width High tDCKH 72 nsec DCLK Edge to DSDL/R (Note 29) tDDD 10 10 nsec (256 mode, DSDSEL 1-0 bits = “10”) DCLK Period tDCK 1/256fs nsec DCLK Pulse Width Low tDCKL 36 nsec DCLK Pulse Width High tDCKH 36 nsec DCLK Edge to DSDL/R (Note 29) tDDD 5 5 nsec Note 24. 1152fs, 512fs or 768fs /256fs or 384fs /128fs or 192fs を切り替えた場合はPDN pinまたはRSTN bit でリセットして下さい。 Note 25. この規格値はLRCKのエッジとBICKの“”が重ならないように規定しています。 Note 26. Daisy Chain mode、TVDD < 3.0Vでは、fsd(max)= 96 kHzです。 Note 27. Daisy Chain mode、TVDD < 3.0Vでは、fsn(max)= 48 kHzです。 Note 28. LDOE pin = “L”、TVDD > 2.6では、tBSH(min)= 4 nsecです。 Note 29. データ送信側に要求される値です。 DCKB= “0” （default） 設定時は、DCLK “” からDSDL/Rのエッジまでの時間をtDDDと規定し、 DCKB= “1”設定時は、DCLK “↑”からDSDL/Rのエッジまでの時間をtDDDと規定します。 015006358-J-01 2015/08 - 20 - [AK4454] (Ta=-40 105°C ; AVDD=3.0 5.5V, TVDD=1.7 3.6V) Parameter Symbol min typ max Control Interface Timing (3-wire Serial mode): CCLK Period 200 tCCK CCLK Pulse Width Low 80 tCCKL Pulse Width High 80 tCCKH CDTI Setup Time 40 tCDS CDTI Hold Time 40 tCDH CSN “H” Time 150 tCSW 50 CSN “” to CCLK “” tCSS 50 tCSH CCLK “” to CSN “” Control Interface Timing (I2C Bus mode): SCL Clock Frequency fSCL 400 Bus Free Time Between Transmissions tBUF 1.3 Start Condition Hold Time (prior to first clock pulse) tHD:STA 0.6 Clock Low Time tLOW 1.3 Clock High Time tHIGH 0.6 Setup Time for Repeated Start Condition tSU:STA 0.6 SDA Hold Time from SCL Falling (Note 30) tHD:DAT 0 SDA Setup Time from SCL Rising tSU:DAT 0.1 Rise Time of Both SDA and SCL Lines tR 1.0 Fall Time of Both SDA and SCL Lines tF 0.3 Setup Time for Stop Condition tSU:STO 0.6 Pulse Width of Spike Noise Suppressed by Input Filter tSP 0 50 Capacitive load on bus Cb 400 Power-down & Reset Timing (Note 31) PDN Accept Pulse Width tAPD 150 PDN Reject Pulse Width tRPD 30 Note 30. データは最低300 nsec (SCLの立ち下がり時間) の間保持されなければなりません。 Note 31. AK4454はPDN pinを“L”にすることでリセットがかかります。 2 Note 32. I C-busはNXP B.V.の商標です。 015006358-J-01 Unit nsec nsec nsec nsec nsec nsec nsec nsec kHz sec sec sec sec sec sec sec sec sec nsec pF nsec nsec 2015/08 - 21 - [AK4454] ■ タイミング波形 1/fCLK VIH MCLK VIL tCLKH tCLKL dCLK=tCLKH x fCLK, tCLKL x fCLK 1/fs VIH LRCK VIL tLRH tLRL Duty=tLRH x fs, tLRL x fs tBCK VIH BICK VIL tBCKH tBCKL Figure 2. Clock Timing VIH LRCK VIL tBLR tLRB VIH BICK VIL tBSH tBSS TDMO 50%TVDD tSDS tSDH VIH SDTI VIL Figure 3. Audio Interface Timing (PCM mode) 015006358-J-01 2015/08 - 22 - [AK4454] tDCK tDCKL tDCKH VIH DCLK VIL tDDD VIH DSDL1-2 DSDR1-2 VIL tDDD VIH DSDL1-2 DSDR1-2 VIL Figure 4. Audio Serial Interface Timing (DSD Normal Mode, DCKB bit = “0”) tDCK tDCKL tDCKH VIH DCLK VIL tDDD tDDD VIH DSDL1-2 DSDR1-2 VIL tDDD tDDD VIH DSDL1-2 DSDR1-2 VIL Figure 5. Audio Serial Interface Timing (DSD Phase Modulation Mode, DCKB bit = “0”) 015006358-J-01 2015/08 - 23 - [AK4454] VIH CSN VIL tCSS tCCKL tCCKH VIH CCLK VIL tCDS CDTI C1 tCDH C0 R/W VIH A4 VIL Figure 6. WRITE Command Input Timing (3-wire Serial mode) tCSW VIH CSN VIL tCSH VIH CCLK CDTI VIL D3 D2 D1 D0 VIH VIL Figure 7. WRITE Data Input Timing (3-wire Serial mode) 015006358-J-01 2015/08 - 24 - [AK4454] VIH SDA VIL tLOW tBUF tR tHIGH tF tSP VIH SCL VIL tHD:STA Stop tHD:DAT Start tSU:DAT tSU:STA tSU:STO Start Stop Figure 8. I2C Bus Mode Timing tAPD tRPD PDN VIL Figure 9. Power-down & Reset Timing 015006358-J-01 2015/08 - 25 - [AK4454] 9. 動作説明 ■ D/A変換モード AK4454はPCMデータとDSDデータの両方をD/A変換することが可能です。DSD mode時は、DCLK, DSDL, DSDRの各ピンからDSDデータを入力できます。PCM modeではBICK, LRCK, SDTIの各ピンからPCMデ ータを入力します。モード切り替えはD/P bitで行います。D/P bitでPCM/DSD modeを切り替えた場合は RSTN bitでリセットして下さい。切り替えには2 ~ 3/fs程度かかります。パラレルモード時はPCMデータ のみに対応します。 D/P bit Interface 0 PCM 1 DSD Table 1. PCM/DSD Mode Control ■ システムクロック [1] PCMモード AK4454に必要なクロックは、MCLK, BICK, LRCKです。MCLKとBICKおよびLRCKは同期する必要はあ りますが位相を合わせる必要はありません。MCLKはインターポレーションフィルタと変調器に使用 されます。MCLK周波数を設定する方法は(Manual Setting Mode) とデバイス内部で自動設定する方法 (Auto Setting Mode) の2つがあります。Manual Setting Mode (ACKS bit= “0”)では、MCLK周波数は自動設 定されます(Table 2)。リセット解除時 (PDN pin = “↑”) はManual Setting Mode に設定されます。Auto Setting Mode (ACKS bit= “1”) では、サンプリングスピードとMCLK周波数は自動検出され(Table 5)、内 部クロックは適切な周波数 (Table 6,Table 7) に自動設定されます。 015006358-J-01 2015/08 - 26 - [AK4454] 1) Manual Setting Mode (ACKS bit = “0”) MCLK周波数は自動設定されますが、DFS2-0 bitsでサンプリングスピードを設定します(Table 2)。各スピ ードでのMCLK周波数は(Table 3,Table 4)で示される周波数を外部から供給して下さい。パワーダウン解 除時(PDN pin = “L” “H”)はManual Setting Modeに設定されます。DFS2-0 bitsを切り替えた場合はRSTN bitでリセットして下さい。 DFS2 DFS1 DFS0 Sampling Rate (fs) (default) 0 0 0 Normal Speed Mode 8kHz 54kHz 0 0 1 Double Speed Mode 54kHz 108kHz 0 1 0 1 1 1 1 1 0 0 1 1 LRCK Fs 32.0kHz 44.1kHz 48.0kHz 88.2kHz 96.0kHz 176.4kHz 192.0kHz 384kHz 768kHz LRCK fs 32.0kHz 44.1kHz 48.0kHz 88.2kHz 96.0kHz 176.4kHz 192.0kHz 384kHz 768kHz 0 Quad Speed Mode 120kHz 216kHz 1 Reserved (※) 0 Oct Speed Mode 384kHz 1 Hex Speed Mode 768kHz (※384kHzにシフト) 0 Reserved (※768kHzにシフト) 1 Reserved Table 2. Sampling Speed (Manual Setting Mode) MCLK(MHz) 16fs 32fs 48fs 64fs 96fs 128fs N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A 22.5792 N/A N/A N/A N/A N/A 24.5760 N/A 12.288 18.432 24.576 36.864 49.152 12.288 24.576 36.864 49.152 N/A N/A Table 3. System Clock Example (Manual Setting Mode) Sampling Speed Normal Double Quad Quad Oct Hex MCLK(MHz) 192fs 256fs 384fs 512fs 768fs 1024fs 1152fs N/A 8.1920 12.2880 16.3840 24.5760 36.8640 36.8640 N/A 11.2896 16.9344 22.5792 33.8688 N/A N/A N/A 12.2880 18.4320 24.5760 36.8640 N/A N/A N/A 22.5792 33.8688 45.1584 N/A N/A N/A N/A 24.5760 36.8640 49.152 N/A N/A N/A 33.8688 45.1584 N/A N/A N/A N/A N/A 36.8640 49.152 N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A Table 4. System Clock Example (Manual Setting Mode) 015006358-J-01 Sampling Speed Normal Double Quad Quad Oct Hex 2015/08 - 27 - [AK4454] 2) Auto Setting Mode (ACKS bit = “1”) MCLK周波数とサンプリングスピードは自動検出(Table 5)されるため、DFS2-0 bitsの設定は不要です。各 スピードでのMCLK周波数は(Table 6,Table 7)で示される周波数を外部から供給して下さい。 MCLK Sampling Speed 1152fs Normal (fs32kHz) 512fs/256fs 768fs/384fs Normal 256fs 384fs Double 128fs 192fs Quad 64fs 96fs Oct 32fs 48fs Hex Table 5. Sampling Speed (Auto Setting Mode) LRCK fs 32.0kHz 44.1kHz 48.0kHz 88.2kHz 96.0kHz 176.4kHz 192.0kHz 384kHz 768kHz LRCK fs 32.0kHz 44.1kHz 48.0kHz 88.2kHz 96.0kHz 176.4kHz 192.0kHz 384kHz 768kHz MCLK(MHz) 32fs 48fs 64fs 96fs 128fs N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A 22.5792 N/A N/A N/A N/A 24.5760 N/A N/A 24.576 36.864 N/A 24.576 36.864 N/A N/A N/A Table 6. System Clock Example (Auto Setting Mode) Sampling Speed Normal Double Quad Quad Oct Hex MCLK(MHz) 192fs 256fs 384fs 512fs 768fs 1152fs N/A 8.1920 12.2880 16.3840 24.5760 36.8640 N/A 11.2896 16.9344 22.5792 33.8688 N/A N/A 12.2880 18.4320 24.5760 36.8640 N/A N/A 22.5792 33.8688 N/A N/A N/A N/A 24.5760 36.8640 N/A N/A N/A 33.8688 N/A N/A N/A N/A N/A 36.8640 N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A N/A Table 7. System Clock Example (Auto Setting Mode) Sampling Speed Normal Double Quad Quad Oct Hex MCLK= 256fs/384fsのとき、Auto Setting Mode は8kHz~96kHzのサンプリングレートまで対応します (Table 8)。但し、8kHz~48kHzのサンプリングレートでは、MCLK= 256fs/384fsでのDR, S/Nは、MCLK= 512fs/768fsの時に比べて3dB程度劣化します。 ACKS bit MCLK DR,S/N 0 256fs/384fs/512fs/768fs 115dB 1 256fs/384fs 112dB 1 512fs/768fs 115dB Table 8. MCLK周波数とDR, S/Nの関係(fs = 44.1kHz) 015006358-J-01 2015/08 - 28 - [AK4454] [2] DSDモード(Serial Control mode only) AK4454はDSDを再生する機能があります。DSDモードで必要なクロックは、MCLK, DCLKです。MCLK とDCLKは同期する必要はありますが位相を合わせる必要はありません。MCLK周波数はDCKS bitで設 定します。(Table 9) 電源ON等のリセット解除時(PDN pin = “L” “H”, RSTN bit = “0” → “1”)はMCLKとDCLKが入力され るまでパワーダウン状態です。 DCKS bit 0 1 MCLK Frequency DCLK Frequency 512fs 64fs/128fs/256fs 768fs 64fs/128fs/256fs Table 9. System Clock (DSD Mode) (default) AK4454はDSDデータストリームの64fsと128fsと256fsに対応します(fs=32kHz,44.1kHz, 48kHz)。設定は DSDSEL1-0 bitsで行います(Table 10)。 DSDSEL1 DSDSEL0 0 0 1 0 1 0 1 1 DSD data stream fs=32kHz fs=44.1kHz 2.048MHz 2.8224MHz 4.096MHz 5.6448MHz 8.192MHz 11.2896MHz Reserved Reserved (8.192MHz) (11.2896MHz) Table 10. DSD Data Stream Select fs=48kHz 3.072MHz 6.144MHz 12.288MHz Reserved (12.288MHz) (default) AK4454はDSDを再生する際に、DSDD bitでモードを選択できます (Table 11)。DSDD bit= “1”の場合は出 力ボリューム機能が使用できず、Cut Off Filterは100kHz固定になります。 DSDD bit Mode 0 Full function 1 (default) Volume pass Table 11. DSD play mode select DSD modeはDSDF bitでフィルタ特性を50kHzから100kHzに切り替えることができます。(Table 12) DSDF bit Cut Off Filter 0 50kHz 1 (default) 100kHz Table 12. DSD filter select 015006358-J-01 2015/08 - 29 - [AK4454] ■ オーディオインタフェースフォーマット AK4454に入力されるディジタル信号はPCMとDSDの両方のフォーマットに対応しています。 モードの切り替えはピン(TDM1-0 pins, DIF pin, DCHAIN pin)及びレジスタ(TDM1-0 bits, DIF2-0 bits, SDS2-0 bits, DCHAIN bit)にて設定可能ですが、動作中には切り替えないでください。Mode Settingを切り 替えた時はRSTN bitでリセットしてください。 [1] PCM mode Normal Mode（TDM1-0 bits= “00”） オーディオデータはBICKとLRCKを使ってSDTI1-2から4ch分のデータが入力されます。データはSDS2-0 bitsで選択可能です。8種類のデータフォーマット(Table 13)がDIF2-0 bitsで選択できます。全モードとも MSBファースト、2’sコンプリメントのデータフォーマットでBICKの立ち上がりでラッチされます。 Mode 2を16ビット、20ビットで使用する場合、また、Mode 6を16ビット、20ビット、24ビットで使用す る場合はデータのないLSBには “0”を入力して下さい。 TDM128 Mode（TDM1-0 bits= “01”） オーディオデータはBICKとLRCKを使ってSDTI1-2から8ch分のデータが入力されます。データはSDS2-0 bitsで選択可能です。BICKは128fs固定です。6種類のデータフォーマット(Table 13)がDIF2-0 bitsで選択で きます。全モードともMSBファースト、2'sコンプリメントのデータフォーマットでBICKの立ち上がり でラッチされます。 TDM256 Mode（TDM1-0 bits= “10”） オーディオデータはBICKとLRCKを使ってSDTI1-2から16ch分のデータが入力されます。データは SDS2-0 bitsで選択可能です。BICKは256fs固定です。6種類のデータフォーマット( Table 13)がDIF2-0 bits で選択できます。全モードともMSBファースト、2'sコンプリメントのデータフォーマットでBICKの立 ち上がりでラッチされます。 TDM512 Mode（TDM1-0 bit= “11”） オーディオデータはBICKとLRCKを使ってSDTI1から16ch分のデータが入力されます。データはSDS2-0 bitsで選択可能です。SDTI2への入力データは無視されます。BICKは512fs固定です。6種類のデータフォ ーマット(Table 13)が及びDIF2-0 bitsで選択できます。全モードともMSBファースト、2'sコンプリメント のデータフォーマットでBICKの立ち上がりでラッチされます。 015006358-J-01 2015/08 - 30 - [AK4454] Mode TDM1 0 1 2 Normal (Note 33) TDM128 TDM256 TDM512 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 0 0 1 1 TDM0 DIF2 0 0 0 DIF1 0 0 1 DIF0 0 1 0 SDTI Format 16-bit 後詰め 20-bit 後詰め 24-bit 前詰め 16-bit I2S 互換 0 1 1 0 24-bit I2S 互換 1 0 0 24-bit 後詰め 1 0 1 32-bit 後詰め 1 1 0 32-bit 前詰め 1 1 1 32-bit I2S 互換 0 0 0 N/A 0 0 1 N/A 0 1 0 24-bit 前詰め 0 1 1 24-bit I2S 互換 1 1 0 0 24-bit 後詰め 1 0 1 32-bit 後詰め 1 1 0 32-bit 前詰め 1 1 1 32-bit I2S 互換 0 0 0 N/A 0 0 1 N/A 0 1 0 24-bit 前詰め 0 1 1 24-bit I2S 互換 0 1 0 0 24-bit 後詰め 1 0 1 32-bit 後詰め 1 1 0 32-bit 前詰め 1 1 1 32-bit I2S 互換 0 0 0 N/A 0 0 1 N/A 0 1 0 24-bit 前詰め 0 1 1 24-bit I2S 互換 1 1 0 0 24-bit 後詰め 1 0 1 32-bit 後詰め 1 1 0 32-bit 前詰め 1 1 1 32-bit I2S 互換 Table 13. オーディオデータフォーマット LRCK H/L H/L H/L L/H L/H H/L H/L H/L L/H BICK 32fs 40fs 48fs 32fs 48fs 48fs 64fs 64fs 64fs 128fs 128fs 128fs 128fs 128fs 128fs 128fs 128fs 256fs 256fs 256fs 256fs 256fs 256fs 256fs 256fs 512fs 512fs 512fs 512fs 512fs 512fs 512fs 512fs (網掛けは仕様外) Note 33.各chに対して、設定したbit以上のBICKを入力してください。 015006358-J-01 2015/08 - 31 - [AK4454] LRCK 0 1 10 11 12 13 14 15 0 1 10 11 12 13 14 15 0 1 BICK (32fs) SDTI1-2 Mode 0 15 14 6 5 1 0 14 4 3 15 16 2 1 17 0 15 31 0 14 6 5 14 1 4 3 15 2 16 1 17 0 31 15 14 0 1 BICK (64fs) SDTI1-2 Mode 0 Don’t care 15 14 Don’t care 0 15 14 0 15:MSB, 0:LSB Lch Data Rch Data Figure 10. Mode 0 Timing LRCK 0 1 8 9 10 11 12 31 0 1 8 9 10 11 12 31 0 1 0 1 BICK (64fs) SDTI1-2 Mode 1 Don’t care 19 0 Don’t care 19 0 Don’t care 19 0 19 0 19:MSB, 0:LSB SDTI1-2 Mode 4 Don’t care 23 22 21 20 23 22 20 21 23:MSB, 0:LSB Lch Data Rch Data Figure 11. Mode 1/4 Timing LRCK 0 1 2 22 23 24 30 31 0 1 2 22 23 24 30 31 BICK (64fs) SDTI1-2 23 22 1 0 Don’t care 23 22 1 0 Don’t care 23 22 23:MSB, 0:LSB Lch Data Rch Data Figure 12. Mode 2 Timing 015006358-J-01 2015/08 - 32 - [AK4454] LRCK 0 1 2 3 23 24 25 31 0 1 2 3 23 24 25 31 0 1 BICK (64fs) SDTI1-2 23 0 1 22 Don’t care 23 22 0 1 23 Don’t care 23:MSB, 0:LSB Lch Data Rch Data Figure 13. Mode 3 Timing LRCK 0 1 2 22 23 24 30 31 0 1 2 22 23 24 30 31 0 1 BICK (64fs) SDTI1-2 Mode 5,6 31 30 1 0 31 30 0 1 31 30 32:MSB, 0:LSB Lch Data Rch Data Figure 14. Mode 5/6 Timing LRCK 0 1 2 3 23 24 25 31 0 1 0 31 2 3 23 24 25 31 0 1 0 31 BICK (64fs) SDTI1-2 31 30 1 30 1 30 32:MSB, 0:LSB Lch Data Rch Data Figure 15. Mode 7 Timing 015006358-J-01 2015/08 - 33 - [AK4454] 128 BICK LRCK BICK(128fs) SDTI1-2 Mode8 23 22 SDTI1-2 Mode11,12 31 30 0 23 22 0 0 31 30 23 22 0 0 31 30 23 22 0 0 31 30 23 22 0 31 30 2 L1 R1 L2 R2 32 BICK 32 BICK 32 BICK 32 BICK Figure 16. Mode 8/11/12 Timing 128 BICK LRCK BICK(128fs) SDTI1-2 Mode9 SDTI1-2 Mode13 0 23 22 0 23 22 31 30 0 23 22 0 31 30 23 22 0 31 30 L1 R1 32 BICK 32 BICK 23 0 0 31 30 2 0 31 30 L2 R2 32 BICK 32 BICK Figure 17. Mode 9/13 Timing 128 BICK LRCK BICK(128fs) SDTI1-2 23 22 0 23 22 0 23 22 0 23 22 0 L1 R1 L2 R2 32 BICK 32 BICK 32 BICK 32 BICK 23 Figure 18. Mode 10 Timing 015006358-J-01 2015/08 - 34 - [AK4454] 256 BICK LRCK BICK (256fs) SDTI1 Mode14 SDTI1 Mode17,18 23 22 0 31 30 23 22 0 0 31 30 23 22 0 0 31 30 23 22 0 0 31 30 23 22 0 0 31 30 23 22 0 23 22 0 31 30 0 0 31 30 23 22 0 23 22 0 31 30 0 31 30 L1 R1 L2 R2 L3 R3 L4 R4 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK Figure 19. Mode 14/17/18 Timing 256 BICK LRCK BICK (256fs) SDTI1 Mode15 SDTI1 Mode19 23 0 23 31 30 0 23 0 31 30 0 23 0 31 30 0 23 0 31 30 0 23 0 31 30 0 0 31 30 23 0 23 0 31 30 0 23 0 31 30 0 31 L1 R1 L2 R2 L3 R3 L4 R4 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK Figure 20. Mode 15/19 Timing 256 BICK LRCK BICK(256fs) SDTI1 23 22 0 23 22 0 23 22 0 23 22 0 23 22 0 23 22 0 23 22 0 23 22 L1 R1 L2 R2 L3 R3 L4 R4 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 0 23 Figure 21. Mode 16 Timing 015006358-J-01 2015/08 - 35 - [AK4454] 512BICK LRCK BICK(512fs) SDTI1 Mode8 SDTI1 Mode11,12 23 22 0 23 22 0 23 22 23 22 0 0 23 22 0 23 22 0 23 22 0 23 22 23 0 2 31 22 0 31 22 0 31 22 R1 L1 0 31 22 0 31 22 R2 L2 0 31 22 0 31 22 R3 L3 0 31 22 31 0 R4 L4 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK Figure 22. Mode 20/23/24 Timing 512BICK LRCK BICK(512fs) SDTI1 Mode21 SDTI1 Mode25 23 22 0 23 22 0 23 22 0 23 22 0 23 22 0 23 22 0 23 22 0 23 22 23 0 2 31 22 0 31 22 0 31 22 R1 L1 0 31 22 0 31 22 R2 L2 0 31 22 0 31 22 R3 L3 0 31 22 31 0 R4 L4 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK Figure 23. Mode 21/25 Timing 512BICK LRCK BICK(512fs) SDTI1 Mode22 23 22 L1 0 23 22 2 R1 0 23 22 L2 0 23 22 R2 0 23 22 L3 0 23 22 R3 0 23 22 L4 0 23 22 23 0 R4 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK 32 BICK Figure 24. Mode 22 Timing 015006358-J-01 2015/08 - 36 - [AK4454] [1]-1. データセレクト AK4454はSDS2-0 bitsで各DACの再生するデータを選択できます。 PCMオーディオデータ(SDTI1-2)の1周期分を下記のように定義します。 LRCK SDTI1 L1 R1 SDTI2 L2 R2 Figure 25. Data Slot in Normal Mode 128 BICK LRCK SDTI1 L1 R1 L2 R2 SDTI2 L3 R3 L4 R4 Figure 26. Data Slot in TDM128 Mode 256 BICK LRCK SDTI1 L1 R1 L2 R2 L3 R3 L4 R4 SDTI2 L5 R5 L6 R6 L7 R7 L8 R8 Figure 27. Data Slot in TDM256 Mode 512 BICK LRCK SDTI1 L1 R1 L2 R2 L3 R3 L4 R4 L5 R5 L6 R6 L7 R7 L8 R8 Figure 28. Data Slot in TDM512 Mode 015006358-J-01 2015/08 - 37 - [AK4454] DAC1 Lch Rch DAC2 Lch Rch * L1 R1 L2 R2 0 0 L1 R1 L2 R2 * 0 1 L2 R2 L3 R3 * 1 0 L3 R3 L4 R4 * 1 1 L4 R4 L1 R1 0 0 0 0 1 1 1 1 0 0 1 1 0 0 1 1 0 1 0 1 0 1 0 1 L1 L2 L3 L4 L5 L6 L7 L8 R1 R2 R3 R4 R5 R6 R7 R8 L2 L3 L4 L5 L6 L7 L8 L1 R2 R3 R4 R5 R6 R7 R8 R1 0 0 0 0 TDM512 1 1 1 1 (*: Do not care) 0 0 1 1 0 0 1 1 0 1 0 1 0 1 0 1 L1 L2 L3 L4 L5 L6 L7 L8 R1 R2 R3 R4 R5 R6 R7 R8 L2 L3 L4 L5 L6 L7 L8 L1 R2 R3 R4 R5 R6 R7 R8 R1 Normal TDM128 TDM256 SDS2 SDS1 SDS0 * * * Table 14. Data Select 015006358-J-01 2015/08 - 38 - [AK4454] [1]-2. Daisy Chain AK4454はDaisy Chainの構成をとることができます。Daisy Chainモードに設定するためには、DCHAIN bit= “1”またはDCHAIN pin= “H”にしてください。Daisy ChainはTDM512/256 modeに対応しています。 Daisy Chain modeではSDS2-0 bitsの設定は無効になります。 1) TDM512 mode (Figure 29)はTDM512 mode(TDM1-0 bits= “11” ) Daisy Chain構成例です。DSPからSecond AK4454のSDTI1 に16chのデータを入力し、Second AK4454のTDMO1をFirst AK4454のSDTI1に接続します。 (Figure 30)はTDM512 mode Daisy Chainのデータ入出力例です。Second AK4454はSDTI1のL7-8, R7-8のデ ータをDACの入力とし、4ch分シフトしたデータをTDMO1から出力します。First AK4454はL5-6, R5-6の データをDACの入力とします。First AK4454とSecond AK4454のDIF2-0 bitsは同じ設定にする必要があり ます。 TDMO1 SDTI1 TDMO1 SDTI1 Second AK4454 First AK4454 DSP Figure 29. Daisy Chain (TDM512/256 Mode) 512 BICK LRCK SDTI1 L1 R1 L2 R2 L3 R3 L4 R4 L5 R5 L6 R6 L7 R7 L8 R8 Second AK4454 TDMO1 L1 R1 L2 R2 L3 R3 L4 R4 L5 R5 L6 R6 First AK4454 Figure 30. Daisy Chain (TDM512 Mode) 015006358-J-01 2015/08 - 39 - [AK4454] 2) TDM256 mode (Figure 29)はTDM256 mode (TDM1-0 bits = “10”) Daisy Chain構成例です。DSPからSecond AK4454の SDTI1/2に8chのデータを入力し、Second AK4454のTDMO1をFirst AK4454のSDTI1/2に接続します。 (Figure 31)はTDM512 mode Daisy Chainのデータ入出力例です。Second AK4454はSDTI1のL3-4, R3-4のデ ータをDACの入力とし、4ch分シフトしたデータをTDMO1から出力します。First AK4454はSDTI1のL1-2, R1-2のデータをDACの入力とします。First AK4454とSecond AK4454のDIF2-0 bitsは同じ設定にする必要 があります。 256 BICK LRCK SDTI1 L1 R1 L2 R2 L3 R3 L4 R4 Second AK4454 L1 TDMO1 R1 L2 R2 First AK4454 Figure 31. Daisy Chain (TDM256 Mode) 015006358-J-01 2015/08 - 40 - [AK4454] [2] DSD mode オーディオデータはDCLKを使ってDSDL1及びDSDR1から4ch分のデータが入力されます。DSDデータ はNormal mode (Figure 32)とPhase Modulation mode (Figure 33)の両方に対応しています。入力されたデー タはDCKB bitで設定されるDCLKの立ち上がり、もしくは立ち下がりで取り込みます。 DCLK周波数はDSDSEL1-0 bitsで64fs, 128fs, 256fsと可変です。 DCLK (DCKB bit=”0”) DSDL,DSDR D0 D1 D2 D3 Figure 32. DSD Mode Timing (Normal mode時) DCLK (DCKB bit=”0”) DSDL,DSDR D0 D1 D1 D2 D2 D3 Figure 33. DSD Mode Timing (Phase Modulation mode時) 015006358-J-01 2015/08 - 41 - [AK4454] ■ D/A変換モード切り替えタイミング RSTN bit 5/fs D/A Mode PCM Mode DSD Mode 0 D/A Data PCM Data DSD Data Figure 34. D/A Mode Switching Timing (PCM to DSD) RSTN bit D/A Mode DSD Mode PCM Mode 5/fs D/A Data DSD Data Figure 35. D/A Mode Switching Timing (DSD to PCM) PCM Data Note 34. DSD mode時は25%から75%デューティを信号レンジとします。SACDフォーマットブック (Scarlet Book)では、DSD信号のピークレベルがこのデューティを越えることは 推奨されていません。 015006358-J-01 2015/08 - 42 - [AK4454] ■ Digital Filter（PCM mode） AK4454ではSD bit, SLOW bit, SSLOW bitで5種類のディジタルフィルタを設定できます。それぞれ好みの 音質で音楽再生が可能です。 SSLOW 0 0 0 0 1 SD bit 0 0 1 1 * SLOW bit 0 1 0 1 * Mode Sharp Roll-off filter Slow Roll-off filter Short delay Sharp Roll-off filter (default) Short delay Slow Roll-off filter Super Slow Roll-off Mode (*: Do not care) Table 15. Digital Filter Setting SSLOW bit = “1”のとき、最も周波数特性の緩い設定となります。 ■ ディエンファシスフィルタ（PCM mode） IIRフィルタによる3周波数(32kHz, 44.1kHz, 48kHz)対応のディエンファシスフィルタ(50/15s特性)を内 蔵しており、DEM11-0/DEM21-0 bits (DEM bit)で選択できます。 DAC1/2のディエンファシスフィルタモードをDEM bitで個別に設定できます。このモードはPCM Normal Speed Modeのみ有効です。 DEM11/ DEM10/ Mode DEM21 DEM20 0 0 44.1kHz 0 1 OFF (default) 1 0 48kHz 1 1 32kHz Table 16. De-emphasis Control 015006358-J-01 2015/08 - 43 - [AK4454] ■ 出力ボリューム（PCM mode、DSD mode） AK4454はMUTEを含む0.5dBステップ、256レベルのチャネル独立ディジタル出力ボリューム(ATT)を内 蔵しています。このボリュームはDACの前段にあり、入力データを0dBから127dBまでアテネーション、 またはミュートします。設定値間の遷移はソフト遷移です。従って、遷移中にスイッチングノイズは発 生しません。 ATT7-0bits Attenuation Level (register 03-04H, 0F-10H) FFH +0dB (default) FEH -0.5dB FDH -1.0dB : : : : 02H -126.5dB 01H -127.0dB 00H MUTE (-∞) Table 17. Attenuation Level of Digital Attenuator ディジタルボリュームの遷移時間はATS1-0 bitsで設定します(Table 18)。 Mode0-4の設定値間の遷移はソ フト遷移です。したがって、遷移中にスイッチングノイズは発生しません。PCM modeとDSD modeを切 り替えてもレジスタ設定値は保持されます。 Mode ATS1 ATS0 ATT speed (default) 0 0 0 4080/fs 1 0 1 2040/fs 2 1 0 510/fs 3 1 1 255/fs Table 18. Transition Time between Set Values of ATT7-0 bits Mode 0の場合、ATT設定間の遷移は4080レベルでソフト遷移します。FFH (0dB)から00H (MUTE)までに は4080/fs (92.5ms@fs=44.1kHz)かかります。PDN pinを “L” にすると、ATT7-0 bitsはFFHに初期化されま す。 リセット期間中にディジタルボリュームを変更した場合、リセット解除後に設定値になります。リセッ ト解除後5/fsの間にディジタルボリュームを変更した場合、ソフト遷移せず即座に設定値になります。 DSD modeの場合、ATT7-0 bits= “02H”, “01H”もMUTEになります。 015006358-J-01 2015/08 - 44 - [AK4454] ■ 帯域外ノイズ除去フィルタ（PCM mode、DSD mode） AK4454は周波数特性の選択可能な帯域外ノイズ除去フィルタを内蔵しています。このフィルタは帯域 外ノイズを減衰し、スイッチングレギュレータ等の影響によるアナログ特性の劣化を防ぎます。FIR2-0 bitsにより、ノイズを減衰する周波数を設定することができます。DSD direct modeのみ、その他のモー ドと異なるフィルタ特性となります(Table 19)。 FIR2-0 bits 000 001 010 011 100 101 110 111 FIR filter Mode 0 1 2 3 4 5 6 7 FIR filter Except DSD direct mode DSD direct mode 1/4*[1 1 1 1 0 0 0 0 0 0 0 0 0 0 0 0] 1/2*[1 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0] 1/4*[1 1 0 0 0 0 0 0 0 0 0 0 0 0 1 1] 1/2*[0 1 0 0 0 0 0 0 0 0 0 0 0 0 1 0] 1/4*[1 0 1 0 0 0 0 0 0 0 0 0 0 1 0 1] 1/2*[0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0] 1/4*[1 0 0 1 0 0 0 0 0 0 0 0 1 0 0 1] 1/2*[0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0] 1/4*[1 0 0 0 1 0 0 0 0 0 0 1 0 0 0 1] 1/2*[0 0 0 0 1 0 0 0 0 0 0 1 0 0 0 0] 1/4*[1 0 0 0 0 1 0 0 0 0 1 0 0 0 0 1] 1/2*[0 0 0 0 0 1 0 0 0 0 1 0 0 0 0 0] 1/4*[1 0 0 0 0 0 1 0 0 1 0 0 0 0 0 1] 1/2*[0 0 0 0 0 0 1 0 0 1 0 0 0 0 0 0] 1/4*[1 0 0 0 0 0 0 1 1 0 0 0 0 0 0 1] 1/2*[0 0 0 0 0 0 0 1 1 0 0 0 0 0 0 0] Table 19. FIR Filter Setting (default) Figure 36. Mode0 FIR Filter (Except DSD direct mode) Figure 37. Mode1 FIR Filter (Except DSD direct mode) 015006358-J-01 2015/08 - 45 - [AK4454] Figure 38. Mode2 FIR Filter (Except DSD direct mode) Figure 39. Mode3 FIR Filter (Except DSD direct mode) Figure 40. Mode4 FIR Filter (Except DSD direct mode) 015006358-J-01 2015/08 - 46 - [AK4454] Figure 41. Mode5 FIR Filter (Except DSD direct mode) Figure 42. Mode6 FIR Filter (Except DSD direct mode) Figure 43. Mode7 FIR Filter (Except DSD direct mode) 015006358-J-01 2015/08 - 47 - [AK4454] Figure 44. Mode0 FIR Filter (DSD direct mode) Figure 45. Mode1 FIR Filter (DSD direct mode) Figure 46. Mode2 FIR Filter (DSD direct mode) 015006358-J-01 2015/08 - 48 - [AK4454] Figure 47. Mode3 FIR Filter (DSD direct mode) Figure 48. Mode4 FIR Filter (DSD direct mode) Figure 49. Mode5 FIR Filter (DSD direct mode) 015006358-J-01 2015/08 - 49 - [AK4454] Figure 50. Mode6 FIR Filter (DSD direct mode) Figure 51. Mode7 FIR Filter (Except DSD direct mode) 015006358-J-01 2015/08 - 50 - [AK4454] ■ ゼロ検出機能（PCM mode、DSD mode） ゼロ検出機能を有効にした場合、入力データにSMUTEとDATTの演算を施したデータが8192回連続して “0”となると、DZF pinが “H”になります。ゼロ検出するチャネルは08Hレジスタ(L1-2, R1-2 bits)で設定 可能です。その後、ゼロ検出するチャネルのデータが“0”でなくなるとDZF pinが“L”になります。RSTN bit が“0”の場合、DZF pinとも“H”になります。RSTN bitが“1”になった後、ゼロ検出するチャネルのデー タが“0”でなくなるとDZF pinは4 5LRCK後に“L”になります。DZF pinの極性はDZFB bitで反転すること が可能です(Table 20)。全てのチャネルがDisableのとき、Not zeroとなります。DSDD bit= “1”のとき、ゼ ロ検出機能は無効です。 DZFB bit Data DZF pin Not zero L 0 Zero detect H Not zero H 1 Zero detect L Not zero: 07H/08Hレジスタ(L1-2, R1-2)の “1”に設定されたチャンネルのいずれかがゼロ検出しない Zero detect: 07H/08Hレジスタ(L1-2, R1-2)の “1”に設定されたチャンネル全てがゼロ検出 Table 20. DZF Pin Function ■ LRチャネル出力信号選択機能 (PCM mode, DSD mode) L chとR chに出力される信号の組み合わせを選択する機能です。MONO1-2 bitsとSELLR1-2 bitsで AOUTL1-2, AOUTR1-2それぞれの入力/出力の組み合わせを変更できます。また、INVL1-2, INVR1-2 bits で入力に対する出力信号の位相を反転することができます。併せて使用することで、16通りの組み合わ せを選択できます。この機能はすべてのオーディオフォーマットで使用できます。 MONO1 bit SELLR1 bit 0 0 0 1 1 0 1 1 INVL1 bit INVR1 bit 0 0 1 0 0 1 1 1 0 0 1 0 0 1 1 1 0 0 1 0 0 1 1 1 0 0 1 0 0 1 1 1 Table 21 Output Select for DAC1 015006358-J-01 L1ch Out R1ch Out L1ch In L1ch In Invert L1ch In L1ch In Invert R1ch In R1ch In Invert R1ch In R1ch In Invert L1ch In L1ch In Invert L1ch In L1ch In Invert R1ch In R1ch In Invert R1ch In R1ch In Invert R1ch In R1ch In R1ch In Invert R1ch In Invert L1ch In L1ch In L1ch In Invert L1ch In Invert L1ch In L1ch In L1ch In Invert L1ch In Invert R1ch In R1ch In R1ch In Invert R1ch In Invert 2015/08 - 51 - [AK4454] MONO2 bit ■ SELLR2 bit 0 0 0 1 1 0 1 1 INVL2 bit INVR2 bit 0 0 1 0 0 1 1 1 0 0 1 0 0 1 1 1 0 0 1 0 0 1 1 1 0 0 1 0 0 1 1 1 Table 22 Output Select for DAC2 L2ch Out R2ch Out L2ch In L2ch In Invert L2ch In L2ch In Invert R2ch In R2ch In Invert R2ch In R2ch In Invert L2ch In L2ch In Invert L2ch In L2ch In Invert R2ch In R2ch In Invert R2ch In R2ch In Invert R2ch In R2ch In R2ch In Invert R2ch In Invert L2ch In L2ch In L2ch In Invert L2ch In Invert L2ch In L2ch In L2ch In Invert L2ch In Invert R2ch In R2ch In R2ch In Invert R2ch In Invert 音質調整機能(PCM, DSD) AK4454は好みにより、テストレジスタSC1-0 bitsで音質をコントロールできます。 SC1 SC0 0 0 Sound Mode 1 0 1 2 1 0 3 1 (default) 1 4 Table 23. Sound Quality Select Mode 015006358-J-01 2015/08 - 52 - [AK4454] ■ DSD信号フルスケール (FS) 検出機能 AK4454は、DSD Mode時に各チャネルでフルスケールの信号を検出する機能を持ちます。 各チャネルの入力データDSDL1/2, DSDR1/2が2048回連続して“0”(-FS)or “1”(+FS)の場合、AK4454はフル スケール検出状態となり、CPUレジスタDML1/2, DMR1/2に“1”を読み出します。またDDM bit= “1”の時、 フルスケール検出状態となると、出力はMute状態になります。DSDD bit = “0”の場合はソフト遷移しま すが、DSDD bit = “1”の場合はソフト遷移しません。 DDM bit= “1”の時、フルスケール検出状態からの通常動作モードへの復帰は、DMC bitで制御します。 DMC bit= “0”の時、AK4454は通常信号が入力されると、自動復帰し通常動作モードに移行します。 DMC bit= “1”の時、AK4454にDMRE bit= “1”を書き込むことで通常動作モードに移行します(DMRE bit= “1”であっても、書き込みされない場合は通常モードに移行しません)。 DSDD Mode 検出後の状態 0 Normal path DSD Mute 1 Volume pass PD (default) Table 24. DSD Mode とフルスケール検出後の状態 (DDM bit= “0”) 2048fs DSD Error (DDR or DDLbit) DSD Data DSD Data DSD Data (FS or -FS ) DSD Data AOUT Figure 52. DSD FS 検出時のアナログ出力波形 (DSDD bit= “1”の時) 2048fs DSD Error (DDR or DDLbit) DSD Data DSD Data DSD Data (FS or -FS ) DSD Data AOUT Figure 53. DSD FS 検出時のアナログ出力波形 (DSDD bit= “0”の時) 015006358-J-01 2015/08 - 53 - [AK4454] ■ ソフトミュート機能（PCM mode、DSD mode） ソフトミュートはディジタル的に実行されます。SMUTE pinを“H”またはSMUTE bitを“1”にするとその 時点のATT設定値からATT設定値 ATT遷移時間で入力データが (“0”)までアテネーションされます。 SMUTE pinを“L”またはSMUTE bitを“0”にすると状態が解除され、からATT設定値 ATT遷移時間 でATT設定値まで復帰します。ATT遷移時間はATS1-0 bitsで設定します。ソフトミュート開始後、ま でアテネーションされる前に解除されるとアテネーションが中断され、同じサイクルでATT設定値まで 復帰します。ソフトミュート機能は信号を止めずに信号源を切り替える場合などに有効です。 SMUTE pin or SMUTE bit (1) (1) ATT_Level (3) Attenuation - GD (2) GD (2) AOUT DZF pin (4) 8192/fs 注： (1) ATT設定値 ATT遷移時間。例えば、Normal Speed Mode時、ATT設定値が“255”の場合は4080LRCK サイクルです。 (2) ディジタル入力に対するアナログ出力は群遅延(GD)をもちます。 (3) ソフトミュート開始後、までアテネーションされる前に解除されるとアテネーションが中断さ れ、同じサイクルでATT設定値まで復帰します。 (4) ゼロ検出するチャネルの入力データが8192回連続して“0”の場合、DZF pinは“H”になります。その 後、ゼロ検出するチャネルの入力データが“0”でなくなると、対応するチャネルのDZF pinが“L”に なります。 Figure 54. Soft Mute Function 015006358-J-01 2015/08 - 54 - [AK4454] ■ エラー検出 AK4454はLDOE pin = “H” , I2Cモード時に、3項目のエラー検出が可能です(Table 25)。エラーが検出され ると全ての回路がパワーダウンし、出力はHi-Zになります。エラー時はI2CモードではACKが返りません。 一旦エラーが検出されるとエラー状態が解除されても自動復帰しませんので、PDN pinで再起動してく ださい。 エラー項目 エラー判定条件 1 内部リファレンス電圧エラー 内部リファレンス電圧が立ち上がらない 2 LDO過電圧検出 LDO電圧 > 2.2～2.5V 3 LDO過電流検出 LDO電流< 40～110mA No Table 25. エラー検出 ■ システムリセット 電源ON 時には、PDN pinに一度“L”を入力してリセットして下さい。 PCM(DSD) mode 時は、PDN pinを“H”にした後、MCLK、LRCK(DCLK)を入力することでリセット解除 されます。システムはまずMCLKの立ち上がりを検出し、その後LRCK(DCLK)の立ち上がりによってア ナログ部のパワーダウン状態が解除されます。ディジタル部は内部カウンタがMCLKを4/fsカウントして からパワーダウン解除されます。 015006358-J-01 2015/08 - 55 - [AK4454] ■ パワーダウン機能 PDN pinを“L”にするとパワーダウン状態になり、アナログ出力はフローティング状態(Hi-Z)になります。 (Figure 55)にパワーダウン及びパワーアップ時のシステムタイミング例を示します。 Power (1) PDN pin VDD18 pin (2) Internal PDN Internal State DAC In (Digital) “0”data “0”data GD (4) DAC Out (Analog) Clock In Reset Normal Operation(レジスタを書き込み、DAC 入力可能) (3) (5) (5) Don’t care (4) Don’t care MCLK,LRCK,BICK (7) DZF External Mute GD (6) Mute ON Mute ON 注： (1) AVDDおよびTVDD立ち上げと、PDN pin を150ns “L” にしてください。 (2) LDOE pin= “H”のとき、パワーアップ後内部LDOが立ち上がります。内部回路は内部オシレータ のカウントアップ後、シャットダウンスイッチがオンした後(10ms(max))にパワーアップします。 LDOE pin= “L”のとき、パワーアップ後内部シャットダウンスイッチがオンします。内部回路は シャットダウンスイッチがオンした後(1ms(max))にパワーアップします。 (2)の期間中はディジタル出力ピン及びディジタル入出力ピンから瞬時的なパルス(パルス幅 Max1s)が出力されることがあります。システムの誤動作を避けるため、(2)の期間中にこれら のピンの出力を参照することと、同じ3-wire Serial / I2Cバス上にあるデバイスと通信をすること は避けて下さい。 (3) ディジタル入力に対してアナログ出力は群遅延(GD)を持ちます。 (4) パワーダウン時、アナログ出力はHi-Zです。 (5) PDN信号のエッジ(“ ”)でクリックノイズが出力されます。このノイズはデータが“0”の場合で も出力されます。 (6) クリックノイズ(5)が問題になる場合はアナログ出力を外部でミュートして下さい。タイミング 例を示します。 (7) パワーダウン状態(PDN pin = “L”)では、DZF pinは“L”になります。 Figure 55. Power-down/up Sequence Example 015006358-J-01 2015/08 - 56 - [AK4454] ■ パワーオフ、リセット機能 PW アナログ出力 RSTN DAC1/2 レジスタ ディジタル 1/2 DAC1 DAC2 1 00 OFF/OFF Hi-Z Hi-Z 保持 オフ 1 10 ON/OFF normal Hi-Z 保持 オン 1 01 OFF/ON Hi-Z normal 保持 オン 1 11 ON/ON normal normal 保持 オン 0 00 OFF /OFF Hi-Z Hi-Z 保持 オフ 0 10 ON/OFF VREFH/2 Hi-Z 保持 オフ 0 01 OFF/ON Hi-Z VREFH/2 保持 オフ 0 11 ON/ON VREFH/2 VREFH/2 保持 オフ Table 26. Power Off、Reset Function 1) パワーオフ機能1 (PW1-2 bits) PW1-2 bitsを“0”に設定するとDAC1-2が瞬時にパワーオフ状態になります。このとき、レジスタ以外の全 ての回路がパワーダウン状態となり、アナログ出力はフローティング状態(Hi-Z)になります。(Figure 56) にパワーオフ及びパワーオン時のシステムタイミング例を示します。 PW1-2 bit Internal State Normal Operation Power-off D/A In (Digital) “0” data GD D/A Out (Analog) (1) GD (3) Clock In (2) (3) (1) Don’t care MCLK, BICK, LRCK DZF External MUTE Normal Operation (5) (4) Mute ON 注： (1) ディジタル入力に対するアナログ出力は群遅延(GD)を持ちます。 (2) パワーオフ時、アナログ出力はHi-Zです。 (3) 内部PW1-2信号のエッジ(“ ”)でクリックノイズが出力されます。このノイズはデータが“0”の 場合でも出力されます。 (4) クリックノイズ(3)が問題になる場合はアナログ出力を外部でミュートして下さい。タイミング 例を示します。 (5) パワーオフ状態(PW1-2 bits= “00”)では、DZF pinは“L”になります。 Figure 56. Power-off/on Sequence Example 1 015006358-J-01 2015/08 - 57 - [AK4454] 2) リセット機能（RSTNビット） RSTN bitを“0”にするとDACはリセットされますが、内部レジスタは初期化されません。この時、MCLK、 LRCK、BICKが供給されていればアナログ出力はVREFH/2電圧になり、DZF pinは“H”になります。(Figure 57)にRSTN bitによるリセットシーケンスを示します。 RSTN bit 3~4/fs (5) 2~3/fs (5) Internal RSTN bit Internal State Normal Operation D/A In (Digital) “0” data (1) D/A Out (Analog) Clock In BICK Normal Operation Digital Block Power-down GD GD (3) (2) (3) (1) Don’t care 2/fs(4) DZF 注： (1) ディジタル入力に対してアナログ出力は群遅延(GD)を持ちます。 (2) RSTN bit = “0”時、アナログ出力はVREFH/2です。 (3) 内部RSTN信号のエッジ(“ ”)でクリックノイズが出力されます。このノイズはデータが“0”の場 合でも出力されます。 (4) DZF pinはRSTN bitの立ち下がりエッジで“H”になり、LSI内部のRSTN bitの立ち上がりエッジの 2/fs後、“L”になります。 (5) RSTN bitを書き込んでからLSI内部のRSTN bitが変化するまでの立ち下がり時に3 ~ 4/fsかかりま す。また、立ち上がり時に2 ~ 3/fsかります。 Figure 57. Reset Sequence Example 1 (注)リセット(RSTN bit= “0”)とビットパワーオフ(PW1-2 bits)を併用する場合、先にビットパワーオフしてくだ さい。 015006358-J-01 2015/08 - 58 - [AK4454] 3) MCLK停止によるリセット 動作中 (PDN pin = “H”) にMCLKが10us以上停止した場合に、AK4454は自動的にリセット状態になり、 アナログ出力はフローティング状態(Hi-Z)になります。MCLKを再入力後、リセット状態が解除され動 作を再開します。MCLKを止めているときは、ゼロ検出機能は動作しません。(Figure 58)にMCLK停止に よるリセットシーケンスを示します。 PDN pin RSTN bit (1) Internal State Power-down D/A In (Digital) Power-down Normal Operation (2) GD (4) Hi-Z (2) (4) (4) Clock In MCLK Stop MCLK External MUTE Normal Operation (3) GD D/A Out (Analog) Digital Circuit Power-down (5) (5) (5) 注： (1) 電源投入後PDN pinを “L”からスタートし150ns以上の間、PDN pinを“L”にして下さい。 (2) ディジタル入力に対してアナログ出力は群遅延(GD)を持ちます。 (3) ディジタルデータの入力を止めることができます。この区間に“0”データを入力しておくことで、 MCLK再入力後のクリックノイズを軽減できます。 (4) PDN pinの立ち上がり(“”)及びMCLKの入力から、3~4LRCK以内にクリックノイズが出力されま す。このノイズはデータが“0”の場合でも出力されます。 (5) クリックノイズ(4)が問題になる場合はアナログ出力を外部でミュートしてください。 Figure 58. Reset Sequence Example 2 015006358-J-01 2015/08 - 59 - [AK4454] ■ 同期化機能（PCM mode） 同期化機能（アナログ出力位相合わせ機能） 同期化機能を有するAKM製品と同時に使用する場合、アナログ出力の位相のずれが3/256fsの範囲内にす る機能です。動作中にSYNCE bitを “1”に設定すると、(1)全てのチャネルの入力データが8192回連続し て“0”の場合、もしくは(2)RSTN bit= “0”の場合に、アナログ出力位相合わせ機能が有効になります。 例）AK4458との同時使いの場合(Figure 59) AK4454とAK4458は同期化機能を有しており、AK4454の出力(AOUT1-2LP/N_4, AOUT1-2RP/N_4)と AK4458の出力(AOUT1-4LP/N_8, AOUT1-4RP/N_8)の位相ずれが3/256fsの範囲内になります。 DSP AK4454 MCLK LRCK MCLK LRCK AOUT1LP/N AOUT1RP/N AOUT2LP/N AOUT2RP/N AOUT1LP/N_4 AOUT1RP/N_4 AOUT2LP/N_4 AOUT2RP/N_4 AK4458 MCLK LRCK AOUT1LP/N AOUT1RP/N AOUT1LP/N_8 AOUT1RP/N_8 AOUT4LP/N AOUT4RP/N AOUT4LP/N_8 AOUT4RP/N_8 Figure 59. クロック同期化機能システム例 015006358-J-01 2015/08 - 60 - [AK4454] ■ パラレルモード（PCM mode） AK4454はI2C pin= “H”, PS pin = “H”とすることでパラレルモードを選択できます。パラレルモードは TDM1-0, DIF pin により、オーディオインタフェースモードを設定できます(Table 27)。また、DCHAIN pin= “H”とすることで、Daisy Chain modeを選択できます。パラレルモードでは強制的にAuto Setting mode になります。 パラレルモードではゼロ検出機能は使用できません。レジスタ設定が必要な機能はデフォルト値から変 更できません。 TDM1 pin 0 0 0 0 1 1 1 1 ■ TDM0 pin DIF pin 0 0 0 1 1 0 1 1 0 0 0 1 1 0 1 1 Table 27. Parallel Mode Mode Mode6(Table 13) Mode7(Table 13) Mode12(Table 13) Mode13(Table 13) Mode18(Table 13) Mode19(Table 13) Mode24(Table 13) Mode25(Table 13) レジスタコントロールインタフェース AK4454はI2C pin = “L”のとき3線シリアルコントロールモード、I2C pin = “H” , PS pin= “L”のときI2Cバス コントロールモードで内部レジスタを制御します。 015006358-J-01 2015/08 - 61 - [AK4454] (1) 3線シリアルコントロールモード (I2C pin = “L”) このモードでは3線式シリアルI/F pin: CSN, CCLK, CDTIで書き込みを行います。I/F上のデータはChip address (2-bit, C1/0), Read/Write (1-bit, “1”固定, Write only), Register address (MSB first, 5-bit)とControl data (MSB first, 8-bit)で構成されます。データ送信側はCCLKの“”で各ビットを出力し、受信側は“”で取り 込みます。データの書き込みはCSNの“”で有効になります。CCLKのクロックスピードは5MHz (max) です。 PDN pinを“L”にすると内部レジスタ値が初期化されます。また、シリアルモードではRSTN bitに“0”を書 き込むと内部タイミング回路がリセットされます。但し、このときレジスタの内容は初期化されません。 CSN 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 CCLK CDTI C1 C0 R/W A4 A3 A2 A1 A0 D7 D6 D5 D4 D3 D2 D1 D0 C1-C0: R/W: A4-A0: D7-D0: Chip Address (C1=CAD1, C0=CAD0) READ/WRITE (Fixed to “1”, Write only) Register Address Control Data Figure 60. Control I/F Timing *3線シリアルモードはデータ読み出しをサポートしません。 *PDN pin = “L”時は、コントロールレジスタへの書き込みはできません。 *CSN = “L”期間中に CCLKの“”が15回以下または17回以上の場合、データは書き込まれません。 015006358-J-01 2015/08 - 62 - [AK4454] (2) I2Cバスコントロールモード (I2C pin = “H”) AK4454のI2Cバスモードのフォーマットは、高速モード(max:400kHz, Ver1.0)に対応しています。 1. WRITE命令 I2Cバスモードにおけるデータ書き込みシーケンスは(Figure 61)に示されます。バス上のICへのアクセス には、最初に開始条件(Start Condition)を入力します。SCLラインが “H”の時にSDAラインを “H”から “L” にすると、開始条件が作られます(Figure 67)。開始条件の後、スレーブアドレスが送信されます。この アドレスは7-bitから構成され、8-bit目にはデータ方向ビット(R/W)が続きます。上位5-bitは “00100”固定、 次の2-bitはアクセスするICを選ぶためのアドレスビットで、CAD1-0 pinsにより設定されます(Figure 62)。 アドレスが一致した場合、AK4454は確認応答(Acknowledge)を生成し、命令が実行されます。マスタは 確認応答用のクロックパルスを生成し、SDAラインを解放しなければなりません(Figure 68)。R/Wビッ トが “0”の場合はデータ書き込み、R/Wビットが “1”の場合はデータ読み出しを行います。 第2バイトはサブアドレス(レジスタアドレス)です。サブアドレスは8-bit、MSB firstで構成され、上位3-bit は “0”固定です(Figure 63)。第3バイト以降はコントロールデータです。コントロールデータは8-bit、MSB firstで構成されます(Figure 64)。AK4454は、各バイトの受信を完了するたびに確認応答を生成します。 データ転送は、必ずマスタが生成する停止条件(Stop Condition)によって終了します。SCLラインが “H” の時にSDAラインを“L”から “H”にすると、停止条件が作られます(Figure 67)。 AK4454は複数のバイトのデータを一度に書き込むことができます。データを1バイト送った後、停止条 件を送らず更にデータを送ると、サブアドレスが自動的にインクリメントされ、次のデータは次のサブ アドレスに格納されます。アドレス “14H”を越えるデータを送ると、内部レジスタに対応するアドレス カウンタはロールオーバし、アドレス “00H”から順に格納されます。 クロックが “H”の間は、SDAラインの状態は一定でなければなりません。データラインが “H”と “L” の間で状態を変更できるのは、SCLラインのクロック信号が “L”の時に限られます(Figure 69)。SCLライ ンが “H”の時にSDAラインを変更するのは、開始条件、停止条件を入力するときのみです。 S T A R T SDA S S T O P R/W= “0” Slave Address Sub Address(n) A C K Data(n) Data(n+1) A C K A C K Data(n+x) A C K A C K P A C K Figure 61. I2Cバスモードのデータ書き込みシーケンス 0 0 1 0 0 CAD1 CAD0 R/W A1 A0 D1 D0 (CAD0はpinにより設定) Figure 62. 第1バイトの構成 0 0 0 A4 A3 A2 Figure 63. 第2バイトの構成 D7 D6 D5 D4 D3 D2 Figure 64. 第3バイト以降の構成 015006358-J-01 2015/08 - 63 - [AK4454] 2. READ命令 R/Wビットが “1”の場合、AK4454はREAD動作を行います。指定されたアドレスのデータが出力された 後、マスタが停止条件を送らず確認応答を生成すると、サブアドレスが自動的にインクリメントされ、 次のアドレスのデータを読み出すことができます。アドレス “14H”のデータを読み出した後、さらに次 のアドレスを読み出す場合にはアドレス “00H”のデータが読み出されます。 AK4454はカレントアドレスリードとランダムリードの2つのREAD命令を持っています。 2-1. カレントアドレスリード AK4454は内部にアドレスカウンタを持っており、カレントアドレスリードではこのカウンタで指定さ れたアドレスのデータを読み出します。内部のアドレスカウンタは最後にアクセスしたアドレスの次の アドレス値を保持しています。例えば、最後にアクセス(READでもWRITEでも)したアドレスが “n”で あり、その後カレントアドレスリードを行った場合、アドレス “n+1”のデータが読み出されます。カレ ントアドレスリードでは、AK4454はREAD命令のスレーブアドレス(R/W = “1”)の入力に対して確認応答 を生成し、次のクロックから内部のアドレスカウンタで指定されたデータを出力したのち内部カウンタ を1つインクリメントします｡データが出力された後､マスタが確認応答を生成せず停止条件を送ると、 READ動作は終了します。 S T A R T SDA S S T O P R/W= “1” Slave Address Data(n) A C K Data(n+1) A C K Data(n+2) A C K Data(n+x) A C K A C K P A C K Figure 65. カレントアドレスリード命令 2-2. ランダムアドレスリード ランダムアドレスリードにより任意のアドレスのデータを読み出すことができます。ランダムアドレス リードはREAD命令のスレーブアドレス(R/W bit= “1”)を入力する前に、ダミーのWRITE命令を入力する 必要があります。ランダムアドレスリードでは最初に開始条件を入力し、次にWRITE命令のスレーブア ドレス(R/W = “0”)、読み出すアドレスを順次入力します。AK4454がこのアドレス入力に対して確認応 答を生成した後、再送条件、READ命令のスレーブアドレス(R/W bit= “1”)を入力します。AK4454はこの スレーブアドレスの入力に対して確認応答を生成し、指定されたアドレスのデータを出力し、内部アド レスカウンタを1つインクリメントします。データが出力された後、マスタがアクノリッジを生成せず 停止条件を送ると、READ動作は終了します。 S T A R T SDA S S T A R T R/W= “0” Slave Address Sub Address(n) A C K S A C K S T O P R/W= “1” Slave Address Data(n) A C K Data(n+1) A C K Data(n+x) A C K A C K P A C K Figure 66. ランダムアドレスリード命令 015006358-J-01 2015/08 - 64 - [AK4454] SDA SCL S P start condition stop condition Figure 67. 開始条件と停止条件 DATA OUTPUT BY TRANSMITTER not acknowledge DATA OUTPUT BY RECEIVER acknowledge SCL FROM MASTER 2 1 8 9 S clock pulse for acknowledgement START CONDITION Figure 68. I2Cバスでの確認応答 SDA SCL data line stable; data valid change of data allowed Figure 69. I2Cバスでのビット転送 015006358-J-01 2015/08 - 65 - [AK4454] ■ ファンクションリスト PCM ModeとDSD Modeで有効な機能が異なります。 Function Attenuation Level Default 0dB アドレス 03-04H 0F-10H 00H 08H ビット PCM DSD ATT7-0 Y Y Y Y Y Y Y Y Y Y N/A Y N/A N/A N/A N/A Y Y N/A Y Y Y Y Y Y Y Y Y Y N/A Y N/A Audio Data Interface Modes 32-bit前詰め DIF2-0 Data Zero Detect Enable Disable L1-2/R1-2 Minimum delay Filter Enable SD Slow Rolloff Filter Enable Sharp roll-off filter 01-02H SLOW Short delay Filter Enable De-emphasis Response OFF 01H,0AH DEM1-2 Soft Mute Enable Normal Operation 01H SMUTE DSD/PCM Mode Select PCM mode 02H D/P Master Clock Frequency Select at 512fs 02H DCKS DSD mode MONO mode Stereo mode select Stereo 02H,0DH MONO Inverting Enable of DZF “H” active 02H DZFB The data selection of L channel R channel 02H,05H SELLR1-2 and R channel The data selection of DAC1-4 Normal 0A-0BH SDS1/2 Data Invert Mode OFF 05H INVL1-2/R1-2 クロック同期化機能 Not Available 07H SYNCE Table 28. Function List (Y: Available, N/A: Not available) 015006358-J-01 2015/08 - 66 - [AK4454] ■ レジスタマップ Addr 00H 01H 02H 03H 04H 05H 06H 07H 08H 09H 0AH 0BH 0CH 0DH 0EH 0FH 10H Register Name Control 1 Control 2 Control 3 L1ch ATT R1ch ATT Control 4 DSD1 Control 5 Sound Control DSD2 Control 6 Control 7 Control 8 Control 9 Reserved L2ch ATT R2ch ATT D7 ACKS 0 DP ATT7 ATT7 INVL1 DDM 0 L1 DML2 TDM1 ATS1 0 0 0 ATT7 ATT7 D6 0 0 0 ATT6 ATT6 INVR1 DML1 0 R1 DMR2 TDM0 ATS0 0 0 1 ATT6 ATT6 D5 0 SD DCKS ATT5 ATT5 INVL2 DMR1 0 L2 0 SDS1 0 0 MONO2 0 ATT5 ATT5 D4 0 DFS1 DCKB ATT4 ATT4 INVR2 DMC 0 R2 0 SDS2 SDS0 0 0 1 ATT4 ATT4 D3 DIF2 DFS0 MONO1 ATT3 ATT3 SELLR2 DMRE 0 0 0 PW2 1 0 0 0 ATT3 ATT3 D2 DIF1 DEM11 DZFB ATT2 ATT2 0 0 0 0 0 PW1 1 FIR2 0 0 ATT2 ATT2 D1 DIF0 DEM10 SELLR1 ATT1 ATT1 DFS2 DSDD 1 SC1 DSDF DEM21 DCHAIN FIR1 0 0 ATT1 ATT1 D0 RSTN SMUTE SLOW ATT0 ATT0 SSLOW DSDSEL0 SYNCE SC0 DSDSEL1 DEM20 0 FIR0 0 0 ATT0 ATT0 Note 35. アドレス11H 1FHへの書き込みは禁止です。 Note 36. PDN pinを“L”にするとレジスタの内容が初期化されます。 Note 37. RSTN bitに“0”を書き込むと内部タイミング回路がリセットされますが、レジスタの内容は 015006358-J-01 2015/08 - 67 - [AK4454] ■ 詳細説明 Addr Register Name 00H Control 1 R/W Default RSTN: D7 ACKS R/W 0 D6 0 R/W 0 D5 0 R/W 0 D4 0 R/W 0 D3 DIF2 R/W 1 D2 DIF1 R/W 1 D1 DIF0 R/W 0 D0 RSTN R/W 0 Internal Timing Reset 0: Reset. All registers are not initialized. (default) 1: Normal Operation “0”で内部タイミング回路がリセットされますが、レジスタの内容は初期化されません。 DIF2-0: Audio Data Interface Modes (Table 13) 初期値は“110” (Mode6: 32-bit前詰め)です。 TDM1, TDM0によってFormatが異なりますのでご注意ください。 ACKS: Master Clock Frequency Auto Setting Mode Enable (PCM only) 0: Disable Manual Setting Mode (default) 1: Enable Auto Setting Mode ACKS bitが“1”の時、サンプリング周波数とMCLK周波数は自動検出されます。 Addr Register Name 01H Control 2 R/W Default D7 0 R/W 0 D6 0 R/W 0 D5 SD R/W 1 D4 DFS1 R/W 0 D3 DFS0 R/W 0 D2 DEM11 R/W 0 D1 DEM10 R/W 1 D0 SMUTE R/W 0 SMUTE: Soft Mute Enable. 0: Normal Operation (default) 1: DAC outputs soft-muted. DEM11-0:DAC1 De-emphasis Response (Table 16) 初期値は“01” (OFF)です。 DFS1-0: Sampling Speed Control (Table 2) 初期値は“00” (Normal Speed)です。DFS2は、address 05Hを参照してください。 DFS2-0 bitsを切り替えた場合、クリックノイズが発生します。 SD: Short delay Filter Enable. (Table 15) 0: Sharp roll-off filter 1: Short delay filter (default) 015006358-J-01 2015/08 - 68 - [AK4454] Addr Register Name 02H Control 3 R/W Default D7 DP R/W 0 D6 0 R/W 0 D5 DCKS R/W 0 D4 DCKB R/W 0 D3 MONO1 R/W 0 D2 DZFB R/W 0 D1 SELLR1 R/W 0 D0 SLOW R/W 0 SLOW: Slow Roll-off Filter Enable. (Table 15) 0: Sharp roll-off filter (default) 1: Slow roll-off filter SELLR1: The data selection of DAC1 L channel and R channel, when MONO mode (Table 21) 0: All channel output L channel data. (default) 1: All channel output R channel data. MONO1 bit, INVL1 bit, INVR1 bit の設定も確認ください。 DZFB: Inverting Enable of DZF(Table 20) 0: DZF pin goes “H” at Zero Detection (default) 1: DZF pin goes “L” at Zero Detection MONO1: MONO1 bitが“1”の時DAC1がモノラル出力になります(Table 21) 0: Stereo mode (default) 1: MONO mode DCKB: Polarity of DCLK (DSD Only) 0: DSD data is output from DCLK falling edge. (default) 1: DSD data is output from DCLK rising edge. DCKS: Master Clock Frequency Select at DSD mode (DSD only) 0: 512fs (default) 1: 768fs DP: DSD/PCM Mode Select 0: PCM Mode (default) 1: DSD Mode D/P bitの設定を変更した場合は、RSTN bitでAK4454をリセットして下さい。 Addr Register Name 03H L1ch ATT 04H R1ch ATT R/W Default D7 ATT7 ATT7 R/W 1 D6 ATT6 ATT6 R/W 1 D5 ATT5 ATT5 R/W 1 D4 ATT4 ATT4 R/W 1 D3 ATT3 ATT3 R/W 1 D2 ATT2 ATT2 R/W 1 D1 ATT1 ATT1 R/W 1 D0 ATT0 ATT0 R/W 1 ATT7-0: Attenuation Level (Table 17) Initial value is “FF” (0dB). 015006358-J-01 2015/08 - 69 - [AK4454] Addr Register Name 05H Control 4 R/W Default D7 INVL1 R/W 0 D6 INVR1 R/W 0 D5 INVL2 R/W 0 D4 INVR2 R/W 0 D3 SELLR2 R/W 0 D2 0 R/W 0 D1 DFS2 R/W 0 D0 SSLOW R/W 0 SSLOW: Digital Filter Bypass Mode Enable 0: Enable digital filter selected by SD and SLOW bits (default) 1: Super Slow Roll-off Mode DFS2: Sampling Speed Control (Table 2) 初期値は“0” (Normal Speed)です。DFS1-0は、address 01Hを参照してください。 DFS2-0 bitsを切り替えた場合、クリックノイズが発生します。 SELLR2: Data Selection of DAC2 L channel and R channel, when MONO mode (Table 22) 0: All channel output L channel data. (default) 1: All channel output R channel data. MONO2 bit, INVL2 bit, INVR2 bit の設定も確認ください。 INVL1: INVR1: INVL2: INVR2: AOUTL1出力位相反転ビット AOUTR1出力位相反転ビット AOUTL2出力位相反転ビット AOUTR2出力位相反転ビット 0: 正転 (default) 1: 反転 015006358-J-01 2015/08 - 70 - [AK4454] Addr Register Name 06H DSD1 R/W Default D7 DDM R/W 0 D6 DML1 R 0 D5 DMR1 R 0 D4 DMC R/W 0 D3 DMRE R/W 0 D2 0 R/W 0 D1 DSDD R/W 0 D0 DSDSEL0 R/W 0 DSDSEL1-0: DSD Sampling Speed Control (Table 10) 初期値は“00”です。 DSDD: DSD Play Back Path Control (Table 11) 初期値は“0”です。 DMRE: DSD Mute Release 0: Hold (default) 1: Mute release このレジスタはDDM bit = “1”かつ DMC bit = “1”のときのみ、有効です。DDM bit, DMC bit によりAK4454がDSD dataをmuteしているとき “1”にすることによりmuteが解除されます。 DMC: DSD Mute Control 0: Auto Return (自動復帰) (default) 1: Mute Hold このレジスタはDDM bit = “1”とき有効です。このレジスタはDDM bitによりAK4454がDSD dataのmuteを行ったあと、DSD dataのレベルがフルスケール以下になった場合の処理を選択 できます。 DMR1/DML1: このレジスタは、DSDR1/L1がFS検出した際に、検出フラグを出力します。 DDM: DSD Data Mute 0: Disable (default) 1: Enable AK4454はDSD dataが2048sample(1/fs)の期間すべて “1”, “0”となったとき内部で出力をミュ ートする機能があります。このレジスタはその機能を有効することが出来ます。 015006358-J-01 2015/08 - 71 - [AK4454] Addr Register Name 07H Control 5 R/W Default D7 0 R/W 0 D6 0 R/W 0 D5 0 R/W 0 D4 0 R/W 0 D3 0 R/W 0 D2 0 R/W 0 D1 1 R/W 1 D0 SYNCE R/W 1 D6 R1 R/W 0 D5 L2 R/W 0 D4 R2 R/W 0 D3 0 R/W 0 D2 0 R/W 0 D1 SC1 R/W 0 D0 SC0 R/W 0 SYNCE: SYNC Mode Enable 0: SYNC Mode Disable 1: SYNC Mode Enable (default) Addr Register Name 08H Sound Control R/W Default D7 L1 R/W 0 SC1-0: Sound Control (Table 23) 初期値は“00”です。 L1-2, R1-2: Zero Detect Flag Enable bit for the DZF pin 0: Disable (default) 1: Enable 015006358-J-01 2015/08 - 72 - [AK4454] Addr Register Name 09H DSD2 R/W Default D7 DML2 R 0 D6 DMR2 R 0 D5 0 R 0 D4 0 R 0 D3 0 R 0 D2 0 R 0 D1 DSDF R/W 0 D0 DSDSEL1 R/W 0 DSDSEL1-0: DSD Sampling Speed Control (Table 10) 初期値は“00”です。 DSDF: DSD Filter Select (Table 12) 初期値は“0”です。 DMR2/DML2 このレジスタは、DSDR2/L2 pinがFS検出した際に、検出フラグを出力します。 Addr Register Name 0AH Control 6 R/W Default D7 TDM1 R/W 0 D6 TDM0 R/W 0 D5 SDS1 R/W 0 D4 SDS2 R/W 0 D3 PW2 R/W 1 D2 PW1 R/W 1 D1 DEM21 R/W 0 D0 DEM20 R/W 1 DEM21-0: DAC2 De-emphasis Response (Table 16) 初期値は“01” (OFF)です。 PW2-1: Power Down control for DAC PW2: Power management for DAC2 0: DAC2 power OFF 1: DAC2 power ON (default) PW1: Power management for DAC1 0: DAC1 power OFF 1: DAC1 power ON (default) SDS2-0: DAC1-2 Data Select のデータ選択 0: 通常動作 1: 別スロットのデータを出力 (Table 14) 初期値は“000”です。 TDM1-0: TDM Mode Select (Table 13) 015006358-J-01 2015/08 - 73 - [AK4454] Addr Register Name 0BH Control 7 R/W Default D7 ATS1 R/W 0 D6 ATS0 R/W 0 D5 0 R/W 0 D4 SDS0 R/W 0 D3 1 R/W 1 D2 1 R/W 1 D1 DCHAIN R/W 0 D0 0 R/W 0 D4 0 R/W 0 D3 0 R/W 0 D2 FIR2 R/W 0 D1 FIR1 R/W 0 D0 FIR0 R/W 0 DCHAIN: Daisy Chain Mode Enable 0: Daisy Chain Mode Disable (default) 1: Daisy Chain Mode Enable SDS2-0: DAC1-2のデータ選択 0: 通常動作 1: 別スロットのデータを出力 (Table 14) ATS1-0: ディジタルボリューム遷移時間の設定 (Table 18) 初期値は“00” です。 Addr Register Name 0CH Control 8 R/W Default D7 0 R/W 0 D6 0 R/W 0 D5 0 R/W 0 FIR2-0: 帯域外ノイズ除去フィルタコントロール(Table 19) 初期値は“000” です。 015006358-J-01 2015/08 - 74 - [AK4454] Addr Register Name 0DH Control 9 R/W Default D7 0 R/W 0 D6 0 R/W 0 D5 MONO2 R/W 0 D4 0 R/W 0 D3 0 R/W 0 D2 0 R/W 0 D1 0 R/W 0 D0 0 R/W 0 MONO2: MONO2 bitが“1”の時DAC2がモノラル出力になります(Table 22) 0: Stereo mode (default) 1: MONO mode Addr Register Name 0EH Reserved R/W Default D7 0 R/W 0 D6 1 R/W 1 D5 0 R/W 0 D4 1 R/W 1 D3 0 R/W 0 D2 0 R/W 0 D1 0 R/W 0 D0 0 R/W 0 Addr Register Name 0FH L2ch ATT 10H R2ch ATT R/W Default D7 ATT7 ATT7 R/W 1 D6 ATT6 ATT6 R/W 1 D5 ATT5 ATT5 R/W 1 D4 ATT4 ATT4 R/W 1 D3 ATT3 ATT3 R/W 1 D2 ATT2 ATT2 R/W 1 D1 ATT1 ATT1 R/W 1 D0 ATT0 ATT0 R/W 1 ATT7-0: Attenuation Level (Table 17) Initial value is “FF” (0dB). 015006358-J-01 2015/08 - 75 - [AK4454] 10. 外部接続回路例 ■ システム接続例 システム接続例を(Figure 70, Figure 71)、アナログ出力回路例を(Figure 72)に示します。 (1) LDOE pin = “H”, I2Cバスコントロールモード(I2C pin = “H”) DZF 8 CAD1 R2ch Out L2ch LPF L2ch Mute L2ch Out R1ch LPF R1ch Mute R1ch Out L1ch LPF L1ch Mute L1ch Out AOUTR2N 26 LDOE 28 VREFL2 25 22 AVDD 21 AVSS 20 0.1u + 10u AOUTR1P 19 AOUTR1N 18 VREFH1 17 N 15 AOUT1LN VREFL1 16 7 AOUTR2P 27 DSDR2 R2ch Mute VREFH2 24 AOUTL2N 23 AOUTL2P 14 AOUT1LP 6 TVDD 29 SDTI2 AK4454VN SDTI1 5 13 I2C 4 DVSS 30 LRCK R2ch LPF 10u + 12 PS 3 Analog 5.0V 0.1u 11 CAD0_I2C PDN 32 BICK 10 SCL Micro- MCLK 2 ９ SDA DSP 1 1u + 10u + 0.1u LDO18 31 Digital 3.3V 0.1u + 10u Controller Digital Ground Analog Ground + Electrolytic Capacitor Ceramic Capacitor 注: - Chip Address = “00”. BICK = 64fs, LRCK = fs - AVDDとVREFH1-2の配線はLDO等からの低インピーダンス状態のまま分けて配線して下さい。 AVDDとVREFH1-2のLDOを分けることを推奨します。分けられない場合は、VREFL1-2と VREFH1-2に10Ωと220uFのLPFを入れることを推奨します。 - DVSS、AVSSは同電位に接続して下さい。 -ディジタル入力ピンはオープンにしないで下さい。 Figure 70. Typical Connection Diagram (AVDD=5V, TVDD=3.3V) 015006358-J-01 2015/08 - 76 - [AK4454] (2) LDOE pin = “L”, I2Cバスコントロールモード(I2C pin = “H”) Digital 3.3V Digital 1.8V Analog 5.0V 10u + 8 CAD1 ９ Micro- AOUTR2P 27 LDOE 28 AOUTR2N 26 AVSS 20 0.1u L2ch Out R1ch LPF R1ch Mute R1ch Out L1ch LPF L1ch Mute L1ch Out + 10u AOUTR1P 19 AOUTR1N 18 VREFH1 17 N 0.1u + 10u Controller Digital Ground L2ch Mute VREFL2 25 22 AVDD 21 15 AOUT1LN VREFL1 16 DZF L2ch LPF VREFH2 24 AOUTL2N 23 AOUTL2P 14 AOUT1LP 7 TVDD 29 DSDR2 AK4454VN 6 13 I2C SDTI2 DVSS 30 SDTI1 5 R2ch Out 0.1u 12 PS 4 11 CAD0_I2C PDN 32 LRCK LDO18 31 3 10 SCL BICK SDA DSP MCLK 2 R2ch Mute 10u + 1u 0.1u + 1 R2ch LPF Analog Ground + Electrolytic Capacitor Ceramic Capacitor 注: - Chip Address = “00”. BICK = 64fs, LRCK = fs - AVDDとVREFH1-2の配線はLDO等からの低インピーダンス状態のまま分けて配線して下さい。 AVDDとVREFH1-2のLDOを分けることを推奨します。分けられない場合は、VREFL1-2と VREFH1-2に10Ωと220uFのLPFを入れることを推奨します。 - DVSS、AVSSは同電位に接続して下さい。 -ディジタル入力ピンはオープンにしないで下さい。 Figure 71. Typical Connection Diagram (AVDD=5V, TVDD=3.3V, VDD18=1.8V) 015006358-J-01 2015/08 - 77 - [AK4454] 1. グランドと電源のデカップリング AK4454ではデジタルノイズのカップリングを最小限に抑えるため、AVDD とTVDDをデカップリング します。AVDDにはシステムのアナログ電源を供給し、TVDDにはシステムのディジタル電源を供給し て下さい。DVSS、AVSSは同じアナロググランドに接続して下さい。デカップリングコンデンサ、特に 小容量のセラミックコンデンサはAK4454にできるだけ近づけて接続します。 2. 基準電圧 VREFH1-2 pinとVREFL1-2 pinに入力される電圧の差がアナログ出力のフルスケールを決定します。通常 はVREFH1-2 pinをAVDDに接続し、VREFL1-2 pinをAVSSに接続します。VREFH1-2 pinとVREFL1-2 pin との間に0.1µFのセラミックコンデンサを接続します。セラミックコンデンサはピンにできるだけ近づけ て接続して下さい。ディジタル信号、特にクロックはAK4454へのカップリングを避けるためVREFH1-2, VREFL1-2 pinからできるだけ離して下さい。 015006358-J-01 2015/08 - 78 - [AK4454] 3. アナログ出力 アナログ出力は完全差動出力になっており、出力レンジはVREFH/2を中心に2.8Vpp (typ, VREFH1-2 VREFL1-2 = 5V)です。差動出力は外部で加算されます。各チャンネルのAOUT+, AOUTの加算電圧は VAOUT = (AOUT+)(AOUT)です。加算ゲインが１の場合、出力レンジは5.6Vpp (typ, VREFH1/2 VREFL1/2 = 5V)です。外部加算回路のバイアス電圧は外部で供給します。 PCM入力コードのフォーマットは2’s compliment (2の補数)で7FFFFFH(@24-bit)に対しては正のフルスケ ール、800000H(@24-bit) に対しては負のフルスケール、000000H(@24-bit)でのVAOUTの理想値は0V電圧 が出力されます。 DSD入力の場合、1-bit信号のデューティによって出力レベルが決定され、デューティ100%(all “1”)入力 に対しては正のフルスケール、デューティ0%(all “0”)入力に対しては負のフルスケール、デューティ50% 入力に対しては理想値は0V電圧が出力されます。 内蔵の変調器の帯域外ノイズは内蔵のスイッチトキャパシタフィルタ(SCF)で減衰されます。 (Figure 72)は差動出力を1個のオペアンプで加算する外部LPF回路例です。 VREFH1-2に1kHz、100mVppのサイン波を入力したときのPSRRは、外付け回路のCMRR+6dBとなります。 外付け回路のCMRRが50dBの場合、PSRRは56dBです。 AK4454 R1 AOUT- 3.9k R2 4.7k 150 470p +Vop AOUT+ 3.9n R1 3.9k 4.7k Analog Out 150 470p -Vop Figure 72. External LPF Circuit Example 1 for PCM (fc = 99.0kHz, Q=0.680) R1 R2 GAIN(dB) DC 負荷(MAX 値) 3.3k 3.9k 3.9k 4.3k 3.3k 4.7k 5.6k 6.8k 0 1.620665 3.142468 3.980809 3.8k 4.0k 3.5k 3.6k Table 29. External LPF Circuit Example 1 for PCM 4.7k 8.2k 4.83432 3.6k 5.6k 12.0k 6.619864 3.8k Frequency Response Gain 20kHz 0.036dB 40kHz 0.225dB 80kHz 1.855dB Table 30. Frequency Response of External LPF Circuit Example 1 for PCM 015006358-J-01 2015/08 - 79 - [AK4454] 11. パッケージ ■ 外形寸法図 32-pin QFN (Unit: mm) ■ 材質・メッキ仕様 パッケージ材質: エポキシ系樹脂、ハロゲン (臭素、塩素)フリー リードフレーム材質: 銅 リードフレーム処理: 半田 (無鉛) メッキ 015006358-J-01 2015/08 - 80 - [AK4454] ■ マーキング 4454 XXXX 1 1) Pin #1 indication 2) Date Code: XXXX (4 digits) 3) Marking Code: 4454 12. 改訂履歴 Date (Y/M/D) 15/05/14 15/08/26 Revision 00 01 Reason 初版 記述追加 Page Contents 56 誤記訂正 68 76 ■ パワーダウン機能 (2)の説明文を変更 RSTNのデフォルト値を”1”→”0”に修正 Figure 70を修正。I2C pin をDigital 3.3Vに接続。 015006358-J-01 2015/08 - 81 - [AK4454] 重要な注意事項 0. 本書に記載された弊社製品（以下、「本製品」といいます。）、および、本製品の仕様につ きましては、本製品改善のために予告なく変更することがあります。従いまして、ご使用を 検討の際には、本書に掲載した情報が最新のものであることを弊社営業担当、あるいは弊社 特約店営業担当にご確認ください。 1. 本書に記載された情報は、本製品の動作例、応用例を説明するものであり、その使用に際し て弊社および第三者の知的財産権その他の権利に対する保証または実施権の許諾を行うもの ではありません。お客様の機器設計において当該情報を使用される場合は、お客様の責任にお いて行って頂くとともに、当該情報の使用に起因してお客様または第三者に生じた損害に対 し、弊社はその責任を負うものではありません。 2. 本製品は、医療機器、航空宇宙用機器、輸送機器、交通信号機器、燃焼機器、原子力制御用 機器、各種安全装置など、その装置・機器の故障や動作不良が、直接または間接を問わず、 生命、身体、財産等へ重大な損害を及ぼすことが通常予想されるような極めて高い信頼性を 要求される用途に使用されることを意図しておらず、保証もされていません。そのため、別 途弊社より書面で許諾された場合を除き、これらの用途に本製品を使用しないでください。 万が一、これらの用途に本製品を使用された場合、弊社は、当該使用から生ずる損害等の責 任を一切負うものではありません。 3. 弊社は品質、信頼性の向上に努めておりますが、電子製品は一般に誤作動または故障する場 合があります。本製品をご使用頂く場合は、本製品の誤作動や故障により、生命、身体、財産 等が侵害されることのないよう、お客様の責任において、本製品を搭載されるお客様の製品に 必要な安全設計を行うことをお願いします。 4. 本製品および本書記載の技術情報を、大量破壊兵器の開発等の目的、軍事利用の目的、ある いはその他軍事用途の目的で使用しないでください。本製品および本書記載の技術情報を輸出ま たは非居住者に提供する場合は、「外国為替及び外国貿易法」その他の適用ある輸出関連法 令を遵守し、必要な手続を行ってください。本製品および本書記載の技術情報を国内外の法 令および規則により製造、使用、販売を禁止されている機器・システムに使用しないでくだ さい。 5. 本製品の環境適合性等の詳細につきましては、製品個別に必ず弊社営業担当までお問合せく ださい。本製品のご使用に際しては、特定の物質の含有・使用を規制するRoHS指令等、適用 される環境関連法令を十分調査のうえ、かかる法令に適合するようにご使用ください。お客 様がかかる法令を遵守しないことにより生じた損害に関して、弊社は一切の責任を負いかね ます。 6. お客様の転売等によりこの注意事項に反して本製品が使用され、その使用から損害等が生じ た場合はお客様にて当該損害をご負担または補償して頂きますのでご了承ください。 7. 本書の全部または一部を、弊社の事前の書面による承諾なしに、転載または複製することを 禁じます。 015006358-J-01 2015/08 - 82 -