中文数据手册

24位、250 kSPS Σ-Δ型ADC，
建立时间20 µs，具有真轨到轨缓冲器
AD7175-2
产品特性
概述
快速且灵活的输出速率：5 SPS至250 kSPS
通道扫描数据速率：50 kSPS/通道(20 µs建立时间)
性能规格
17.2位无噪声分辨率(250 kSPS)
20位无噪声分辨率(2.5 kSPS)
24位无噪声分辨率(20 SPS)
积分非线性(INL)：FSR的±1 ppm
50 Hz和60 Hz抑制：85 dB，建立时间为50 ms
用户可配置的输入通道
2个差分通道或4个单端通道
交叉点多路复用器
2.5 V片内基准电压源(±2 ppm/°C漂移)
真轨到轨模拟和基准输入缓冲器
内部或外部时钟
电源：AVDD1 = 5 V，AVDD2 = IOVDD = 2 V至5 V
分离电源，AVDD1/AVSS为±2.5 V
ADC电流：8.4 mA
温度范围：−40°C至+105°C
3或4线串行数字接口(SCLK上为施密特触发器)
串行端口接口(SPI)、QSPI、MICROWIRE和DSP兼容
AD7175-2是一款低噪声、快速建立、多路复用、2/4通道
(全差分/伪差分)Σ-Δ型模数转换器(ADC)，适合低带宽输
入。对于完全建立的数据，其最大通道扫描速率为50 kSPS
(20 µs)。输出数据速率范围为5 SPS至250 kSPS。
AD7175-2集成关键的模拟和数字信号调理模块，可让用户
针对所用的每个模拟输入通道单独进行配置。每种特性都
能以通道为基础进行选择。模拟输入端和外部基准输入端
集成真轨到轨缓冲器，提供易于驱动的高阻抗输入。精密
2.5 V低漂移(2 ppm/°C)带隙内部基准电压源(带输出基准电
压缓冲)增加了嵌入式功能，同时减少了外部元件数。
数字滤波器能以27.27 SPS输出数据速率进行50 Hz/60 Hz同
步抑制。用户可根据应用中每个通道的需要而在不同滤波
器选项之间进行切换。ADC可自动在每个选定的通道间进
行切换。更多数字处理功能包括失调和增益校准寄存器，
可基于通道进行配置。
器件采用5 V AVDD1或±2.5 V AVDD1/AVSS、2 V至5 V AVDD2
以及IOVDD电源供电。AD7175-2的额定工作温度范围为
−40°C至+105°C，提供24引脚TSSOP封装。
应用
注意，在整篇数据手册中，双功能引脚名称仅通过相关功
能来引用。
过程控制：PLC/DCS模块
温度和压力测量
医疗与科学多通道仪器
色谱仪
功能框图
AVDD1
CROSSPOINT
MULTIPLEXER
AIN0
AVDD2 REGCAPA
RAIL-TO-RAIL
REFERENCE
INPUT BUFFERS
1.8V
LDO
AVDD
AIN1
IOVDD REGCAPD
REF– REF+ REFOUT
BUFFERED
PRECISION
REFERENCE
1.8V
LDO
INT
REF
RAIL-TO-RAIL
ANALOG INPUT
BUFFERS
CS
DIGITAL
FILTER
Σ-Δ ADC
AIN2
SERIAL
INTERFACE
AND CONTROL
SCLK
DIN
DOUT/RDY
AIN3
AD7175-2
TEMPERATURE
SENSOR
AVSS
Rev. A
SYNC/ERROR
XTAL AND INTERNAL
CLOCK OSCILLATOR
CIRCUITRY
GPIO0 GPIO1
Document Feedback
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responsibility is assumed by Analog Devices for its use, nor for any infringements of patents or other
rights of third parties that may result from its use. Specifications subject to change without notice. No
license is granted by implication or otherwise under any patent or patent rights of Analog Devices.
Trademarks and registered trademarks are the property of their respective owners.
XTAL1 XTAL2/CLKIO
DGND
12468-001
AIN4
GPIO AND
MUX
I/O CONTROL
AVSS
图1.
One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106, U.S.A.
Tel: 781.329.4700
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AD7175-2重要链接*
最后更新时间：10/03/2014 03:57 pm
建议配套产品
设计工具、模型、驱动器和软件
推荐AD7175-2使用的驱动放大器
• 针对单电源、低噪声、低失真、完全斩波型差分驱动
器，推荐使用ADA4528-1或ADA4528-2。
• 针对单电源、衰减输入级差分驱动器，推荐使用
AD8475。
• 关于其它驱动放大器选择，建议选择产品类别并使用我
们的参数搜索表格进行筛选。
AD7175-2 IBIS模型
类似产品和参数选型表
依据工作参数查找类似产品
推荐AD7175-2使用的外部基准电压源
• 针对低噪声、低漂移和高精度基准电压源系列，推荐使用
ADR445或ADR4550。
• 关于其它基准电压源选择，建议使用我们的参数搜索表
格进行筛选。
评估套件、原理图符号与PCB封装
原理图符号和PCB封装
设计协作社区
推荐AD7175-2使用的数字隔离器
• 针对SPI接口、最低功耗、2.5 kVrms隔离，推荐使用
ADuM1401。
• 针对SPI接口、增强的系统级ESD性能、2.5 kVrms隔离，
推荐使用ADuM3401。
• 针对SPI接口、低功耗、5.0 kVrms隔离，推荐使用
ADuM4401。
• 针对SPI接口、最小封装、低压I/O(1.8 V至5.5 V)，推荐使
用ADuM3481。
• 关于其它数字隔离器选择，建议使用我们的参数搜索表
格进行筛选。
推荐AD7175-2使用的外部多路复用器
• 针对低Ron、4:1通道多路复用器，推荐使用ADG1404。
• 针对四路差分输入的低Ron，推荐使用ADG1409。
• 针对提供+/-550 V保护的故障检测和保护系列，推荐使用
ADG5412F。
• 关于其它多路复用器选择，建议选择产品类别并使用我
们的参数搜索表格进行筛选。
推荐AD7175-2使用的电源解决方案
• 针对高输入电压LDO，推荐使用ADP7118和ADP7182。
• 针对电荷泵电压转换器，推荐使用ADG1404。
与ADI支持团队和其他设计人员就ADI产品选型在线协作。
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设计支持
请将支持请求提交至：
线性和数据转换器
嵌入式处理器和DSP
免费致电客户服务中心：
美洲：
欧洲：
中国：
印度：
俄罗斯：
1-800-262-5643
00800-266-822-82
4006-100-006
1800-419-0108
8-800-555-45-90
质量和可靠性的真实情况
无铅(Pb)数据
封装信息
申请样片与购买
AD7175-2
• 查看报价和封装
• 申请评估板
• 申请样片
• 检查库存并购买
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此内容可能会经常改变。
AD7175-2
目录
产品特性 ......................................................................................... 1
应用.................................................................................................. 1
概述.................................................................................................. 1
功能框图 ......................................................................................... 1
修订历史 ......................................................................................... 2
技术规格 ......................................................................................... 3
时序特性.................................................................................... 6
时序图 ........................................................................................ 7
绝对最大额定值............................................................................ 8
热阻 ............................................................................................ 8
ESD警告..................................................................................... 8
引脚配置和功能描述 ................................................................... 9
典型性能参数 .............................................................................. 11
噪声性能和分辨率 ..................................................................... 18
开始使用 ....................................................................................... 19
电源 .......................................................................................... 20
数字通信.................................................................................. 20
AD7175-2复位 ........................................................................ 21
配置概述.................................................................................. 21
电路描述 ....................................................................................... 26
模拟输入缓冲 ......................................................................... 26
交叉点多路复用器 ................................................................ 26
AD7175-2基准电压源 ........................................................... 27
基准电压输入缓冲 ................................................................ 28
时钟源 ...................................................................................... 28
数字滤波器................................................................................... 29
Sinc5 + Sinc1滤波器 .............................................................. 29
Sinc3滤波器............................................................................. 29
单周期建立 ............................................................................. 30
增强型50 Hz和60 Hz抑制滤波器 ....................................... 34
工作模式 ....................................................................................... 37
连续转换模式 ......................................................................... 37
连续读取模式 ......................................................................... 38
单次转换模式 ......................................................................... 39
待机和掉电模式..................................................................... 40
校准 .......................................................................................... 40
数字接口 ....................................................................................... 41
校验和保护 ............................................................................. 41
CRC计算 .................................................................................. 42
集成功能 ....................................................................................... 44
通用I/O .................................................................................... 44
外部多路复用器控制............................................................ 44
延迟 .......................................................................................... 44
16位/24位转换........................................................................ 44
DOUT_RESET........................................................................ 44
同步 .......................................................................................... 44
错误标志.................................................................................. 45
DATA_STAT............................................................................ 45
IOSTRENGTH ........................................................................ 46
内部温度传感器..................................................................... 46
接地和布局布线.......................................................................... 47
寄存器汇总................................................................................... 48
寄存器详解................................................................................... 49
通信寄存器 ............................................................................. 49
状态寄存器 ............................................................................. 50
ADC模式寄存器 .................................................................... 51
接口模式寄存器..................................................................... 52
寄存器检查 ............................................................................. 53
数据寄存器 ............................................................................. 53
GPIO配置寄存器 ................................................................... 54
ID寄存器 ................................................................................. 55
通道寄存器0 ........................................................................... 55
通道寄存器1至通道寄存器3 .............................................. 56
设置配置寄存器0 .................................................................. 57
设置配置寄存器1至设置配置寄存器3 ............................. 57
滤波器配置寄存器0 .............................................................. 58
滤波器配置寄存器1至滤波器配置寄存器3 ................... 59
失调寄存器0 ........................................................................... 59
失调寄存器1至失调寄存器3............................................... 59
增益寄存器0 ........................................................................... 59
增益寄存器1至增益寄存器3............................................... 59
外形尺寸 ....................................................................................... 60
订购指南.................................................................................. 60
修订历史
2014年9月 — 修订版0至修订版A
更改“订购指南”........................................................................... 60
2014年7月—修订版0：初始版
Rev. A | Page 2 of 60
AD7175-2
技术规格
除非另有说明，AVDD1 = 4.5 V至5.5 V，AVDD2 = 2 V至5.5 V，IOVDD = 2 V至5.5 V，AVSS = DGND = 0 V，REF+ = 2.5 V，
REF− = AVSS，MCLK = 内部主时钟 = 16 MHz，TA = TMIN至TMAX(−40°C至+105°C)。
表1.
参数
ADC速度和性能
输出数据速率(ODR)
无失码1
分辨率
噪声
精度
积分非线性(INL)
失调误差2
失调漂移
增益误差2
增益漂移
抑制
电源抑制
共模抑制
DC时
50 Hz、60 Hz时1
串模干扰抑制1
模拟输入
差分输入范围
绝对电压限值1
输入缓冲器禁用
输入缓冲器使能
模拟输入电流
输入缓冲器禁用
输入电流
输入电流漂移
输入缓冲器使能
输入电流
输入电流漂移
串扰
内部基准电压源
输出电压
初始精度3
温度系数
0°C至105°C
−40°C至+105°C
基准负载电流ILOAD
电源抑制
负载调整率
电压噪声
电压噪声密度
测试条件/注释
最小值
不包括sinc3滤波器 ≥ 125 kSPS
参见表6和表7
参见表6和表7
典型值
5
24
±3.5
±1
±40
±80
±35
±0.4
模拟输入缓冲器使能
模拟输入缓冲器禁用
内部短路
内部短路
AVDD1，AVDD2，VIN = 1 V
VIN = 0.1 V
20 Hz输出数据速率(后置滤波器)，
50 Hz ± 1 Hz和60 Hz ± 1 Hz
50 Hz ± 1 Hz和60 Hz ± 1 Hz
内部时钟，20 SPS ODR(后置滤波器)
外部时钟，20 SPS ODR(后置滤波器)
71
85
外部时钟
内部时钟(±2.5%时钟)
SPS
位
±7.8
±3.5
FSR的ppm
FSR的ppm
µV
nV/°C
FSR的ppm
ppm/°C
±85
±0.75
dB
dB
dB
90
90
dB
dB
±VREF
V
AVDD1 + 0.05
AVDD1
V
V
±48
±0.75
±4
µA/V
nA/V/°C
nA/V/°C
±30
±75
±1
−120
nA
pA/°C
nA/°C
dB
2.5
−0.12
+0.12
±2
±3
−10
Rev. A | Page 3 of 60
250,000
95
120
AVSS − 0.05
AVSS
AVDD1，AVDD2，(电压调整率)
∆VOUT/∆ILOAD
eN，0.1 Hz至10 Hz，2.5 V基准电压
eN，1 kHz，2.5 V基准电压
单位
95
VREF = (REF+) − (REF−)
AVDD1 − 0.2 V至AVSS + 0.2 V
AVDD1至AVSS
1 kHz输入
100 nF外部电容接AVSS
REFOUT，相对于AVSS
REFOUT, TA = 25°C
最大值
90
32
4.5
215
±5
±10
+10
V
% of V
ppm/°C
ppm/°C
mA
dB
ppm/mA
µV rms
nV/√Hz
AD7175-2
参数
开启建立时间
短路电流ISC
外部基准输入
差分输入范围
绝对电压限值1
输入缓冲器禁用
输入缓冲器使能
REFIN输入电流
输入缓冲器禁用
输入电流
输入电流漂移
输入缓冲器使能
输入电流
输入电流漂移
串模干扰抑制1
共模抑制
温度传感器
精度
灵敏度
激励电流
源/吸电流
通用I/O(GPIO0、GPIO1)
输入模式漏电流1
浮空态输出电容
输出高电压VOH1
输出低电压VOL1
输入高电压VIH1
输入低电压VIL1
测试条件/注释
100 nF REFOUT电容
最小值
典型值
200
25
最大值
单位
µs
mA
VREF = (REF+) − (REF−)
1
2.5
AVDD1
V
AVDD1 + 0.05
AVDD1
V
V
AVSS − 0.05
AVSS
±72
±1.2
±6
µA/V
nA/V/°C
nA/V/°C
±800
1.25
nA
nA/°C
95
dB
25°C时用户校准后应用
±2
477
°C
µV/K
必须使能模拟输入缓冲器
相对于AVSS
±10
µA
外部时钟
内部时钟
见“抑制”参数部分
−10
+10
5
ISOURCE = 200 µA
ISINK = 800 µA
AVSS + 4
AVSS + 0.4
AVSS + 3
AVSS + 0.7
时钟
内部时钟
频率
精度
占空比
输出低电压VOL
输出高电压VOH
晶振
频率
启动时间
外部时钟(CLKIO)
占空比1
16
−2.5%
+2.5%
50
0.4
0.8 × IOVDD
14
30
Rev. A | Page 4 of 60
16
10
16
50
16.384
16.384
70
µA
pF
V
V
V
V
MHz
%
%
V
V
MHz
µs
MHz
%
AD7175-2
参数
逻辑输入
输入高电压VINH1
输入低电压VINL1
迟滞1
漏电流
逻辑输出(DOUT/RDY)
输出高电压VOH1
输出低电压VOL1
漏电流
输出电容
系统校准1
满量程(FS)校准限值
零电平校准限值
输入范围
电源要求
电源电压
AVDD1至AVSS
AVDD2至AVSS
AVSS至DGND
IOVDD至DGND
IOVDD至AVSS
电源电流4
完全工作模式
AVDD1电流
AVDD2电流
IOVDD电流
待机模式(LDO开启)
掉电模式
测试条件/注释
最小值
2 V ≤ IOVDD < 2.3 V
2.3 V ≤ IOVDD ≤ 5.5 V
2 V ≤ IOVDD < 2.3 V
2.3 V ≤ IOVDD ≤ 5.5 V
IOVDD ≥ 2.7 V
IOVDD < 2.7 V
0.65 × IOVDD
0.7 × IOVDD
IOVDD ≥ 4.5 V, ISOURCE = 1 mA
2.7 V ≤ IOVDD < 4.5 V, ISOURCE = 500 µA
IOVDD < 2.7 V, ISOURCE = 200 µA
IOVDD ≥ 4.5 V, ISINK = 2 mA
2.7 V ≤ IOVDD < 4.5 V, ISINK = 1 mA
IOVDD < 2.7 V, ISINK = 400 µA
浮空态
浮空态
0.8 × IOVDD
0.8 × IOVDD
0.8 × IOVDD
典型值
0.08
0.04
−10
最大值
单位
0.35 × IOVDD
0.7
0.25
0.2
+10
V
V
V
V
V
V
µA
0.4
0.4
0.4
+10
−10
10
1.05 × FS
2.1 × FS
V
V
V
5.5
5.5
0
5.5
6.35
V
V
V
V
V
1.4
1.65
mA
1.75
2
mA
13
16
mA
−1.05 × FS
0.8 × FS
4.5
2
−2.75
2
AVSS < DGND
所有输出空载，数字输入连接到
IOVDD或DGND
模拟输入和基准输入缓冲器禁用，
外部基准电压源
模拟输入和基准输入缓冲器禁用，
内部基准电压源
模拟输入和基准输入缓冲器使能，
外部基准电压源
各缓冲器：AIN+、AIN−、REF+、REF−
外部基准电压源
内部基准电压源
外部时钟
内部时钟
外部晶振
内部基准电压源关闭，总功耗
内部基准电压源开启，总功耗
完全掉电(包括LDO和内部基准电压源)
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V
V
V
V
V
V
µA
pF
2.9
4.5
4.75
2.5
2.75
3
25
425
5
5
5.2
2.8
3.1
10
mA
mA
mA
mA
mA
mA
µA
µA
µA
AD7175-2
参数
功耗4
完全工作模式
测试条件/注释
所有缓冲器禁用，外部时钟和基准电
压源，AVDD2 = 2 V，IOVDD = 2 V
所有缓冲器禁用，外部时钟和基准电
压源，所有电源 = 5 V
所有缓冲器禁用，外部时钟和基准电
压源，所有电源 = 5.5 V
所有缓冲器使能，内部时钟和基准电
压源，AVDD2 = 2 V，IOVDD = 2 V
所有缓冲器使能，内部时钟和基准电
压源，所有电源 = 5 V
所有缓冲器使能，内部时钟和基准电
压源，所有电源 = 5.5 V
内部基准电压源关闭，所有电源 = 5 V
内部基准电压源开启，所有电源 = 5 V
完全掉电，所有电源 = 5 V
待机模式
掉电模式
1
2
3
4
最小值
典型值
最大值
单位
21
mW
42
mW
52
mW
82
mW
105
mW
125
2.2
25
136
mW
50
µW
mW
µW
技术规格未经生产测试，但受产品初始发布时的特性数据支持。
经系统或内部零电平校准，此失调误差与选定的编程输出数据速率所对应的噪声相当。系统满量程校准可以把增益误差降至与编程输出数据速率对应的噪声
相当的水平。
该规格包括湿度敏感度等级(MSL)预调理效应。
该规格在REFOUT和数字输出引脚空载下测量。
时序特性
除非另有说明，IOVDD = 2 V至5.5 V，DGND = 0 V，逻辑输入0 = 0 V，逻辑输入1 = IOVDD，CLOAD = 20 pF。
表2.
参数
SCLK
t3
t4
读操作
t1
t23
t5 5
t6
t7
写操作
t8
t9
t10
t11
1
2
3
4
5
TMIN、TMAX的限值
单位
25
25
ns(最小值) SCLK高电平脉宽
ns(最小值) SCLK低电平脉宽
0
15
40
0
12.5
25
2.5
20
0
10
ns(最小值)
ns(最大值)
ns(最大值)
ns(最小值)
ns(最大值)
ns(最大值)
ns(最小值)
ns(最大值)
ns(最小值)
ns(最小值)
CS下降沿到DOUT/RDY有效时间
IOVDD = 4.75 V至5.5 V
IOVDD = 2 V至3.6 V
SCLK有效沿到数据有效延迟4
IOVDD = 4.75 V至5.5 V
IOVDD = 2 V至3.6 V
CS无效沿后的总线释放时间
0
8
8
5
ns(最小值)
ns(最小值)
ns(最小值)
ns(最小值)
CS下降沿到SCLK有效沿建立时间4
数据有效到SCLK沿建立时间
数据有效到SCLK沿保持时间
CS上升沿到SCLK沿保持时间
测试条件/注释1, 2
SCLK无效沿到CS无效沿
SCLK无效沿到DOUT/RDY高电平/低电平
样片在初次发布期间均经过测试，以确保符合标准要求。
参见图2和图3。
该参数定义为输出跨越VOL或VOH限值所需的时间。
SCLK有效沿为SCLK的下降沿。
读取数据寄存器之后，DOUT/RDY返回高电平。在单次转换模式和连续转换模式下，当DOUT/RDY为高电平时，如有必要，可以再次读取同一数据，但必须确
保后续读取操作的发生时间不能接近下一次输出更新时间。如果使能连续读取功能，数字字只能被读取一次。
Rev. A | Page 6 of 60
AD7175-2
时序图
CS (I)
t6
t1
t5
MSB
DOUT/RDY (O)
LSB
t7
t2
t3
12468-003
SCLK (I)
t4
I = INPUT, O = OUTPUT
图2. 读取周期时序图
CS (I)
t11
t8
SCLK (I)
t9
t10
MSB
I = INPUT, O = OUTPUT
图3. 写入周期时序图
Rev. A | Page 7 of 60
LSB
12468-004
DIN (I)
AD7175-2
绝对最大额定值
除非另有说明，TA = 25°C。
热阻
θJA指定器件焊接在JEDEC测试板上以实现表贴封装。
表3.
参数
AVDD1、AVDD2至AVSS
AVDD1至DGND
IOVDD至DGND
IOVDD至AVSS
AVSS至DGND
模拟输入电压至AVSS
基准输入电压至AVSS
数字输入电压至DGND
数字输出电压至DGND
模拟输入/数字输入电流
工作温度范围
存储温度范围
最高结温
引脚焊接，回流温度
ESD额定值(HBM)
额定值
−0.3 V至+6.5 V
−0.3 V至+6.5 V
−0.3 V至+6.5 V
−0.3 V至+7.5 V
−3.25 V至+0.3 V
−0.3 V至AVDD1+ 0.3 V
−0.3 V至AVDD1+ 0.3 V
−0.3 V至IOVDD + 0.3 V
−0.3 V至IOVDD + 0.3 V
10 mA
−40°C至+105°C
−65°C至+150°C
150°C
260°C
4 kV
表4. 热阻
封装类型
24引脚 TSSOP
JEDEC 1层板
JEDEC 2层板
θJA
单位
149
81
°C/W
°C/W
ESD警告
注意，等于或超出上述绝对最大额定值可能会导致产品永
久性损坏。这只是额定最值，并不能以这些条件或者在任
何其它超出本技术规范操作章节中所示规格的条件下，推
断产品能否正常工作。长期在超出最大额定值条件下工作
会影响产品的可靠性。
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ESD(静电放电)敏感器件。
带电器件和电路板可能会在没有察觉的情况下放电。
尽管本产品具有专利或专有保护电路，但在遇到高能
量ESD时，器件可能会损坏。因此，应当采取适当的
ESD防范措施，以避免器件性能下降或功能丧失。
AD7175-2
AIN4 1
24
AIN3
REF– 2
23
AIN2
REF+ 3
22
AIN1
REFOUT 4
21
AIN0
REGCAPA 5
20
GPIO1
19
GPIO0
18
REGCAPD
AVDD2 8
17
DGND
XTAL1 9
16
IOVDD
XTAL2/CLKIO 10
15
SYNC/ERROR
DOUT/RDY 11
14
CS
DIN 12
13
SCLK
AVSS 6
AVDD1 7
AD7175-2
TOP VIEW
(Not to Scale)
12468-002
引脚配置和功能描述
图4. 引脚配置
表5. 引脚功能描述
引脚编号
1
2
3
引脚名称
AIN4
REF−
REF+
类型1
AI
AI
AI
4
5
6
7
8
9
10
REFOUT
REGCAPA
AVSS
AVDD1
AVDD2
XTAL1
XTAL2/CLKIO
AO
AO
P
P
P
AI
AI/DI
11
DOUT/RDY
DO
12
DIN
DI
13
SCLK
DI
14
CS
DI
说明
模拟输入4。可通过交叉点多路复用器选择。
基准输入负端。REF−的范围是AVSS至AVDD1 − 1 V。
基准输入正端。可以在REF+与REF−之间施加一个外部基准电压。REF+的范围是AVSS + 1 V至AVDD1。
该器件采用1 V至AVDD1的基准电压工作。
内部基准电压源的缓冲输出。输出相对于AVSS为2.5 V。
模拟LDO稳压器输出。利用一个1 µF和一个0.1 µF电容将此引脚去耦至AVSS。
负模拟电源。此电源的范围是−2.75 V到0 V，标称设置为0 V。
模拟电源1。此电压相对于AVSS为5 V ± 10%。
模拟电源2。此电压相对于AVSS的范围是2 V至5 V。
晶振的输入1。
晶振的输入2/时钟输入或输出。基于ADCMODE寄存器中的CLOCKSEL位。MCLK源选择有4个选项可用：
内部振荡器：无输出。
内部振荡器：输出至XTAL2/CLKIO。工作在IOVDD逻辑电平。
外部时钟：输入至XTAL2/CLKIO。输入必须为IOVDD逻辑电平。
外部晶振：连接在XTAL1与XTAL2/CLKIO之间。
串行数据输出/数据就绪输出引脚。DOUT/RDY引脚具有双重用途。它可以用作串行数据输出引脚，
以访问ADC的输出移位寄存器。输出移位寄存器可以含有来自任一片内数据寄存器或控制寄存器
的数据。数据字/控制字信息在SCLK下降沿置于DOUT/RDY引脚上，且在SCLK上升沿有效。当CS
为高电平时，DOUT/RDY输出为三态。当CS为低电平时，DOUT/RDY用作数据就绪引脚，变为低
电平时表示转换已完成。转换完成后，如果数据未被读取，该引脚将在下一次更新之前变为高电
平。DOUT/RDY下降沿可以用作处理器的中断，表示存在可用数据。
ADC输入移位寄存器的串行数据输入。该移位寄存器中的数据传输至ADC内的控制寄存器，通信
寄存器的寄存器地址(RA)位确定适当的寄存器。数据在SCLK的上升沿逐个输入。
串行时钟输入。用于与ADC进行数据传输。SCLK具有施密特触发式输入，因而该接口适合光隔离
应用。
片选输入引脚。这是一个低电平有效逻辑输入，用于选择ADC，CS可以用来在串行总线上具有多
个器件的系统中选择ADC。CS可以用硬连线方式置为低电平，使得ADC能以3线式模式工作，使
用SCLK、DIN和DOUT与器件接口。当CS为高电平时，DOUT/RDY输出为三态。
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AD7175-2
引脚编号 引脚名称
15
SYNC/ERROR
类型1
DI/O
16
IOVDD
P
17
18
19
20
21
22
23
24
DGND
REGCAPD
GPIO0
GPIO1
AIN0
AIN1
AIN2
AIN3
P
AO
DI/O
DI/O
AI
AI
AI
AI
1
说明
同步输入/错误输入/输出。此引脚可以通过GPIOCON寄存器在逻辑输入与逻辑输出之间切换。使
能同步输入(SYNC)时，此引脚可以使多个AD7175-2器件的数字滤波器和模拟调制器同步。更多
信息参见“同步”部分。禁用同步输入时，此引脚可以用于三种模式之一：
低电平有效错误输入模式：此模式将状态寄存器的ADC_ERROR位设为1。
低电平有效、开漏错误输出模式：状态寄存器错误位映射到ERROR输出。多个器件的SYNC/
ERROR引脚可以连接到同一个上拉电阻，这样就可以观察到任何器件的错误。
通用输出模式：此引脚的状态由GPIOCON寄存器的ERR_DAT位控制。此引脚参考IOVDD与DGND
之间的电平，而不是GPIOx引脚使用的AVDD1和AVSS电平。这种模式下，该引脚有一个有源上拉
电阻。
数字I/O电源电压。IOVDD电压范围是2 V至5 V。IOVDD与AVDD2无关。例如，当AVDD2为5 V时，
IOVDD可采用3 V工作，反之亦然。如果AVSS设置为−2.5 V，则IOVDD上的电压不得超过3.6 V。
数字地。
数字LDO稳压器输出。此引脚仅用于去耦。利用一个1 µF和一个0.1 µF电容将此引脚去耦至DGND。
通用输入/输出0。此引脚参考AVDD1与AVSS之间的电平。
通用输入/输出1。此引脚参考AVDD1与AVSS之间的电平。
模拟输入0。可通过交叉点多路复用器选择。
模拟输入1。可通过交叉点多路复用器选择。
模拟输入2。可通过交叉点多路复用器选择。
模拟输入3。可通过交叉点多路复用器选择。
AI = 模拟输入，AO = 模拟输出，DI/O = 双向数字输入/输出，DO = 数字输出，DI = 数字输入，P = 电源。
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AD7175-2
典型性能参数
除非另有说明，AVDD1 = 5 V，AVDD2 = 5 V，IOVDD = 3.3 V，TA = 25°C。
8390000
1000
900
8389500
800
8389000
SAMPLE COUNT
ADC CODE
700
8388500
8388000
8387500
600
500
400
300
8387000
200
8386500
100
200
300
400 500 600 700
SAMPLE NUMBER
800
900
1000
0
图5. 噪声(模拟输入缓冲器禁用，VREF = 5 V，
输出数据速率 = 5 SPS)
图8. 直方图(模拟输入缓冲器禁用，VREF = 5 V，
输出数据速率 = 5 SPS)
120
8388480
8388475
100
SAMPLE COUNT
8388470
ADC CODE
8388460 8388461 8388462 8388463 8388464 8388465 8388466
ADC CODE
12468-208
0
12468-205
8386000
100
8388465
8388460
80
60
40
8388455
100
200
300
400 500 600 700
SAMPLE NUMBER
800
900
1000
0
ADC CODE
图6. 噪声(模拟输入缓冲器禁用，VREF = 5 V，
输出数据速率 = 10 kSPS)
12468-209
0
12468-206
8388445
8388450
8388451
8388452
8388453
8388454
8388455
8388456
8388457
8388458
8388459
8388460
8388461
8388462
8388463
8388464
8388465
8388466
8388467
8388468
8388469
8388470
8388471
8388472
8388473
8388474
8388475
8388476
8388477
20
8388450
图9. 直方图(模拟输入缓冲器禁用，VREF = 5 V，
输出数据速率 = 10 kSPS)
8388520
45
40
8388500
35
SAMPLE COUNT
8388460
8388440
30
25
20
15
10
8388420
100
200
300
400 500 600 700
SAMPLE NUMBER
800
900
1000
0
ADC CODE
图7. 噪声(模拟输入缓冲器禁用，VREF = 5 V，
输出数据速率 = 250 kSPS)
图10. 直方图(模拟输入缓冲器禁用，VREF = 5 V，
输出数据速率 = 250 kSPS)
Rev. A | Page 11 of 60
12468-210
0
8388420
8388422
8388424
8388426
8388428
8388430
8388432
8388434
8388436
8388438
8388440
8388442
8388444
8388446
8388448
8388450
8388452
8388454
8388456
8388458
8388460
8388462
8388464
8388466
8388468
8388470
8388472
8388474
8388476
8388478
8388480
8388482
8388484
8388486
8388488
8388490
8388492
8388494
8388496
8388498
8388500
8388502
8388504
5
8388400
12468-207
ADC CODE
8388480
1000
8389500
900
8389000
800
8388500
700
8388000
8387500
8387000
600
500
400
8386500
300
8386000
200
8385500
100
8385000
0
100
200
300
400 500 600 700
SAMPLE NUMBER
800
900
1000
0
8388490 8388491 8388492 8388493 8388494 8388495 8388496
ADC CODE
12468-214
SAMPLE COUNT
8390000
12468-211
ADC CODE
AD7175-2
图14. 直方图(模拟输入缓冲器使能，VREF = 5 V，
输出数据速率 = 5 SPS)
图11. 噪声(模拟输入缓冲器使能，VREF = 5 V，
输出数据速率 = 5 SPS)
100
8388520
90
8388515
80
70
SAMPLE COUNT
ADC CODE
8388510
8388505
8388500
8388495
60
50
40
30
8388490
20
8388485
300
400 500 600 700
SAMPLE NUMBER
800
900
1000
0
ADC CODE
图15. 直方图(模拟输入缓冲器使能，VREF = 5 V，
输出数据速率 = 10 kSPS)
35
8388560
30
8388540
25
8388520
8388500
20
15
8388480
10
8388460
5
8388440
100
200
300
400 500 600 700
SAMPLE NUMBER
800
900
1000
0
8388460
8388462
8388464
8388466
8388468
8388470
8388472
8388474
8388476
8388478
8388480
8388482
8388484
8388486
8388488
8388490
8388492
8388494
8388496
8388498
8388500
8388502
8388504
8388506
8388508
8388510
8388512
8388514
8388516
8388518
8388520
8388522
8388524
8388526
8388528
8388530
8388532
SAMPLE COUNT
8388580
12468-213
ADC CODE
图12. 噪声(模拟输入缓冲器使能，VREF = 5 V，
输出数据速率 = 10 kSPS)
0
12468-215
200
ADC CODE
图13. 噪声(模拟输入缓冲器使能，VREF = 5 V，
输出数据速率 = 250 kSPS)
图16. 直方图(模拟输入缓冲器使能，VREF = 5 V，
输出数据速率 = 250 kSPS)
Rev. A | Page 12 of 60
12468-216
100
8388480
8388481
8388482
8388483
8388484
8388485
8388486
8388487
8388488
8388489
8388490
8388491
8388492
8388493
8388494
8388495
8388496
8388497
8388498
8388499
8388500
8388501
8388502
8388503
8388504
8388505
8388506
8388507
8388508
8388509
8388510
8388511
8388512
8388513
8388514
0
12468-212
8388480
10
AD7175-2
0.000016
0
BUFFER ON
BUFFER OFF
0.000014
–20
–40
0.000010
CMRR (dB)
NOISE (V)
0.000012
0.000008
0.000006
–60
–80
0.000004
0.5
1.0
1.5
2.0
2.5
3.0
3.5
4.0
INPUT COMMON-MODE VOLTAGE (V)
4.5
5.0
–120
1
图17. 噪声与输入共模电压的关系，模拟输入缓冲器开启和关闭
20
–120
CMRR (dB)
–110
12
10
8
–140
–150
4
–160
2
–170
4
6
8
10
FREQUENCY (MHz)
12
14
16
–180
10
图18. 噪声与外部主时钟频率的关系，模拟输入缓冲器开启和关闭
16800000
–60
30
40
50
VIN FREQUENCY (Hz)
60
70
AVDD1—EXTERNAL 2.5V REFERENCE
AVDD1—INTERNAL 2.5V REFERENCE
–70
16760000
–80
PSRR (dB)
16740000
16720000
16700000
–90
–100
–110
16680000
1
10
100
SAMPLE NUMBER
1k
10k
图19. 内部基准电压源建立时间
–130
1
10
100
1k
10k
100k
VIN FREQUENCY (Hz)
1M
10M
图22. 电源抑制比(PSRR)与VIN 频率的关系
Rev. A | Page 13 of 60
100M
12468-228
–120
12468-225
16660000
20
图21. 共模抑制比(CMRR)与VIN 频率的关系
(VIN = 0.1 V，10 Hz至70 Hz，输出数据速率 = 20 SPS增强型滤波器)
CONTINUOUS CONVERSION—REFERENCE DISABLED
STANDBY—REFERENCE DISABLED
STANDBY—REFERENCE ENABLED
16780000
OUTPUT CODE
–130
6
12468-218
NOISE (µV rms)
14
2
1M
–90
–100
0
100k
–80
16
0
100
1k
10k
VIN FREQUENCY (Hz)
图20. 共模抑制比(CMRR)与VIN 频率的关系
(VIN = 0.1 V，输出数据速率 = 250 kSPS)
ANALOG INPUT BUFFERS OFF
ANALOG INPUT BUFFERS ON
18
10
12468-227
0
12468-217
0
12468-226
–100
0.000002
AD7175-2
20
10
5
25
SAMPLE COUNT
15
INL (ppm of FS)
30
INTERNAL 2.5V REF,
ANALOG INPUT BUFFERS OFF
INTERNAL 2.5V REF,
ANALOG INPUT BUFFERS ON
EXTERNAL 2.5V REF,
ANALOG INPUT BUFFERS OFF
EXTERNAL 2.5V REF,
ANALOG INPUT BUFFERS ON
EXTERNAL 5V REF,
ANALOG INPUT BUFFERS OFF
EXTERNAL 5V REF,
ANALOG INPUT BUFFERS ON
0
–5
20
15
10
–10
–4
–3
–2
–1
0
VIN (V)
1
2
3
4
5
图23. 积分非线性(INL)与VIN (差分输入)的关系
30
30
25
25
20
20
15
10
1.5
2.0
2.5
3.0
3.5
INL ERROR (ppm)
4.0
4.5
5.0
15
10
5
0
12468-230
2.50 2.75 3.00 3.25 3.50 3.75 4.00 4.25 4.50 4.75 5.00
INL ERROR (ppm)
图24. 积分非线性(INL)分布直方图(差分输入，模拟输入缓冲器使能，
VREF = 2.5 V外部，100片)
0.2
0.4
0.6
0.8
1.0
1.2
INL ERROR (ppm)
1.4
1.6
图27. 积分非线性(INL)分布直方图(模拟输入缓冲器禁用，差分输入，
VREF = 5 V外部，100片)
30
5.0
4.5
25
BUFFER DISABLED
BUFFER ENABLED
4.0
20
INL (ppm of FSR)
SAMPLE COUNT
1.0
12468-233
5
0
0.5
图26. 积分非线性(INL)分布直方图(模拟输入缓冲器使能，差分输入，
VREF = 5 V外部，100片)
SAMPLE COUNT
SAMPLE COUNT
0
12468-229
–20
–5
12468-232
5
–15
15
10
3.5
3.0
2.5
2.0
1.5
1.0
5
0.4
0.6
0.8
1.0
1.2
1.4
INL ERROR (ppm)
1.6
1.8
2.0
0
–40
12468-231
0.2
图25. 积分非线性(INL)分布直方图(差分输入，模拟输入缓冲器禁用，
VREF = 2.5 V外部，100片)
–20
0
20
40
60
TEMPERATURE (°C)
80
100
12468-234
0.5
0
图28. 积分非线性(INL)与温度的关系(差分输入，VREF = 2.5 V外部)
Rev. A | Page 14 of 60
50
45
45
40
40
35
35
SAMPLE COUNT
50
30
25
20
30
25
20
15
15
10
10
5
5
15.98
15.99
16.00 16.01 16.02 16.03
FREQUENCY (MHz)
16.04
16.05
0
–40 –30 –20 –10 0
图29. 内部振荡器频率/精度分布直方图(100片)
35
16300000
30
16200000
25
SAMPLE COUNT
16100000
16000000
15900000
20
15
10
15800000
0
20
40
60
TEMPERATURE (°C)
80
100
0
12468-236
–20
OFFSET DRIFT ERROR (nV/°C)
图30. 内部振荡器频率与温度的关系
12468-239
5
15700000
–90
–80
–70
–60
–50
–40
–30
–20
–10
0
10
20
30
40
50
60
70
80
90
100
110
120
FREQUENCY (Hz)
10 20 30 40 50 60 70 80 90
OFFSET ERROR (µV)
图32. 失调误差分布直方图(内部短路，248片)
16400000
15600000
–40
12468-238
0
12468-235
SAMPLE COUNT
AD7175-2
图33. 失调误差漂移分布直方图(内部短路，248片)
0.0010
40
35
SAMPLE COUNT
30
0
–0.0005
25
20
15
10
–0.0010
–40
–20
0
20
40
60
TEMPERATURE (°C)
80
100
图31. 基准电压绝对误差与温度的关系
0
–4
–3
–2
–1
0
1
2
GAIN ERROR (ppm/FSR)
3
4
图34. 增益误差分布直方图(模拟输入缓冲器使能，100片)
Rev. A | Page 15 of 60
12468-240
5
12468-237
ERROR (V)
0.0005
AD7175-2
0.025
30
0.020
20
CURRENT (A)
15
0.015
0.010
10
0.005
5
34
35
36
37
38
39
40
GAIN ERROR (ppm/FSR)
41
42
43
0
–40
12468-241
0
图35. 增益误差分布直方图(模拟输入缓冲器禁用，100片)
BUFFERS DISABLED
BUFFERS ENABLED
–20
0
20
40
60
TEMPERATURE (°C)
80
100
12468-244
SAMPLE COUNT
25
图38. 功耗与温度的关系(连续转换模式)
1.6
25
1.4
1.2
CURRENT (µA)
SAMPLE COUNT
20
15
10
1.0
0.8
0.6
0.4
5
图36. 增益误差漂移分布直方图(模拟输入缓冲器使能，100片)
0
20
40
60
TEMPERATURE (°C)
80
100
图39. 功耗与温度的关系(掉电模式)
40
18
35
16
14
SAMPLE COUNT
30
25
20
15
10
12
10
8
6
4
5
0
0.10
0.15
0.20 0.25 0.30 0.35 0.40 0.45
GAIN ERROR DRIFT (ppm/FSR)
0.50
0.55
12468-243
2
图37. 增益误差漂移分布直方图(模拟输入缓冲器禁用，100片)
0
–1.2 –1.0 –0.8 –0.6 –0.4 –0.2 0
0.2 0.4
TEMPERATURE DELTA (°C)
0.6
0.8
图40. 温度传感器分布直方图(未校准，100片)
Rev. A | Page 16 of 60
1.0
12468-246
SAMPLE COUNT
–20
12468-245
GAIN ERROR DRIFT (ppm/FSR)
0
–40
12468-242
0.30
0.28
0.26
0.24
0.22
0.20
0.18
0.16
0.14
0.12
0.10
0.08
0.06
0.04
0
0.02
0
–0.02
0.2
AD7175-2
100
35
80
30
60
INPUT CURRENT (nA)
SAMPLE COUNT
25
20
15
10
AIN+ = AVDD1 – 0.2V
AIN– = AVSS + 0.2V
AIN+ = AVDD1
AIN– = AVSS
40
20
0
–20
–40
–60
5
9.60 9.65 9.70 9.75 9.80 9.85 9.90 9.95 10.00 10.05 10.10
CURRENT (µA)
图41. 激励电流分布直方图(100片)
100
40
20
0
–20
–40
–60
–80
–100
–5
–4
–3
–2
–1
0
1
2
INPUT VOLTAGE (V)
3
4
5
12468-248
INPUT CURRENT (nA)
60
–20
0
20
40
60
TEMPERATURE (°C)
图43. 模拟输入电流与温度的关系
–40°C, AIN+
–40°C, AIN–
+25°C, AIN+
+25°C, AIN–
+105°C, AIN+
+105°C, AIN–
80
–100
–40
图42. 模拟输入电流与输入电压的关系(VCM = 2.5 V)
Rev. A | Page 17 of 60
80
100
12468-249
0
12468-247
–80
AD7175-2
噪声性能和分辨率
表6和表7所示为AD7175-2在不同输出数据速率和滤波器下
的均方根噪声、峰峰值噪声、有效分辨率和无噪声(峰峰值)
分辨率。所提供的数据是针对双极性输入范围以及采用5 V
外部基准电压源而言。这些数据是在单个通道上连续转换
ADC时，差分输入电压为0 V产生的典型值。必须注意，峰
峰值分辨率是根据峰峰值噪声计算得出。峰峰值分辨率表
示无闪烁码的分辨率。
表6. 均方根噪声和峰峰值分辨率与输出数据速率的关系(使用Sinc5 + Sinc1滤波器(默认))1
输出数据速率(SPS)
输入缓冲器禁用
250,000
62,500
10,000
1000
59.92
49.96
16.66
5
输入缓冲器使能
250,000
62,500
10,000
1000
59.98
49.96
16.66
5
1
均方根噪声(µV rms)
有效分辨率(位)
峰峰值噪声(µV p-p)
峰峰值分辨率(位)
8.7
5.5
2.5
0.77
0.19
0.18
0.1
0.07
20.1
20.8
21.9
23.6
24
24
24
24
65
43
18.3
5.2
1.1
0.95
0.45
0.34
17.2
17.8
19.1
20.9
23.1
23.3
24
24
9.8
6.4
3
0.92
0.23
0.2
0.13
0.07
20
20.6
21.7
23.4
24
24
24
24
85
55
23
5.7
1.2
1
0.66
0.32
16.8
17.5
18.7
20.7
23.0
23.3
23.9
24
仅限选定速率，1000样本。
表7. 均方根噪声和峰峰值分辨率与输出数据速率的关系(使用Sinc3滤波器)1
输出数据速率(SPS)
输入缓冲器禁用
250,000
62,500
10,000
1000
60
50
16.66
5
输入缓冲器使能
250,000
62,500
10,000
1000
60
50
16.66
5
1
均方根噪声(µV rms)
有效分辨率(位)
峰峰值噪声(µV p-p)
峰峰值分辨率(位)
210
5.2
1.8
0.56
0.13
0.13
0.07
0.05
15.5
20.9
22.4
24
24
24
24
24
1600
40
14
3.9
0.8
0.7
0.37
0.21
12.6
17.9
19.4
21.3
23.6
23.8
24
24
210
5.8
2.1
0.71
0.17
0.15
0.12
0.08
15.5
20.7
22.2
23.7
24
24
24
24
1600
48
16
4.5
1.1
0.83
0.6
0.35
12.6
17.7
19.3
21.1
23.1
23.5
24
24
仅限选定速率，1000样本。
Rev. A | Page 18 of 60
AD7175-2
开始使用
AD7175-2是一款快速建立、高分辨率、多路复用ADC，配
置灵活。
AD7175-2内置一个2.5 V精密低漂移(±2 ppm/°C)带隙基准电
压源。此基准电压源可以用于ADC转换，从而减少外部元
件数量。另外，该基准电压源也可以通过REFOUT引脚输
出，用作外部电路的低噪声偏置电压。例子之一是利用
REFOUT信号设置外部放大器的输入共模电压。
• 两路全差分或四路单端模拟输入。
• 交叉点多路复用器可选择任何模拟输入组合作为要转换
的输入信号，并将其路由至调制器正或负输入。
• 真轨到轨缓冲模拟和基准输入。
• 支持全差分输入或单端输入(相对于任何模拟输入)。
• 各通道独立配置能力——最多可以定义四种不同的设置。
可以将不同的设置映射到各通道。每种设置均支持用户
配置：使能或禁用缓冲器，增益和失调校正，滤波器类
型、输出数据速率和基准电压源选择(内部/外部)。
AD7175-2内置两个独立的线性稳压器模块，分别用于模拟
和数字电路。模拟LDO将AVDD2电源调节到1.8 V，以便为
ADC内核供电。用户可以将AVDD1和AVDD2电源连在一
起，此时连接最简单。如果系统中已经有一个2 V(最小值)至
5.5 V(最大值)的干净模拟电源轨，用户也可以选择将此电源
连接到AVDD2输入，从而降低功耗。
GENERAL-PURPOSE I/O 0 AND
GENERAL-PURPOSE I/O 1
OUTPUT HIGH = AVDDx
GPIO1
OUTPUT LOW = AVSS
GPIO0
16MHz
19
20
GPIO0
GPIO1
OPTIONAL EXTERNAL
CRYSTAL CIRCUITRY
CAPACITORS
XTAL1 9
21
AIN0
CX2
CX1
XTAL2/CLKI0 10
DOUT/RDY 11
22
DOUT/RDY
AIN1
DIN
DIN 12
23
SCLK
SCLK 13
AIN2
CS
CS 14
24
AIN3
1
AIN4
CLKIN
OPTIONAL
EXTERNAL
CLOCK
INPUT
SYNC/ERROR 15
SYNC/ERROR
AD7175-2
IOVDD
IOVDD 16
0.1µF
DGND 17
1
2
4.7µF
0.1µF
VIN
3
REGCAPD 18
NC 7
0.1µF
ADR445BRZ
4
GND
5
AVDD1
AVDD1 7
VOUT 6
8
1µF
3
0.1µF
4.7µF
0.1µF
REF+
0.1µF
AVDD2
AVDD2 8
2.5V REFERENCE
OUTPUT
0.1µF
2
REF–
4
REFOUT
0.1µF
REGCAPA 5
0.1µF
AVSS
1µF
6
0.1µF
图44. 典型连接图
Rev. A | Page 19 of 60
12468-051
VIN
AD7175-2
用于数字IOVDD电源的线性稳压器执行类似的功能，将施
加于IOVDD引脚的输入电压调节至1.8 V，用于内部数字滤
波。串行接口信号始终采用该引脚上出现的IOVDD电源工
作。这意味着，如果将3.3 V电压施加于IOVDD引脚，接口
逻辑输入和输出将以此电平工作。
访问ADC寄存器映射
AD7175-2适合类型广泛的应用，可提供高分辨率和高精
度。应用情形举例如下：
写入通信寄存器的数据决定要访问哪一个寄存器，以及下
一个操作是读操作还是写操作。寄存器地址位(RA[5:0])决
定读或写操作的目标寄存器。
• 利用内部多路复用器快速扫描模拟输入通道
• 利用外部多路复用器和GPIO自动控制快速扫描模拟输
入通道
• 在通道扫描或每通道ADC应用中以较低速度实现高分
辨率
• 每通道单ADC：快速低延迟输出支持在外部微控制器、
DSP或FPGA中进行进一步的应用特定滤波
通信寄存器控制对ADC全部寄存器映射的访问。此寄存器
是一个8位只写寄存器。上电或复位后，数字接口默认处
于期待对通信寄存器执行一个写操作的状态；因此，所有
通信均从写入通信寄存器开始。
当对选定寄存器的读或写操作完成后，接口返回到默认状
态，即期待对通信寄存器执行写操作的状态。
图46和图47显示了对一个寄存器的读写操作：首先将一个
8位命令写入通信寄存器，然后是针对该寄存器的数据。
电源
8-BIT COMMAND
8 BITS, 16 BITS,
OR 24 BITS OF DATA
CMD
DATA
CS
AD7175-2有三个独立的电源引脚：AVDD1、AVDD2和
IOVDD。
DIN
图46. 写入一个寄存器
(8位命令和寄存器地址，随后是8位、16位或24位数据；
DIN上的数据长度取决于所选的寄存器)
AVDD2为内部1.8 V模拟LDO稳压器供电。此稳压器为ADC
内核供电。AVDD2以AVSS为基准，AVDD2 − AVSS可以在
5.5 V(最大值)到2 V(最小值)之间。
8-BIT COMMAND
IOVDD为内部1.8 V数字LDO稳压器供电。此稳压器为ADC
的数字逻辑供电。IOVDD设置ADC的SPI接口的电平。
IOVDD以DGND为基准，IOVDD − DGND可以在5.5 V
(最大值)到2 V(最小值)之间。
数字通信
A D 7 1 7 5 - 2 有 一 个 3线 或 4 线 SPI 接 口 ， 它 与 Q SPI ™ 、
MICROWIRE®和DSP兼容。该接口以SPI模式3工作，在CS
接低电平时也能工作。在SPI模式3下，SCLK空闲时为高电
平，SCLK的下降沿为驱动沿，上升沿为采样沿。这意味着，
数据在下降/驱动沿输出，在上升/采样沿输入。
SAMPLE EDGE
12468-052
DRIVE EDGE
12468-053
SCLK
8 BITS, 16 BITS,
24 BITS, OR
32 BITS OUTPUT
CS
DIN
DOUT/RDY
CMD
DATA
SCLK
12468-054
AVDD1为交叉点多路复用器和集成的模拟与基准输入缓冲
器供电。AVDD1以AVSS为基准，AVDD1 − AVSS = 5 V。它
可以是5 V单电源或±2.5 V分离电源。分离电源供电支持真双
极性输入。采用分离电源时，必须注意绝对最大额定值(参
见“绝对最大额定值”部分)。
图47. 读取一个寄存器
(8位命令和寄存器地址，随后是8位、16位或24位数据；
DOUT上的数据长度取决于所选的寄存器)
要验证器件通信是否正常，建议读取ID寄存器。ID寄存器
是一个只读寄存器，对于AD7175-2，其值为0x0CDX。通
信寄存器和ID寄存器详情参见表8和表9。
图45. SPI模式3 SCLK沿
Rev. A | Page 20 of 60
AD7175-2
AD7175-2复位
图48概要展示了ADC配置的建议更改流程，分为以下三个
模块：
当接口同步丧失时，执行一个占用至少64个串行时钟周期
的写操作，并使DIN处于高电平状态，可以复位整个器件，
使ADC返回默认状态，包括寄存器内容。另外，如果CS配
合数字接口使用，让CS变为高电平就能将数字接口设为默
认状态，并中止任何串行接口操作。
• 通道配置(见图48中的框A)
• 设置配置(见图48中的框B)
• ADC模式和接口模式配置(见图48中的框C)
通道配置
配置概述
AD7175-2有4个独立通道和4种独立设置。用户可以选择任
意通道上的任何模拟输入对，还可为任何通道选择4种设
置中的任意一种，让用户在通道配置方面拥有全面的灵活
性。此外，在使用差分输入和单端输入时，每个通道都可
以拥有自己的专用设置，这样就可以按通道进行配置。
在加电或复位后，AD7175-2的默认配置如下：
• 通道配置。CH0使能，AIN0被选为正输入，AIN1被选
为负输入。选择设置0。
• 设置配置。内部基准电压和模拟输入缓冲器均使能。禁
用基准输入缓冲器。
• 滤波器配置寄。选择sinc5 + sinc 1滤波器，选择最大输出
数据速率250 kSPS。
• ADC模式。使能连续转换模式和内部振荡器。
• 接口模式。禁用CRC和数据加状态输出。
通道寄存器
通道寄存器用于选择5个模拟输入引脚(AIN0至AIN4)中的
哪 一 个 用 作 该 通 道 的 正 模 拟 输 入 (AIN+)或 负 模 拟 输 入
(AIN−)。此寄存器还包含通道使能/禁用位和设置选择位，
用于选择该通道使用四种可用设置中的哪一种。
注意，表中只展示了少数几种寄存器设置选项，本列表只
是一个示例。有关寄存器的完整信息，请参阅“寄存器详
解”部分。
A
CHANNEL CONFIGURATION
SELECT POSITIVE AND NEGATIVE INPUT FOR EACH ADC CHANNEL
SELECT ONE OF 4 SETUPS FOR ADC CHANNEL
B
SETUP CONFIGURATION
4 POSSIBLE ADC SETUPS
SELECT FILTER ORDER, OUTPUT DATA RATE, AND MORE
C
ADC MODE AND INTERFACE MODE CONFIGURATION
SELECT ADC OPERATING MODE, CLOCK SOURCE,
ENABLE CRC, DATA + STATUS, AND MORE
12468-044
当AD7175-2工作时，若有一个以上的通道被使能，通道序
列器将按顺序遍历各使能的通道，从通道0到通道3。如果
一个通道被禁用，序列器将跳过该通道。通道0的通道寄
存器详情如表10所示。
图48. 建立ADC配置流程
表8. 通信寄存器
寄存器
0x00
名称
COMMS
位
[7:0]
位7
WEN
位6
R/W
位5
位
[15:8]
[7:0]
位7
位6
位5
位
[15:8]
[7:0]
位7
CH_EN0
位4
位3
位2
位1
位0
复位
0x00
RW
W
位2
位1
位0
复位
0x0CDX
RW
R
RA
表9. ID寄存器
寄存器
0x07
名称
ID
位4
位3
ID[15:8]
ID[7:0]
表10. 通道0寄存器
寄存器
0x10
名称
CH0
位6
位5
位4
保留
SETUP_SEL[2:0]
AINPOS0[2:0]
位3
Rev. A | Page 21 of 60
位2
保留
AINNEG0
位1
位0
AINPOS0[4:3]
复位
0x8001
RW
RW
AD7175-2
设置配置寄存器
设置配置寄存器允许用户通过选择双极性或单极性来选择
ADC的输出编码。在双极性模式下，ADC支持负差分输入
电压，输出编码为偏移二进制。在单极性模式下，ADC仅
支持正差分电压，输出编码为标准二进制。无论何种情况，
输入电压必须在AVDD1/AVSS电源电压范围内。利用此寄
存器，用户可以选择基准电压源。有三个选项可用：内部
2.5 V基准电压源、连接在REF+与REF−引脚之间的外部基准
电压源或AVDD1 – AVSS。模拟输入和基准输入缓冲器也可
以用该寄存器使能或禁用。
ADC设置
AD7175-2有4种独立设置。每种设置包括以下四个寄存器：
设置配置寄存器
滤波器配置寄存器
失调寄存器
增益寄存器
例如，设置0包括设置配置寄存器0、滤波器配置寄存器0、
增益寄存器0和失调寄存器0。图49显示的是这些寄存器的
分组情况。设置可从通道寄存器选择(参见“通道配置”部
分)，每个通道可以分配四种独立设置中的一种。表11至表14
显示了设置0相关的四个寄存器。该结构在设置1至设置3
重复出现。
滤波器配置寄存器
滤波器配置寄存器选择ADC调制器的输出端使用何种数字
滤波器。滤波器的阶数和输出数据速率通过设置此寄存器
的各位来选择。更多信息请参阅“数字滤波器”部分。
FILTER CONFIG
REGISTERS
SETUP CONFIG
REGISTERS
GAIN REGISTERS*
OFFSET REGISTERS
SETUPCON0 0x20
FILTCON0 0x28
GAIN0
0x38
OFFSET0 0x30
SETUPCON1 0x21
FILTCON1 0x29
GAIN1
0x39
OFFSET1 0x31
SETUPCON2 0x22
FILTCON2 0x2A
GAIN2
0x3A
OFFSET2 0x32
SETUPCON3 0x23
FILTCON3 0x2B
GAIN3
0x3B
OFFSET3 0x33
SELECT PERIPHERAL
FUNCTIONS FOR
ADC CHANNEL
DATA OUTPUT CODING
REFERENCE SOURCE
INPUT BUFFERS
SELECT DIGITAL
FILTER TYPE
AND OUTPUT DATA RATE
GAIN CORRECTION
OFFSET CORRECTION
OPTIONALLY
OPTIONALLY PROGRAMMED
PROGRAMMED
PER SETUP AS REQUIRED
PER SETUP AS REQUIRED
(*FACTORY CALIBRATED)
SINC5 + SINC1
SINC3
SINC3 MAP
ENHANCED 50Hz AND 60Hz
12468-045
•
•
•
•
图49. ADC设置寄存器分组情况
表11. 设置配置0寄存器
寄存器 名称
位
位7
位6
0x20
SETUPCON0 [15:8]
保留
[7:0]
BURNOUT_EN0 保留
位5
位4
位3
位2
位1
位0
复位
BI_UNIPOLAR0 REFBUF0+ REFBUF0− AINBUF0+ AINBUF0− 0x1320
REF_SEL0
保留
RW
RW
表12. 滤波器配置0寄存器
寄存器 名称
0x28
FILTCON0
位
位7
[15:8] SINC3_MAP0
[7:0] 保留
位6
位5
位4
位3
位2
ENHFILTEN0
ODR0
保留
ORDER0
位1
位0
ENHFILT0
复位
0x0500
RW
RW
表13. 增益配置0寄存器
寄存器 名称
0x38
GAIN0
位
[23:0]
位[23:0]
GAIN0[23:0]
复位
RW
0x5XXXX0 RW
位[23:0]
OFFSET0[23:0]
复位
RW
0x800000 RW
表14. 失调配置0寄存器
寄存器 名称
0x30
OFFSET0
位
[23:0]
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AD7175-2
ADC模式和接口模式配置
ADC模式寄存器和接口模式寄存器用于配置供AD7175-2使
用的内核外设，同时也用于配置数字接口的模式。
增益寄存器
增益寄存器是一个24位寄存器，用来保存ADC的增益校准
系数。增益寄存器是读/写寄存器。这些寄存器在上电时加
载工厂校准系数。因此，每个器件具有不同的默认系数。
如果用户启动系统满量程校准，或者写入增益寄存器，该
默认值将被自动覆盖。有关校准的更多信息请参见“工作
模式”部分。
ADC模式寄存器
ADC模式寄存器主要用于设置ADC的转换模式：连续转换
或单次转换。用户也可以选择待机和掉电模式以及任何校
准模式。此外，该寄存器还包含时钟源选择位和内部基准
电压源使能位。基准电压源选择位包含在设置配置寄存器
中(更多信息参见“ADC设置”部分)。
失调寄存器
失调寄存器保存ADC的失调校准系数。失调寄存器的上电
复位值为0x800000。失调寄存器为24位读/写寄存器。如果
用户启动内部或系统零电平校准，或者写入失调寄存器，
该上电复位值将被自动覆盖。
接口模式寄存器
接口模式寄存器用于配置数字接口的工作模式。利用此寄
存器，用户可以控制数据字长度、CRC使能、数据加状态
读取和连续读取模式。两种寄存器的详情请参阅表15和表
16。更多信息请参阅“数字接口”部分。
表15. ADC模式寄存器
寄存器 名称
0x01 ADCMODE
位
[15:8]
[7:0]
位7
REF_EN
保留
位6
HIDE_DELAY
位5
SING_CYC
Mode
位4
位3
位2
位1
位0
Delay
保留
保留
CLOCKSEL
复位
0x8000
RW
RW
复位
RW
表16. 接口模式寄存器
寄存器 名称
0x02 IFMODE
位
[15:8]
[7:0]
位7
CONTREAD
位6
保留
DATA_S
位5
位4
位3
保留
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位2
位1
保留
保留
位0
AD7175-2
了解配置灵活性
AD7175-2最简单的实现方式是将模拟输入就近配对成为2
个差分输入通道，并在这2个差分通道上使用相同的设置、
增益校正和失调校正寄存器。在这种情况下，用户选择以
下差分输入：AIN0/AIN1和AIN2/AIN3。在图50中，黑色
字体所示寄存器必须针对这样一种配置进行编程。在这种
配置中，显示为灰色字体的寄存器是冗余的。
CHANNEL
REGISTERS
CH0
AIN1
CH1
AIN2
CH2
AIN3
CH3
AIN4
实现这2个全差分输入的另一种方法是使用4种可用设置。
这样做的动因包括：各差分输入存在不同的速度/噪声要
求，或者各通道可能有特定的失调或增益校正。图51展示
了每个差分输入可能使用独立设置的方式，从而为每个通
道的配置带来全面的灵活性。
FILTER CONFIG
REGISTERS
GAIN REGISTERS*
OFFSET0 0x30
GAIN1
0x39
OFFSET1 0x31
GAIN2
0x3A
OFFSET2 0x32
GAIN3
0x3B
OFFSET3 0x33
FILTCON0 0x28
GAIN0
0x11
SETUPCON1 0x21
FILTCON1 0x29
0x12
SETUPCON2 0x22
FILTCON2 0x2A
0x13
SETUPCON3 0x23
FILTCON3 0x2B
SELECT ANALOG INPUT PAIRS
ENABLE THE CHANNEL
SELECT SETUP 0
SELECT PERIPHERAL
FUNCTIONS FOR
ADC CHANNEL
DATA OUTPUT CODING
REFERENCE SOURCE
INPUT BUFFERS
SELECT DIGITAL
FILTER TYPE
AND OUTPUT DATA RATE
OFFSET REGISTERS
0x38
0x10
SETUPCON0 0x20
GAIN CORRECTION
OFFSET CORRECTION
OPTIONALLY
OPTIONALLY PROGRAMMED
PROGRAMMED
PER SETUP AS REQUIRED
PER SETUP AS REQUIRED
(*FACTORY CALIBRATED)
SINC5 + SINC1
SINC3
SINC3 MAP
12468-046
AIN0
SETUP CONFIG
REGISTERS
对于任何应用案例，对增益和失调寄存器进行编程都是可
选的，寄存器框图之间的虚线也表明了这一点。
ENHANCED 50Hz AND 60Hz
图50. 2个全差分输入，全部使用一种设置(SETUPCON0；FILTCON0；GAIN0；OFFSET0)
SETUP CONFIG
REGISTERS
FILTER CONFIG
REGISTERS
GAIN REGISTERS*
OFFSET REGISTERS
AIN0
CH0
0x10
SETUPCON0 0x20
FILTCON0 0x28
GAIN0
0x38
OFFSET0 0x30
AIN1
CH1
0x11
SETUPCON1 0x21
FILTCON1 0x29
GAIN1
0x39
OFFSET1 0x31
AIN2
CH2
0x12
SETUPCON2 0x22
FILTCON2 0x2A
GAIN2
0x3A
OFFSET2 0x32
AIN3
CH3
0x13
SETUPCON3 0x23
FILTCON3 0x2B
GAIN3
0x3B
OFFSET3 0x33
AIN4
SELECT PERIPHERAL
FUNCTIONS FOR
ADC CHANNEL
DATA OUTPUT CODING
REFERENCE SOURCE
INPUT BUFFERS
SELECT DIGITAL
FILTER TYPE
AND OUTPUT DATA RATE
SINC5 + SINC1
SINC3
SINC3 MAP
GAIN CORRECTION
OFFSET CORRECTION
OPTIONALLY
OPTIONALLY PROGRAMMED
PROGRAMMED
PER SETUP AS REQUIRED
PER SETUP AS REQUIRED
(*FACTORY CALIBRATED)
ENHANCED 50Hz AND 60Hz
图51. 2个全差分输入(各通道一种设置)
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12468-047
CHANNEL
REGISTERS
AD7175-2
CHANNEL
REGISTERS
SETUP CONFIG
REGISTERS
编程，同时还根据需要对FILTCON0和FILTCON1寄存器进
行编程。通过对GAIN0和GAIN1寄存器以及OFFSET0和
OFFSET1寄存器编程，可以根据具体设置使用可选的增益
和失调校正。
在图52所示的例子中，使用的是CH0至CH2寄存器。将这
些寄存器的MSB(CH_EN0至CH_EN2)设置为1，以使能这
些通道以及它们对应的交叉点多路复用器组合。当
AD7175-2转换时，序列器以升序从CH0转到CH1，再到
CH2，最后返回CH0，重复整个序列。
FILTER CONFIG
REGISTERS
GAIN REGISTERS*
AIN0
CH0
0x10
SETUPCON0 0x20
FILTCON0 0x28
GAIN0
AIN1
CH1
0x11
SETUPCON1 0x21
FILTCON1 0x29
AIN2
CH2
0x12
SETUPCON2 0x22
FILTCON2 0x2A
AIN3
CH3
0x13
SETUPCON3 0x23
FILTCON3 0x2B
AIN4
SELECT ANALOG INPUT PARTS
ENABLE THE CHANNEL
SELECT SETUP
SELECT PERIPHERAL
FUNCTIONS FOR
ADC CHANNEL
DATA OUTPUT CODING
REFERENCE SOURCE
INPUT BUFFERS
SELECT DIGITAL
FILTER TYPE
AND OUTPUT DATA RATE
OFFSET0 0x30
GAIN1
0x39
OFFSET1 0x31
GAIN2
0x3A
OFFSET2 0x32
GAIN3
0x3B
OFFSET3 0x33
GAIN CORRECTION
OFFSET CORRECTION
OPTIONALLY
OPTIONALLY PROGRAMMED
PROGRAMMED
PER SETUP AS REQUIRED
PER SETUP AS REQUIRED
(*FACTORY CALIBRATED)
SINC5 + SINC1
SINC3
SINC3 MAP
ENHANCED 50Hz AND 60Hz
图52. 混合差分和单端配置(使用多种共用设置)
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OFFSET REGISTERS
0x38
12468-048
图52中的示例展示了通道寄存器在模拟输入引脚与设置配
置下游之间的关系。在该示例中，需要1个差分输入和2个
单端输入。单端输入为AIN2/AIN4和AIN3/AIN4组合。差
分输入对为AIN0/AIN1，使用设置0。2个单端输入对被设
置为诊断，因此，它们使用与差分输入不同的设置，但单
端输入共用一种设置：设置1。鉴于选择了2种设置供使用，
因此，根据需要对SETUPCON0和SETUPCON1寄存器进行
AD7175-2
电路描述
模拟输入缓冲
AVDD1
AD7175-2在两路ADC模拟输入上都集成了真轨到轨、精密
单位增益缓冲器。缓冲器的好处是给用户带来高输入阻抗，
并且典型输入电流只有30 nA，使得高阻抗信号源可以直接
连到模拟输入。缓冲器完全驱动内部ADC开关电容采样网
络，简化模拟前端电路要求，同时每个缓冲器的典型功耗
仅2.9 mA，效率非常高。每个模拟输入缓冲放大器均完全斩
波，就是说，这会使缓冲器的失调误差漂移和1/f噪声最小。
ADC和缓冲器组合的1/f噪声曲线如图53所示。
AIN0
AVSS
AVDD1
+IN
AIN1
Ø1
CS1
AVSS
Ø2
AVDD1
Ø2
AIN2
CS2
AVSS
0
AVDD1
–IN
Ø1
AIN3
AVSS
AVDD1
–100
AIN4
AVSS
–150
图54. 简化模拟输入电路
CS1和CS2为皮法级电容。此容值是采样电容和寄生电容的
组合。
1
10
100
1k
FREQUENCY (Hz)
10k
12468-259
–200
–250
0.1
12468-056
AMPLITUDE (dB)
–50
图53. 短路输入FFT(模拟输入缓冲器使能)
与许多分立放大器不同，模拟输入缓冲器以供电轨工作时，
线性度不会下降。以AVDD1和AVSS供电轨或接近供电轨
的电压工作时，输入电流会提高。在高温时，这种提高最
为明显。图42和图43显示了不同条件下的输入电流。模拟
输入缓冲器禁用时，AD7175-2的平均输入电流以48 µA/V的
速率随差分输入电压而线性变化。
交叉点多路复用器
有5个模拟输入引脚：AIN0、AIN1、AIN2、AIN3和AIN4。
各引脚均连接到内部交叉点多路复用器。交叉点多路复用
器支持将这些引脚配置为单端或全差分输入对。AD7175-2
最多可以有四个有效通道。使能多个通道时，各通道按从
号码低到高的顺序处理。多路复用器的输出连接到集成真
轨到轨缓冲器的输入。可以旁路这些缓冲器，将多路复用
器的输出直接连到ADC的开关电容输入。简化的模拟输入
电路如图54所示。
全差分输入
AIN0至AIN4模拟输入均连接到交叉点多路复用器，因此
可以使用信号的任意组合来构成模拟输入对。这样，用户
就可以选择2个全差分输入或4个单端输入。
若有两个全差分输入路径连接到AD7175-2，考虑到引脚彼
此的相对位置，建议将AIN0/AIN1用作一个差分输入对，
并将AIN2/AIN3用作第二个差分输入对。将所有模拟输入
去耦至AVSS。
单端输入
用户也可以选择测量四路不同的单端模拟输入。这种情况
下，各路模拟输入被转换为待测量的单端输入与设定的模
拟输入公共引脚之间的差值。由于存在一个交叉点多路复
用器，因此用户可以将任意模拟输入设置为公共引脚。例
如，将AIN4引脚连接到AVSS或REFOUT电压(即AVSS + 2.5 V)，
并在配置交叉点多路复用器时选择此输入。在单端输入下
使用AD7175-2时，INL性能会降低。
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AD7175-2
AD7175-2基准电压源
其输出端的0.1 µF电容去耦以确保稳定。输出然后连接到一
个4.7 µF电容，它用作ADC所需动态电荷的储存库，REF+输
入端连接一个0.1 µF去耦电容。此电容应尽可能靠近REF+和
REF−引脚。REF−引脚直接连到AVSS电位。AD7175-2上电
时，内部基准电压源默认使能，并通过REFOUT引脚输出。
当使用外部基准电压源而非内部基准电压源为AD7175-2供
电时，必须注意REFOUT引脚的输出。如果应用的其它地
方不使用内部基准电压源，应确保不要将REFOUT引脚硬
线连接到AVSS，否则会在上电时消耗大量电流。上电时，
如果不使用内部基准电压源，应写入ADC模式寄存器，禁
用内部基准电压源。这是由ADC模式寄存器的REF_EN位
(位15)控制，如表18所示。
AD7175-2允许用户将外部基准电压源施加于器件的REF+
和REF−引脚，或者使用内部2.5 V、低噪声、低漂移基准电
压源。适当设置设置配置寄存器的REF_SELx位(位[5:4])，
可以选择要使用的基准电压源。设置配置0寄存器的结构
如表17所示。上电时，AD7175-2默认使用内部2.5 V基准电
压源。
外部基准电压源
AD7175-2具有全差分基准电压输入，通过REF+和REF−引
脚施加。推荐使用标准低噪声、低漂移基准电压源，如
ADR445、ADR444和ADR441等。将外部基准电压施加于
AD7175-2基准电压引脚，如图55所示。将任何外部基准电
压源的输出去耦至AVSS。如图55所示，ADR445输出通过
AD7175-2
5.5V TO 18V
ADR4452
0.1µF
0.1µF
5V VREF
1
4.7µF
1
1
3
REF+
2
REF–
0.1µF
1
1ALL DECOUPLING IS
2ANY OF THE ADR44x
TO AVSS.
FAMILY OF REFERENCES CAN BE USED.
THE ADR444 AND ADR441 BOTH ENABLE REUSE OF THE 5V ANALOG SUPPLY
NEEDED FOR AVDD1 TO POWER THE REFERENCE VIN.
12468-159
1
图55. 外部基准电压源ADR445连接到AD7175-2基准电压引脚
表17. 设置配置0寄存器
寄存器 名称
0x20
SETUPCON0
位
[15:8]
[7:0]
位7
位6
保留
BURNOUT_EN0 保留
位5
位4
位3
位2
位1
位0
BI_UNIPOLAR0 REFBUF0+ REFBUF0− AINBUF0+ AINBUF0−
REF_SEL0
保留
复位
RW
0x1320 RW
表18. ADC模式寄存器
寄存器 名称
0x01
ADCMODE
位
[15:8]
[7:0]
位7
REF_EN
保留
位6
HIDE_DELAY
位5
SING_CYC
Mode
位4
位3
位2
保留
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CLOCKSEL
位1
Delay
保留
位0
复位
0x8000
RW
RW
AD7175-2
内部基准电压源
AD7175-2内置低噪声、低漂移基准电压源。内部基准电压
源提供2.5 V输出。ADC模式寄存器的REF_EN位设置为1后，
内部基准电压源通过REFOUT引脚输出，并通过一个0.1 µF
电容去耦至AVSS。AD7175-2的内部基准电压源在上电时
默认使能，并且被选择为ADC的基准电压源。使用内部基
准电压源时，INL性能会降低，如图23所示。
REFOUT信号经过缓冲后输出到该引脚。该信号可以在电
路外部使用，用作外部放大器配置的共模源。
基准电压输入缓冲
AD7175-2在两路ADC基准电压输入上都集成了真轨到轨、
精密单位增益缓冲器。缓冲器的好处是给用户带来高输入
阻抗，使得外部高阻抗信号源可以直接连到基准电压输入。
集成的基准电压缓冲器可以完全驱动内部基准电压开关电
容采样网络，简化基准电压电路要求，同时每个缓冲器的
典型功耗仅2.9 mA，效率非常高。每个基准电压输入缓冲放
大器均完全斩波，就是说，这会使缓冲器的失调误差漂移
和1/f噪声最小。使用ADR445、ADR444和ADR441等外部
基准电压源时，不需要这些缓冲器，因为这些基准电压源
经过适当去耦后，可以直接驱动基准输入。
会产生干扰，使用此选项可能影响AD7175-2的直流性能。
性能受影响的程度取决于IOVDD电压。IOVDD电压越
高，则驱动器的逻辑输出摆幅越宽，因而性能受到的影响
越大。如果IOSTRENGTH位设置为较高的IOVDD电平，
则影响更严重(更多信息参见表28)。
外部晶振
如果需要更高精度、更低抖动的时钟源，AD7175-2可以使
用外部晶振来产生主时钟。晶振连接到XTAL1和XTAL2/
CLKIO引脚。建议使用的晶振之一是Epson-Toyocom的16 MHz、
10 ppm、9 pF晶振FA-20H，它采用表贴封装。如图56所示，
在连接晶振的走线到XTAL1和XTAL2/CLKIO引脚之间插入
两个电容。利用这些电容可以调谐电路。应将这些电容连
接到DGND引脚。这些电容的值取决于晶振与XTAL1和
XTAL2/CLKIO引脚之间的走线连接的长度和容值。因此，
印刷电路板(PCB)布局和采用的晶振不同，这些电容的值
也不同。
AD7175-2
Cx1
*
XTAL1 9
XTAL2/CLKIO 10
*
AD7175-2使用标称16 MHz的主时钟。AD7175-2可以从以下
三个来源获得采样时钟：
• 内部振荡器
• 外部晶振
• 外部时钟源
数据手册中列出的所有输出数据速率均与16 MHz的主时钟
速率相关。例如，使用外部源提供的较低时钟频率时，所
有列出的数据速率将按比例缩放。为实现额定数据速率，
尤其是支持50 Hz和60 Hz抑制的速率，应使用16 MHz时钟。
主时钟的来源通过设置ADC模式寄存器的CLOCKSEL位(位
[3:2])来选择，如表18所示。AD7175-2上电和复位时默认
使用内部振荡器工作。可以利用SINC3_MAPx位，微调低
输出数据速率时的输出数据速率和滤波器陷波频率。更多
信息参见“Sinc3滤波器”部分。
内部振荡器
内部振荡器工作频率为16 MHz，可以用作ADC主时钟。它
是AD7175-2的默认时钟源，额定精度为±2.5%。
有一个选项允许内部时钟振荡器通过XTAL2/CLKIO引脚输
出。时钟输出被驱动到IOVDD逻辑电平。由于输出驱动器
*DECOUPLE TO DGND.
12468-160
Cx2
时钟源
图56. 外部晶振连接
外部晶振电路可能对SCLK边沿敏感，具体情况取决于
SCLK频率、IOVDD电压、晶振电路布局和所用的晶振。
晶振启动时，SLCK边沿引起的任何扰动都可能会在晶振输
入端引起双边沿，造成无效转换，直至晶振电压达到足够
高的电平，使得SCLK边沿的任何干扰都不足以引起双时钟。
确保晶振电路启动后已达到足够高的电平，再施加SCLK，
可以避免双时钟问题。
考虑到晶振电路的性质，建议在要求条件下，利用最终
PCB布局和晶振对电路进行经验测试，以确保它能正常
工作。
外部时钟
AD7175-2也可以使用外部提供的时钟。在使用外部时钟的
系统中，外部时钟连接到XTAL2/CLKIO引脚。这种配置中，
XTAL2/CLKIO引脚接受外部提供的时钟，并将其路由至调
制器。此时钟输入的逻辑电平由施加于IOVDD引脚的电压
定义。
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AD7175-2
数字滤波器
AD7175-2有三个灵活的滤波器选项，支持对噪声、建立时
间和抑制性能进行优化：
• Sinc5 + sinc1滤波器
• Sinc3滤波器
• 增强型50 Hz和60 Hz抑制滤波器
SINC5
SINC1
SINC3滤波器
Sinc3滤波器在较低速率时可实现最佳单通道噪声性能，因
此最适合单通道应用。Sinc3滤波器的建立时间始终等于
tSETTLE = 3/输出数据速率
图59所示为Sinc3滤波器的频域滤波器响应。Sinc3滤波器具
有良好的随频率滚降性能，并具有宽陷波频率，可实现良
好的陷波频率抑制。
50Hz AND 60Hz
POSTFILTER
0
–10
12468-058
SINC3
–20
–30
滤波器和输出数据速率是通过所选设置的滤波器配置寄存
器的相应位来配置。每个通道可以使用不同的设置，因而
可以使用不同的滤波器和输出数据速率。更多信息参见
“寄存器详解”部分。
FILTER GAIN (dB)
图57. 数字滤波器功能框图
–70
–80
–100
0
–20
–110
–120
0
50
150
图59. Sinc3滤波器响应
表21和表22列出了Sinc3滤波器的输出数据速率以及相应的
建立时间和均方根噪声。通过设置滤波器配置寄存器的
SINC3_MAPx位，可以精密调整Sinc3滤波器的输出数据速
率。如果此位置1，滤波器寄存器的映射将变为直接对
Sinc3滤波器的抽取率进行编程。所有其他选项均无效。单
通道的数据速率可通过下式计算：
–40
Output Data Rate =
–60
100
FREQUENCY (Hz)
12468-060
Sinc5 + Sinc1滤波器主要用于多路复用应用，在10 kSPS和
更低的输出数据速率时，可实现单周期建立。Sinc5模块输
出固定在250 kSPS的最大速率，Sinc1模块的输出数据速率可
变，从而控制最终ADC输出数据速率。图58显示Sinc5 + Sinc1
滤波器在50 SPS输出数据速率时的频域响应。Sinc5 + Sinc1
滤波器随频率的滚降速度很慢，陷波频率很窄。
FILTER GAIN (dB)
–50
–60
–90
SINC5 + SINC1滤波器
f MOD
32 × FILTCONx[14:0]
其中：
fMOD为调制器速率(MCLK/2)；对于16 MHz MCLK，它等于
8 MHz。
FILTCONx[14:0]是滤波器配置寄存器的内容，不包括MSB。
–80
0
50
100
FREQUENCY (Hz)
150
12468-059
–100
–120
–40
例 如 ， 通 过 将 FILTCONx[14:0]位 设 置 为 5000以 使 能
SINC3_MAPx，可以实现50 SPS的输出数据速率。
图58. Sinc5 + Sinc1滤波器在50 SPS ODR时的响应
表19和表20列出了Sinc5 + Sinc1滤波器的输出数据速率以及
相应的建立时间和均方根噪声。
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AD7175-2
AD7175-2可以配置如下：将ADC模式寄存器的SING_CYC
位设置为1，以便仅输出完全建立的数据，从而将ADC有
效置于单周期建立模式。此模式将输出数据速率降至与选
定输出数据速率的ADC建立时间相等的水平，从而实现单
周期建立。Sinc5 + Sinc1滤波器在10 kSPS及更低的输出数据
速率时，此位不起作用。
图61显示了单周期建立使能时模拟输入上的相同阶跃。为
使输出完全建立，模拟输入至少需要一个周期。输出数据
速率(如RDY信号所示)现在降为与选定输出数据速率的建
立时间相当的水平。
ANALOG
INPUT
FULLY
SETTLED
ADC
OUTPUT
图60显示了禁用此模式且选择Sinc3滤波器时模拟输入上的
阶跃。阶跃变化后，为使输出达到最终稳定值，模拟输入
至少需要三个周期。
tSETTLE
12468-062
单周期建立
图61. 带单周期建立的阶跃输入
ANALOG
INPUT
FULLY
SETTLED
12468-061
ADC
OUTPUT
1/ODR
图60. 无单周期建立的阶跃输入
表19. 使用Sinc5 + Sinc1滤波器时(禁用输入缓冲器)的输出数据速率、建立时间和噪声
默认输出数据速率
(SPS)；
SING_CYC = 0且
单通道使能1
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
397.5
200
100
59.92
49.96
20
16.66
10
5
1
2
输出数据速率
(SPS/通道)；
SING_CYC = 1或
使能多个通道1
50,000
41,667
31,250
27,778
20,833
17,857
12,500
10,000
5000
2500
1000
500.0
397.5
200.0
100
59.92
49.96
20.00
16.66
10.00
5.00
建立时间1
20 µs
24 µs
32 µs
36 µs
48 µs
56 µs
80 µs
100 µs
200 µs
400 µs
1.0 ms
2.0 ms
2.516 ms
5.0 ms
10 ms
16.67 ms
20.016 ms
50.0 ms
60.02 ms
100 ms
200 ms
陷波频率
(Hz)
250,000
125,000
62,500
50,000
31,250
25,000
15,625
11,905
5435
2604
1016
504
400.00
200.64
100.16
59.98
50.00
20.01
16.66
10.00
5.00
噪声
(µV rms)
8.7
7.2
5.5
5
4
3.6
2.9
2.5
1.7
1.2
0.77
0.57
0.5
0.36
0.25
0.19
0.18
0.11
0.1
0.08
0.07
采用5 V基准电压
时的有效分辨率
(位)
20.1
20.4
20.8
20.9
21.3
21.4
21.7
21.9
22.5
23.0
23.6
24
24
24
24
24
24
24
24
24
24
建立时间舍入到最接近的微秒数。这反映在输出数据速率和通道开关速率中。通道开关速率 = 1 ÷ 建立时间。
1000个采样。
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噪声
(µV p-p)2
65
60
43
41
32
29
22
18.3
12
8.2
5.2
3.2
3
2
1.3
1.1
0.95
0.6
0.45
0.4
0.34
采用5 V基准电压时
的峰峰值分辨率
(位)
17.2
17.3
17.8
17.9
18.3
18.4
18.8
19.1
19.7
20.2
20.9
21.6
21.7
22.3
22.9
23.1
23.3
24
24
24
24
AD7175-2
表20. 使用Sinc5 + Sinc1滤波器时(使能输入缓冲器)的输出数据速率、建立时间和噪声
默认输出数据速率
(SPS)；
SING_CYC = 0且
单通道使能1
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
397.5
200
100
59.92
49.96
20
16.66
10
5
1
2
输出数据速率
(SPS/通道)；
SING_CYC = 1或
使能多个通道1
50,000
41,667
31,250
27,778
20,833
17,857
12,500
10,000
5000
2500
1000
500.0
397.5
200.0
100
59.92
49.96
20.00
16.66
10.00
5.00
建立时间1
20 µs
24 µs
32 µs
36 µs
48 µs
56 µs
80 µs
100 µs
200 µs
400 µs
1.0 ms
2.0 ms
2.516 ms
5.0 ms
10 ms
16.67 ms
20.016 ms
50.0 ms
60.02 ms
100 ms
200 ms
陷波频率
(Hz)
250,000
125,000
62,500
50,000
31,250
25,000
15,625
11,905
5435
2604
1016
504
400.00
200.64
100.16
59.98
50.00
20.01
16.66
10.00
5.00
噪声
(µV rms)
9.8
8.4
6.4
5.9
4.8
4.3
3.4
3
2.1
1.5
0.92
0.68
0.6
0.43
0.32
0.23
0.2
0.14
0.13
0.1
0.07
采用5 V基准电压时
的有效分辨率(位)
20
20.2
20.6
20.7
21
21.1
21.5
21.7
22.2
22.7
23.4
23.8
24
24
24
24
24
24
24
24
24
建立时间舍入到最接近的微秒数。这反映在输出数据速率和通道开关速率中。通道开关速率 = 1 ÷ 建立时间。
1000个采样。
Rev. A | Page 31 of 60
噪声
(µV p-p)2
85
66
55
49
39
33
26
23
16
10
5.7
3.9
3.7
2.2
1.7
1.2
1
0.75
0.66
0.47
0.32
采用5 V基准电压
时的峰峰值分辨率
(位)
16.8
17.2
17.5
17.6
18.0
18.2
18.6
18.7
19.3
19.9
20.7
21.3
21.4
22.1
22.5
23
23.3
23.7
23.9
24
24
AD7175-2
表21. 使用Sinc3滤波器时(禁用输入缓冲器)的输出数据速率、建立时间和噪声
默认输出数据速率
(SPS)；
SING_CYC = 0且
单通道使能1
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
400
200
100
60
50
20
16.67
10
5
1
2
输出数据速率
(SPS/通道)；
SING_CYC = 1或
使能多个通道1
83,333
41,667
20,833
16,667
10,417
8333
5208
3333
1667
833
333.3
166.7
133.3
66.7
33.33
19.99
16.67
6.67
5.56
3.33
1.67
建立时间1
12 µs
24 µs
48 µs
60 µs
96 µs
120 µs
192 µs
300 µs
6 µs
1.2 ms
3 ms
6 ms
7.5 ms
15 ms
30 ms
50.02 ms
60 ms
150 ms
180 ms
300 ms
600 ms
陷波频率
(Hz)
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
400
200
100
59.98
50
20
16.67
10
5
噪声
(µV rms)
210
28
5.2
4.2
3.2
2.9
2.2
1.8
1.3
0.91
0.56
0.44
0.4
0.25
0.2
0.13
0.13
0.08
0.07
0.06
0.05
采用5 V基准电压
时的有效分辨率
(位)
15.5
18.4
20.9
21.2
21.6
21.7
22.1
22.4
22.9
23.4
24
24
24
24
24
24
24
24
24
24
24
建立时间舍入到最接近的微秒数。这反映在输出数据速率和通道开关速率中。通道开关速率 = 1 ÷ 建立时间。
1000个采样。
Rev. A | Page 32 of 60
噪声
(µV p-p)2
1600
200
40
34
26
23
17
14
9.5
6
3.9
2.5
2.3
1.4
1
0.8
0.7
0.42
0.37
0.28
0.21
采用5 V基准电压时
的峰峰值分辨率
(位)
12.6
15.6
17.9
18.2
18.6
18.7
19.2
19.4
20
20.7
21.3
21.9
22.1
22.8
23.3
23.6
23.8
24
24
24
24
AD7175-2
表22. 使用Sinc3滤波器时(使能输入缓冲器)的输出数据速率、建立时间和噪声
默认输出数据速率
(SPS)；
SING_CYC = 0且
单通道使能1
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
400
200
100
60
50
20
16.67
10
5
1
2
输出数据速率
(SPS/通道)；
SING_CYC = 1或
使能多个通道1
83,333
41,667
20,833
16,667
10,417
8333
5208
3333
1667
833
333.3
166.7
133.3
66.7
33.33
19.99
16.67
6.67
5.56
3.33
1.67
建立时间1
12 µs
24 µs
48 µs
60 µs
96 µs
120 µs
192 µs
300 µs
6 µs
1.2 ms
3 ms
6 ms
7.5 ms
15 ms
30 ms
50.02ms
60 ms
150 ms
180 ms
300 ms
600 ms
陷波频率
(Hz)
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
400
200
100
59.98
50
20
16.67
10
5
噪声
(µV rms)
210
28
5.8
4.9
3.8
3.4
2.6
2.1
1.5
1.1
0.71
0.52
0.41
0.32
0.2
0.17
0.15
0.13
0.12
0.1
0.08
采用5 V基准电压
时的有效分辨率
(位)
15.5
18.4
20.7
21
21.3
21.5
21.9
22.2
22.7
23.1
23.7
24
24
24
24
24
24
24
24
24
24
建立时间舍入到最接近的微秒数。这反映在输出数据速率和通道开关速率中。通道开关速率 = 1 ÷ 建立时间。
1000个采样。
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噪声
(µV p-p)2
1600
210
48
41
30
26
18
16
11
7
4.5
3
2.7
1.8
1.2
1.1
0.83
0.61
0.6
0.55
0.35
采用5 V基准电压时
的峰峰值分辨率
(位)
12.6
15.5
17.7
17.9
18.3
18.6
19.1
19.3
19.8
20.4
21.1
21.7
21.8
22.4
23
23.1
23.5
24
24
24
24
AD7175-2
增强型50 HZ和60 HZ抑制滤波器
增强型滤波器旨在提供50 Hz和60 Hz同时抑制，并且允许用
户用建立时间交换抑制性能。这些滤波器可以最高27.27 SPS
的速率工作，或者可以抑制最高90 dB的50 Hz ± 1 Hz和60 Hz
± 1 Hz干扰。这些滤波器是通过对Sinc5 + Sinc1滤波器输出
进行后滤波实现的。因此，使用增强型滤波器时，为了实
现额定建立时间和噪声性能，必须选择Sinc5 + Sinc1滤波器。
表23显示了输出数据速率及相应的建立时间、抑制性能和
均方根噪声。图62至图69显示了增强型滤波器的频域响应。
表23. 输出数据速率、噪声、建立时间和抑制——使用增强型滤波器
输出数据速率(SPS)
输入缓冲器禁用
27.27
25
20
16.667
输入缓冲器使能
27.27
25
20
16.667
1
建立时间
(ms)
50 Hz ± 1 Hz和60 Hz ± 1 Hz同时
抑制(dB)1
噪声
(µV rms)
峰峰值分辨率(位)
注释
36.67
40.0
50.0
60.0
47
62
85
90
0.22
0.2
0.2
0.17
22.7
22.9
22.9
23
参见图62和图65
参见图63和图66
参见图64和图67
参见图68和图69
36.67
40.0
50.0
60.0
47
62
85
90
0.22
0.22
0.21
0.21
22.7
22.7
22.8
22.8
参见图62和图65
参见图63和图66
参见图64和图67
参见图68和图69
主时钟 = 16.00 MHz。
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0
–10
–10
–20
–20
–30
–30
–40
–50
–60
–40
–50
–60
–70
–70
–80
–80
–90
–90
–100
–100
40
0
100
200
300
400
500
600
FREQUENCY (Hz)
65
70
–10
–20
–20
–30
FILTER GAIN (dB)
–40
–50
–60
–70
–30
–40
–50
–60
–70
–80
–80
100
200
300
400
500
600
FREQUENCY (Hz)
–100
40
12468-065
0
45
50
55
60
65
70
65
70
FREQUENCY (Hz)
12468-066
–90
–90
图66. 25 SPS ODR、40 ms建立时间
图63. 25 SPS ODR、40 ms建立时间
0
0
–10
–10
–20
–20
FILTER GAIN (dB)
–30
–40
–50
–60
–70
–30
–40
–50
–60
–70
–80
–80
–90
0
100
200
300
400
500
FREQUENCY (Hz)
600
12468-067
–90
–100
40
45
50
55
60
FREQUENCY (Hz)
图67. 20 SPS ODR、50 ms建立时间
图64. 20 SPS ODR、50 ms建立时间
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12468-068
FILTER GAIN (dB)
60
图65. 27.27 SPS ODR、36.67 ms建立时间
0
FILTER GAIN (dB)
55
0
–10
–100
50
FREQUENCY (Hz)
图62. 27.27 SPS ODR、36.67 ms建立时间
–100
45
12468-064
FILTER GAIN (dB)
0
12468-063
FILTER GAIN (dB)
AD7175-2
0
–10
–10
–20
–20
–30
–30
FILTER GAIN (dB)
0
–40
–50
–60
–70
–80
–40
–50
–60
–70
–90
–90
–100
–100
40
0
100
200
300
400
500
FREQUENCY (Hz)
600
图68. 16.667 SPS ODR、60 ms建立时间
45
50
55
60
65
FREQUENCY (Hz)
图69. 16.667 SPS ODR、60 ms建立时间
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70
12468-070
–80
12468-069
FILTER GAIN (dB)
AD7175-2
AD7175-2
工作模式
AD7175-2有多种工作模式，通过ADC模式寄存器和接口模
式寄存器可以设置工作模式(参见表27和表28)。这些模式
列示如下，下文将介绍各种模式：
•
•
•
•
•
•
连续转换模式
连续读取模式
单次转换模式
待机模式
掉电模式
校准模式(三种)
存器，指示下一操作为读取数据寄存器。从数据寄存器中
读取数据字后，DOUT/RDY引脚变为高电平。如需要，用
户可以多次读取该寄存器。但用户必须确保在下一次转换
完成前，不访问数据寄存器；否则，新的转换结果将丢失。
如果使能了多个通道，ADC将自动遍历各使能通道，在每
个通道上执行一次转换。所有通道均转换完毕后，又从第
一个通道开始。使能的通道按从低到高的顺序转换。一旦
获得转换结果，就会立即更新数据寄存器。每次获得转换
结果时，RDY输出就会变为低电平。然后，用户可以读取
转换结果，同时ADC转换下一个使能通道。
连续转换模式
连续转换模式是上电后的默认转换模式。AD7175-2连续进
行转换，每次完成转换后，状态寄存器中的RDY位变为低
电平。如果CS为低电平，则完成一次转换时，RDY输出也
会变为低电平。若要读取转换结果，用户需要写入通信寄
如果接口模式寄存器中的DATA_STAT位设置为1，则每次
读取数据寄存器时，状态寄存器的内容将与转换数据一同
输出。状态寄存器指示对应的转换通道。
CS
0x44
0x44
DIN
DATA
DATA
12468-071
DOUT/RDY
SCLK
图70. 连续转换模式
Rev. A | Page 37 of 60
AD7175-2
连续读取模式
要使能连续读取模式，应将接口模式寄存器的
CONTREAD位设置为1。此位设置为1时，唯一可能的串行
接口操作是读取数据寄存器。要退出连续读取模式，应在
RDY输出为低电平时发出一个伪读取ADC数据寄存器命令
(0x44)，或者应用软件复位，即在CS = 0且DIN = 1时提供64
个SCLK，从而复位ADC及所有寄存器内容。接口被置于
连续读取模式后只能识别这些命令。在连续读取模式下，
在有指令写入器件前，DIN应保持低电平。
在连续读取模式下，读取ADC数据之前不需要写入通信寄
存器，只需在RDY变为低电平(表示转换结束)后提供所需
数量的SCLK。读取转换结果后，RDY返回到高电平，直到
下一转换结果可用为止。这种模式下，数据只能被读取一
次，而且用户必须确保在下一转换完成前读取数据字。如
果在下一转换完成之前，用户尚未读取转换结果，或者为
AD7175-2提供的串行时钟数不足以完成对数据字的读取，
则在下一转换完成之前不久，串行输出寄存器将复位，新
转换结果将置于输出串行寄存器中。要使用连续读取模式，
ADC必须配置为连续转换模式。
使能多个ADC通道时，各通道轮流输出；如果接口模式寄
存器的DATA_STAT置1，数据将为附加状态位。状态寄存
器指示对应的转换通道。
CS
DOUT/RDY
0x02
0x0080
DATA
DATA
DATA
12468-072
DIN
SCLK
图71. 连续读取模式
Rev. A | Page 38 of 60
AD7175-2
单次转换模式
在单次转换模式下，AD7175-2执行一次转换，完成转换后
即被置于待机模式。RDY输出变为低电平表示转换完成。
从数据寄存器中读取数据字后，DOUT/RDY引脚变为高电
平。如果需要，即使DOUT/RDY引脚已变为高电平，也可
以多次读取数据寄存器。
平。一旦获得转换结果，RDY输出便会变为低电平。然
后，ADC选择下一个通道并开始转换。在执行下一转换过
程中，用户可以读取当前的转换结果。下一转换完成后，
数据寄存器便会更新；因此，用户读取转换结果的时间有
限。ADC在各选择通道上均完成一次转换后，便会返回待
机模式。
如果使能了多个通道，ADC将自动遍历各使能通道，并在
各通道上执行转换。开始转换后，DOUT/RDY引脚变为高
电平并保持该状态，直到获得有效转换结果且CS变为低电
如果接口模式寄存器中的DATA_STAT位设置为1，则每次
读取数据寄存器时，状态寄存器的内容将与转换数据一同
输出。状态寄存器的两个LSB表示对应的转换通道。
CS
DIN
0x01
0x8010
0x44
DATA
12468-073
DOUT/RDY
SCLK
图72. 单次转换模式
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AD7175-2
待机和掉电模式
在待机模式下，大部分模块被关断。LDO仍然有效，因此
寄存器保持其内容不变。内部基准电压源若使能则仍然有
效，晶振若被选择则仍然有效。要在待机模式下关断基准
电压源，应将ADC模式寄存器的REF_EN位设置为0。要在
待机模式下关断时钟，应将ADC模式寄存器的CLOCKSEL
位设置为00(内部振荡器)。
在掉电模式下，所有模块均被关断，包括LDO。所有寄存
器丧失其内容，GPIO输出被置于三态。要防止意外进入掉
电模式，必须首先将ADC置于待机模式。退出掉电模式需
要在CS = 0且DIN = 1时提供64个SCLK，即执行串行接口复
位。发出后续串行接口命令以允许LDO上电之前，建议延
迟500 µs。
图19显示了退出待机模式(REF_EN先设为0再设为1)和退出
掉电模式后的内部基准电压建立时间。
校准
AD7175-2支持执行两点校准来消除任何失调和增益误差。
它提供三种校准模式，可用来在每种设置基础上消除失调
和增益误差：
• 内部零电平校准模式
• 系统零电平校准模式
• 系统满量程校准模式
没有内部满量程校准模式，因为该校准已于生产时在工厂
进行。
校准期间只能有一个通道有效。每次转换完成后，ADC转
换结果需利用ADC校准寄存器进行调整，然后写入数据寄
存器。
失调寄存器的默认值是0x800000，增益寄存器的标称值是
0x555555。ADC增益的校准范围是0.4 x VREF至1.05 x VREF。
计算使用下面的公式。在单极性模式下，理想关系(即不考
虑ADC增益误差和失调误差)如下：
 0.75 × V

Gain
IN
Data = 
× 2 23 − ( Offset − 0 x 800000 )  ×
+ 0 x 800000
 V
 0 x 400000
REF


为启动校准，应将适当的值写入ADC模式寄存器的MODE
位。启动校准后，DOUT/RDY引脚和状态寄存器的RDY位
变为高电平。校准完成时，相应失调或增益寄存器的内容
会更新，状态寄存器的RDY位复位，RDY输出引脚返回到
低电平(如果CS为低电平)，并且AD7175-2返回待机模式。
内部失调校准期间，所选正模拟输入引脚断开，调制器的
两个输入均内部连接到所选的负模拟输入引脚。因此，必
须确保所选负模拟输入引脚上的电压不超过允许的限值，
并且没有过大的噪声和干扰。
然而，系统校准要求在启动校准模式之前，将系统零电平
(失调)和系统满量程(增益)电压施加于ADC引脚，这样可
以消除ADC的外部误差。
从操作上来看，校准就像另一次ADC转换。如果需要，失
调校准必须总是在满量程校准之前执行。对系统软件进行
设置，以监视状态寄存器的RDY位或RDY输出引脚，进而
通过一个轮询序列或中断驱动的例行程序确定校准何时结
束。所有校准所需的时间等于选定滤波器的建立时间加上
要完成的输出数据速率。
内部失调校准、系统零电平校准和系统满量程校准可以在
任何输出数据速率下执行。使用较低的输出数据速率可以
获得更高的校准精度，并且对所有输出数据速率都是精确
的。如果一个通道的基准电压源发生改变，则该通道需要
重新校准失调。
失调误差典型值为±40 µV，失调校准将失调误差降至噪声水
平。增益误差在环境温度下经过出厂校准。校准之后，增
益误差典型值为FSR的±35 ppm。
用户可以访问AD7175-2的片内校准寄存器，通过微处理器
读取器件的校准系数，以及写入自己的校准系数。读写失
调和增益寄存器可以在内部或自校准以外的任意时间执行。

 0.75 × V
Gain
IN
×2
Data = 
× 2 23 − ( Offset − 0 x 800000 )  ×
 0 x 400000
 V
REF


在双极性模式下，理想关系(即不考虑ADC增益误差和失
调误差)如下：
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AD7175-2
数字接口
图2和图3显示了与AD7175-2进行接口的时序图，其中CS用
于解码该器件。图2显示对AD7175-2执行读操作的时序，
图3显示对AD7175-2执行写操作的时序。即使在第一次读
操作之后RDY输出返回到高电平，也可以多次读取数据寄
存器。不过，必须确保在下一输出更新发生之前，这些读
操作已完成。连续读取模式下，只能从数据寄存器读取
一次。
将CS与低电平相连时，串行接口可以在三线模式下工作。
这 种 情 况 下 ， SCLK、 DIN和 DOUT/RDY引 脚 用 于 与
AD7175-2通信。转换是否结束也可以利用状态寄存器的
RDY位来监视。
在CS = 0且DIN = 1时，写入64个SCLK可以复位AD7175-2。
复位使接口返回到期待对通信寄存器执行写操作的状态。
该操作会将所有寄存器的内容复位到其上电值。复位后，
用户应等待500 µs再访问串行接口。
x8 + x2 + x + 1
读操作期间，用户可以选择此多项式或更简单的XOR函
数。与基于多项式的校验和相比，主机处理器处理XOR函
数所需的时间更少。接口模式寄存器的CRC_EN位用于使
能和禁用校验和，并允许用户选择多项式或简单的XOR
校验。
校验和附加于每次读和写处理的末尾。写处理的校验和利
用8位命令字和8至24位数据计算。读处理的校验和利用命
令字和8至32位数据输出计算。图73和图74分别显示了SPI
读和写处理。
8-BIT COMMAND
UP TO 24-BIT INPUT
8-BIT CRC
CS
DATA
CRC
CS
DIN
SCLK
12468-074
DOUT/RDY引脚也可用作数据就绪信号；当数据寄存器中
有新数据字可用时，如果CS为低电平，则该输出变为低电
平。对数据寄存器的读操作完成时，RDY输出复位为高电
平。数据寄存器更新之前，RDY输出也会变为高电平，以
提示此时不应读取器件，确保寄存器正在更新时不会发生
数据读取操作。当RDY输出即将变为低电平时，务必小
心，避免从数据寄存器读取数据。确保无数据读取操作的
最佳方法是始终监控RDY输出；当RDY输出变为低电平
时，立即开始读取数据寄存器；确保SCLK速率足够高，以
便读取操作能在下一个转换结果之前完成。CS用来选择器
件。在多个器件与串行总线相连的系统中，它可以用于对
AD7175-2进行解码。
写操作期间的CRC校验和计算始终使用下列多项式：
图73. 使能CRC的SPI写处理
8-BIT COMMAND
UP TO 32-BIT INPUT
8-BIT CRC
CS
DIN
DOUT/
RDY
CMD
DATA
SCLK
CRC
12468-075
AD7175-2的可编程功能通过SPI串行接口控制。AD7175-2
的串行接口包含四个信号：CS、DIN、SCLK、DOUT/
RDY。DIN输入用于将数据传输至片内寄存器中，DOUT
输出则用于从片内寄存器中获取数据。SCLK是器件的串行
时钟输入，所有数据传输(无论是DIN输入上还是DOUT输
出上)均与SCLK信号相关。
图74. 使能CRC的SPI读处理
连续读取模式有效时，如果使能校验和保护，则每次数据
传输前存在暗含的读取数据命令0x44，计算校验和值时必
须予以考虑。该暗含的读取数据命令可确保即使ADC数据
等于0x000000，校验和值也不是零。
校验和保护
AD7175-2具有校验和模式，可用来提高接口的鲁棒性。使
用校验和可确保仅将有效数据写入寄存器，并且可以对从
寄存器读取的数据进行验证。如果寄存器写入期间发生错
误，状态寄存器的CRC_ERROR位将置1。然而，为确保寄
存器写入成功，应回读该寄存器并验证校验和。
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AD7175-2
CRC计算
对齐。对该数据施加一个异或(XOR)函数，以产生一个更
短的新数。再次对齐多项式，使其MSB与新结果最左侧的
逻辑1对齐，重复上述步骤。最后，原始数据将减少至小
于多项式的值。此值即是8位校验和。
多项式
校验和为8位宽，利用以下多项式产生：
x8 + x2 + x + 1
要生成校验和，需将数据左移8位，产生一个后8位为逻辑
0的数值。对齐多项式，使其MSB与该数据最左侧的逻辑1
多项式CRC计算示例—24位字：0x654321(8命令位和16位数据)
下例使用基于多项式的校验和生成8位校验和：
011001010100001100100001
初始值
x8 + x2 + x + 1
01100101010000110010000100000000
左移8位
=
多项式
100000111
XOR结果
100100100000110010000100000000
100000111
多项式
XOR结果
100011000110010000100000000
100000111
多项式
11111110010000100000000
100000111
XOR结果
多项式值
1111101110000100000000
100000111
XOR结果
多项式值
111100000000100000000
100000111
XOR结果
多项式值
11100111000100000000
100000111
XOR结果
多项式值
1100100100100000000
100000111
XOR结果
多项式值
100101010100000000
100000111
XOR结果
多项式值
101101100000000
100000111
1101011000000
100000111
101010110000
100000111
1010001000
100000111
10000110
XOR结果
多项式值
XOR结果
多项式值
XOR结果
多项式值
XOR结果
多项式值
校验和 = 0x86
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AD7175-2
XOR计算
校验和为8位宽，产生方法如下：将数据拆分为字节，然后对这些字节执行XOR运算。
XOR计算示例—24位字：0x654321(8命令位和16位数据)
使用上例，分为三个字节：0x65、0x43和0x21
01100101
0x65
01000011
0x43
00100110
XOR结果
00100001
0x21
00000111
CRC
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AD7175-2
集成功能
AD7175-2集成了多个功能以改善其在多种应用中的作用，
并且可在安全敏感的应用中用于诊断。
通用I/O
AD7175-2有两个通用数字输入/输出引脚：GPIO0和GPIO1。
这些引脚通过GPIOCON寄存器中的IP_EN0/IP_EN1位或
OP_EN0/OP_EN1位使能。当GPIO0或GPIO1引脚被使能为
输入时，引脚的逻辑电平分别包含在GP_DATA0和GP_DATA1
位中。当GPIO0或GPIO1引脚被使能为输出时，GP_DATA0
或GP_DATA1位决定引脚的逻辑电平输出。这些引脚的逻
辑电平以AVDD1和AVSS为基准，因此，输出幅度为5 V。
SYNC/ERROR引脚也可以用作通用输出。当GPIOCON寄
存器的ERR_EN位设置为11时，SYNC/ERROR引脚用作通
用输出。这种配置下，GPIOCON寄存器的ERR_DAT位决
定 引 脚 的 逻 辑 电 平 输出 。 引 脚 的 逻 辑 电 平 以 IOVDD和
DGND为基准。
对噪声性能的影响取决于延迟时间与转换时间的关系。对
于10 kSPS以下的输出数据速率，可以吸收延迟时间，但以
下四种速率不能吸收任何延迟：397.5 SPS、59.92 SPS、
49.96 SPS和16.66 SPS。
16位/24位转换
AD7175-2默认产生24位转换结果。然而，转换结果的宽度
可以减少至16位。将接口模式寄存器的WL16位设置为1，
可将所有数据转换舍入到16位。此位清0时，数据转换的
宽度为24位。
DOUT_RESET
设置为通用输出时，GPIO和SYNC/ERROR引脚均有一个有
源上拉电阻。
串行接口使用共享的DOUT/RDY引脚。默认情况下，此引
脚输出RDY信号。数据读取期间，此引脚输出所读取寄存
器的数据。读取完成后，经过很短的固定时间(t7)，该引脚
重新输出RDY信号。然而，该时间对于某些微控制器而言
可能过短。将接口模式寄存器中的DOUT_RESET位设为1时，
可以将该时间延长到CS引脚变为高电平为止。这意味着，
CS必须以帧传输方式执行每个读操作并完成串行接口处理。
外部多路复用器控制
同步
当使用外部多路复用器来提高通道数时，多路复用器逻辑引
脚可以通过AD7175-2 GPIOx引脚进行控制。利用MUX_IO位，
GPIOx时序通过ADC控制；因此，通道变化与ADC同步，
无需外部同步。
延迟
在AD7175-2开始采样之前，可以插入一个可编程延迟时间。
该延迟用于使外部放大器或多路复用器稳定下来，此外还
可以降低外部放大器或多路复用器的性能要求。利用ADC
模式寄存器的delay位(寄存器0x01的位[10:8])，可以设置从
0 µs到1 ms的8个延迟时间。
如果选择大于0 µs的延迟时间，并且ADC模式寄存器的HIDE_
DELAY位设为0，则转换时间会增加该延迟时间，无论旋
转何种输出数据速率。
使用sinc5 + sinc1滤波器时，可以隐藏该延迟，使得输出数
据速率与延迟未使能时的输出数据速率相同。如果
HIDE_DELAY位设为1，并且选定的延迟小于转换时间的
一半，则可以通过减少数字滤波器执行的均值操作次数来
吸收该延迟，使得转换时间不变，但这会影响噪声性能。
正常同步
当 GPIOCON寄 存 器 的 SYNC_EN位 设 置 为 1时 ， SYNC/
ERROR引脚用作同步输入。利用SYNC输入，用户可以复
位调制器和数字滤波器，而不会影响器件的任何设置条件。
这样，用户就可以从已知点，即SYNC输入的上升沿开始
采集模拟输入的样本。为确保同步发生，SYNC输入必须
保持低电平至少一个主时钟周期。
如果多个AD7175-2器件利用一个公共主时钟工作，则可以
让这些器件同步，使其模拟输入被同步采样。该同步一般
在各AD7175-2已执行自身的校准或已将校准系数载入其校
准寄存器之后完成。SYNC输入的下降沿使数字滤波器和
模拟调制器复位，并将AD7175-2置于一致的已知状态。在
SYNC输入为低电平期间，AD7175-2保持该已知状态。在
SYNC输入上升沿，调制器和滤波器离开复位状态；在下
一主时钟沿，器件再次开始采集输入样本。
Rev. A | Page 44 of 60
AD7175-2
器件在SYNC输入由低到高跃迁之后的主时钟下降沿离开
复位状态。因此，当同步多个器件时，在主时钟上升沿使
SYNC输入变为高电平，确保所有器件均在主时钟下降沿
被释放。如果SYNC输入没有在充足的时间内变为高电平，
则器件之间可能相差一个主时钟周期，即对于不同器件，
获得转换结果的时刻最多相差一个主时钟周期。
在普通同步模式下，对于单一通道，SYNC输入也可用作
启动转换命令。这种模式下，SYNC输入的上升沿启动转
换，RDY输出的下降沿指示转换已完成。每次数据寄存器
更新时，必须预留滤波器的建立时间。转换完成后，应拉
低SYNC输入，为下一个转换开始信号做好准备。
交替同步
在 交 替 同 步 模 式 下 ， 当 AD7175-2的 多 个 通 道 使 能 时 ，
SYNC输 入 用 作 启 动 转 换 命 令 。 将 接 口 模 式 寄 存 器 的
ALT_SYNC位设置为1，可以使能交替同步方案。当SYNC
输入变为低电平时，ADC完成对当前通道的转换，按顺序
选择下一个通道，然后等到SYNC输入变为高电平时开始
转换。当前通道的转换完成时，RDY输出变为低电平，数
据寄存器更新为对应的转换结果。
因此，SYNC输入不会干扰当前选定通道的采样，但允许
用户控制下一个通道开始转换的时刻。
交替同步模式只能在使能多个通道时使用。仅使能一个通
道时不建议使用这种模式。
错误标志
状态寄存器包含三个错误位——ADC_ERROR、CRC_ERROR
和REG_ERROR，分别指示ADC转换错误、CRC校验错误
和寄存器改变引起的错误。此外，ERROR输出可以指示已
发生错误。
ADC_ERROR
状态寄存器的ADC_ERROR位指示转换过程中发生的所有
错误。当ADC输出超量程或欠量程结果时，该标志位置1。发
生过压或欠压时，ADC也会输出全0或全1。此标志仅在过
压或欠压消失时复位。读取数据寄存器不会使其复位。
CRC_ERROR
如果一个写操作相关的CRC值与所发送的信息不一致，
CRC_ERROR标志位即置1。一旦明确读取状态寄存器，该
标志就会复位。
REG_ERROR
RE_ERROR标志位与接口模式寄存器的REG_CHECK位一
起使用。当REG_CHECK位置1时，AD7175-2监视片内寄
存器的值。若有一位改变，REG_ERROR位就会置1。因此，
为了写入片内寄存器，应将REG_CHECK置0。更新寄存器
后，就可以将REG_CHECK位置1。AD7175-2计算片内寄
存器的校验和。若有一个寄存器值发生改变，REG_ERROR
位就会置1。发现错误后，必须将REG_CHECK位清0才能
清除状态寄存器的REG_ERROR位。寄存器校验功能不监
视数据寄存器、状态寄存器和接口模式寄存器。
ERROR输入/输出
当 GPIOCON寄 存 器 的 SYNC_EN位 设 置 为 0时 ， SYNC/
ERROR引脚用作错误输入/输出引脚或通用输出引脚。
GPIOCON寄存器的ERR_EN位决定该引脚的功能。
ERR_EN设置为10时，SYNC/ERROR引脚用作开漏错误输
出 ERROR。 状 态 寄 存 器 的 三 个 错 误 位 (ADC_ERROR、
CRC_ERROR和REG_ERROR)经过“或”运算并反转后映射到
ERROR输出。因此，ERROR输出指示已发生错误。要确定
错误来源，必须读取状态寄存器。
ERR_EN设置为01时，SYNC/ERROR引脚用作错误输入
ERROR。 其 它 器 件 的 错 误 输 出 可 以 连 接 到 AD7175-2
ERROR输入，因此AD7175-2可以指示自身或外部器件发生
错误。ERROR输入的值经过反转并与ADC转换错误进行
“或”运算，结果通过状态寄存器的ADC_ERROR位显示。
ERROR输入的值反映在状态寄存器的ERR_DAT位。
ERR_EN位设置为00时，ERROR输入/输出禁用。ERR_EN
位设置为11时，SYNC/ERROR引脚用作通用输出。
DATA_STAT
可以将状态寄存器的内容附加到AD7175-2的每次转换结果。
使能多个通道时，此功能很有用。每次输出转换结果时，
都会附加状态寄存器的内容。状态寄存器的两个LSB表示
对应的转换通道。此外，用户可以通过错误位确定是否发
生错误。
Rev. A | Page 45 of 60
AD7175-2
IOSTRENGTH
串行接口可以采用低至2 V的电源工作。然而，在此低压下，
如果板上的寄生电容较大或SCLK频率较高，DOUT/RDY
2
引脚可能没有足够的驱动强度。接口模式寄存器的
IOSTRENGTH位可提高DOUT/RDY引脚的驱动强度。
内部温度传感器
AD7175-2集成有温度传感器。该温度传感器可以指示器件
工作所处的大致环境温度。它可以用于诊断，或指示应用
电路何时需要重新运行校准例程以补偿工作温度引起的偏
移。温度传感器通过交叉点多路复用器选择，像模拟输入
通道一样进行选择。温度传感器要求两个模拟输入上的模
拟输入缓冲器均使能。转换期间，如果缓冲器未使能，选
择温度传感器作为输入将迫使缓冲器使能。
为了使用温度传感器，首先要在已知温度(25°C)下校准器
件，并执行一次转换作为基准点。温度传感器的标称灵敏
度为477 µV/K，这一理想斜率与实测斜率的差可用来校准
温度传感器。在25°C执行校准后，温度传感器的额定精度
典型值为±2°C。温度可通过下式计算：
Rev. A | Page 46 of 60
 Conversion Result
Temperature ( °C ) = 

477 μV


 – 273.15


AD7175-2
接地和布局布线
由于模拟输入和基准输入均为差分输入，因此模拟调制器
中的多数电压都是共模电压。器件的高共模抑制性能可消
除这些输入信号中的共模噪声。为将模拟部分与数字部分
之间的耦合降至最低，AD7175-2的模拟电源和数字电源彼
此独立，连接到单独的引脚。数字滤波器可抑制电源上的
宽带噪声，但无法抑制那些频率为主时钟频率的整数倍的
噪声。
阻抗路径，并减小电源线路上的毛刺噪声。应利用数字地
屏蔽时钟等快速切换信号，以免向电路板的其他部分辐射
噪声，并且绝不应将时钟信号走线布设在模拟输入附近。
避免数字信号与模拟信号交叠。电路板相反两侧上的走线
应彼此垂直，这种技术有助于减小电路板上的馈通效应。
微带线技术是目前的最佳选择，但这种技术对于双面电路
板未必总是可行。
另外，数字滤波器还能够消除来自模拟和基准输入端的噪
声，但前提是这些噪声源没有使模拟调制器饱和。因此，
与传统高分辨率转换器相比，AD7175-2具有更强的抗噪能
力。不过，由于AD7175-2的分辨率较高，而转换器的噪声
电平极低，因此必须谨慎对待接地和布局。
使用高分辨率ADC时，良好的去耦十分重要。AD7175-2有
三个电源引脚：AVDD1、AVDD2和IOVDD。AVDD1和
AVDD2引脚以AVSS为基准，IOVDD引脚以DGND为基
准。通过10 µF电容与0.1 µF电容的并联组合将AVDD1和AVDD2
去耦至各引脚上的AVSS。使各电源的0.1 µF电容应尽可能靠
近该器件，最好正对着该器件。通过10 µF电容与0.1 µF电容
的并联组合将IOVDD去耦至DGND。将所有模拟输入去耦
至AVSS。如果使用外部基准电压源，将REF+和REF−引脚
去耦至AVSS。
ADC所在的PCB应采用模拟部分与数字部分分离设计，并
限制在电路板的一定区域内。为实现最佳屏蔽，接地层一
般应尽量少采用蚀刻技术。
无论采取何种布局，用户均必须注意规划系统中电流的回
流路径，确保所有电流的回流路径均尽可能靠近电流到达
目的地所经过的路径。
避免在该器件下方布设数字线路，否则会将噪声耦合至芯
片；将模拟接地层放在AD7175-2下方可以防止噪声耦合。
AD7175-2的电源线路必须采用尽可能宽的走线，以提供低
AD7175-2还有两个片上LDO稳压器，一个调节AVDD2电
源，另一个调节IOVDD电源。对于REGCAPA引脚，建议利
用1 µF和0.1 µF电容将其去耦至AVSS。类似地，对于REGCAPD
引脚，建议利用1 µF和0.1 µF电容将其去耦至DGND。
如果AD7175-2采用分离电源供电，AVSS必须使用单独
的层。
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AD7175-2
寄存器汇总
表24. 寄存器汇总
寄存
器
0x00
名称
COMMS
0x00
STATUS
[7:0]
RDY
0x01
ADCMODE
[15:8]
[7:0]
[15:8]
REF_EN
保留
0x02
IFMODE
0x03
REGCHECK
0x04
DATA
0x06
GPIOCON
位
[7:0]
位7
WEN
位6
位5
位4
位3
ID
SING_CYC
MODE
0x10
CH0
0x20
SETUPCON0
0x21
SETUPCON1
[15:8]
0x22
SETUPCON2
0x23
0x28
0x11
0x12
0x13
0x29
0x2A
0x2B
0x30
0x31
0x32
0x33
0x38
0x39
0x3A
0x3B
CH1
CH2
CH3
CLOCKSEL
IO
保留
_EN1
OP_EN0
CH_EN2
CH_EN3
SETUP_
保留
AINPOS0[2:0]
保留
AINPOS1[2:0]
保留
AINPOS2[2:0]
保留
AINPOS3[2:0]
保留
保留
SETUP_
SETUP_
SETUP_
REFBUF2+
SETUPCON3
[15:8]
保留
保留
BI_UNIPOLAR3
REFBUF3+
FILTCON0
[15:8]
[23:0]
[23:0]
[23:0]
[23:0]
[23:0]
[23:0]
[23:0]
[23:0]
0x0800
RW
0x0CDX
R
GP_DATA0
RW
RW
RW
SINC3_MAP0
保留
保留
SINC3_MAP1
保留
SINC3_MAP2
保留
保留
RW
保留
BI_UNIPOLAR2
OFFSET0
OFFSET1
OFFSET2
OFFSET3
GAIN0
GAIN1
GAIN2
GAIN3
R
AINNEG2
保留
保留
SINC3_MAP3
保留
0x000000
保留
[15:8]
[15:8]
R
AINNEG1
REFBUF1+
FILTCON3
0x000000
保留
BI_UNIPOLAR1
[15:8]
RW
AINNEG0
保留
保留
FILTCON2
0x8000
保留
REFBUF0+
[15:8]
GP_DATA1
ID[15:8]
ID[7:0]
CH_EN1
RW
W
保留
REGISTER_CHECK[23:16]
REGISTER_CHECK[15:8]
REGISTER_CHECK[7:0]
DATA[23:16]
DATA[15:8]
DATA[7:0]
CH_EN0
复位
0x00
保留
BI_UNIPOLAR0
FILTCON1
位0
DELAY
保留
保留
ALT_SYNC
保留
保留
[23:16]
[15:8]
[7:0]
[23:16]
[15:8]
[7:0]
[15:8]
[15:8]
[7:0]
[15:8]
[7:0]
[15:8]
[7:0]
[15:8]
[7:0]
[15:8]
[7:0]
[15:8]
位1
保留
HIDE_DELAY
保留
0x07
位2
RA
R/W
AINNEG3
REFBUF0保留
REFBUF1−
保留
REFBUF2−
保留
REFBUF3−
保留
ENHFILTEN0
AINBUF0+
AINBUF0−
0x1320
RW
AINBUF1+
AINBUF1−
0x1320
RW
AINBUF2+
AINBUF2−
0x1320
RW
AINBUF3+
AINBUF3−
0x1320
RW
ENHFILT0
0x0500
RW
ENHFILT1
0x0500
RW
ODR0
ENHFILTEN1
ODR1
RW
保留
ODR2
RW
保留
ODR3
OFFSET0[23:0]
OFFSET1[23:0]
OFFSET2[23:0]
OFFSET3[23:0]
GAIN0[23:0]
GAIN1[23:0]
GAIN2[23:0]
GAIN3[23:0]
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0x800000
0x800000
0x800000
0x800000
0x5XXXX0
0x5XXXX0
0x5XXXX0
0x5XXXX0
RW
RW
RW
RW
RW
RW
RW
RW
AD7175-2
寄存器详解
通信寄存器
地址：0x00；复位：0x00；名称：COMMS
对片内寄存器的所有访问均必须以对通信寄存器的写操作开始。该写操作决定接下来访问哪个寄存器，以及访问操作是写
还是读。
表25. COMMS的位功能描述
位
7
位名称
WEN
6
R/W
设置
0
1
[5:0]
RA
000000
000001
000010
000011
000100
000110
000111
010000
010001
010010
010011
100000
100001
100010
100011
101000
101001
101010
101011
110000
110001
110010
110011
111000
111001
111010
111011
说明
要与ADC开始通信，此位必须为低电平。
复位
0x0
访问类型
W
此位决定命令是读操作还是写操作。
写命令
读命令
寄存器地址位决定当前通信读写哪一个寄存器。
状态寄存器
ADC模式寄存器
接口模式寄存器
寄存器校验和寄存器
数据寄存器
GPIO配置寄存器
ID寄存器
r
通道0寄存器
通道1寄存器
通道2寄存器
通道3寄存器
设置配置0寄存器
设置配置1寄存器
设置配置2寄存器
设置配置3寄存器
滤波器配置0寄存器
滤波器配置1寄存器
滤波器配置2寄存器
滤波器配置3寄存器
失调0寄存器
失调1寄存器
失调2寄存器
失调3寄存器
增益0寄存器
增益1寄存器
增益2寄存器
增益3寄存器
0x0
W
0x00
W
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AD7175-2
状态寄存器
地址：0x00；复位：0x80；名称：STATUS
状态寄存器是一个8位寄存器，包含ADC和串行接口的状态信息。通过将接口模式寄存器的DATA_STAT位设置为1，可以将
其附加到数据寄存器。
表26. STATUS的位功能描述
位
7
位名称
RDY
设置
0
1
6
ADC_ERROR
0
1
5
CRC_ERROR
0
1
4
REG_ERROR
0
1
[3:2]
[1:0]
保留
CHANNEL
00
01
10
11
说明
只要CS为低电平且不在读取寄存器，RDY的状态就会输出到DOUT/RDY
引脚。当ADC已将新结果写入数据寄存器时，此位变为低电平。在ADC
校准模式下，ADC写入校准结果后，此位变为低电平。读取数据寄存器
时，RDY自动变为高电平。
新数据结果可用
等待新数据结果
此位默认指示是否发生ADC超量程或欠量程事件。如果发生超量程或欠
量程错误，ADC结果将箝位至0xFFFFFF或0x000000。此位在写入ADC结
果时更新，在消除超量程或欠量程状况后的下一次更新时清零。
无错误
有错误
此位指示寄存器写操作期间是否发生CRC错误。对于寄存器读操作，主机
微控制器决定是否发生CRC错误。读取此寄存器时，该位清0。
无错误
CRC错误
此位指示一个内部寄存器的内容是否发生变化，与激活寄存器完整性检
查时计算的值不同。要激活该检查，须将接口模式寄存器的REG_CHECK
位设置为1。REG_CHECK位清0时，此位清0。
无错误
有错误
这些位保留。
这些位指示数据寄存器中当前存储的结果所对应的ADC转换通道。这可
能与当前正在转换的通道不同。该映射是通道映射寄存器的直接映射；
因此，通道0产生0x0，通道3产生0x3。
通道0
通道1
通道2
通道3
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复位
0x1
访问类型
R
0x0
R
0x0
R
0x0
R
0x0
0x0
R
R
AD7175-2
ADC模式寄存器
地址：0x01；复位：0x8000；名称：ADCMODE
ADC模式寄存器控制ADC的工作模式和主时钟选择。写入ADC模式寄存器会复位滤波器和RDY位，并开始新的转换或校准。
表27. ADCMODE的位功能描述
位
15
位名称
REF_EN
设置
0
1
14
HIDE_DELAY
0
1
13
SING_CYC
0
1
[12:11]
[10:8]
保留
DELAY
000
001
010
011
100
101
110
111
7
[6:4]
保留
MODE
000
001
010
011
100
110
111
[3:2]
CLOCKSEL
00
01
10
11
[1:0]
保留
说明
使能内部基准电压源并输出缓冲2.5 V电压到REFOUT引脚。
禁用
使能
利用DELAY位设置可编程延迟后，对于采用sinc5 + sinc1滤波器的选
定数据速率，此位允许将延迟吸收到转换时间中，从而隐藏延迟。
详情见“延迟”部分。
使能
禁用
仅单个通道有效时，可以使用此位来设置ADC仅以建立的滤波器数据
速率输出。
禁用
使能
这些位保留，应置0。
这些位允许通道切换后增加一个可编程的延迟时间，以便外部电路能
在ADC开始处理其输入前稳定下来。
0
4 µs
16 µs
40 µs
100 µs
200 µs
500 µs
1 ms
此位保留，应置0。
这些位控制ADC的工作模式。详情见“工作模式”部分。
连续转换模式
单次转换模式
待机模式
掉电模式
内部失调校准
系统失调校准
系统增益校准
此位用来选择ADC时钟源。如果选择内部振荡器，则也会使能内部振
荡器。
内部振荡器
XTAL2/CLKIO引脚上的内部振荡器输出
XTAL2/CLKIO引脚上的外部时钟输入
XTAL1和XTAL2/CLKIO引脚上的外部晶振
这些位保留，应置0。
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复位
0x1
访问类型
RW
0x0
RW
0x0
RW
0x0
0x0
R
RW
0x0
0x0
R
RW
0x0
RW
0x0
R
AD7175-2
接口模式寄存器
地址：0x02；复位：0x0000；名称：IFMODE
接口模式寄存器配置各种串行接口选项。
表28. IFMODE的位功能描述
位
[15:13]
12
位名称
保留
ALT_SYNC
设置
0
1
11
IOSTRENGTH
0
1
[10:9]
8
保留
DOUT_复位
0
1
7
CONTREAD
0
1
6
DATA_STAT
0
1
5
REG_CHECK
0
1
4
[3:2]
保留
CRC_EN
00
01
10
1
保留
说明
这些位保留，应置0。
此位使能SYNC/ERROR引脚的不同行为，以便利用SYNC/ERROR来控制
循环通道的转换(详见GPIO配置寄存器中的SYNC_EN位部分的说明)。
禁用
使能
此位控制DOUT/RDY引脚的驱动强度。在IOVDD电源较低且电容中等
的情况下高速读取串行接口时，将此位置1。
禁用(默认)
使能
这些位保留，应置0。
详情见“DOUT_RESET”部分。
禁用
使能
使能连续读取ADC数据寄存器。要使用连续读取，ADC必须配置为连
续转换模式。详情参见“工作模式”部分。
禁用
使能
此位使状态寄存器可以在读取时附加到数据寄存器上，使得通道和状
态信息与数据一同传输。这是确保从状态寄存器读出的通道位与数据
寄存器中的数据对应的唯一方式。
禁用
使能
此位使能寄存器完整性检查，利用此检查可监视用户寄存器值的任何
变化。要使用此特性，应在此位清0的情况下根据需要配置所有其它
寄存器。然后写入此寄存器，设置REG_CHECK位为1。若有任一寄存
器的内容发生变化，状态寄存器的REG_ERROR位就会置1。要清除错
误，将REG_CHECK位置0。检查的寄存器不包括接口模式寄存器、
ADC数据和状态寄存器。如果一个寄存器必须写入新值，必须先将此
位清0；否则，写入新寄存器内容时会报错。
禁用
使能
此位保留，应置0。
使能寄存器读写的CRC保护。CRC会将串行接口传输的字节数加1。
详情参见“CRC计算”部分。
禁用
使能寄存器读处理的XOR校验和；寄存器写处理仍将使用CRC
读和写处理均使能CRC校验和
此位保留，应置0。
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复位
0x0
0x0
访问类型
R
RW
0x0
RW
0x0
0x0
R
RW
0x0
RW
0x0
RW
0x0
RW
0x0
0x00
R
RW
0x0
R
AD7175-2
位
0
位名称
WL16
设置
0
1
说明
ADC数据寄存器变为16位。写入接口模式寄存器不会复位ADC；
因此，写入这些位后，ADC结果不会立即舍入到正确的字长。第一
个新的ADC结果是正确的。
24位数据
16位数据
复位
0x0
访问类型
RW
寄存器检查
地址：0x03；复位：0x000000；名称：REGCHECK
寄存器检查寄存器是通过对用户寄存器的内容进行异或运算而求得的24位校验和。要使用此功能，接口模式寄存器的
REG_CHECK位必须置1；否则，寄存器读出0。
表29. REGCHECK的位功能描述
位
[23:0]
位名称
REGISTER_CHECK
设置
说明
接口模式寄存器的REG_CHECK位设置为1时，此寄存器包含用户寄
存器的24位校验和。
复位
0x000000
访问类型
R
数据寄存器
地址：0x04；复位：0x000000；名称：数据
数据寄存器包含ADC转换结果。编码为偏移二进制，也可以通过设置配置寄存器的BI_UNIPOLARx位更改为单极性。读
取数据寄存器会将RDY位和RDY输出拉高(如果原先为低电平)。ADC结果可以多次读取，但由于RDY输出已被拉高，因此
无法知道下一个ADC结果是否即将到来。收到读取ADC寄存器的命令后，ADC不会将新结果写入数据寄存器。
表30. DATA的位功能描述
位
[23:0]
位名称
DATA
设置
说明
此寄存器包含ADC转换结果。若接口模式寄存器的DATA_STAT置1，
则读取时状态寄存器会附加于此寄存器，使其成为32位寄存器。
若接口模式寄存器的WL16置1，则此寄存器减少到16位。
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复位
0x000000
访问类型
R
AD7175-2
GPIO配置寄存器
地址：0x06；复位：0x0800；名称：GPIOCON
GPIO配置寄存器控制ADC的通用I/O引脚。
表31. GPIOCON的位功能描述
位
[15:13]
12
位名称
保留
MUX_IO
11
SYNC_EN
设置
0
1
[10:9]
ERR_EN
00
01
10
11
8
ERR_DAT
[7:6]
5
保留
IP_EN1
0
1
4
IP_EN0
0
1
3
OP_EN1
0
1
2
OP_EN0
0
1
1
0
GP_DATA1
GP_DATA0
说明
这些位保留，应置0。
此位允许ADC控制外部多路复用器，与内部通道顺序同步使用GPIO0/GPIO1。
用于一个通道的模拟输入引脚仍可按通道进行选择。因此，可以在AIN0/AIN1
之前放上一个4通道多路复用器，并在AIN2/AIN3之前放上另一个多路复用器，
从而为AD7175-2提供总共8个差分通道。但是，一次只能自动安排4个通道。
切换外部多路复用器之后可以插入一个延迟时间 (参见ADC模式寄存器的
DELAY位部分)。
此位可使SYNC/ERROR引脚用作同步输入。设置为低电平时，该引脚使ADC和
滤波器保持复位状态，直到SYNC/ERROR引脚变为高电平为止。当接口模式寄
存器的ALT_SYNC位置1时，可以使用SYNC/ERROR引脚的另一个功能。此模式
仅在使能多个通道时有效。这种情况下，SYNC/ERROR引脚的低电平不会导致
滤波器/调制器立即复位。相反，当通道就要切换时，如果SYNC/ERROR引脚
为低电平，则会阻止调制器和滤波器开始新的转换。将SYNC/ERROR拉高就会
开始新的转换。利用这一备选同步模式，可以在遍历通道的同时使用
SYNC/ERROR。
禁用。
使能。
这些位可使SYNC/ERROR引脚用作错误输入/输出。
禁用。
SYNC/ERROR是错误输入。(反转)回读状态与其他误差源进行“或”运算，结果
通过状态寄存器的ADC_ERROR位输出。SYNC/ERROR引脚状态也可通过此寄存
器的ERR_DAT位读取。
复位
0x0
0x0
访问类型
R
RW
0x1
RW
0x0
RW
0x0
RW
0x0
0x0
R
RW
0x0
RW
0x0
RW
0x0
RW
0x0
0x0
RW
RW
SYNC/ERROR是开漏错误输出。状态寄存器错误位经过“或”运算、反转后映射
到SYNC/ERROR引脚。多个器件的SYNC/ERROR引脚可以连接到同一个上拉电
阻，这样就可以观察到任何器件的错误。
SYNC/ERROR是通用输出。此引脚的状态由该寄存器的ERR_DAT位控制。此输
出参考IOVDD与DGND之间的电平，而不是GPIO引脚使用的AVDD1和AVSS电
平。这种情况下，SYNC/ERROR引脚有一个有源上拉电阻。
SYNC/ERROR引脚用作通用输出时，此位决定其逻辑电平。用作输入时，此位
反映该引脚的回读状态。
这些位保留，应置0。
此位将GPIO1变为输入。输入参考AVDD1或AVSS。
禁用。
使能。
此位将GPIO0变为输入。输入参考AVDD1或AVSS。
禁用。
使能。
此位将GPIO1变为输出。输出参考AVDD1与AVSS之间的电平。
禁用。
使能。
此位将GPIO0变为输出。输出参考AVDD1与AVSS之间的电平。
禁用。
使能。
此位是GPIO1的回读或写入数据。
此位是GPIO0的回读或写入数据。
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AD7175-2
ID寄存器
地址：0x07；复位：0x0CDX；名称：ID
ID寄存器返回16位ID。对于AD7175-2，此ID是0x0CDX。
表32. ID的位功能描述
位
[15:0]
位名称
ID
设置
0x0CDX
说明
ID寄存器返回ADC特定的16位ID代码。
AD7175-2
复位
0x0CDX
访问类型
R
通道寄存器0
地址：0x10；复位：0x8001；名称：CH0
通道寄存器是16位寄存器，用于选择当前有效的通道、各通道使用哪些输入以及该通道使用何种设置来配置ADC。
表33. CH0的位功能描述
位
15
位名称
CH_EN0
设置
0
1
14
[13:12]
保留
SETUP_SEL0
00
01
10
11
[11:10]
[9:5]
保留
AINPOS0
00000
00001
00010
00011
00100
10001
10010
10011
10100
10101
10110
说明
此位使能通道0。使能多个通道时，ADC自动按顺序处理各通道。
禁用
使能(默认)
此位保留，应置0。
这些位决定该通道使用4种设置中的哪一种来配置ADC。设置由四个寄
存器组成：设置配置寄存器、滤波器配置寄存器、失调寄存器和增益
寄存器。所有通道可以使用相同的设置，此时对于所有有效的通道，
必须将相同的2位值写入这些位；最多可以配置4个不同的通道。
设置0
设置1
设置2
设置3
这些位保留，应置0。
这些位选择此通道的哪个输入连接到ADC的正输入。
AIN0(默认)
AIN1
AIN2
AIN3
AIN4
温度传感器+
温度传感器−
((AVDD1 − AVSS)/5)+(必须使能模拟输入缓冲器)
((AVDD1 − AVSS)/5)−(必须使能模拟输入缓冲器)
REF+
REF−
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复位
0x1
访问类型
RW
0x0
0x0
R
RW
0x0
0x0
R
RW
AD7175-2
位
[4:0]
位名称
AINNEG0
设置
00000
00001
00010
00011
00100
10001
10010
10011
10100
10101
10110
说明
这些位选择此通道的哪个输入连接到ADC的负输入。
AIN0
AIN1(默认)
AIN2
AIN3
AIN4
温度传感器+
温度传感器−
((AVDD1 − AVSS)/5)+
((AVDD1 − AVSS)/5)−
REF+
REF−
复位
0x1
访问类型
RW
通道寄存器1至通道寄存器3
地址：0x11至0x13；复位：0x0001；名称：CH1至CH3
剩下的3个通道寄存器使用与通道寄存器0相同的布局。
表34. CH1至CH3寄存器映射
寄存
器
0x11
0x12
0x13
名称
CH1
CH2
CH3
位
[15:8]
[7:0]
位7
CH_EN1
[15:8]
[7:0]
CH_EN2
[15:8]
CH_EN3
[7:0]
位6
保留
AINPOS1[2:0]
保留
AINPOS2[2:0]
保留
位5
位4
SETUP_SEL1
位3
位2
保留
位1
位0
AINPOS1[4:3]
复位
0x0001
RW
RW
AINPOS2[4:3]
0x0001
RW
AINPOS3[4:3]
0x0001
RW
AINNEG1
SETUP_SEL2
保留
AINNEG2
SETUP_SEL3
AINPOS3[2:0]
保留
AINNEG3
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AD7175-2
设置配置寄存器0
地址：0x20；复位：0x1320；名称：SETUPCON0
设置配置寄存器是16位寄存器，用于配置ADC的基准电压源选择、输入缓冲器和输出编码方式。
表35. SETUPCON0的位功能描述
位
[15:13]
12
位名称
保留
BI_UNIPOLAR0
设置
0
1
11
REFBUF0+
0
1
10
REFBUF0−
0
1
9
AINBUF0+
0
1
8
AINBUF0−
0
1
7
BURNOUT_EN0
6
[5:4]
保留
REF_SEL0
00
10
11
[3:0]
保留
说明
这些位保留，应置0。
此位设置设置0的ADC输出编码。
单极性编码输出
双极性编码输出(偏移二进制编码)
此位使能或禁用REF+输入缓冲器。
REF+缓冲器禁用
REF+缓冲器使能
此位使能或禁用REF−输入缓冲器。
REF−缓冲器使能
REF−缓冲器禁用
此位使能或禁用AIN+输入缓冲器。
AIN+缓冲器使能
AIN+缓冲器使能
此位使能或禁用AIN−输入缓冲器。
AIN−缓冲器禁用
AIN−缓冲器使能
此位在所选正模拟输入上使能10 µA源电流，在所选负模拟输入上使
能10 µA吸电流。激励电流可以用于开路诊断，在这种情况下，ADC
结果变为满量程。在测量期间使能激励电流，可在ADC上获得一个
失调电压。这意味着，在精密测量前后间断开启激励电流，是诊断
开路的最佳方式。
复位
0x0
0x1
访问类型
R
RW
0x0
RW
0x0
RW
0x1
RW
0x1
RW
0x00
R
这些位保留，应置0。
这些位选择用于设置0 ADC转换的基准电压源。
外部基准电压源。
2.5 V内部基准电压源。ADC模式寄存器也必须使能此基准电压源。
AVDD1 − AVSS。这可用于诊断，验证其它基准值。
这些位保留，应置0。
0x00
0x2
R
RW
0x0
R
设置配置寄存器1至设置配置寄存器3
地址：0x21至0x23；复位：0x1320；名称：SETUPCON1至SETUPCON3
剩下的3个设置配置寄存器使用与设置配置寄存器0相同的布局。
表36. SETUPCON1至SETUPCON3寄存器映射
寄存器
0x21
名称
SETUPCON1
位
[15:8]
位7
SETUPCON2
[7:0]
[15:8]
BURNOUT_EN1
0x22
[7:0]
[15:8]
[7:0]
BURNOUT_EN2
0x23
SETUPCON3
BURNOUT_EN3
位6
保留
位5
位4
BI_UNIPOLAR1
位3
REFBUF1+
保留
保留
REF_SEL1
BI_UNIPOLAR2
REFBUF2+
保留
保留
保留
REF_SEL2
BI_UNIPOLAR3
REF_SEL3
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REFBUF3+
位2
REFBUF1−
保留
REFBUF2−
保留
REFBUF3−
保留
位1
AINBUF1+
位0
AINBUF1−
复位
0x1320
RW
RW
AINBUF2+
AINBUF2−
0x1320
RW
AINBUF3+
AINBUF3−
0x1320
RW
AD7175-2
滤波器配置寄存器0
地址：0x28；复位：0x0500；名称：FILTCON0
滤波器配置寄存器是16位寄存器，用于配置ADC数据速率和滤波器选项。写入此类寄存器会复位任何正在进行的ADC转换，
重新从序列中的第一个通道开始转换。
表37. FILTCON0的位功能描述
位
15
位名称
SINC3_MAP0
[14:12]
11
保留
ENHFILTEN0
设置
说明
如果此位置1，滤波器寄存器的映射将变为直接对设置0的Sinc3滤波器
的抽取率进行编程。所有其他选项均无效。这种情况下，可以对输出
数据速率和滤波器陷波进行精密调整，以便抑制特定频率。对于单个
通道，数据速率等于fMOD/(32 × FILTCON0[14:0])。
0
1
[10:8]
ENHFILT0
010
011
101
110
7
[6:5]
保留
ORDER0
00
11
[4:0]
ODR0
00000
00001
00010
00011
00100
00101
00110
00111
01000
01001
01010
01011
01100
01101
01110
01111
10000
10001
10010
10011
10100
复位
0x0
这些位保留，应置0。
0x0
此位使能设置0的各种后置滤波器，以提供增强的50 Hz/60 Hz抑制性能。 0x0
为此，ORDER0位必须设置为00以选择Sinc5 + Sinc1滤波器。
禁用
使能
这些位选择设置0的各种后置滤波器，以提供增强的50 Hz/60 Hz抑制性能。 0x5
27 SPS、47 dB抑制、36.7 ms建立
25 SPS、62 dB抑制、40 ms建立
20 SPS、86 dB抑制、50 ms建立
16.67 SPS、92 dB抑制、60 ms建立
此位保留，应置0。
0x0
这些位控制设置0的数字滤波器(用于处理调制器数据)的阶数。
0x0
Sinc5 + Sinc1(默认)
Sinc3
这些位控制ADC的输出数据速率，从而控制设置0的建立时间和噪声。
0x0
所示的速率是针对sinc5 + sinc 1滤波器。参见表19至表22。
250,000
125,000
62,500
50,000
31,250
25,000
15,625
10,000
5000
2500
1000
500
397.5
200
100
59.92
49.96
20
16.66
10
5
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访问类型
RW
R
RW
RW
R
RW
RW
AD7175-2
滤波器配置寄存器1至滤波器配置寄存器3
地址：0x29至0x2B；复位：0x0500；名称：FILTCON1至FILTCON3
剩下的3个滤波器配置寄存器使用与滤波器配置寄存器0相同的布局。
表38. FILTCON1至FILTCON3寄存器映射
寄存器
名称
位
位7
0x2 9
FILTCON1
[15:8]
[7:0]
SINC3_MAP1
保留
保留
ORDER1
ENHFILTEN1
[15:8]
[7:0]
SINC3_MAP2
保留
保留
ORDER2
ENHFILTEN2
[15:8]
SINC3_MAP3
保留
ENHFILTEN3
[7:0]
保留
0x2 A
0x2 B
FILTCON2
FILTCON3
位6
位5
位4
位3
位2
复位
RW
ENHFILT1
0x0500
RW
ENHFILT2
0x0500
RW
ENHFILT3
0x0500
RW
位1
位0
ODR1
ODR2
ORDER3
ODR3
失调寄存器0
地址：0x30；复位：0x800000；名称：OFFSET0
失调(零电平)寄存器是24位寄存器，可用来补偿ADC或系统中的任何失调误差。
表39. OFFSET0的位功能描述
位
[23:0]
位名称
OFFSET0
设置
说明
设置0的失调校准系数。
复位
0x800000
访问类型
RW
失调寄存器1至失调寄存器3
地址：0x31至0x33；复位：0x800000；名称：OFFSET1至OFFSET3
剩下的3个失调寄存器使用与失调寄存器0相同的布局。
表40. OFFSET1至OFFSET3寄存器映射
寄存
器
0x31
0x32
0x33
名称
OFFSET1
OFFSET2
OFFSET3
位
[23:0]
[23:0]
[23:0]
OFFSET1[23:0]
OFFSET2[23:0]
OFFSET3[23:0]
复位
0x800000
0x800000
0x800000
RW
RW
RW
RW
增益寄存器0
地址：0x38；复位：0x5XXXX0；名称：GAIN0
增益(满量程)寄存器是24位寄存器，可用来补偿ADC或系统中的任何增益误差。
表41. GAIN0的位功能描述
位
[23:0]
位名称
GAIN0
设置
说明
设置0的增益校准系数。
复位
0x5XXXX0
访问类型
RW
增益寄存器1至增益寄存器3
地址：0x39至0x3B；复位：0x5XXXX0；名称：GAIN1至GAIN3
剩下的3个增益寄存器使用与增益寄存器0相同的布局。
表42. GAIN1至GAIN3寄存器映射
寄存
器
0x39
0x3A
0x3B
名称
GAIN1
GAIN2
GAIN3
位
[23:0]
[23:0]
[23:0]
GAIN1[23:0]
GAIN2[23:0]
GAIN3[23:0]
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复位
0x5XXXX0
0x5XXXX0
0x5XXXX0
RW
RW
RW
RW
AD7175-2
外形尺寸
7.90
7.80
7.70
24
13
4.50
4.40
4.30
1
12
6.40 BSC
PIN 1
0.15
0.05
0.65
BSC
0.30
0.19
0.10 COPLANARITY
1.20
MAX
SEATING
PLANE
0.20
0.09
8°
0°
0.75
0.60
0.45
COMPLIANT TO JEDEC STANDARDS MO-153-AD
图75. 24引脚超薄紧缩小型封装[TSSOP]
(RU-24)
图示尺寸单位：mm
订购指南
型号1
AD7175-2BRUZ
AD7175-2BRUZ-RL
AD7175-2BRUZ-RL7
EVAL-AD7175-2SDZ
EVAL-SDP-CB1Z
1
温度范围
−40°C至+105°C
−40°C至+105°C
−40°C至+105°C
封装描述
24引脚超薄紧缩小型封装[TSSOP]
24引脚超薄紧缩小型封装[TSSOP]
24引脚超薄紧缩小型封装[TSSOP]
评估板
评估控制板
Z = 符合RoHS标准的器件。
©2014 Analog Devices, Inc. All rights reserved. Trademarks and
registered trademarks are the property of their respective owners.
D12468sc-0-9/14(A)
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封装选项
RU-24
RU-24
RU-24